JPS60200311A - 分散形数値制御システムの主軸同期方式 - Google Patents
分散形数値制御システムの主軸同期方式Info
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- JPS60200311A JPS60200311A JP5698484A JP5698484A JPS60200311A JP S60200311 A JPS60200311 A JP S60200311A JP 5698484 A JP5698484 A JP 5698484A JP 5698484 A JP5698484 A JP 5698484A JP S60200311 A JPS60200311 A JP S60200311A
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- JP
- Japan
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- signal
- transmission
- output
- delivered
- main shaft
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- Pending
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/18—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form
- G05B19/182—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form characterised by the machine tool function, e.g. thread cutting, cam making, tool direction control
- G05B19/186—Generation of screw- or gearlike surfaces
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/30—Nc systems
- G05B2219/37—Measurements
- G05B2219/37144—Delay marker to synchronize motions
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/30—Nc systems
- G05B2219/42—Servomotor, servo controller kind till VSS
- G05B2219/42186—Master slave, motion proportional to axis
Landscapes
- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Automation & Control Theory (AREA)
- Numerical Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、工作機械等の一軸ごとに数値制御装置を備え
、これらを情報伝送装置で連結してなる分散形数値制御
システムにおいて、伝送信号と主軸とを同期させる方式
に関するものである。
、これらを情報伝送装置で連結してなる分散形数値制御
システムにおいて、伝送信号と主軸とを同期させる方式
に関するものである。
例えば、ＮＣ工作機で坏ジ切シを打力う場合、第１図に
示すようにワーク１に対するバイト２の切込みを、ｂ１
→ｂ２→ｂ３と少しづつ大きくしていき、最終の仕上り
径まで削シ上げている。
示すようにワーク１に対するバイト２の切込みを、ｂ１
→ｂ２→ｂ３と少しづつ大きくしていき、最終の仕上り
径まで削シ上げている。
図示しているバイト経路は、波線部は早送シ、直線部は
切削送シを表わしている。
切削送シを表わしている。
ここでは、簡単化のため、バイトが前回の経路と同一経
路を移動するよう、つまシ同じネジミゾ上をなぞるよう
にした構成例を第２図、及びその出力パルス例を第８図
に示して説明する。
路を移動するよう、つまシ同じネジミゾ上をなぞるよう
にした構成例を第２図、及びその出力パルス例を第８図
に示して説明する。
第２図において、３は主軸のパルスエンコーダでｓｂ、
主軸の１回転あたシ所定のパルス（人相、Ｂ相、原点パ
ルス）を発するものである。
主軸の１回転あたシ所定のパルス（人相、Ｂ相、原点パ
ルス）を発するものである。
４はパルス処理回路でめシ、前記Ａ−Ｂ２相パルスを所
定のパルスＰ＋ （第３図参照）に変換すルカ、図示し
；’ｉいＣＰＵからＺＥＲＯＷＡＩＴ 信号を入力する
と、前記原点パルスを入力するまでパルス出力を浄化す
るようになっている。
定のパルスＰ＋ （第３図参照）に変換すルカ、図示し
；’ｉいＣＰＵからＺＥＲＯＷＡＩＴ 信号を入力する
と、前記原点パルスを入力するまでパルス出力を浄化す
るようになっている。
定数器５は、関数発生器６に出力するパルスのレートを
設定するものである。
設定するものである。
関数発生器６は、前記パルスを入力して、Ｘ、Ｙのパル
スを発生する。
スを発生する。
すなわち、バイト２がａからｂｌに位置決めされると、
ＺＥＩＬＯＷＡＩＴ信号によって、原点パルスが入力す
るまでバイト２は停止し、原点パルスの入力によってパ
ルスＰ１が出力を開始する。
ＺＥＩＬＯＷＡＩＴ信号によって、原点パルスが入力す
るまでバイト２は停止し、原点パルスの入力によってパ
ルスＰ１が出力を開始する。
このパルスＰ１が定数倍されてＰ２となって（第３図参
照）、関数発生器６を動作させるので、バイト２の経路
は前回と同一になシ、同じネジミゾをなぞることになる
。
照）、関数発生器６を動作させるので、バイト２の経路
は前回と同一になシ、同じネジミゾをなぞることになる
。
ところが、情報伝送装置で連結してなる分散形数値制御
装置（例えば、本出願人がさきに出願した特願昭５８−
７５６０８を参照されたい。）においては、伝送周期の
タイミングと送〃パルスのタイミングとの１！］にズレ
がるるため、経路を動く状態が一定になるとは限らない
。
装置（例えば、本出願人がさきに出願した特願昭５８−
７５６０８を参照されたい。）においては、伝送周期の
タイミングと送〃パルスのタイミングとの１！］にズレ
がるるため、経路を動く状態が一定になるとは限らない
。
例えば、第４図に示すように、タイムチャートＰａの伝
送周期によって送るべきデータを、同じ周期の伝送開始
時点の異なるタイミング周期のタイムチャートＰｂで送
ると、追従誤差が生じ、目標線Ｌａに対して、実際には
Ｌｌ）の軌跡をたど占ことになる。
送周期によって送るべきデータを、同じ周期の伝送開始
時点の異なるタイミング周期のタイムチャートＰｂで送
ると、追従誤差が生じ、目標線Ｌａに対して、実際には
Ｌｌ）の軌跡をたど占ことになる。
この弊害を除去するためには、バイト２が停止している
位置からワーク１までの絶対値距１ｉ１１１：Ｉを十分
長くとる必要があるので、ワーク１の大きさが制限され
るという欠点があった。
位置からワーク１までの絶対値距１ｉ１１１：Ｉを十分
長くとる必要があるので、ワーク１の大きさが制限され
るという欠点があった。
また、路離１が長くてもサーボ機能の特性によっては完
全に一致することは保証しえないため、繰り返し精度（
再現性）に難点が残るという問題がめった。
全に一致することは保証しえないため、繰り返し精度（
再現性）に難点が残るという問題がめった。
ここで、本発明は、情報伝送手段がＨＤＬＣ（Ｈｉｇｈ
Ｌｅｖｅｌ Ｄａｔａ Ｌｉｎｋ Ｃｏｎｔｒｏｌ
）であることを前提としているので、それにもとづいて
、従来の欠点をさらに詳しく説明する。
Ｌｅｖｅｌ Ｄａｔａ Ｌｉｎｋ Ｃｏｎｔｒｏｌ
）であることを前提としているので、それにもとづいて
、従来の欠点をさらに詳しく説明する。
Ｉ（ＤＬＣによる伝送は、フレームと呼ばれる独特のデ
ータ構成で行なわれ、そのフレームの前後には、フラグ
シーケンスと呼ばれる８ピツトの所定ピットパターンが
固定される。
ータ構成で行なわれ、そのフレームの前後には、フラグ
シーケンスと呼ばれる８ピツトの所定ピットパターンが
固定される。
フラグシーケンスは′″０１１１１１１０’でめシ、受
信側はフレーム中にこのビットパターンを見つけるとフ
レームの終シと判断する。
信側はフレーム中にこのビットパターンを見つけるとフ
レームの終シと判断する。
よって、フラグシーケンス以外の個所に「ｊ１１記ピッ
トパターンが出てくると伝送制御が混乱してし１つこと
になる。
トパターンが出てくると伝送制御が混乱してし１つこと
になる。
そこで、フラグシーケンスと同じパターンが生じないよ
うに、フラグシーケンス以外がｌ′が５個連続したら、
強制的に０′を１個挿入するようになっている。これを
「ゼロピントインサージョン」と呼んでいるが、そのた
めにデータ長が変化するので、第５図に示すように、あ
る数のフレームごとにサイクルを構成し、そのサイクル
の終シにバッフ１エリアＡを設けて長くなった分を吸収
し、ｌサイクルのＲＥＳＴＡＲＴ信号で伝送装置がアド
レス゛ＦＦＨ−から再び送信を行なうようになっている
。
うに、フラグシーケンス以外がｌ′が５個連続したら、
強制的に０′を１個挿入するようになっている。これを
「ゼロピントインサージョン」と呼んでいるが、そのた
めにデータ長が変化するので、第５図に示すように、あ
る数のフレームごとにサイクルを構成し、そのサイクル
の終シにバッフ１エリアＡを設けて長くなった分を吸収
し、ｌサイクルのＲＥＳＴＡＲＴ信号で伝送装置がアド
レス゛ＦＦＨ−から再び送信を行なうようになっている
。
これによって前記＝ＦＦＨ′の送出タイミングは常に一
足に保たれる。
足に保たれる。
ところが、この方式では主軸と同期をとる手段、すなわ
ち主軸のパルスジェネレ〜りが発生する原点パルスと、
［￥ｉＪ記ＩＬＥ８ＴＡＩＬＴ信号とを同時に出力させ
る手段がなく、前述したように第４図で示した追従誤差
が発生してしまうのでるる。
ち主軸のパルスジェネレ〜りが発生する原点パルスと、
［￥ｉＪ記ＩＬＥ８ＴＡＩＬＴ信号とを同時に出力させ
る手段がなく、前述したように第４図で示した追従誤差
が発生してしまうのでるる。
〔発明の目的」
本発明は、上記問題点を解決することを目的としてなさ
れたもので、伝送周期と主軸原点パルスを強制的に同期
させることによシ、繰シ返し精度を向上させる方式を提
供するものである。
れたもので、伝送周期と主軸原点パルスを強制的に同期
させることによシ、繰シ返し精度を向上させる方式を提
供するものである。
〔発明の実施例」
まず、本発明の概念図を第６図に示して説明する。
６０１は軸群管理器の伝送関係部分を示し、軸群管理器
６０１は、ｌ軸ＮＯ６０２及び６０３を統括する。
６０１は、ｌ軸ＮＯ６０２及び６０３を統括する。
すなわち、第６図は主軸パルスジェネレータ６０４を主
軸カウンタ６０５でカウントし、そのカウントしたデー
タを各１軸ＮＣ６０２，６０８に伝送し、各１４１１１
１ＮＯでは、このデータを送シ速度データとして、輸送
シ用モータ６０６（例えばＸ軸用）と６０７（例えばｙ
ＩＩＩＩＩｌ用）をそれぞれ個々に駆動するシステムを
示している。
軸カウンタ６０５でカウントし、そのカウントしたデー
タを各１軸ＮＣ６０２，６０８に伝送し、各１４１１１
１ＮＯでは、このデータを送シ速度データとして、輸送
シ用モータ６０６（例えばＸ軸用）と６０７（例えばｙ
ＩＩＩＩＩｌ用）をそれぞれ個々に駆動するシステムを
示している。
本発明は、前記システムの伝送方式を提供するもので、
ｌ、具体的には、その方式にもとづいて伝送回路６０８
に対して起動をかけるＲＥＳＴＡＲＴ信号を創出する伝
送起動回路６０９を提供する。
ｌ、具体的には、その方式にもとづいて伝送回路６０８
に対して起動をかけるＲＥＳＴＡＲＴ信号を創出する伝
送起動回路６０９を提供する。
以下、本発明の具体的実施例を第７図に示して説明する
。
。
第７図は、第６図伝送起動回路６０９の具体的回路例で
ある。
ある。
図において１０１はカウンタでアシ、１０２はＲＳフリ
ップフロップ、１０３はアンドゲート、１０４はナツト
ゲート、１０５はインバータである。
ップフロップ、１０３はアンドゲート、１０４はナツト
ゲート、１０５はインバータである。
この回路は、起点持ち信号（ＷＡＩＴ８Ｐ：図示しない
ＣＰＵが発する）、リセット信号（ｌＬＥ８）、原点パ
ルスを微分した信号（Ｓｒ／） 、及びクロック信号（
ＧＫ）を入力して、伝送同期信号（ＲＥ８ＴＡＲＴ）を
出力するものである。
ＣＰＵが発する）、リセット信号（ｌＬＥ８）、原点パ
ルスを微分した信号（Ｓｒ／） 、及びクロック信号（
ＧＫ）を入力して、伝送同期信号（ＲＥ８ＴＡＲＴ）を
出力するものである。
すなわち、リセット時は、ＲＳフリップフロップ１０２
の出力は■′になっているので、カウンタ１０１！′ｉ
、オーバー７ｏ−のｎＣ（ｒｉｐｐｌｅｃａｒｒｙ）で
再ロードを行なうので、一定周期でＲＥＳＴＡ几Ｔ信号
を出力する。
の出力は■′になっているので、カウンタ１０１！′ｉ
、オーバー７ｏ−のｎＣ（ｒｉｐｐｌｅｃａｒｒｙ）で
再ロードを行なうので、一定周期でＲＥＳＴＡ几Ｔ信号
を出力する。
この様子を第８図の区間（Ｉ）に示す。
ここで、ネジ切シ開始点ｂ１（第１図参照）にバイトが
来たとき、ＣＰＵはＷＡＩＴＳＦ信号を発する。（第８
図参照）このためｌＬＳフＩＪ ノブフロップ１０２の
出力は１Ｌ′となり第８図のＡで出るべき几ＥＳＴＡＲ
Ｔ信号はここでは出力されずＳｒ／信号を入力してｎＳ
フリップフロップ１０２の出力が■′となってはじめて
出力される。
来たとき、ＣＰＵはＷＡＩＴＳＦ信号を発する。（第８
図参照）このためｌＬＳフＩＪ ノブフロップ１０２の
出力は１Ｌ′となり第８図のＡで出るべき几ＥＳＴＡＲ
Ｔ信号はここでは出力されずＳｒ／信号を入力してｎＳ
フリップフロップ１０２の出力が■′となってはじめて
出力される。
以後のＩＬＥＳＴＡＲＴ信号は、前述したように、オー
バーフローのｌＬＣの再ロードによって一定周期で出力
される。
バーフローのｌＬＣの再ロードによって一定周期で出力
される。
これによって、伝送周期と、主軸起点とが完全に同期化
し、誤差が解消される。
し、誤差が解消される。
以上、ネジ切シについて説明したが、他の加工について
も同様の効果が得られることはいう壕でもない。
も同様の効果が得られることはいう壕でもない。
以上述べたように、本発明によれば、分散形数値制御シ
ステムにおける伝送周期と主転起点とが完全に同期する
ので、追従誤差の発生を防止でき、加工精度を大幅に向
上させることができる。
ステムにおける伝送周期と主転起点とが完全に同期する
ので、追従誤差の発生を防止でき、加工精度を大幅に向
上させることができる。
第１図はネジ切シの様子を示す図、第２図は従来の構成
例、第３図／′ｉ従来の出力パルス例、第４図は従来の
動作例、第５図は）ｌ Ｄ Ｌ Ｃの伝送例、第６図は
本発明の概念図、第７図は本発明の具体的回路例、第８
図は本発明の出力パルス例である。 第１ 図 第 ２ 図 ＺＥＲＯＷへ１丁 第 ３ 図 ２ 第 ４ 図 第 ５ 図 第６図
例、第３図／′ｉ従来の出力パルス例、第４図は従来の
動作例、第５図は）ｌ Ｄ Ｌ Ｃの伝送例、第６図は
本発明の概念図、第７図は本発明の具体的回路例、第８
図は本発明の出力パルス例である。 第１ 図 第 ２ 図 ＺＥＲＯＷへ１丁 第 ３ 図 ２ 第 ４ 図 第 ５ 図 第６図
Claims (1)
- 【特許請求の範囲】 軸群管理器が一軸ごとに設けられた数値制御装置を伝送
手段を介して統括する分散形数値制御システムにおいて
、 加工開始信号待ち状態で伝送を停止し、加工開始信号で
伝送を再開するとともに、以後クロックパルスをカウン
トした一定周期で伝送のタイミングをとることを特徴と
する分散形数値制御システムの主軸間」υ］方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5698484A JPS60200311A (ja) | 1984-03-23 | 1984-03-23 | 分散形数値制御システムの主軸同期方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5698484A JPS60200311A (ja) | 1984-03-23 | 1984-03-23 | 分散形数値制御システムの主軸同期方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60200311A true JPS60200311A (ja) | 1985-10-09 |
Family
ID=13042761
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5698484A Pending JPS60200311A (ja) | 1984-03-23 | 1984-03-23 | 分散形数値制御システムの主軸同期方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60200311A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1990016022A1 (en) * | 1989-06-20 | 1990-12-27 | Fanuc Ltd | Axis control system of numerical control apparatus |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57125406A (en) * | 1981-01-26 | 1982-08-04 | Shin Meiwa Ind Co Ltd | Automatic position control device |
-
1984
- 1984-03-23 JP JP5698484A patent/JPS60200311A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57125406A (en) * | 1981-01-26 | 1982-08-04 | Shin Meiwa Ind Co Ltd | Automatic position control device |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1990016022A1 (en) * | 1989-06-20 | 1990-12-27 | Fanuc Ltd | Axis control system of numerical control apparatus |
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