JPS60189263A - 半導体電力制御素子及びその製造方法 - Google Patents
半導体電力制御素子及びその製造方法Info
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- H01L21/74—Making of localized buried regions, e.g. buried collector layers, internal connections substrate contacts
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- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0657—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
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- H01L29/1066—Gate region of field-effect devices with PN junction gate
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、半導体電力制御素子、例えばサイリスタやグ
リジスタ、及びその製造方法に関する。
リジスタ、及びその製造方法に関する。
半導体電力制御素子用のグリッド体としては、二種のも
のが知られている。aち、表面°グリッド体及び埋込み
グリッド体(IEEE トランザクションズ オン エ
レクトロン デバイセズ(Transactions
on Eiectron Devices ) 、 E
D −27巻Al l 、 1980年11月、 21
41〜2145 ヘー シ)がある。埋込みグリッド体
を備えた半導体電力制御素子を製造するには、1ずシリ
コンウェハーのよりなn−にドープした半導体基板の表
面に熱酸化によってマスキング層を形成する。そして窓
部分がウェハーの周縁部を残してエツチングされて開け
られ、プレーナーボロン拡散によってグリッド体がそこ
に形成される。渣たこのボロン拡散工程において、ウェ
ハーの底面にはp+陽極が同時に形成される。そして、
ウェハーの活性域には酸化膜をエツチングで取除くこと
により金属性グリッドマスクに似たパターンが形成され
る。グリッドは、このグリッドマスクパターンの隙間の
部分において、ボロン拡散によりウェハーの表面に形成
される。更にm化膜の大部分がエツチングで取除かれ、
nのド−プ層がシリコン液のエピタキシャル成長によっ
て形成される。かぐして埋込みグリッド体が半導体ウェ
ハー内に形成される。
のが知られている。aち、表面°グリッド体及び埋込み
グリッド体(IEEE トランザクションズ オン エ
レクトロン デバイセズ(Transactions
on Eiectron Devices ) 、 E
D −27巻Al l 、 1980年11月、 21
41〜2145 ヘー シ)がある。埋込みグリッド体
を備えた半導体電力制御素子を製造するには、1ずシリ
コンウェハーのよりなn−にドープした半導体基板の表
面に熱酸化によってマスキング層を形成する。そして窓
部分がウェハーの周縁部を残してエツチングされて開け
られ、プレーナーボロン拡散によってグリッド体がそこ
に形成される。渣たこのボロン拡散工程において、ウェ
ハーの底面にはp+陽極が同時に形成される。そして、
ウェハーの活性域には酸化膜をエツチングで取除くこと
により金属性グリッドマスクに似たパターンが形成され
る。グリッドは、このグリッドマスクパターンの隙間の
部分において、ボロン拡散によりウェハーの表面に形成
される。更にm化膜の大部分がエツチングで取除かれ、
nのド−プ層がシリコン液のエピタキシャル成長によっ
て形成される。かぐして埋込みグリッド体が半導体ウェ
ハー内に形成される。
そして最終の工程としては、何らカバーされてbないグ
リッド体の周縁部分に導電性の接触子を配することであ
る。
リッド体の周縁部分に導電性の接触子を配することであ
る。
従来の技術においては、例えば真空中で、逆ドーピング
された導電性のグリッドが半導体中に形成される。この
ため多くのマスキング工程及びエツチング工程が要求さ
れる。即ち、エピタキシーにおいては、逆ドーピングさ
れる素材を基材上圧整列させること及びこれに続いて基
材が成長すること、そして埋込みグリッド体も整列状に
形成することが要求される。
された導電性のグリッドが半導体中に形成される。この
ため多くのマスキング工程及びエツチング工程が要求さ
れる。即ち、エピタキシーにおいては、逆ドーピングさ
れる素材を基材上圧整列させること及びこれに続いて基
材が成長すること、そして埋込みグリッド体も整列状に
形成することが要求される。
ところが、従来の技術においては、これらの要求を満た
すためにあまりにも多くの工程を費やし、高価なものと
なっており解決が望まれていた。
すためにあまりにも多くの工程を費やし、高価なものと
なっており解決が望まれていた。
上記問題点を解決するため、本発明は、その構成を第一
発明に係る半導体を力制御素子においては、頂面と、底
面と、及び上記頂面から底面にかけて斜面状に頂面と鋭
角をなすように形成した側面とを有する半導体の基板、
該基板の底面に設ける制御及びスイッチング用の電極、
上記基板の内部に形成された二つの埋込みグリッド体で
あって、各グリッド体は多数の要素体よりなり、各要素
体は他方の埋込みグリッド体の対応する要素体から垂直
方向で所定距離だけ離れ且つ水平方向でず九て位置して
いる埋込みグリッド体、そして上記基板の斜面に形成さ
れた側面に沿って平行に延びて基板内に埋設され、上記
二つの埋込みグリッド体と・上記電極とを接続する導電
性の接触体とよりなるものとしている。
発明に係る半導体を力制御素子においては、頂面と、底
面と、及び上記頂面から底面にかけて斜面状に頂面と鋭
角をなすように形成した側面とを有する半導体の基板、
該基板の底面に設ける制御及びスイッチング用の電極、
上記基板の内部に形成された二つの埋込みグリッド体で
あって、各グリッド体は多数の要素体よりなり、各要素
体は他方の埋込みグリッド体の対応する要素体から垂直
方向で所定距離だけ離れ且つ水平方向でず九て位置して
いる埋込みグリッド体、そして上記基板の斜面に形成さ
れた側面に沿って平行に延びて基板内に埋設され、上記
二つの埋込みグリッド体と・上記電極とを接続する導電
性の接触体とよりなるものとしている。
また第二発明たる半導体電力制御素子の製造方法におい
ては、その構成を、頂面、底面及び側面を有する半導体
の基板の頂面に金属製のグリッドマスクを形成し、上記
基板中に、高エネルギの加速器を用いてイオン注入の逆
ドーピングを基板の頂面から行ない、基板中に直接的に
グリッド体を埋込み形成するものとしている。
ては、その構成を、頂面、底面及び側面を有する半導体
の基板の頂面に金属製のグリッドマスクを形成し、上記
基板中に、高エネルギの加速器を用いてイオン注入の逆
ドーピングを基板の頂面から行ない、基板中に直接的に
グリッド体を埋込み形成するものとしている。
災に、第三発明たるシリコンのウェハー中に、金属製の
グリッドマスクを用いて埋込みグリッド体を形成し半導
体製のサイリスタやグリジスタを製造する半導体電力制
御素子の製造方法においては、高エネルギ加速器による
イオン注入の逆ドーピングを金属製のグリッドマスクを
介して行ない、半導体の基板中に直接埋込みグリッド体
を形成することを特徴としてなるものとしている。
グリッドマスクを用いて埋込みグリッド体を形成し半導
体製のサイリスタやグリジスタを製造する半導体電力制
御素子の製造方法においては、高エネルギ加速器による
イオン注入の逆ドーピングを金属製のグリッドマスクを
介して行ない、半導体の基板中に直接埋込みグリッド体
を形成することを特徴としてなるものとしている。
本発明においては、単一のマスキング工程のみ要求され
る。即ち、半導体の表面の酸化膜をωつでいる金属膜に
対するエツチングにより金属製のグリッドマスクを形成
する工程である。この金属製のグリッドマスクを通した
イオン注入の逆ドーピングにより、埋込みグリッドは半
導体内(直接に形成されることになる。この金属製のグ
リッドマスクは、棒状部分の間からのみイオン注入を許
すもので、グリッド体は、10 pm以上の深さのとこ
ろに形成される。この深さは50μm以上であることが
望ましbが、この場合高エネルギ加速器は100MeV
の作動域で運転する必要がある。
る。即ち、半導体の表面の酸化膜をωつでいる金属膜に
対するエツチングにより金属製のグリッドマスクを形成
する工程である。この金属製のグリッドマスクを通した
イオン注入の逆ドーピングにより、埋込みグリッドは半
導体内(直接に形成されることになる。この金属製のグ
リッドマスクは、棒状部分の間からのみイオン注入を許
すもので、グリッド体は、10 pm以上の深さのとこ
ろに形成される。この深さは50μm以上であることが
望ましbが、この場合高エネルギ加速器は100MeV
の作動域で運転する必要がある。
埋込みグリッド体の深さ方向での寸法、即ち注入深さは
、イオンの半値幅(Half−value width
oftlle 1ons ) の物理的限界によって
決定される。
、イオンの半値幅(Half−value width
oftlle 1ons ) の物理的限界によって
決定される。
この点につ−ては1983年7月1日付西独特許P33
23672、 Oに記述されている。垂直方向でのグリ
ッド体の厚みはe1ホ金属製のグリッドマスクの寸法に
よって決定される。この場合、問題となるのは金属製の
グリッドマスクの精密さと、制御用電極との接続である
。またグリッド体における平行間隙は、架電される代表
的な阻止電圧によるチャージゾーン間隙の2倍を越えな
いようにするよう考慮しなければならない。ドーピング
と電圧とにより、これらの値はl Opm以内である。
23672、 Oに記述されている。垂直方向でのグリ
ッド体の厚みはe1ホ金属製のグリッドマスクの寸法に
よって決定される。この場合、問題となるのは金属製の
グリッドマスクの精密さと、制御用電極との接続である
。またグリッド体における平行間隙は、架電される代表
的な阻止電圧によるチャージゾーン間隙の2倍を越えな
いようにするよう考慮しなければならない。ドーピング
と電圧とにより、これらの値はl Opm以内である。
同時にグリッドマスクの棒状部分の厚み又は深さは、イ
オンがマスク内に打込まれて入る深さを実質的に越えな
ければならない。この後者の深さは、1100pのとこ
ろである。また、グリッドマスクは半影効果を十分に排
除し短絡を防止するためにきっちりと四角形になってい
々ければならない。グリッドマスクの深さと、グリッド
体まで間隙の比がlOを超えるものは、製造できていな
いが、二つのグリッド体が垂直方向で所定の距離をおき
、且つ水平方向でずれていること、及び半導体のウェハ
ーに斜面を設けることで解決している。
オンがマスク内に打込まれて入る深さを実質的に越えな
ければならない。この後者の深さは、1100pのとこ
ろである。また、グリッドマスクは半影効果を十分に排
除し短絡を防止するためにきっちりと四角形になってい
々ければならない。グリッドマスクの深さと、グリッド
体まで間隙の比がlOを超えるものは、製造できていな
いが、二つのグリッド体が垂直方向で所定の距離をおき
、且つ水平方向でずれていること、及び半導体のウェハ
ーに斜面を設けることで解決している。
斜面の角度はlσ〜6σ、好ましくはlσ〜3σである
。酸化膜(SiO2)に関する試験においては二つの埋
込みグリッド体間の距離は望ましいもの、即ち限界距離
である4μm以内のものになった。
。酸化膜(SiO2)に関する試験においては二つの埋
込みグリッド体間の距離は望ましいもの、即ち限界距離
である4μm以内のものになった。
とのため二つのグリッド体間に短絡は生じ得ない。
以下、本発明の実施例を図面に基づいて説明する。第1
図〜第4図は本発明の電力制御素子の製法を示し、第5
図及び第6図は、その一部を示している。
図〜第4図は本発明の電力制御素子の製法を示し、第5
図及び第6図は、その一部を示している。
図中lはn−となるようドーピングされた母材、即ち半
導体製の基板で、I O’ 3/cm”の濃度でリンを
ド−ピングしたシリコンである。母、材1は、輪切りに
した円筒状のウェハーで、直径は19ミリメートル(3
/4インチ)、厚さは約900μmである。
導体製の基板で、I O’ 3/cm”の濃度でリンを
ド−ピングしたシリコンである。母、材1は、輪切りに
した円筒状のウェハーで、直径は19ミリメートル(3
/4インチ)、厚さは約900μmである。
母材1の底面2側には中央部に、頂面3側には全体に、
濃度10”/♂のn+のコンタクトが貫通方向で深さが
50〜80/ljmまで拡散せられている。また底面2
の周縁部にはボロンをドーピングしたp+のコンタクト
4が設けてあり、濃度は10”/cr!〜lOI′/c
r!で拡散によってリング状に形成しである。
濃度10”/♂のn+のコンタクトが貫通方向で深さが
50〜80/ljmまで拡散せられている。また底面2
の周縁部にはボロンをドーピングしたp+のコンタクト
4が設けてあり、濃度は10”/cr!〜lOI′/c
r!で拡散によってリング状に形成しである。
更に母材1の頂面3は金属を蒸着して50〜100μm
の金属層5を形成しである。金属には例えばアルミニウ
ムが用いられる。
の金属層5を形成しである。金属には例えばアルミニウ
ムが用いられる。
そして、第2図に示すように、母材1の側面6外周を据
置がりにして斜めに角度をつける。即ち母材lの頂面3
と所定の角度αをつけるが、この角度αはlσ〜60°
、好ましくは1σ〜30°とする。このため母材l〔以
下ウェハー1という。〕は斜面7を備えた截頭円錐形の
ものとなる。更に全体的にミクロンレベルの厚さのフォ
トレジストで被膜を形成する。
置がりにして斜めに角度をつける。即ち母材lの頂面3
と所定の角度αをつけるが、この角度αはlσ〜60°
、好ましくは1σ〜30°とする。このため母材l〔以
下ウェハー1という。〕は斜面7を備えた截頭円錐形の
ものとなる。更に全体的にミクロンレベルの厚さのフォ
トレジストで被膜を形成する。
次に、上記金属層5にグリッドパターンを形成する。最
終的には、第2図を9σ回転させて描いた第3図に示す
ように、多数の棒状のリプ8を形成するように金属層5
上に多数の整列させた帯状にエツチングが施される。棒
状のリプ8,8間の距離及び各リプ8の厚みは、最も斜
面7に近い最外周のものを除いて夫々100μmである
。
終的には、第2図を9σ回転させて描いた第3図に示す
ように、多数の棒状のリプ8を形成するように金属層5
上に多数の整列させた帯状にエツチングが施される。棒
状のリプ8,8間の距離及び各リプ8の厚みは、最も斜
面7に近い最外周のものを除いて夫々100μmである
。
そして最後に行なわれる実質的な工程は、第4図に示す
ようにイオン注入の逆ドーピングである。
ようにイオン注入の逆ドーピングである。
第4図は第3図の状態からウェハーlを9σ再び回転さ
せた状態を示している。この段階を実施するためには、
ウェハーlを高エネルギーの加速器中におき、高エネル
ギーイオン9の逆放射中にさらす。このため釦用いられ
た高エネルギー加速器は、ヘビーイオン用のパン・デ・
グラーフ サイクロトロンコンビネーション(Van−
de−GraafCyclotron Combina
tion for heavy 1ons (VICK
SI ) )である。このVIeKSIは、本実施例に
おいてボロンが使われていることに鑑み80〜100M
eVの範囲で作動させイオン9の打込み深さは200μ
mとして用いている。またイオン9の濃度は1014/
cnF 〜1 o15/uとしている。
せた状態を示している。この段階を実施するためには、
ウェハーlを高エネルギーの加速器中におき、高エネル
ギーイオン9の逆放射中にさらす。このため釦用いられ
た高エネルギー加速器は、ヘビーイオン用のパン・デ・
グラーフ サイクロトロンコンビネーション(Van−
de−GraafCyclotron Combina
tion for heavy 1ons (VICK
SI ) )である。このVIeKSIは、本実施例に
おいてボロンが使われていることに鑑み80〜100M
eVの範囲で作動させイオン9の打込み深さは200μ
mとして用いている。またイオン9の濃度は1014/
cnF 〜1 o15/uとしている。
上記のイオン注入の逆ドーピングは、半導体のウェハー
1中に直接的に二つの埋込みグリッド体10.11を形
成する。これら埋込みグリッド体10.11は垂直方向
に平行に離れている。
1中に直接的に二つの埋込みグリッド体10.11を形
成する。これら埋込みグリッド体10.11は垂直方向
に平行に離れている。
第5図は、第4図の状態から更に9σ回転させた状態の
ウェハー1の一部を拡大して示している。
ウェハー1の一部を拡大して示している。
埋込まれた各グリッド体10.11は、深さ方向で所定
の距離dsだけ離している。この距離dSは4μmの限
界内である。また各グリッド体10゜11は複数の要素
体IQa 、 llaからなりこれらの水平方向での距
@、 d aは、ウニノー−1の表面に設けたグリッド
マスクとなった金属層5のリプ8の幅に相応している。
の距離dsだけ離している。この距離dSは4μmの限
界内である。また各グリッド体10゜11は複数の要素
体IQa 、 llaからなりこれらの水平方向での距
@、 d aは、ウニノー−1の表面に設けたグリッド
マスクとなった金属層5のリプ8の幅に相応している。
斜面7は、グリッド体10.11間の接触を行なう接触
体12.13を設けること及び鱈にドープされた制御及
びスイッチング用の電極4とを設けることを可能とする
。これらの接触体12.13は、基板中へのイオン注入
により自己調整接触体として直接的に形成され、二つの
平面状に注入される。
体12.13を設けること及び鱈にドープされた制御及
びスイッチング用の電極4とを設けることを可能とする
。これらの接触体12.13は、基板中へのイオン注入
により自己調整接触体として直接的に形成され、二つの
平面状に注入される。
第6図は、他の実施例であって、深さがtMの金属製の
グリッドマスク8′を使用したものが図示されている。
グリッドマスク8′を使用したものが図示されている。
この深さtMはマスク8′中へのイオン注入深さを実質
的に越えているものである。従ってたった一つの埋込み
グリッド体11’が形成されており、このグリッド体1
1’は夫々距離dGだけ離れると共にマスク8′に形成
されるリプ8′aに相応する幅を有するものとなってい
る。リプslaを通過しようとするイオンは、リプ8′
aの材質によってその中に止められて注入されることに
なり、層10’を形成する。もつとも、ウェハーの加工
が続けられると、このイオン注入による層10’は、リ
プ8′を含むマスク全体と共にエツチングにより除去さ
れてしまう。
的に越えているものである。従ってたった一つの埋込み
グリッド体11’が形成されており、このグリッド体1
1’は夫々距離dGだけ離れると共にマスク8′に形成
されるリプ8′aに相応する幅を有するものとなってい
る。リプslaを通過しようとするイオンは、リプ8′
aの材質によってその中に止められて注入されることに
なり、層10’を形成する。もつとも、ウェハーの加工
が続けられると、このイオン注入による層10’は、リ
プ8′を含むマスク全体と共にエツチングにより除去さ
れてしまう。
なお、上記の例は単なる実施例であって、本発明がこれ
らの実施例に限定されることを意味するものではない。
らの実施例に限定されることを意味するものではない。
本発明は、以上説明してきた如きものなので、必要な加
工工程は単一のマスキング工程と、斜面形成工程のみと
bう簡単なものとなる。また同時に埋込みグリッド体と
電極とが自動的に接続されるので、製造が非常に単純且
つ容易に行なえるものとなる。
工工程は単一のマスキング工程と、斜面形成工程のみと
bう簡単なものとなる。また同時に埋込みグリッド体と
電極とが自動的に接続されるので、製造が非常に単純且
つ容易に行なえるものとなる。
第1図〜第4図は、本発明の一実施例に係る電力制御素
子の製造工程を順次に示す断面図。 第5図は、グリッドマスクとしての金属層を介してイオ
ン注入を行ない、埋込みグリッド体を二つ形成する状態
を示す上記実施例の部分拡大図。 そして 第6図は、大きな厚み又は深いグリッドマスクとしての
金属層を用いてイオン注入により単一のグリッド体を形
成した本発明に係る電力制御素子の他の実施例を示す断
面図である。 l・・・基板(ウエノ・−) 2・・・底面3・・・頂
面 4・・・コンタクト 5・・・金属層(グリッドマスク) 6・・・側面7・
・・斜面 s、s’a・・・リブ(棒状体)10.11
・・・埋込みグリッド体 J、 2 、13・・・接触体 代理人 弁理士 村 1)幹 雄 第1頁の続き 0発 明 者 ディートリツヒ プロ ドイツ連邦丈−
ニツヒ パープル う @発明者 マイソノ1ルト クツ−ドイツ連邦プル シ
ュトラ− 0発 明 者 ヨアヒム ラツシンス ドイツ連邦1キ
ー ユトラーセ QQI− ;和国1000 ベルリン 33 フランツエンズ′ユ
トラーセ 14 ;和国1000 ベルリン 31 ガストアイネルーセ
13 ミ和国1000 ベルリン 41 ルーベンス シ2
子の製造工程を順次に示す断面図。 第5図は、グリッドマスクとしての金属層を介してイオ
ン注入を行ない、埋込みグリッド体を二つ形成する状態
を示す上記実施例の部分拡大図。 そして 第6図は、大きな厚み又は深いグリッドマスクとしての
金属層を用いてイオン注入により単一のグリッド体を形
成した本発明に係る電力制御素子の他の実施例を示す断
面図である。 l・・・基板(ウエノ・−) 2・・・底面3・・・頂
面 4・・・コンタクト 5・・・金属層(グリッドマスク) 6・・・側面7・
・・斜面 s、s’a・・・リブ(棒状体)10.11
・・・埋込みグリッド体 J、 2 、13・・・接触体 代理人 弁理士 村 1)幹 雄 第1頁の続き 0発 明 者 ディートリツヒ プロ ドイツ連邦丈−
ニツヒ パープル う @発明者 マイソノ1ルト クツ−ドイツ連邦プル シ
ュトラ− 0発 明 者 ヨアヒム ラツシンス ドイツ連邦1キ
ー ユトラーセ QQI− ;和国1000 ベルリン 33 フランツエンズ′ユ
トラーセ 14 ;和国1000 ベルリン 31 ガストアイネルーセ
13 ミ和国1000 ベルリン 41 ルーベンス シ2
Claims (1)
- 【特許請求の範囲】 (1)以下の要件を含んでなる半導体電力制御素子。 (イ)頂面と、底面と、及び上記頂面から底面にかけて
斜面状に頂面と鋭角をなすように形成した側面とを有す
る半導体の基板。 (ロ)上記基板の底面に設ける制御及びスイッチング用
の電極。 (ハ)上記基板の内部に形成された二つの埋込みグリッ
ド体であって、各グリッド体は多数の要素体よりなり、
各要素体は他方の埋込みグリッド体の対応する要素体か
ら垂直方向で所定距離だけ離れ且つ水平方向でずれて位
置している。そして に)上記基板の斜面に形成された側面に沿って平行に延
びて基板内に埋設され、上記二つの埋込みグリッド体と
上記電極とを接続する導電性の接触体。 (21上記基板の頂面と側面のなす角度が1σ〜6σの
鋭角である請求の範囲第1項の半導体電力制御素子。 (3)上記基板の頂面と側面のなす角度が1σ〜3σの
鋭角である請求の範囲第2項の半導体電力制御素子。 (4)上記基板が截頭円錐形状を有する請求の範囲第1
項の半導体電力制御素子。 (5)上記基板が截頭円錐形状を有する請求の範囲第3
項の半導体電力制御素子。 (6)以下の要件を含み、頂面、底面及び側面を有する
半導体の基板を用いた半導体電力制御素子の製造方法。 (イ)上記基板の頂面に金属製のグリッドマスクを形成
すること。 (ロ)上記基板中に、高エネルギの加速器を用いてイオ
ン注入の逆ドーピングを基板の頂面から行ない、基板中
に直接的にグリッド体を埋込み形成すること。 (7)上記高エネルギの加速器を80 MeV−100
MeVで作動させる請求の範囲第6項の半導体電力制御
素子の製造方法。 (8)上記グリッド体を埋込み形成するためのイオン注
入の深さが10μmを超える請求の範囲第6項の半導体
電力制御素子の製造方法。 (9)上記グリッド体を埋込み形成するためのイオン注
入の深さが50μmを超える請求の範囲第7項の半導体
電力制御素子の製造方法。 QO) 上記グリッドマスクは、多数の離設された棒状
体からなり、且つ高エネルギの加速器から出るイオンが
この棒状体から基板の表面を通り抜け、更に基板内に互
いに垂直方向で離れ且つ水平方向で互いにずれて位置し
ている検数の要素体を夫々備えた二つの埋込みグリッド
体を形成することを許す厚みを備えている請求の範囲第
6項の半導体電力制御素子の製造方法。 aυ 上記グリッドマスクは、多数の離設された棒状体
からなり、且つ高エネルギの加速器から出るイオンがこ
の棒状体から基板の表面を通り抜け、更に基板内に互い
に垂直方向で離れ且つ水平方向で互いにずれて位置して
いる複数の要素体を夫々備えた二つの埋込みグリッド体
を形成することを許す厚みを備えている請求の範囲第9
項の半導体電力制御素子の製造方法0α2 上記基板の
側面を頂面に対して鋭角をなすよう斜面状に形成°し、
上記高エネルギの加速器によるグリッド体の埋込み形成
と共に、斜面とした上記基板の側面に該側面に沿って平
行に延びる導電体を形成し、且つ基板の底面に制御及び
スイッチング用の電極を設け、この電極を導電体を介し
て上記グリッド体と接続させる請求の範囲第6項の半導
体筒、力制御素子の製造方法。 a3 上記基板の側面を頂面に対して鋭角をなすよう斜
面状に形成し、上記高エネルギの加速器によるグリッド
体の埋込み形成と共に、斜面とした上記基板の側面に該
側面に浴って平行に延びる導電体を形成し、且つ基板の
底面に制御及びスイッチング用の電極を設け、この電極
を導電体を介して上記グリッド体と接続させる請求の範
囲第11項の半導体電力制御素子の製造方法。 (141基板の頂面と側面とが1σ〜6σの鋭角をなす
よう側面を斜面状に形成する請求の範囲第12項の半導
体電力制御素子の製造方法。 051 基板の頂面と側面とが1σ〜6σの鋭角をなす
よう側面を斜面状に形成する請求の範囲第13− 項の
半導体電力制御素子の製造方法。 (+6+ シリコンのウェハー中に、金属製のグリッド
マスクを用いて埋込みグリッド体を形成し半導体製のサ
イリスタやグリジスタを製造する半導体電力制御素子の
製造方法において、高エネルギ加速器によるイオン(9
)注入の逆ドーピングを金属製のグリッドマスク(5,
8)を介して行ない、半導体の基板中に直接埋込みグリ
ッド体(10,11)を形成することを特徴とする半導
体電力制御素子の製造方法。 αD 上記高エネルギ加速器を80〜100MeVの範
囲で作動させ且つイオンの打込み深さを50μmを越え
るものとしたことを特徴とする請求の範囲第16項の半
導体電力制御素子の製造方法。 α印 上記グリッドマスク(5,8)は、高エネルギの
加速器から出るイオン(9)がグリッドマスク(5)及
び棒状部分(8)においても基板(1)の表面を通り抜
け、更に基板(11内で互いに垂直方向で離れ且つ水平
方向で互いにずれて位置している二つの埋込みグリッド
体(10,11)を形成することを許す材質及び厚みを
備えている請求の範ご第17項の半導体電力制御素子の
製造方法。 09 半導体の基板(11の側面(6)が頂面3から鋭
角をなすように斜面状に形成され、且つ基板の底面(2
)に制御及びスイッチング用の電極(4)を設け、更に
上記イオンの打込みによって同時に上記グリッド体(1
0,11)と上記電極(4)とを接続する埋込み導電体
(12,13)を上記側面(6)の斜面(7)に平行に
検数形成することを特徴とする請求の範囲第18項の半
導体電力制御素子の製造方法。 (20) 上記斜面状に形成された側面が頂面となす鋭
角は、1σ〜3σである請求の範囲第19項の半導体電
力制御素子の製造方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19843404834 DE3404834A1 (de) | 1984-02-08 | 1984-02-08 | Halbleiter-leistungsbauelement, insbesondere thyristor und gridistor, sowie verfahren zu dessen herstellung |
DE3404834.0 | 1984-02-08 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60189263A true JPS60189263A (ja) | 1985-09-26 |
Family
ID=6227404
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60022101A Pending JPS60189263A (ja) | 1984-02-08 | 1985-02-08 | 半導体電力制御素子及びその製造方法 |
Country Status (6)
Country | Link |
---|---|
US (1) | US4663830A (ja) |
EP (1) | EP0153902A3 (ja) |
JP (1) | JPS60189263A (ja) |
CA (1) | CA1226968A (ja) |
DE (1) | DE3404834A1 (ja) |
IL (1) | IL74217A (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
SE454309B (sv) * | 1986-08-29 | 1988-04-18 | Stiftelsen Inst Mikrovags | Forfarande att framstella tunna ledande eller halvledande skikt inbeddade i kisel medelst implantering av metallatomer |
US6168983B1 (en) | 1996-11-05 | 2001-01-02 | Power Integrations, Inc. | Method of making a high-voltage transistor with multiple lateral conduction layers |
SE9904785D0 (sv) * | 1999-12-27 | 1999-12-27 | Abb Research Ltd | "A semiconductor device" |
DE10025567C2 (de) * | 2000-05-24 | 2003-03-27 | Infineon Technologies Ag | Verfahren zum Herstellen von tiefdotierten Gebieten in einem Halbleiterkörper |
US9660053B2 (en) | 2013-07-12 | 2017-05-23 | Power Integrations, Inc. | High-voltage field-effect transistor having multiple implanted layers |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2303383A1 (fr) * | 1975-03-06 | 1976-10-01 | Alsthom Cgee | Transistor a effet de champ a plat |
US4198645A (en) * | 1976-01-27 | 1980-04-15 | Semiconductor Research Foundation | Semiconductor controlled rectifier having gate grid dividing surrounding zone into two different impurity concentration sections |
US4113516A (en) * | 1977-01-28 | 1978-09-12 | Rca Corporation | Method of forming a curved implanted region in a semiconductor body |
DE2706623A1 (de) * | 1977-02-16 | 1978-08-17 | Siemens Ag | Mis-fet fuer hohe source-drain-spannungen |
US4151540A (en) * | 1977-12-08 | 1979-04-24 | Fairchild Camera And Instrument Corporation | High beta, high frequency transistor structure |
US4278475A (en) * | 1979-01-04 | 1981-07-14 | Westinghouse Electric Corp. | Forming of contoured irradiated regions in materials such as semiconductor bodies by nuclear radiation |
DE2903219A1 (de) * | 1979-01-27 | 1980-08-07 | Bosch Gmbh Robert | Vorrichtung zur anzeige von reglerausfaellen bei lichtmaschinen |
US4278476A (en) * | 1979-12-05 | 1981-07-14 | Westinghouse Electric Corp. | Method of making ion implanted reverse-conducting thyristor |
GB2078441A (en) * | 1980-06-17 | 1982-01-06 | Westinghouse Electric Corp | Forming impurity regions in semiconductor bodies by high energy ion irradiation |
US4424526A (en) * | 1981-05-29 | 1984-01-03 | International Business Machines Corporation | Structure for collection of ionization-induced excess minority carriers in a semiconductor substrate and method for the fabrication thereof |
-
1984
- 1984-02-08 DE DE19843404834 patent/DE3404834A1/de active Granted
-
1985
- 1985-01-31 EP EP85730013A patent/EP0153902A3/de not_active Withdrawn
- 1985-02-01 IL IL74217A patent/IL74217A/xx unknown
- 1985-02-07 US US06/699,018 patent/US4663830A/en not_active Expired - Fee Related
- 1985-02-08 CA CA000473916A patent/CA1226968A/en not_active Expired
- 1985-02-08 JP JP60022101A patent/JPS60189263A/ja active Pending
Also Published As
Publication number | Publication date |
---|---|
DE3404834A1 (de) | 1985-08-08 |
EP0153902A3 (de) | 1987-08-19 |
DE3404834C2 (ja) | 1989-05-18 |
IL74217A (en) | 1988-07-31 |
CA1226968A (en) | 1987-09-15 |
US4663830A (en) | 1987-05-12 |
EP0153902A2 (de) | 1985-09-04 |
IL74217A0 (en) | 1985-05-31 |
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