JPS6016999Y2 - Electronic device with pronunciation function - Google Patents

Electronic device with pronunciation function

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JPS6016999Y2
JPS6016999Y2 JP7710878U JP7710878U JPS6016999Y2 JP S6016999 Y2 JPS6016999 Y2 JP S6016999Y2 JP 7710878 U JP7710878 U JP 7710878U JP 7710878 U JP7710878 U JP 7710878U JP S6016999 Y2 JPS6016999 Y2 JP S6016999Y2
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JP
Japan
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drive signal
signal
circuit
piezoelectric buzzer
input terminal
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JP7710878U
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Japanese (ja)
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JPS54177884U (en
Inventor
修 亀田
Original Assignee
カシオ計算機株式会社
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Description

【考案の詳細な説明】 この考案は発音機能別に異なった二つの圧電ブザー駆動
方式を用いることにより音量の異なる発音がなされるよ
うにした発音機能付電子機器に関するものである。
[Detailed Description of the Invention] This invention relates to an electronic device with a sound generation function that uses two different piezoelectric buzzer drive systems for different sound generation functions to produce sounds of different volumes.

例えば小型電子式計算機において、計時機能を有するも
のが実用化されているが、この種の計時機能を有するも
のには更にアラーム機能を備えているものがある。
For example, small electronic calculators that have a timekeeping function are in practical use, and some of those that have this kind of timekeeping function also have an alarm function.

また他の小型電子式計算機においては、キーオン時に発
音してキーが確実に操作されたことを報知する発音手段
が備えられているものもある。
Other small electronic calculators are also equipped with a sounding means that sounds when a key is turned on to notify that the key has been operated reliably.

ところでこのアラーム機能とキーオン時での報音機能の
両機能を備えた機種においては、その発音手段は兼用さ
れるのが常である。
Incidentally, in models that have both the alarm function and the sound alarm function when the key is turned on, the sounding means is usually used for the same purpose.

しかし、この従来の発音手段では単一の音色あるいは音
量しか発音できないのでキーオン時の発音の音量に設定
した場合にはアラーム音が小さすぎて実用的ではくなっ
たり、また逆にアラーム音に設定した場合にはキーオン
時での報知音が必要以上に大きくなったりするという欠
点があり、更には′音による両機能の判別が不可能であ
った。
However, with this conventional sound generation method, only a single tone or volume can be produced, so if the volume is set to the key-on sound volume, the alarm sound will be too low to be practical, or conversely, if it is set as the alarm sound. In this case, there is a drawback that the notification sound when the key is turned on becomes louder than necessary, and furthermore, it is impossible to distinguish between the two functions by the sound.

そこで、音色あるいは音量の異る複数個の発音体を別設
し、各別に一つづつの機能を対応して適切な音色あるい
は音量を選択し発音させ、しかも音による機能判別がで
きるようにすることも考えられるが、これでは構成が複
雑化するだけでなく、発音体を数多く備えるという理由
でコストアップするという欠点がある。
Therefore, a plurality of sounding bodies with different tones or volumes are provided separately, each corresponding to one function, and the appropriate tones or volumes are selected and produced, and the functions can be distinguished by sound. However, this has the disadvantage of not only complicating the structure but also increasing cost due to the large number of sounding bodies.

この考案は前記事情に鑑みてなされたもので機能別に発
音体の駆動方式を使いわけるとにより単一の発音体を用
いて音量の異なる発音を行なう発音機能付電子機器を提
供することを目的とする。
This invention was made in view of the above circumstances, and the purpose is to provide an electronic device with a sound generation function that uses a single sounding body to produce sounds of different volumes by using different driving methods for the sounding body depending on the function. do.

以下、この考案の一実施例を図面を参照しながら詳細に
説明する。
Hereinafter, one embodiment of this invention will be described in detail with reference to the drawings.

第1図において、1は非安定マルチバイブレークとして
知られるパルス発生器であり、抵抗R1およびR2、コ
ンデンサC1およびC2の容量で定まる一定周波数fを
もって発振される。
In FIG. 1, 1 is a pulse generator known as an astable multi-by-break, which oscillates at a constant frequency f determined by the capacitances of resistors R1 and R2 and capacitors C1 and C2.

この周波数fは圧電ブザー2の共振周波数近傍の値をと
るように設定する。
This frequency f is set to take a value near the resonance frequency of the piezoelectric buzzer 2.

そして、このパルス信号はアンド回路3を介して圧電ブ
ザー2のA端子に与えられる。
This pulse signal is then applied to the A terminal of the piezoelectric buzzer 2 via the AND circuit 3.

キー人力部4は0〜9までの数値キー、各種演算を指令
するファンクションキーに対応するキースイッチを具備
している。
The key operator section 4 is equipped with key switches corresponding to numeric keys from 0 to 9 and function keys for commanding various calculations.

また、制御部5ではキーサンプリング信号を制御信号a
によって読込制御されるバッファ6を介してデコーダ7
に与える。
In addition, the control unit 5 converts the key sampling signal into a control signal a.
Decoder 7 via buffer 6 whose reading is controlled by
give to

このデコーダ7においては、例えば4ビツト構戒のキー
サンプリング信号をデコードして、順次キー人力部4の
キー山。
The decoder 7 decodes, for example, a 4-bit key sampling signal, and sequentially outputs the key peaks of the key input unit 4.

[2] 、 i3] 、 14]ニ対するラインL1、
+−felt [ffi、17j、IKに対するライン
L2、・・・・・・とラインL1〜L5を順次走査し、
そのキー操作信号は夫々対応するラインL6〜L9に出
力された制御信号すによって読込み制御されるバッファ
8に読込まれる。
[2], i3], 14] line L1,
+-felt [ffi, 17j, line L2 for IK, . . . and lines L1 to L5 are sequentially scanned,
The key operation signals are read into the buffer 8 which is controlled by the control signals outputted to the corresponding lines L6 to L9, respectively.

なおキー操作が行われていないラインL6〜L9は各々
抵抗Rを介して接地されているため“0゛°状態を保持
する。
Note that the lines L6 to L9, on which no key operation is performed, are each grounded through a resistor R, and thus maintain a "0° state."

しかしてバッファ8に記憶されたデータは演算記憶部9
に送出され、この演算記憶部9において、制御部5から
の各種制御信号に制御されて演算し記憶する。
Therefore, the data stored in the buffer 8 is stored in the calculation storage section 9.
The calculation storage unit 9 calculates and stores the data under the control of various control signals from the control unit 5.

更に、ラインL6〜L9から出力されたキーオン信号は
オア回路10゜11を介してアンド回路3の一方の入力
端に開閉制御信号として印加される。
Further, the key-on signals outputted from lines L6 to L9 are applied to one input terminal of AND circuit 3 as an opening/closing control signal via OR circuit 10.degree.11.

また演算記憶部9において制御部5により制御信号によ
り、キー人力部4で指定された演算を実行した際に、例
えばデータが定められた桁数以上になってオーバーフロ
ーしたり、あるいは予め定められた演算の範囲を越えて
演算を行うようにキー人力部4で指定した場合、上記制
御部5からはエラー信号が出力され、前記オア回路11
を介して前記アンド回路3の一方の入力端に入力するよ
うになっている。
In addition, when the calculation storage unit 9 executes the calculation specified by the key manual unit 4 by the control signal from the control unit 5, for example, the data exceeds a predetermined number of digits and overflows, or if the data exceeds a predetermined number of digits. When the key human power section 4 specifies that the calculation be performed beyond the calculation range, the control section 5 outputs an error signal, and the OR circuit 11
The signal is inputted to one input terminal of the AND circuit 3 via.

なおこのエラー信号の解除はよく知られているように、
キー人力部4のオールクリアーキー[E]の操作によっ
てなされる。
As is well known, the cancellation of this error signal is
This is done by operating the all clear key [E] of the key manual section 4.

また演算記憶部9には計時用レジスタを有し制御部5よ
りの一秒信号等によって時刻を順次カウントアツプし、
表示部(図示せず)において現在時刻を表示することが
出来る。
The arithmetic storage unit 9 also has a timekeeping register that sequentially counts up the time using a one-second signal from the control unit 5.
The current time can be displayed on a display unit (not shown).

また、演算記憶部9にはアラーム用レジスタを有し、所
望のアラーム時刻をキー人力部4のアラームキー吹口、
時刻セットキーはY等によりセットすることが出来る。
Further, the calculation storage section 9 has an alarm register, and the desired alarm time can be input to the alarm key mouthpiece of the key manual section 4.
The time set key can be set using Y or the like.

これらの技術は当業者にとっては明白であるので詳細に
はその構成を示さない。
Since these techniques are obvious to those skilled in the art, their construction is not shown in detail.

しかして、アラーム時刻と現在時刻とが一致することが
検出されると、アラームセット信号が制御部5よりフリ
ップフロップ回路12のセット端子Sに与えられる。
When it is detected that the alarm time and the current time match, an alarm set signal is applied from the control section 5 to the set terminal S of the flip-flop circuit 12.

そして、上記フリップフロップ回路12のセット側出力
Qはオア回路11を介して前記アンド回路3の一方の入
力端に印加される。
The set-side output Q of the flip-flop circuit 12 is applied to one input terminal of the AND circuit 3 via the OR circuit 11.

更に、上記アンド回路3の出力信号はナンド回路13の
一方の入力端に与えられ他方の入力端にはフリップフロ
ップ回路12のセット側出力Qが直接加えられる。
Furthermore, the output signal of the AND circuit 3 is applied to one input terminal of the NAND circuit 13, and the set side output Q of the flip-flop circuit 12 is directly applied to the other input terminal.

しかしてフリップフロップ回路12のセット側出力Qが
°“1“の場合、パルス発生器1から出力したパルス信
号を圧電ブザー2のA端子にその位相を反転したパルス
信号を圧電素子2のB端子にそれぞれ与え圧電ブザー2
を駆動する。
Therefore, when the set side output Q of the flip-flop circuit 12 is "1", the pulse signal output from the pulse generator 1 is sent to the A terminal of the piezoelectric buzzer 2, and the pulse signal whose phase is inverted is sent to the B terminal of the piezoelectric element 2. piezoelectric buzzer 2
to drive.

上記フリップフロップ回路12をリセットするためのア
ラームリセット信号は制御部5よりオア回路14を介し
てアラームセット信号の出力より所定時間経過後自動的
にリセット端子Rに与えられるか、手動操作でラインL
IOに°°1′信号を印加し、上記オア回路14を介し
てリセット端子Rに与えられる。
An alarm reset signal for resetting the flip-flop circuit 12 is automatically applied to the reset terminal R from the control unit 5 via the OR circuit 14 after a predetermined time has elapsed since the output of the alarm set signal, or is applied manually to the line L.
A °°1' signal is applied to IO, and is applied to the reset terminal R via the OR circuit 14.

次に上記の如く構成された本考案の動作を説明する。Next, the operation of the present invention configured as described above will be explained.

パルス発生器1からはアンド回路3に常時第2図Aの1
の如くパルス信号が与えられているが、キー人力部4の
いずれかのキーが操作されるとオア回路10.11を介
しキーオン信号(第2図Aの(2)参照)が出力し、上
記アンド回路3のゲートを開いてパルス信号を圧電ブザ
ー2のA端子に第2図Aの3の如く与え駆動する。
From the pulse generator 1 to the AND circuit 3, 1 in Figure 2 A is always sent.
A pulse signal is given as shown in FIG. The gate of the AND circuit 3 is opened and a pulse signal is applied to the A terminal of the piezoelectric buzzer 2 as shown in 3 in FIG. 2A to drive it.

このとき圧電ブザー2のB端子には、フリップフロップ
回路12の出力Qは0゛であるため、常に第2図Aの4
の如く“1°”(Vボルト)が与えられる。
At this time, since the output Q of the flip-flop circuit 12 is 0, the B terminal of the piezoelectric buzzer 2 always receives the signal 4 in FIG. 2A.
"1°" (V volts) is given as follows.

しかして、両端子閾電圧(A−B)の振幅値は第2図A
の5の如くVボルトとなり、圧電ブザー2は単相駆動さ
れることになる。
Therefore, the amplitude value of both terminal threshold voltage (A-B) is
5, the voltage becomes V volts, and the piezoelectric buzzer 2 is driven in a single phase.

また、演算実行中に制御部5よりエラー信号が出力する
と、上記同様に、オア回路11を介して、アンド回路3
にゲート信号を与え、パルス発生器1からのパルス信号
によって圧電ブザー2を単相駆動する。
Further, when an error signal is output from the control unit 5 during execution of the calculation, it is sent to the AND circuit 3 via the OR circuit 11 in the same manner as described above.
The piezoelectric buzzer 2 is driven in a single phase by the pulse signal from the pulse generator 1.

なお実験によると単相駆動の際の音圧レベルは35乃至
40デシベルとなる。
According to experiments, the sound pressure level during single-phase drive is 35 to 40 decibels.

さらに、前述の演算、記憶部9内にある計時用レジスタ
とアラーム用レジスタの内容が一致することが検出され
るとアラームセット信号が制御部5より出力し、フリッ
プフロップ回路12をセットする。
Further, when it is detected that the contents of the time register and the alarm register in the storage section 9 match with each other in the aforementioned calculation, an alarm set signal is outputted from the control section 5, and the flip-flop circuit 12 is set.

従ってこのフリップフロップ回路12のセット側出力Q
は“°1゛となり、その信号は、オア回路11を介して
アンド回路3に入力され、パルス信号が圧電ブザー2の
A端子に入力される。
Therefore, the set side output Q of this flip-flop circuit 12
becomes "°1", the signal is input to the AND circuit 3 via the OR circuit 11, and the pulse signal is input to the A terminal of the piezoelectric buzzer 2.

同時にナンド回路13の一方の入力端はフリップフロッ
プ回路12より゛1゛信号をうけることになり、パルス
信号は出力位相を反転した状態で圧電ブザー2のB端子
に入力される。
At the same time, one input terminal of the NAND circuit 13 receives the "1" signal from the flip-flop circuit 12, and the pulse signal is input to the B terminal of the piezoelectric buzzer 2 with its output phase inverted.

このときの各回路の出力及び圧電ブザー2に与えられる
電圧変化を第2図Bのタイミングチャートに示す。
The output of each circuit and the voltage change applied to the piezoelectric buzzer 2 at this time are shown in the timing chart of FIG. 2B.

まず第2図Bの1はパルス発生器1の出力である。First, 1 in FIG. 2B is the output of the pulse generator 1.

第2図Bの2はフリップフロップ回路12のセット側出
力Qで、アラームセット信号により1゛の論理状態とな
る。
Reference numeral 2 in FIG. 2B is the set side output Q of the flip-flop circuit 12, which becomes a logic state of 1'' by the alarm set signal.

フリップフロップ回路12がセットされると、前述のと
おり、圧電ブザー2のA、 8両端子に加わる駆動電圧
は第2図Bの3゜4の如くなる。
When the flip-flop circuit 12 is set, the driving voltage applied to both terminals A and 8 of the piezoelectric buzzer 2 becomes 3°4 as shown in FIG. 2B, as described above.

その結果両端手間電圧(A−B)は第2図Bの5の如く
なり、その振幅値は2Vボルトである。
As a result, the voltage between both ends (A-B) becomes as shown in 5 in FIG. 2B, and its amplitude value is 2V volts.

従ってその駆動方式はA、8両端子に互いに位相が反転
したパルス波を加え駆動するというプッシュプル駆動方
式であり、実験によるとその音圧レベルは75〜80デ
シベルとなる。
Therefore, the driving method is a push-pull driving method in which pulse waves whose phases are reversed to each other are applied to both the A and 8 terminals, and according to experiments, the sound pressure level is 75 to 80 decibels.

もし、自動あるいは手動でフリップフロップ回路12の
リセット端子Rにアラームリセット信号が入れば、アン
ド回路3およびナンド回路13への制御信号が解除され
るので圧電ブザー2にパルス信号は入力しなくなり、発
音が停止される。
If an alarm reset signal is input automatically or manually to the reset terminal R of the flip-flop circuit 12, the control signals to the AND circuit 3 and the NAND circuit 13 will be canceled, so no pulse signal will be input to the piezoelectric buzzer 2, and no sound will be generated. will be stopped.

なお、第2図A、 Bの3乃至5において圧電ブザー2
のA、 8両端子にかかる駆動電圧及び、A、 8両端
子の電圧A−Bを示したが、圧電ブザー2は電気容量を
有していて、その電圧波形は第2図A、 Bの3乃至5
に示す方形波よりも若干歪みを帯びたものとなる。
In addition, in 3 to 5 of Fig. 2 A and B, the piezoelectric buzzer 2
Although the driving voltage applied to both terminals A and 8 of FIG. 3 to 5
It is slightly more distorted than the square wave shown in .

しかしこの歪みによって本考案の意図するところが妨げ
られることは全くない為、説明の便宜上、第2図A、
Bの3乃至5の如くその電圧波形を方形波として表わす
ものである。
However, since this distortion does not impede the purpose of the present invention in any way, for convenience of explanation, Figure 2A,
The voltage waveform is expressed as a square wave as shown in 3 to 5 of B.

以上、この実施例では一方の動作信号としてキーオン信
号及びエラー信号を、他方の動作信号としてアラーム信
号を選択したが、キーオン信号とエラー信号とを各動作
信号に選択してもよく、その機能分類の仕方は適宜選択
できることは勿論である。
As described above, in this embodiment, the key-on signal and the error signal were selected as one of the operating signals, and the alarm signal was selected as the other operating signal, but the key-on signal and the error signal may be selected as each operating signal, and their functional classifications Of course, the method can be selected as appropriate.

また、この実施例では、発振器として非安定マルチバイ
ブレータを使用したが、その他の発振器を使用してもよ
く、あるいは小型電子式計算機を駆動するためのパルス
発生器と兼用腰その出力をそのまま、あるいは適当に分
周して圧電ブザーの共振周波数付近で使用するようにす
れば、特に発振器が不要となり、コスト低減を計ること
も出来る。
In this example, an unstable multivibrator was used as the oscillator, but other oscillators may be used, or the output may be used as is, or it may be used as a pulse generator to drive a small electronic calculator. If the frequency is divided appropriately and used near the resonant frequency of the piezoelectric buzzer, an oscillator is no longer necessary, and costs can be reduced.

本考案は以上詳述したように、2つの入力端をもつ単一
の圧電ブザーに対し、第1の発音機能が選択されたとき
は一方の入力端に所定周波数の駆動信号を与え他方の入
力端を所定電圧レベルに保持して単相駆動する第1の駆
動信号制御回路と、第2の発音機能が選択されたときは
2つの入力端に互いに位相の反転された周波数の駆動信
号を与えてプッシュプル駆動する第2の駆動信号制御回
路とを設けた構成であるから、圧電ブザーから発生する
発音の音量によって何の発音機能が選択されたかを区別
でき、しかも圧電ブザーは単一であるため全体構造も複
雑化せず低コストに維持でき、小型電子機器の構造とし
て最適であるなどの優れた実用上の効果を奏しうる。
As described in detail above, the present invention provides a single piezoelectric buzzer having two input terminals; when the first sound generation function is selected, a driving signal of a predetermined frequency is applied to one input terminal; A first drive signal control circuit performs single-phase drive while holding the terminal at a predetermined voltage level, and when a second sound generation function is selected, a drive signal having frequencies whose phases are inverted from each other is applied to the two input terminals. Since the piezoelectric buzzer is configured to include a second drive signal control circuit that performs push-pull drive, it is possible to distinguish which sound generation function is selected by the volume of the sound generated from the piezoelectric buzzer, and there is only one piezoelectric buzzer. Therefore, the overall structure can be maintained at low cost without becoming complicated, and excellent practical effects can be achieved, such as being optimal as a structure for small electronic devices.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの考案の一実施例を示す概略回路構成図、第
2図は各出力信号のタイミングチャートでAは単相駆動
方式の場合、Bはプッシュプル駆動方式の場合を示すも
のである。 1・・・・・・パルス発生器、2・・・・・・圧電ブザ
ー、3・・・・・・アンド回路、4・・・・・・キー人
力部、5・・・・・・制御部、9・・・・・・演算・記
憶部、10,11・・・・・・オア回路、12・・・・
・・フリップフロップ回路、13・・・・・・ナンド回
路。
Figure 1 is a schematic circuit configuration diagram showing an embodiment of this invention, and Figure 2 is a timing chart of each output signal, where A shows the case of the single-phase drive system and B shows the case of the push-pull drive system. . 1... Pulse generator, 2... Piezoelectric buzzer, 3... AND circuit, 4... Key human power section, 5... Control part, 9... calculation/storage part, 10, 11... OR circuit, 12...
...Flip-flop circuit, 13...NAND circuit.

Claims (1)

【実用新案登録請求の範囲】 複数の発音機能を有する電子器機において、2つの入力
端をもつ単一の圧電ブザーと、この圧電ブザーを駆動す
るための所定周波数を有する駆動信号を発生する駆動信
号発生回路と、 少なくとも第1及び第2の発音機能の選択を夫々検出す
る発音機能検出部と、 この発音機能検出部により上記第1の発音機能が検出さ
れた際に上記圧電ブザーの一方の入力端に上記所定周波
数の駆動信号を印加すると共に他方の入力端を所定電圧
レベルに保持し、上記電圧ブザーを単相駆動する第1の
駆動信号制御回路と、上記発音機能検出部により上記第
2の発音機能が検出された際に上記電圧ブザーの一方の
入力端に上記所定周波数の駆動信号を印加すると共に他
方の入力端には上記駆動信号を位相を反転して印加し、
上記圧電ブザーをプッシュプル駆動する第2の駆動信号
制御回路とを具備し、上記第1及び第2の発音機能の選
択を上記圧電ブザーから発生する発音の音量により区別
したことを特徴とする発音機能付電子機器。
[Claims for Utility Model Registration] In an electronic device having multiple sound generation functions, a single piezoelectric buzzer having two input terminals, and a drive signal that generates a drive signal having a predetermined frequency to drive the piezoelectric buzzer. a generating circuit; a sounding function detection section that detects selection of at least a first and second sounding function; and an input of one of the piezoelectric buzzers when the first sounding function is detected by the sounding function detection section. A first drive signal control circuit applies a drive signal of the predetermined frequency to one input terminal and holds the other input terminal at a predetermined voltage level to drive the voltage buzzer in a single phase; When the sound generation function is detected, applying the drive signal of the predetermined frequency to one input terminal of the voltage buzzer, and applying the drive signal with the phase reversed to the other input terminal,
and a second drive signal control circuit that drives the piezoelectric buzzer in a push-pull manner, and the selection of the first and second sound generation functions is differentiated based on the volume of the sound generated from the piezoelectric buzzer. Electronic equipment with functions.
JP7710878U 1978-06-06 1978-06-06 Electronic device with pronunciation function Expired JPS6016999Y2 (en)

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