JPS6016248U - ２進デ−タ平均装置 - Google Patents

２進デ−タ平均装置

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Publication number
JPS6016248U
JPS6016248U JP10702983U JP10702983U JPS6016248U JP S6016248 U JPS6016248 U JP S6016248U JP 10702983 U JP10702983 U JP 10702983U JP 10702983 U JP10702983 U JP 10702983U JP S6016248 U JPS6016248 U JP S6016248U
Authority
JP
Japan
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binary data
memory means
averaging device
full addition
data averaging
Prior art date
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Pending
Application number
JP10702983U
Other languages
English (en)
Inventor
鹿　徳保
Original Assignee
松下電器産業株式会社
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Publication date
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Priority to JP10702983U priority Critical patent/JPS6016248U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は画像の２次元平面的平均化処理の従来例の説明
図、第２図は本考案の一実施例の基本構成図、第３図は
第２図の具体的な構成図である。 ２１・・・画像信号の走査線期間内をｎ等分したサンプ
ル電圧、２２・・・Ａ／Ｄ変換器、２３・・・全加算器
、２４・・・メモリ、３４・・・スタティック・ラム、
３２・・・４ビツトＡ／Ｄ変換器、３３・・・４ビツト
全加算器、３６・・・メモリ制御回路、３７・・・平均
結果出力端子。

Claims (1)

    【実用新案登録請求の範囲】
  1. ２進データを記憶するメモリ手段と、このメモリ手段に
    記憶された２進データと新たな入力２進データとを全加
    算して計算結果を前記メモリ手段に書き込む全加算手段
    と、２の倍数側の前記入力２進データに対して前記メモ
    リ手段による全加算と前記メモリ手段への書き込みをそ
    の都度実加して全加算終了時の前記メモリ手段の内容を
    桁移動して前記２の倍数側の入力２進データの平均とし
    て読み出すメモリ制御手段とを設けた２進データ平均装
    置。
JP10702983U 1983-07-08 1983-07-08 ２進デ−タ平均装置 Pending JPS6016248U (ja)

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JP10702983U JPS6016248U (ja) 1983-07-08 1983-07-08 ２進デ−タ平均装置

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JP10702983U JPS6016248U (ja) 1983-07-08 1983-07-08 ２進デ−タ平均装置

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JPS6016248U true JPS6016248U (ja) 1985-02-04

Family

ID=30250231

Family Applications (1)

Application Number Title Priority Date Filing Date
JP10702983U Pending JPS6016248U (ja) 1983-07-08 1983-07-08 ２進デ−タ平均装置

Country Status (1)

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JP (1) JPS6016248U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01103085A (ja) * 1987-10-16 1989-04-20 Fuji Photo Film Co Ltd 映像信号加算平均演算装置

Cited By (1)

* Cited by examiner, † Cited by third party
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