JPS6015910B2 - alarm clock - Google Patents
alarm clockInfo
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- JPS6015910B2 JPS6015910B2 JP3835874A JP3835874A JPS6015910B2 JP S6015910 B2 JPS6015910 B2 JP S6015910B2 JP 3835874 A JP3835874 A JP 3835874A JP 3835874 A JP3835874 A JP 3835874A JP S6015910 B2 JPS6015910 B2 JP S6015910B2
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- Japan
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- buzzer
- alarm
- circuit
- time
- switch
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Description
【発明の詳細な説明】
本発明は、ブザー等を有する電子式のディジタルアラー
ム時計に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an electronic digital alarm clock having a buzzer and the like.
本発明の目的は、アラーム時計の使用者の要望にできる
だけ応えられる機構を提供することであり、さらに具体
化するなら１日１回決った時間に使う人が毎日アラーム
設定を行なわなくてもすむ機構を提供することである。The purpose of the present invention is to provide a mechanism that can meet the needs of alarm clock users as much as possible.More specifically, it is an object of the present invention to provide a mechanism that can meet the needs of alarm clock users as much as possible. It is to provide a mechanism.
従釆のアラーム時計は報音中に停止スイッチを押すと、
再設定しなければならなかった。１日に数回アラ−ムを
用いる人や、めったに用いない人は停止スイッチによっ
て永続的に報音停止となる方が便利であるが、１日１回
決った時間に用いる人は報音中に停止スイッチを押して
も次の日再び報青さるように自動設定機能をつけた方が
毎日設定する手間が省ける。If you press the stop switch while the subordinate alarm clock is sounding,
Had to reconfigure. For people who use the alarm several times a day or for people who rarely use it, it is more convenient to turn off the alarm permanently using a stop switch, but for people who use the alarm once a day at a set time, it is more convenient to turn off the alarm permanently. It would be better to have an automatic setting function so that even if you press the stop switch, it will start again the next day, saving you the trouble of having to set it every day.
本発明は、そうした意図で報音ストップのスイッチと報
音ストップ自動解除を設けたものである。With this intention in mind, the present invention provides a sound stop switch and a sound stop automatic release.
以下図面に基いて説明する。This will be explained below based on the drawings.
第１図は本発明のディジタルアラーム時計の回路ブロッ
ク図であり、１は周知のアラーム時計の主ブロックであ
る。FIG. 1 is a circuit block diagram of the digital alarm clock of the present invention, and 1 is the main block of the well-known alarm clock.
２は時間標準発振器、即ち主に水晶発振器が用いられる
。2 is a time standard oscillator, that is, a crystal oscillator is mainly used.
３は前段分周回路、４は時刻表示のための計数回路であ
る。3 is a pre-stage frequency dividing circuit, and 4 is a counting circuit for time display.
スイッチ５は時計の時刻修正とアラームの設定時刻の設
定に用いられるセツテイングスイツチであり、これはロ
ックスイッチ６によってゲート８でロックされ常時は働
らかない。７は時計とアラーム時刻の切替スイッチであ
り、ゲート９，１川こよってセッティングを切替え、ゲ
ート１４，１５によって表示を切替える。The switch 5 is a setting switch used for adjusting the time of the clock and setting the alarm setting time, and is locked by a gate 8 by a lock switch 6 and does not operate at all times. Reference numeral 7 is a switch for changing the clock and alarm time, and gates 9 and 1 are used to change the setting, and gates 14 and 15 are used to change the display.
１１はィンバータである。11 is an inverter.
１２はアラーム時刻のメモリ回路、１３は一致検出回路
、１６はディジタル表示部である。12 is a memory circuit for alarm time, 13 is a coincidence detection circuit, and 16 is a digital display section.
１７，１８はゲート回路、１９はブザー、２０は報音停
止自動解除制御部である。17 and 18 are gate circuits, 19 is a buzzer, and 20 is a warning sound stop automatic release control section.
２１はブザーの報音停止自動解除の機能を作動させるか
、作動させないかの切替スイッチである。Reference numeral 21 denotes a changeover switch for activating or not activating the function of automatically canceling the buzzer's sound stop.
２２はブザーの報音中に報音を止めるスイッチである。22 is a switch that stops the buzzer while it is sounding.
第１図の１７〜２２の部分を具体化したのが第２図の回
路図である。まず、スイッチ２１がＡＵＴＯにある場合
を説明する。２３はフリツプフロッブでスイッチ２２に
よって反転する。The circuit diagram in FIG. 2 embodies the portions 17 to 22 in FIG. 1. First, a case where the switch 21 is in AUTO will be described. 23 is a flip-flop which is inverted by switch 22.
一致回路１３からの一致信号は１分間ハィレベルとなる
パルスであるから、一致信号が／・ィとなった時にはＮ
ＯＲ２４の出力がロウとなり、フリツプフロップ２３は
スイッチ２２によって反転するスイッチ２ １がＡＵＴ
Ｏであるから一致信号がハィとなる前はフリップフロツ
プ２３はリセットされており、スイッチ２２によって変
らず、Ｑはハィである。従って次に一致信号が／・ィと
なるとＮＡＮＤ２５の出力はロウとなり、分周回路３の
途中からひき出されたブザーの駆動信号はＮＯＲ２６で
反転してブザー１９を駆動する。この時、スイッチ２２
を押すとＱがロウとなりブザーは停止する。しかし、一
致信号がｏウとなった時、フリツプフロツプ２３は再び
リセットされＱはハイとなって１幼時間後又は２独特間
後に一致信号が／・ィとなった時、再びブザーが鳴るこ
とになる。従って、スイッチ２ １がＡＵＴＯにある場
合にはブザーをスイッチ２２によってｑ島鐘中に停止さ
せても、また１２時間後又は２処時間後の同じ時刻にブ
ザーが鳴る。スイッチ２１がマニュアルの場合は、フリ
ツプフロップ２３は常にリセットがかからないのでスイ
ッチ２２によって報音状態になったり報音停止になった
りする。従って、この場合には、ブザ−をスイッチ２２
で停止すると以後ブザーは鳴らない。ただし、スイッチ
２２を再度操作するとブザーはまたｑ島鐘可能な状態と
なる。２７はィンバータである。The coincidence signal from the coincidence circuit 13 is a pulse that remains at a high level for one minute, so when the coincidence signal becomes /.
The output of OR24 becomes low, and the flip-flop 23 is inverted by switch 22. Switch 21 becomes AUT.
Since it is O, the flip-flop 23 is reset before the match signal goes high, and it is not changed by the switch 22, and Q is high. Therefore, when the next match signal becomes /.--, the output of the NAND 25 becomes low, and the buzzer drive signal extracted from the middle of the frequency dividing circuit 3 is inverted by the NOR 26 and drives the buzzer 19. At this time, switch 22
When pressed, Q goes low and the buzzer stops. However, when the match signal becomes o, the flip-flop 23 is reset again and Q goes high, and when the match signal becomes / after one time or two unique times, the buzzer will sound again. Become. Therefore, when the switch 21 is in the AUTO position, even if the buzzer is stopped during the Q island bell by the switch 22, the buzzer will sound again at the same time 12 hours later or 2 hours later. When the switch 21 is in the manual mode, the flip-flop 23 is not always reset, so the switch 22 causes the sound to be activated or stopped. Therefore, in this case, the buzzer is switched to switch 22.
If you stop at , the buzzer will no longer sound. However, if the switch 22 is operated again, the buzzer will be in a state where it can be used again. 27 is an inverter.
Ｑ出力を第３図２９に供給し、ィンバータ２７の出力を
第３図３０１こ供給すれば設定状況が一目でわかる。第
３図は表示部を示すが、パネル２８の上にプザーマーク
２９が点灯している時は次の一致信号でブザーが鳴る状
態であり、ブザーマーク３０が点灯している時はスイッ
チ２１がＡＵＴＯになっていて自動復帰するということ
を示している。By supplying the Q output to 29 in FIG. 3 and supplying the output of the inverter 27 to 301 in FIG. 3, the setting status can be seen at a glance. FIG. 3 shows the display section. When the buzzer mark 29 is lit on the panel 28, the buzzer will sound at the next match signal, and when the buzzer mark 30 is lit, the switch 21 is set to AUTO. , indicating that it will return automatically.
このようにすれば使用者は分りやすい。以上述べた如く
、本発明のディジタルアラーム時計は報音停止自動解除
制御部を有するので、ブザー停止スイッチを操作しても
１独特間又は２餌時間後に再びブザーが鳴るようになり
、毎日同じ時刻にブザーを必要とする人は毎日ブザーを
設定する手間が省け、ディジタルアラーム時計の操作性
を向上させることができた。This makes it easy for the user to understand. As described above, since the digital alarm clock of the present invention has an automatic alarm stop canceling control section, even if the buzzer stop switch is operated, the buzzer will sound again after 1 unique time or 2 feeding times, and the buzzer will sound again at the same time every day. This saves people who require a buzzer every day the trouble of setting a buzzer every day, and improves the operability of the digital alarm clock.
第１図は、本発明のディジタルアラーム時計の回路ブロ
ック図である。
２・・・・・・時間標準発振器、３…・・・前段分周回
路、４・・・・・・時間表示分周回路、５・・・・・・
セッティングスイツチ、６・・・・・・ロックスイッチ
、７…・・・時計とアラームの切替スイッチ、８〜１０
・・・・・・ゲート、１２…・・・アラーム時刻のメモ
リー、１３・・・・・・一致検出回路、１６・・・・・
・表示部、１９…・・・ブザー、２０・・・・・・報音
停止自動解除制御部、２１・・・・・・薮音停止自動解
除作動スイッチ、２２・・・・・・報音停止スイッチ。
第２図は、第１図の１７〜２２の部分を具体化した回路
である。２３……フリツプフロツプ。
第３図は、表示部にブザーマークが表示される様子を示
す。
了／幻
オＺ斑
ナ３函FIG. 1 is a circuit block diagram of the digital alarm clock of the present invention. 2... Time standard oscillator, 3... Pre-stage frequency divider circuit, 4... Time display frequency divider circuit, 5...
Setting switch, 6...Lock switch, 7...Clock and alarm changeover switch, 8-10
...Gate, 12...Alarm time memory, 13...Coincidence detection circuit, 16...
・Display unit, 19... Buzzer, 20... Sound alarm stop automatic release control unit, 21... Bush sound stop automatic release switch, 22... Sound alarm Stop switch. FIG. 2 is a circuit that embodies parts 17 to 22 of FIG. 1. 23...Flip-flop. FIG. 3 shows how the buzzer mark is displayed on the display section. Ryo/Phantom OZ Madara 3 boxes
Claims (1)
する前段分周回路、前記前段分周回路の信号を分周して
時刻表示信号を形成する計数回路、アラーム時刻を記憶
するメモリ回路、前記計数回路と前記メモリ回路の一致
を検出する一致検出回路、前記一致検出回路の出力によ
り駆動されるブザー及び前記時刻表示信号と前記アラー
ム時刻を表示する表示部よりなるアラーム時計において
、ブザー停止スイツチ及び報音停止自動解除制御部を設
け、前記報音停止自動解除制御部は前記ブザー停止スイ
ツチによつて設定されたブザー停止状態を前記一致検出
回路からの出力に基づいて解除するフリツプフロツプを
有することを特徴とするアラーム時計。1 a time standard oscillator, a pre-stage frequency divider circuit that divides the signal of the time standard oscillator, a counting circuit that divides the signal of the pre-stage frequency divider circuit to form a time display signal, a memory circuit that stores the alarm time; An alarm clock comprising a coincidence detection circuit for detecting coincidence between a counting circuit and the memory circuit, a buzzer driven by the output of the coincidence detection circuit, and a display section for displaying the time display signal and the alarm time, the alarm clock comprising: a buzzer stop switch; A sound alarm stop automatic release control section is provided, and the sound alarm stop automatic release control section has a flip-flop that releases the buzzer stop state set by the buzzer stop switch based on the output from the coincidence detection circuit. Features an alarm clock.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3835874A JPS6015910B2 (en) | 1974-04-04 | 1974-04-04 | alarm clock |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3835874A JPS6015910B2 (en) | 1974-04-04 | 1974-04-04 | alarm clock |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS50131567A JPS50131567A (en) | 1975-10-17 |
| JPS6015910B2 true JPS6015910B2 (en) | 1985-04-22 |
Family
ID=12523043
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3835874A Expired JPS6015910B2 (en) | 1974-04-04 | 1974-04-04 | alarm clock |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6015910B2 (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6075620U (en) * | 1983-10-31 | 1985-05-27 | スズキ株式会社 | 4-cycle engine breather chamber |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53124475A (en) * | 1977-03-08 | 1978-10-30 | Seiko Epson Corp | Electronic watch |
| JPS5425872A (en) * | 1977-07-29 | 1979-02-27 | Seikosha Kk | Alarm tone generating apparatus |
| JPS61180183A (en) * | 1986-01-10 | 1986-08-12 | Seikosha Co Ltd | Timer device |
-
1974
- 1974-04-04 JP JP3835874A patent/JPS6015910B2/en not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6075620U (en) * | 1983-10-31 | 1985-05-27 | スズキ株式会社 | 4-cycle engine breather chamber |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS50131567A (en) | 1975-10-17 |
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