JPS60136829A - Writing method of voice in storage element - Google Patents

Writing method of voice in storage element

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Publication number
JPS60136829A
JPS60136829A JP58251179A JP25117983A JPS60136829A JP S60136829 A JPS60136829 A JP S60136829A JP 58251179 A JP58251179 A JP 58251179A JP 25117983 A JP25117983 A JP 25117983A JP S60136829 A JPS60136829 A JP S60136829A
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JP
Japan
Prior art keywords
data
time
signal
storage element
divided
Prior art date
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Pending
Application number
JP58251179A
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Japanese (ja)
Inventor
Teruji Yamaji
山地 暉二
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Original Assignee
Individual
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Publication date
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Abstract

PURPOSE:To exclude a rotary means and to attain stable operation by dividing a voice waveform with time, A/D converting the time-divided signal to use the digital signal as a data signal of a storage element, and using flock frequency to be time-divided as an address signal to write the address signal in the storage element. CONSTITUTION:A signal recorded at a micro-level is inputted to a slicer 9 (time division circuit) through a band pass filter 10, divided into ten parts at high frequency in an unaudible range e.g. and the divided signals are successively inputted to a CPU1 as data by a counter 7 through an A/D converter 8 and simultaneously used for controlling the addresses of the CPU1. The data obtained by said method are written in the storage device 3. At the time of reading, the counter 7 is stopped and the CPU1 is run, so that a voice is reproduced from a speaker 15 through an address bus 2, a data bus 5 and a D/A converter 13.

Description

【発明の詳細な説明】 本発明は、記憶素子への書込みに際し音声より直接行う
方法に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a method for directly writing to a memory element by voice.

従来、記憶素子(ROMまたはRAM)にデーターを記
憶せしめるには該素子のアドレスを選択し、そのアドレ
スに対応してハイレベルおよびローレベルの信号を二進
数によりデーターとしての書込みがなされるが、この場
合アドレス(Aバス)の選択はカウンタまたはキー入力
によりなされ、そのアドレスに対してデーター(Dバス
)はキー入力によりなされるのが通常の方法である。そ
してこれらは通常CPU(Central Pr。
Conventionally, in order to store data in a storage element (ROM or RAM), an address of the element is selected, and high-level and low-level signals corresponding to the address are written as data in binary numbers. In this case, the usual method is to select the address (A bus) by a counter or key input, and to select the data (D bus) for that address by key input. These are usually CPUs (Central Pr.

cesing Unit)により制御されている。cessing Unit).

このためCPUを制御するためには専用の=m<例えば
マイクロソフト社のベーンツクやマンン語)が必要であ
り、しかもCPUの種類(例えば68系と80系等は異
なる)により相違がある等の不具合があり簡単には書込
むことかできない。
Therefore, in order to control the CPU, a dedicated =m is required (e.g., Microsoft's Bentzk or Mann), and there are also problems such as differences depending on the type of CPU (e.g., 68 series and 80 series are different). There is something that cannot be easily written.

本発明は、これら不具合を解消し、人の菖詔により直接
記憶素子に書込むと共に読出しも同様に行なうことがで
きる方法の提供を目的とする。
It is an object of the present invention to provide a method that eliminates these problems and allows a person to directly write to a memory element and read data as well.

すなわち本発明は、記憶素子へデーターを書込むに際し
、収音した音声波形を帯域フィルターにより有効周波数
帯域に分離した後、該波形を時分割し、得たる時分割信
号をAD変換して記憶素子のデーター信号とし、他方前
記した時分割を行うクロック周波数をアドレス信号とし
て用い、記憶素子にデーターを書込むことを要旨とする
That is, when writing data to a memory element, the present invention separates a collected audio waveform into an effective frequency band using a bandpass filter, then time-divisions the waveform, AD converts the obtained time-division signal, and writes the data to the memory element. The gist of the present invention is to write data into a storage element using the clock frequency for time division as the address signal.

以下、本発明の要旨をさらに明確にするため、その一実
施例をあげ図面を利用して説明する。
Hereinafter, in order to further clarify the gist of the present invention, one embodiment thereof will be described with reference to the drawings.

第1図において、C!PU1には発振子6によりクロッ
クが与えられている。そして0PU1のアドレスは、ア
ドレスバス2(Aバス)を介して記憶素子8(例えばE
FROMまたはRAM)に接続されると共にPio4(
入出力素子)にも入力される。またCPU1のデーター
は、データーバス5(Dバス)を介して記憶素子3のデ
ーター入力に接続されると共に、Fio4(入出力素子
)ノテーター入力にも接続されている。才たCPU1へ
のデーター入力はカウンタ7を介してADコンバータ8
、スライサー9(時分割回路)およびバンドパスフィル
タ10に接続され、さらに低周波増幅器11からマイク
ロフォン12に接続されている。
In Figure 1, C! A clock is applied to the PU1 by an oscillator 6. Then, the address of 0PU1 is transferred to the memory element 8 (for example, E
FROM or RAM) and connected to Pio4 (
input/output elements). Further, the data of the CPU 1 is connected to the data input of the storage element 3 via a data bus 5 (D bus), and is also connected to the notator input of FIO4 (input/output element). Data is input to the CPU 1 via the counter 7 and the AD converter 8.
, a slicer 9 (time division circuit) and a bandpass filter 10, and further connected from a low frequency amplifier 11 to a microphone 12.

他方Pio4(入出力素子)のボートは、DAコンバー
タ13を介してトフンジスタ−14に接続され、さらに
スピーカ15に接読されている。
On the other hand, the port of Pio 4 (input/output element) is connected to the digital converter 14 via the DA converter 13, and is further read directly to the speaker 15.

上記した構成において、各部の作用を説明すると、マイ
クロフォン12により収音され、低周波増幅器11によ
り増幅されtこ波形は、第2図に示すように、音圧を含
んだ超低周波から可聴周波数を超える高周波まで包含し
ている。
In the above configuration, to explain the function of each part, the sound is collected by the microphone 12 and amplified by the low frequency amplifier 11. As shown in FIG. It includes high frequencies exceeding .

上記第2図に示す波形は1本発明の用途には不同きであ
るためバンドパスフィルタ10により不必要な帯域を取
除くと、第3図に示す波形となる。
Since the waveform shown in FIG. 2 is not suitable for the purpose of the present invention, unnecessary bands are removed by the bandpass filter 10, resulting in the waveform shown in FIG. 3.

1記憶8図に示す波形は、次のスライサー9(時分割回
路)に入力し1例えは、不可聴範囲の尚周波数で10分
割し、その波形を第4図に示す。
The waveform shown in FIG. 1 and 8 is input to the next slicer 9 (time division circuit) and divided into 10 parts by, for example, a frequency in the inaudible range, and the waveform is shown in FIG.

そして時分割された波形はA’Dフンパータ8に入力さ
れ、二進数(本発明の場合は1バイト8ビツト)に変換
される。このデーターは、カウンタ7により順次(3P
U1のデーターとして入力されると共に、0PUIのア
ドレスも同時に制御する。
The time-divided waveform is then input to the A'D divider 8 and converted into a binary number (in the case of the present invention, 1 byte is 8 bits). This data is sequentially (3P
It is input as data of U1 and also controls the address of 0PUI at the same time.

そして、このようにして得られる波形のデーターは、記
憶素子8に書込まれる。また読出しに際してはカウンタ
7を停止せしめ、cPulをランにすれば記憶素子3に
書込まれたデーターはアドレスバス2(Aバス)、デー
ターバス5(Dパス)を介してPio4(入出力素子)
に入力され、適切なポート(例えばAボート)より二進
数として出力する。そしてこの二進数はDAコンバータ
18によりアナログ信号に変換された後、図示しない積
分回路により元の波形に整形された後トランジスター1
4により増幅され、スピーカ15を振動させ音声として
再生される。
The waveform data obtained in this manner is then written into the storage element 8. In addition, when reading data, if the counter 7 is stopped and cPul is set to run, the data written in the memory element 3 is transferred to the Pio4 (input/output element) via the address bus 2 (A bus) and the data bus 5 (D path).
and outputs it as a binary number from an appropriate port (for example, the A port). This binary number is converted into an analog signal by the DA converter 18, and then shaped into the original waveform by an integrating circuit (not shown).
4 and vibrates the speaker 15 to reproduce it as sound.

以上の説明は、書込みと読出しく再生)とを同一構成と
して説明したのであるが、W込みまたは読出し受用とし
て用いるのであれば、回路構成は簡単となる。
The above explanation has been made assuming that writing, reading and reproducing are the same configuration, but if it is used for W writing or reading and receiving, the circuit configuration will be simple.

なお、このようにして書込まれた記憶素子は勿論取外し
が可能で、前述した読出し専用回路に挿入すれば、音声
で書込まれた内容が音声で再生される。
It should be noted that the memory element written in this way can of course be removed, and if inserted into the read-only circuit described above, the contents written in voice will be reproduced in voice.

以上説明したように、本発明によれば書込み(録音)、
読出しく再生)共に他の録音方式に比べて種々すぐれた
特徴を有する。すなわち、純電気式であるため回転部(
機械部)がないため寿命が長く、しかも極めて安価に製
作できる。また回転部がないため極めて小・型に製作で
き、しかも振動や衝撃に対しても極めて安定に動作する
ことができ、さらに電力の消費が極めて少ないため、小
型の乾電池等で充分長時開動作する等非常に有用な発明
といわねばならない。
As explained above, according to the present invention, writing (recording),
It has various superior features compared to other recording methods in both readout and playback. In other words, since it is a purely electric type, the rotating part (
Since there are no mechanical parts, it has a long life and can be manufactured at an extremely low cost. In addition, since there are no rotating parts, it can be made extremely small and compact, and it can operate extremely stably against vibrations and shocks.Furthermore, since it consumes extremely little power, it can be operated for a long time using small dry batteries, etc. It must be said that this is a very useful invention.

【図面の簡単な説明】[Brief explanation of the drawing]

餡1因は本発明の一実施例を示すブロックタイヤグラム
、第2図、@8図、第4図は波形を説明するための説明
図である。 1−−−CPU、 2−m−アドレスバス(Aバス)、 3−m−記憶素子、 4−−−Pio(入出力素子)、 5−m−データーパス(Dバス)、 6−−−発振子、 7−−−カウンタ、8−−−ADコ
ンバータ。 9−m−スライサー(時分割回路)、 10−一バンドパスフィルタ、 11−−低周波増幅器、12−一マイクロフォン、1B
−−DAコンバータ、 14−−トランジスター、15−−スピーカ。 特許出願人 山 地 暉 二
The first reason is a block tire diagram showing an embodiment of the present invention, and FIGS. 2, 8, and 4 are explanatory diagrams for explaining waveforms. 1---CPU, 2-m-address bus (A bus), 3-m-storage element, 4----Pio (input/output element), 5-m-data path (D bus), 6---- Oscillator, 7---Counter, 8---AD converter. 9-m-slicer (time division circuit), 10--1 band pass filter, 11--low frequency amplifier, 12--1 microphone, 1B
--DA converter, 14--transistor, 15--speaker. Patent applicant: Koji Yamachi

Claims (1)

【特許請求の範囲】[Claims] 記憶素子へデーターを書込むに際し、収音した音声波形
を帯域フィルターにより有効周波帯域に分離した後、該
波形を時分割し、得たる時分割信号をAD変換して記憶
素子のデーター信号とし、他方前記した時分割を行うク
ロック周波数をアドレス信号として用い、記憶素子にデ
ーターを書込むことを特徴とする音声による記憶素子へ
の書込方法。
When writing data to the storage element, the collected audio waveform is separated into effective frequency bands by a bandpass filter, and then the waveform is time-divided, and the resulting time-division signal is AD-converted and used as a data signal for the storage element. On the other hand, there is a method for writing data into a memory element by voice, which is characterized in that data is written into the memory element using the clock frequency for performing time division as described above as an address signal.
JP58251179A 1983-12-26 1983-12-26 Writing method of voice in storage element Pending JPS60136829A (en)

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