JPS60110482U - フィ−ラ制御装置 - Google Patents

フィ−ラ制御装置

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JPS60110482U
JPS60110482U JP20003983U JP20003983U JPS60110482U JP S60110482 U JPS60110482 U JP S60110482U JP 20003983 U JP20003983 U JP 20003983U JP 20003983 U JP20003983 U JP 20003983U JP S60110482 U JPS60110482 U JP S60110482U
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JP
Japan
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counter
control device
timing
circuit
output
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有田 豊和
義信 小塚
平石 幸史
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案によるフイーラ制御装置の一実施施例を
示すブロック図、第2図はその各部の波形を示す波形図
、第3図は本考案によるフイーラ制御装置の他の実施例
の一部分を示すブロック図である。 1.2・・・電極、3・・・高圧電源、R4・・・可変
抵抗、9,15・・・ナンド回路、10・・・クロック
発生器、11,12,27・・・カウンタ、13,14
・・・デジタルスイッチ、22・・・近接スイッチ、2
,4・・・ラッチ信号発生回路、25・・・クリア信号
発生回路、26.28・・・波形整形回路、29・・・
カウンタ/ドライバ、30・・・表示器、31・・・設
定器、32・・・W進−BCDデコーダ。

Claims (3)

    【実用新案登録請求の範囲】
  1. (1)緯糸の通過を検知する検知部と、緯糸の通過時の
    タイミングに応じたタイミング信号を与えるタイミング
    回路と、クロック発生器と、これらの論理積信号を計数
    する第1のカウンタとを有し、該第1のカウンタの計数
    値が所定値を越えたときに織機の動作を停止させるフイ
    ーラ制御装置において、 前記検知部の検知出力及び前記クロック発生器のクロッ
    ク信号の論理積信号を計数する第2のカウンタと、 前記第2のカウンタの計数値を表示する表示器と、 前記タイミング回路の所定のタイミング回数毎に前記第
    2のカウンタに表示出力を与えるラッチ回路と、 前記タイミング回路のタイミング出力により前記第2の
    カウンタをリセットするリセット回路と、を具備するこ
    とを特徴とするフイーラ制御装置。
  2. (2)前記タイミング回路は、緯糸の供給に基づいて動
    作する近接スイッチであることを特徴とする実用新案登
    録請求の範囲第1項記載のフイーラ制御装置。
  3. (3)前記ラッチ回路は、ラッチ出力を与える回数を変
    更することができるプリセットカウンタを含むものであ
    ることを特徴とする実用新案登録請求の範囲第1項記載
    のフイーラ制御装置。
JP20003983U 1983-12-27 1983-12-27 フィ−ラ制御装置 Granted JPS60110482U (ja)

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JP20003983U JPS60110482U (ja) 1983-12-27 1983-12-27 フィ−ラ制御装置

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JPS60110482U true JPS60110482U (ja) 1985-07-26
JPS6113575Y2 JPS6113575Y2 (ja) 1986-04-26

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