JPS60109959A - 三者通話装置の試験方法 - Google Patents
三者通話装置の試験方法Info
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- JPS60109959A JPS60109959A JP21709783A JP21709783A JPS60109959A JP S60109959 A JPS60109959 A JP S60109959A JP 21709783 A JP21709783 A JP 21709783A JP 21709783 A JP21709783 A JP 21709783A JP S60109959 A JPS60109959 A JP S60109959A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M3/00—Automatic or semi-automatic exchanges
- H04M3/22—Arrangements for supervision, monitoring or testing
- H04M3/24—Arrangements for supervision, monitoring or testing with provision for checking the normal operation
- H04M3/244—Arrangements for supervision, monitoring or testing with provision for checking the normal operation for multiplex systems
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- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Monitoring And Testing Of Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の技術分野′
本発明は、ディジタル交換システムに接続された王者通
話装置を、経済的に且つ正確に試験することができる王
者通話装置の試験方法に関するものである。
話装置を、経済的に且つ正確に試験することができる王
者通話装置の試験方法に関するものである。
従来技術と問題点
一般の通話は、周知のように、交換機のネットワークを
介して発呼者と被呼者との間が接続されることにより、
王者通話となるものである。これに対して、交換機のネ
ットワークに三者通話装置を接続し、この王者通話装置
を介して王者間を接続することにより、三者間で通話す
るのが王者通話である。この三者通話装置は、３入力端
子と３出力端子とを有し、内部に加算回路を含むもので
あり、その動作の正常性を監視する為に所定の期間毎に
試験が行われる。この試験は、従来、交換機に於ける手
動接続試験機能により、保守者が音声的に確認するのが
一般的であり、最近では、トーンジェネレータからのト
ーン信号を三者通話装置に入力し、三者通話装置に於い
て合成されたトーン信号をレシーバにより受信すること
により行われている。
介して発呼者と被呼者との間が接続されることにより、
王者通話となるものである。これに対して、交換機のネ
ットワークに三者通話装置を接続し、この王者通話装置
を介して王者間を接続することにより、三者間で通話す
るのが王者通話である。この三者通話装置は、３入力端
子と３出力端子とを有し、内部に加算回路を含むもので
あり、その動作の正常性を監視する為に所定の期間毎に
試験が行われる。この試験は、従来、交換機に於ける手
動接続試験機能により、保守者が音声的に確認するのが
一般的であり、最近では、トーンジェネレータからのト
ーン信号を三者通話装置に入力し、三者通話装置に於い
て合成されたトーン信号をレシーバにより受信すること
により行われている。
このような三者通話装置の試験に於いて、ＭＦ（多周波
信号）レシーバを利用して三者通話装置により合成され
た信号を受信検出する為には、三者通話装置への人力信
号は単一周波数信号でなければならない。従って、単一
周波数音源が必要となる。このような単一周波数の音源
は、通常の交換機には備えていないものであるから、王
者通話装置の試験の為にのみ付加しなければならない欠
点があった。又レシーバの検出精度以下のノイズや間欠
障害は検出することができないものであった。即ちレシ
ーバは、一時的に入力トーン信号が中断しても、すぐに
正常に戻る場合は正常動作となるから、間欠的な障害に
より入力トーン信号が中断されても、これを検出するこ
とができない欠点があった。
信号）レシーバを利用して三者通話装置により合成され
た信号を受信検出する為には、三者通話装置への人力信
号は単一周波数信号でなければならない。従って、単一
周波数音源が必要となる。このような単一周波数の音源
は、通常の交換機には備えていないものであるから、王
者通話装置の試験の為にのみ付加しなければならない欠
点があった。又レシーバの検出精度以下のノイズや間欠
障害は検出することができないものであった。即ちレシ
ーバは、一時的に入力トーン信号が中断しても、すぐに
正常に戻る場合は正常動作となるから、間欠的な障害に
より入力トーン信号が中断されても、これを検出するこ
とができない欠点があった。
発明の目的
本発明は、ディジタル交換システムに接続された王者通
話装置を、特別な構成を付加することなく、且つ正確な
試験を可能とすることを目的とするものである。
話装置を、特別な構成を付加することなく、且つ正確な
試験を可能とすることを目的とするものである。
発明の構成
本発明は、王者通話装置を具備したディジタル交換シス
テムに於いて、プロセッサから三つの試験情報を第１の
メモリに格納し、該三つの試験情報を任意の指定された
タイムスロットに読出して、デマルチプレクサを介して
前記王者通話装置の三つの入力端子にそれぞれ入力し、
該王者通話装置により前記試験情報が合成されて出力さ
れる出力端子からの情報を第２のメモリに書込み、該第
２のメモリの内容を前記プロセッサが読出して、前記王
者通話装置から本来出力されるべき情報と比較照合する
ものであり、以下実施例について詳細に説明する。
テムに於いて、プロセッサから三つの試験情報を第１の
メモリに格納し、該三つの試験情報を任意の指定された
タイムスロットに読出して、デマルチプレクサを介して
前記王者通話装置の三つの入力端子にそれぞれ入力し、
該王者通話装置により前記試験情報が合成されて出力さ
れる出力端子からの情報を第２のメモリに書込み、該第
２のメモリの内容を前記プロセッサが読出して、前記王
者通話装置から本来出力されるべき情報と比較照合する
ものであり、以下実施例について詳細に説明する。
発明の実施例
第１図は、本発明の実施例の要部ブロック図であり、デ
ィジタル・ネットワークＮＷは、プロセッサＣＰＵから
の情報を書込み、指定されたタイムスロットで電話機等
の端末装置へその情報を送出する為の第１のメモリＳＳ
Ｍと、電話機等の端末装置の状態情報等の情報を指定さ
れたタイムスロットで転送されて書込み、プロセッサＣ
ＰＵにより読出される第２のメモリＲ３Ｍとを有するも
のであり、又図示を省略した時間スイッチ、空間スイッ
チ等によるタイムスロットの交換を行う構成を含むもの
である。
ィジタル・ネットワークＮＷは、プロセッサＣＰＵから
の情報を書込み、指定されたタイムスロットで電話機等
の端末装置へその情報を送出する為の第１のメモリＳＳ
Ｍと、電話機等の端末装置の状態情報等の情報を指定さ
れたタイムスロットで転送されて書込み、プロセッサＣ
ＰＵにより読出される第２のメモリＲ３Ｍとを有するも
のであり、又図示を省略した時間スイッチ、空間スイッ
チ等によるタイムスロットの交換を行う構成を含むもの
である。
又三者通話装置ＴＷＴは、第２図に示すように、圧伸側
（μｍＩｌｏｗ、Ａ−βＯＷ等）により圧縮されたＰＣ
Ｍ信号を直線符号に変換するデコーダＤＥＣと、加算回
路ＡＤＤと、直線符号を圧伸側に従って圧縮するコーグ
ＣＯＤとから構成され、入力端子ａ、ｂ、ｃに入力され
た信号は、デコーダＤＥＣにより直線符号に変換され、
加算回路ＡＤＤによりそれぞれ加算されてコーグＣＯＤ
により再び圧伸側に従って圧縮されて出力端子ｄ。
（μｍＩｌｏｗ、Ａ−βＯＷ等）により圧縮されたＰＣ
Ｍ信号を直線符号に変換するデコーダＤＥＣと、加算回
路ＡＤＤと、直線符号を圧伸側に従って圧縮するコーグ
ＣＯＤとから構成され、入力端子ａ、ｂ、ｃに入力され
た信号は、デコーダＤＥＣにより直線符号に変換され、
加算回路ＡＤＤによりそれぞれ加算されてコーグＣＯＤ
により再び圧伸側に従って圧縮されて出力端子ｄ。
ｅ、ｆから出力される。即ち加算回路ＡＤＤに於いては
、実線１点線及び鎖線で示すように二入力端子の信号に
ついての加算（簡単なオア回路で実現できる）が行われ
るので、出力端子ｄには、入力端子す、ｃの人力信号が
合成されて出力され、出力端子ｅには、入力端子ａ、ｃ
の人力信号が合成されて出力され、出力端子ｆには、入
力端子ａ、ｂの入力信号が合成されて出力されることに
なる。
、実線１点線及び鎖線で示すように二入力端子の信号に
ついての加算（簡単なオア回路で実現できる）が行われ
るので、出力端子ｄには、入力端子す、ｃの人力信号が
合成されて出力され、出力端子ｅには、入力端子ａ、ｃ
の人力信号が合成されて出力され、出力端子ｆには、入
力端子ａ、ｂの入力信号が合成されて出力されることに
なる。
試験時は、プロセッサＣＰＵからメモリＳＳＭに試験デ
ータを書込み、指定されたタイムスロットにより読出さ
れて王者通話装置ＴＷＴの入力端會子ａ、ｂ、ｃに人力
される。例えば入力端子ａにのみ、成るパターンの試験
データを入力し、他の入力端子す、ｃには無音データを
入力するように、プロセッサＣＰＵからメモリＳＳＭの
入力端子対応の領域にデータを書込むと、これらのデー
タが特定のタイムスロットで読出されて王者通話装置Ｔ
ＷＴに入力され、この王者通話装置ＴＷＴの出力端子ｄ
には無音データが出力され、出力端子ｅ、ｆには、入力
端子ａに入力した試験データが出力されることになる。
ータを書込み、指定されたタイムスロットにより読出さ
れて王者通話装置ＴＷＴの入力端會子ａ、ｂ、ｃに人力
される。例えば入力端子ａにのみ、成るパターンの試験
データを入力し、他の入力端子す、ｃには無音データを
入力するように、プロセッサＣＰＵからメモリＳＳＭの
入力端子対応の領域にデータを書込むと、これらのデー
タが特定のタイムスロットで読出されて王者通話装置Ｔ
ＷＴに入力され、この王者通話装置ＴＷＴの出力端子ｄ
には無音データが出力され、出力端子ｅ、ｆには、入力
端子ａに入力した試験データが出力されることになる。
三者通話装置ＴＷＴの各出力端子ｄ、ｅ、ｆの出力信号
は、第２のメモリＲ３Ｍの出力端子対応の領域に書込ま
れる。プロセッサＣＰＵはこのメモリＲ３Ｍの内容を読
出して、王者通話装置ＴＷＴの出力端子ｄの出力信号が
無音データであり、出力端子ｅ、ｆ（７）出力信号が試
験データであることを比較照合することにより、王者通
話装置ＴＷＴが正常であると判定されることになる。
は、第２のメモリＲ３Ｍの出力端子対応の領域に書込ま
れる。プロセッサＣＰＵはこのメモリＲ３Ｍの内容を読
出して、王者通話装置ＴＷＴの出力端子ｄの出力信号が
無音データであり、出力端子ｅ、ｆ（７）出力信号が試
験データであることを比較照合することにより、王者通
話装置ＴＷＴが正常であると判定されることになる。
前述のように、王者通話袋ｆｉＴＷＴの特定の入力端子
ａにのみ試験データを入力し、他の入力端子す、ｃに無
音データを入力し、特定の入力端子ａに対応する出力端
子ｄからのみ無音データが出力され、他の入力端子す、
ｃに対応する出力端子ｅ、ｆからは試験データが出力さ
れて、各出力端子ｄ、ｅ、ｆ対応に第２のメモリＲ３Ｍ
に書込まれ、この第２のメモリＲ３Ｍの内容をプロセッ
サＣＰＵが読取って、データの比較照合を行うことによ
り、王者通話装置ＴＷＴの正常性を簡単に判別すること
ができるが、無音データでな（、他の試験データとする
ことも一勿論可能である。即ち三者通話装置ＴＷＴに入
力するデータに対して、出力端子に本来出力されるべき
データは、予め判るものであるから、プロセッサＣＰＵ
は、本来出力されるべきデータと、実際に出力されたデ
ータとの比較照合を容易に行うことができる。
ａにのみ試験データを入力し、他の入力端子す、ｃに無
音データを入力し、特定の入力端子ａに対応する出力端
子ｄからのみ無音データが出力され、他の入力端子す、
ｃに対応する出力端子ｅ、ｆからは試験データが出力さ
れて、各出力端子ｄ、ｅ、ｆ対応に第２のメモリＲ３Ｍ
に書込まれ、この第２のメモリＲ３Ｍの内容をプロセッ
サＣＰＵが読取って、データの比較照合を行うことによ
り、王者通話装置ＴＷＴの正常性を簡単に判別すること
ができるが、無音データでな（、他の試験データとする
ことも一勿論可能である。即ち三者通話装置ＴＷＴに入
力するデータに対して、出力端子に本来出力されるべき
データは、予め判るものであるから、プロセッサＣＰＵ
は、本来出力されるべきデータと、実際に出力されたデ
ータとの比較照合を容易に行うことができる。
第３図は、本発明の実施例の更に詳細なブロック図であ
り、ＴＷＴは王者通話装置、ａ、ｂ、ｃ及びｄ、ｅ、ｆ
は第２図に示す三者通話装置に対応した入力端子及び出
力端子、ＭＰＸＩ、ＭＰＸ２はマルチプレクサ、ＰＴＳ
は一次時間スイッチ、ＳＳＷは空間スイッチ、ＳＴＳは
二次時間スイッチ、Ｒ３Ｍは受信信号メモリ、即ち第２
のメモリ、ＳＳＭは送信信号メモリ、即ち第１のメモリ
、ＰＴＣは一次時間スイッチ制御メモリ、ＳＴＣは二次
時間スイッチ制御メモリ、ｓｗｃは空間スイッチ制御メ
モリ、ＳＲＤは信号受信分配装置、ｃｐｕはプロセッサ
、ＤＭＰＸｌ、ＤＭＰＸ２はデマルチプレクサである。
り、ＴＷＴは王者通話装置、ａ、ｂ、ｃ及びｄ、ｅ、ｆ
は第２図に示す三者通話装置に対応した入力端子及び出
力端子、ＭＰＸＩ、ＭＰＸ２はマルチプレクサ、ＰＴＳ
は一次時間スイッチ、ＳＳＷは空間スイッチ、ＳＴＳは
二次時間スイッチ、Ｒ３Ｍは受信信号メモリ、即ち第２
のメモリ、ＳＳＭは送信信号メモリ、即ち第１のメモリ
、ＰＴＣは一次時間スイッチ制御メモリ、ＳＴＣは二次
時間スイッチ制御メモリ、ｓｗｃは空間スイッチ制御メ
モリ、ＳＲＤは信号受信分配装置、ｃｐｕはプロセッサ
、ＤＭＰＸｌ、ＤＭＰＸ２はデマルチプレクサである。
一次時間スイッチＰＴＳは、ランダムライト。
シーケンシャルリード、二次時間スイッチＳＴＳは、シ
ーケンシャルライト、ランダムリードの構成の場合につ
いて説明する。なお−次時間スイッチＰＴＳをシーケン
シャルライト、ランダムリード、二次時間スイッチＳＴ
Ｓをランダムライト。
ーケンシャルライト、ランダムリードの構成の場合につ
いて説明する。なお−次時間スイッチＰＴＳをシーケン
シャルライト、ランダムリード、二次時間スイッチＳＴ
Ｓをランダムライト。
シーケンシャルリードとすることも勿論可能である。
一次時間スイッチｐ ′ｒ ｓは、−次時間スイッチ制
御メモリＰＴＣから読出された書込アドレスに従ってマ
ルチプレクサＭＰＸ２からの信号が書込まれ、シーケン
シャルアドレス発生部（図示を省略）からのシーケンシ
ャルアドレスにより読出される。又二次時間スイッチＳ
、ＴＳは、シーケンシャルアドレス発生部からのシーケ
ンシャルアドレスに従って書込まれ、二次時間スイッチ
制御メモリＳＴＣから読出された続出アドレスに従って
読出される。空間スイッチＳＳＷは、空間スイッチ制御
メモリＳＷＣから読出されたアドレスに従ってクロスポ
イントのスイッチが制御される。
御メモリＰＴＣから読出された書込アドレスに従ってマ
ルチプレクサＭＰＸ２からの信号が書込まれ、シーケン
シャルアドレス発生部（図示を省略）からのシーケンシ
ャルアドレスにより読出される。又二次時間スイッチＳ
、ＴＳは、シーケンシャルアドレス発生部からのシーケ
ンシャルアドレスに従って書込まれ、二次時間スイッチ
制御メモリＳＴＣから読出された続出アドレスに従って
読出される。空間スイッチＳＳＷは、空間スイッチ制御
メモリＳＷＣから読出されたアドレスに従ってクロスポ
イントのスイッチが制御される。
−次時間スイッチ制御メモリＰＴＣ１二次時間スイッチ
制御メモリＳＴＣ及び空間スイッチ制御メモリＳＷＣに
は、プロセッサＣＰＵから信号受信分配装置ＳＲＤを介
して交換接続情報に従ったアドレス及び制御情報が書込
まれる。この制御情報は、−次時間スイッチＰＴＳ及び
二次時間スイッチＳＴＳの書込み、読出しの制御を行う
か、又は受信信号メモリＲ３Ｍ及び送信信号メモリＳＳ
Ｍを制御するかを示すものであり、通常の通話信号は、
−次時間スイッチ制御メモリＰＴＣがら続出された書込
アドレスに従って書込まれ、シーケンシャルアドレスに
より読出されてタイムスロットの交換が行われ、空間ス
イッチｓｓｗのクロスポイントの制御により空間的な交
換が行われ、シーケンシャルアドレスにより二次時間ス
イッチＳＴＳに書込まれ、二次時間スイッチ制御メモリ
ＳＴＣから続出された続出アドレスに従って読出されて
タイムスロットの交換が行われる。又発呼情報等は特定
のタイムロフトにより伝送されるから、この特定のタイ
ムスロットの信号は、−次時間スイッチ制御メモリＰＴ
Ｃにより、受信信号メモリＲ３Ｍに書込まれ、信号受信
分配装置ＳＲＤを介してプロセッサＣＰＵに一転送され
る。又特定の制御信号は、プロセッサＣＰＵがら信号受
信分配装置ＳＲＤを介して送信信号メモリＳＳＭに書込
まれ、特定のタイムスロットにより送出されるものであ
る。
制御メモリＳＴＣ及び空間スイッチ制御メモリＳＷＣに
は、プロセッサＣＰＵから信号受信分配装置ＳＲＤを介
して交換接続情報に従ったアドレス及び制御情報が書込
まれる。この制御情報は、−次時間スイッチＰＴＳ及び
二次時間スイッチＳＴＳの書込み、読出しの制御を行う
か、又は受信信号メモリＲ３Ｍ及び送信信号メモリＳＳ
Ｍを制御するかを示すものであり、通常の通話信号は、
−次時間スイッチ制御メモリＰＴＣがら続出された書込
アドレスに従って書込まれ、シーケンシャルアドレスに
より読出されてタイムスロットの交換が行われ、空間ス
イッチｓｓｗのクロスポイントの制御により空間的な交
換が行われ、シーケンシャルアドレスにより二次時間ス
イッチＳＴＳに書込まれ、二次時間スイッチ制御メモリ
ＳＴＣから続出された続出アドレスに従って読出されて
タイムスロットの交換が行われる。又発呼情報等は特定
のタイムロフトにより伝送されるから、この特定のタイ
ムスロットの信号は、−次時間スイッチ制御メモリＰＴ
Ｃにより、受信信号メモリＲ３Ｍに書込まれ、信号受信
分配装置ＳＲＤを介してプロセッサＣＰＵに一転送され
る。又特定の制御信号は、プロセッサＣＰＵがら信号受
信分配装置ＳＲＤを介して送信信号メモリＳＳＭに書込
まれ、特定のタイムスロットにより送出されるものであ
る。
三者通話は、二次時間スイッチＳＴＳがら続出された王
者からの通話信号がデマルチプレクザＤＭＰＸ２．ＤＭ
ＰＸＩを介して王者通話装置ＴＷＴにタイムスロットＴ
Ｓ ｉ、ＴＳ ｊ、ＴＳｋにより加えられ、王者通話装
置ＴＷＴにより合成された信号は、マルチプレクサＭＰ
ＸＩ、ＭＰＸ２を介して一次時間スイッチＰＴＳに加え
られ、空間スイッチＳＳＷ、二次時間スイッチＳＴＳを
介してそれぞれの加入者に送出される。又それぞれの加
入者からの通話信号は、−次時間スイッチＰＴＳ、空間
スイッチＳＳＷ、二次時間スイッチ５ＴＳ１デマルチプ
レクサＤＭＰＸ２．ＤＭＰＸＩを介して王者通話装置Ｔ
ＷＴに加えられる。
者からの通話信号がデマルチプレクザＤＭＰＸ２．ＤＭ
ＰＸＩを介して王者通話装置ＴＷＴにタイムスロットＴ
Ｓ ｉ、ＴＳ ｊ、ＴＳｋにより加えられ、王者通話装
置ＴＷＴにより合成された信号は、マルチプレクサＭＰ
ＸＩ、ＭＰＸ２を介して一次時間スイッチＰＴＳに加え
られ、空間スイッチＳＳＷ、二次時間スイッチＳＴＳを
介してそれぞれの加入者に送出される。又それぞれの加
入者からの通話信号は、−次時間スイッチＰＴＳ、空間
スイッチＳＳＷ、二次時間スイッチ５ＴＳ１デマルチプ
レクサＤＭＰＸ２．ＤＭＰＸＩを介して王者通話装置Ｔ
ＷＴに加えられる。
王者通話装ＷＴＷＴの試験時は、プロセッサＣＰＵから
一次時間スイッチ制御メモリＰＴＣ及び二次時間スイッ
チ制御メモリＳＴＣに制御信号と王者通話装置ＴＷＴを
使用１する為の書込アドレス及び続出アドレスが信号受
信分配装置ＳＲＤを介して書込まれる。又プロセッサＣ
ＰＵから信号受信分配装置ＳＲＤを介して試験データが
送信信号メモリＳＳＭに加えられる。王者通話装置ＴＷ
Ｔの入力端子ａ、ｂ、ｃに対応した試験データをα、β
、Ｔとすると、例えば図示のように送信信号メモリＳＳ
Ｍに書込□まれる。この試験データα。
一次時間スイッチ制御メモリＰＴＣ及び二次時間スイッ
チ制御メモリＳＴＣに制御信号と王者通話装置ＴＷＴを
使用１する為の書込アドレス及び続出アドレスが信号受
信分配装置ＳＲＤを介して書込まれる。又プロセッサＣ
ＰＵから信号受信分配装置ＳＲＤを介して試験データが
送信信号メモリＳＳＭに加えられる。王者通話装置ＴＷ
Ｔの入力端子ａ、ｂ、ｃに対応した試験データをα、β
、Ｔとすると、例えば図示のように送信信号メモリＳＳ
Ｍに書込□まれる。この試験データα。
β、γは、二次時間スイッチ制御メモリＳＴＣに書込ま
れた続出アドレスにより、例えば、タイムスロットＴＳ
ｉ、ＴＳ ｊ、ＴＳｋに読出される。
れた続出アドレスにより、例えば、タイムスロットＴＳ
ｉ、ＴＳ ｊ、ＴＳｋに読出される。
送信信号メモリＳＳＭから読出された試験データα、β
、γは、デマルチプレクサＤＭＰＸ２゜ＤＭＰＸＩを介
して王者通話装置ＴＷＴの入力端子ａ、ｂ、ｃに加えら
れ、合成された信号Ａ、Ｂ、Ｃは出力端子ｄ、ｅ、ｆか
らマルチプレクサＭＰＸＩ、ＭＰＸ２を介して一次時間
スイッチＰＴＳ及び受信信号メモＩＪ ＲＳ Ｍに加え
られる。−次時間スイッチ制御メモリＰＴＣには、制御
信号により受信信号メモリＲ３Ｍをアクセスする書込ア
ドレスが書込まれ、王者通話装置ＴＷＴの出力端子ｄ、
ｅ、ｆからの信号が、タイムスロットＴＳｉ’、ｒｓｊ
″、ＴＳｋ’ でマルチプレクサＭＰＸ２から出力され
たとすると、そのタイムスロットＴＳ ｉ’ 、ＴＳ
ｊ’ 、ＴＳｋ”に対応するタイミングで一次時間スイ
ッチ制御メモリＰＴＣから読出された書込アドレスによ
り、図示のように、受信信号メモＩＪ ＲＳ Ｍに信号
Ａ、Ｂ、Ｃが書込まれる。これらの信号Ａ、Ｂ、Ｃは信
号受信分配装ＷＲ８Ｄを介してプロセッサＣＰＵに転送
され、送信信号メモリＳＳＭに書込んだ試験データα。
、γは、デマルチプレクサＤＭＰＸ２゜ＤＭＰＸＩを介
して王者通話装置ＴＷＴの入力端子ａ、ｂ、ｃに加えら
れ、合成された信号Ａ、Ｂ、Ｃは出力端子ｄ、ｅ、ｆか
らマルチプレクサＭＰＸＩ、ＭＰＸ２を介して一次時間
スイッチＰＴＳ及び受信信号メモＩＪ ＲＳ Ｍに加え
られる。−次時間スイッチ制御メモリＰＴＣには、制御
信号により受信信号メモリＲ３Ｍをアクセスする書込ア
ドレスが書込まれ、王者通話装置ＴＷＴの出力端子ｄ、
ｅ、ｆからの信号が、タイムスロットＴＳｉ’、ｒｓｊ
″、ＴＳｋ’ でマルチプレクサＭＰＸ２から出力され
たとすると、そのタイムスロットＴＳ ｉ’ 、ＴＳ
ｊ’ 、ＴＳｋ”に対応するタイミングで一次時間スイ
ッチ制御メモリＰＴＣから読出された書込アドレスによ
り、図示のように、受信信号メモＩＪ ＲＳ Ｍに信号
Ａ、Ｂ、Ｃが書込まれる。これらの信号Ａ、Ｂ、Ｃは信
号受信分配装ＷＲ８Ｄを介してプロセッサＣＰＵに転送
され、送信信号メモリＳＳＭに書込んだ試験データα。
β、γとの関係をチェックする照合が行われ、三者通話
装置ＴＷＴの正常性の試験が行われる。
装置ＴＷＴの正常性の試験が行われる。
前述の如く、試験データβ、γを無音データとすると、
信号Ａは無音データ、信号Ｂ、Ｃは試験データαとなる
。そして信号Ａが無音データ以外を含む場合、信号Ｂ、
Ｃが試験データα以外を含む場合には、三者通話装置Ｔ
ＷＴが異常であると判定されることになる。
信号Ａは無音データ、信号Ｂ、Ｃは試験データαとなる
。そして信号Ａが無音データ以外を含む場合、信号Ｂ、
Ｃが試験データα以外を含む場合には、三者通話装置Ｔ
ＷＴが異常であると判定されることになる。
第４図はタイムスロットの説明図であり、送信信号メモ
リＳＳＭから試験データα、β２ γが、タイムスロッ
トＴＳ ｉ、ＴＳ ｊ、ＴＳｋに読出されて、デマルチ
プレクサＤＭＰＸ２．ＤＭＰＸＩを介して王者通話装置
ＴＷＴの入力端子ａ、ｂ。
リＳＳＭから試験データα、β２ γが、タイムスロッ
トＴＳ ｉ、ＴＳ ｊ、ＴＳｋに読出されて、デマルチ
プレクサＤＭＰＸ２．ＤＭＰＸＩを介して王者通話装置
ＴＷＴの入力端子ａ、ｂ。
Ｃに加えられることになる。即ち、プロセッサＣＰＵか
らこれらのタイムスロットＴＳｉ、ＴＳｊ、ＴＳｋを指
定する為に、二次時間スイッチ制御メモリＳＴＣに続出
アドレスが書込まれ、この続出アドレスにより送信信号
メモリＳＳＭから試験データα、β、Ｔがタイムスロッ
トＴＳｉ、ＴＳｊ、ＴＳｋに読出されることになる。又
他のタイムスロットは、通常の通話信号の為に使用され
るものであるから、王者通話装置ＴＷＴの試験の為に、
他の通話を妨害することはない。
らこれらのタイムスロットＴＳｉ、ＴＳｊ、ＴＳｋを指
定する為に、二次時間スイッチ制御メモリＳＴＣに続出
アドレスが書込まれ、この続出アドレスにより送信信号
メモリＳＳＭから試験データα、β、Ｔがタイムスロッ
トＴＳｉ、ＴＳｊ、ＴＳｋに読出されることになる。又
他のタイムスロットは、通常の通話信号の為に使用され
るものであるから、王者通話装置ＴＷＴの試験の為に、
他の通話を妨害することはない。
第５図は、試験データの照合を行うプロセッサＣＰＵの
要部ブロック図であり、試験データα。
要部ブロック図であり、試験データα。
β、γはレジスタＲＥＧ１を介して送信信号メモリＳＳ
Ｍに転送され、受信信号メモリＲＳ Ｍから読出された
信号Ａ、Ｂ、ＣはレジスタＲＦ、Ｇ２にセットされ、又
レジスタＲＥＧＩにセットされた試験データα、β、Ｔ
は論理演算回路ＬＯＧに加えられ、β＋Ｔ、α＋γ、α
＋βの演算を行い、この演算結果とレジスタＲＥＧ２に
セットされた信号Ａ、Ｂ、Ｃとが照合回路ＣＯＭＰに加
えられて照合される。そしてＡ＝β＋γ、Ｂ＝α＋Ｔ。
Ｍに転送され、受信信号メモリＲＳ Ｍから読出された
信号Ａ、Ｂ、ＣはレジスタＲＦ、Ｇ２にセットされ、又
レジスタＲＥＧＩにセットされた試験データα、β、Ｔ
は論理演算回路ＬＯＧに加えられ、β＋Ｔ、α＋γ、α
＋βの演算を行い、この演算結果とレジスタＲＥＧ２に
セットされた信号Ａ、Ｂ、Ｃとが照合回路ＣＯＭＰに加
えられて照合される。そしてＡ＝β＋γ、Ｂ＝α＋Ｔ。
Ｃ＝α＋βの場合に、照合一致を示す信号ＤＳが出力さ
れ、三者通話装置ＴＷＴが正常であると判定される。゛
照合回路ＣＯＭＰに於いて、ビット対応の照合を行う構
成とすることにより、どの位置のビットに誤りがあるか
を示す照合結果信号を出力するようにすることもできる
。なおこのようなハード構成を特別に設けることなく、
プロセッサＣＰＵのソフトウェアによって判定すること
も可能である。
れ、三者通話装置ＴＷＴが正常であると判定される。゛
照合回路ＣＯＭＰに於いて、ビット対応の照合を行う構
成とすることにより、どの位置のビットに誤りがあるか
を示す照合結果信号を出力するようにすることもできる
。なおこのようなハード構成を特別に設けることなく、
プロセッサＣＰＵのソフトウェアによって判定すること
も可能である。
発明の詳細
な説明したように、本発明は、王者通話装置ＴＷＴの試
験の為に特別な装置を付加する必要がないので、経済的
に試験を行うことができ、又１ビット誤り等の障害が発
生した場合も容易に検出することができる。従来の試験
方式では、このような１ビット誤り等の障害を検出する
ことができなかったものである。又ビット誤り位置によ
り、障害個所の指摘が成る程度可能となるから、試験精
度が向上することになる。更に間欠障害に対しても、試
験データによる繰り返し試験により確実に検出すること
が可能となるものである。
験の為に特別な装置を付加する必要がないので、経済的
に試験を行うことができ、又１ビット誤り等の障害が発
生した場合も容易に検出することができる。従来の試験
方式では、このような１ビット誤り等の障害を検出する
ことができなかったものである。又ビット誤り位置によ
り、障害個所の指摘が成る程度可能となるから、試験精
度が向上することになる。更に間欠障害に対しても、試
験データによる繰り返し試験により確実に検出すること
が可能となるものである。
第１図は本発明の実施例の要部ブロック図、第２図は王
者通話装置の要部ブロック図、第３図は本発明の実施例
の更に詳細なブロック図、第４図はタイムスロットの説
明図、第５図は試験データの照合を行う構成の要部ブロ
ック図である。 ＮＷはディジタル・ネットワーク、ＴＷＴは王者通話装
置、ＤＥＣはデコーダ、ＡＤＤは加算回路、ＣＯＤはコ
ーグ、ＭＰＸｌ、ＭＰＸ２はマルチプレクサ、ＰＴＳは
一次時間スイッチ、ＳＳＷは空間スイッチ、ＳＴＳは二
次時間スイッチ、Ｒ３Ｍは受信信号メモリ、即ち第２の
メモリ、ＳＳＭは送信信号メモリ、即ち第１のメモリ、
ＰＴＣは一次時間スイッチ制御メモリ、ＳＴＣは二次時
間スイッチ制御メモリ、ＳＷＣは空間スイッチ制御メモ
リ、ＳＲＤは信号受信分配装置、ＣＰＵはプロセッサ、
ＤＭＰＸＩ、ＤＭＰＸ２はデマルチプレクサである。 特許出願人 富士通株式会社 代理人弁理士 相 谷 昭 司 代理人弁理士 渡 邊 弘 −
者通話装置の要部ブロック図、第３図は本発明の実施例
の更に詳細なブロック図、第４図はタイムスロットの説
明図、第５図は試験データの照合を行う構成の要部ブロ
ック図である。 ＮＷはディジタル・ネットワーク、ＴＷＴは王者通話装
置、ＤＥＣはデコーダ、ＡＤＤは加算回路、ＣＯＤはコ
ーグ、ＭＰＸｌ、ＭＰＸ２はマルチプレクサ、ＰＴＳは
一次時間スイッチ、ＳＳＷは空間スイッチ、ＳＴＳは二
次時間スイッチ、Ｒ３Ｍは受信信号メモリ、即ち第２の
メモリ、ＳＳＭは送信信号メモリ、即ち第１のメモリ、
ＰＴＣは一次時間スイッチ制御メモリ、ＳＴＣは二次時
間スイッチ制御メモリ、ＳＷＣは空間スイッチ制御メモ
リ、ＳＲＤは信号受信分配装置、ＣＰＵはプロセッサ、
ＤＭＰＸＩ、ＤＭＰＸ２はデマルチプレクサである。 特許出願人 富士通株式会社 代理人弁理士 相 谷 昭 司 代理人弁理士 渡 邊 弘 −
Claims (1)
- 王者通話装置を具備したディジタル交換システムに於い
て、プロセッサから三つの試験情報を第１のメモリに格
納し、該三つの試験情報を任意の指定されたタイムスロ
ットに読出して、デマルチプレクサを介して前記王者通
話装置の三つの入力端子にそれぞれ入力し、該王者通話
装置により前記試験情報が合成されて出力される出力端
子からの情報を第２のメモリに書込み、該第２のメモリ
の内容を前記プロセッサが読出して、前記王者通話装置
から本来出力されるべき情報と比較照合することを特徴
とする三者通話装置の試験方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21709783A JPS60109959A (ja) | 1983-11-19 | 1983-11-19 | 三者通話装置の試験方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21709783A JPS60109959A (ja) | 1983-11-19 | 1983-11-19 | 三者通話装置の試験方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60109959A true JPS60109959A (ja) | 1985-06-15 |
| JPH0326588B2 JPH0326588B2 (ja) | 1991-04-11 |
Family
ID=16698791
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21709783A Granted JPS60109959A (ja) | 1983-11-19 | 1983-11-19 | 三者通話装置の試験方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60109959A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04236552A (ja) * | 1991-01-18 | 1992-08-25 | Nec Corp | 加入者疑似呼装置の通話路形成確認制御方式 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56104563A (en) * | 1980-01-25 | 1981-08-20 | Nec Corp | Test system for digital tripartite service trunk |
| JPS56122261A (en) * | 1980-02-29 | 1981-09-25 | Nec Corp | Function test system for tripartite service trunk |
-
1983
- 1983-11-19 JP JP21709783A patent/JPS60109959A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56104563A (en) * | 1980-01-25 | 1981-08-20 | Nec Corp | Test system for digital tripartite service trunk |
| JPS56122261A (en) * | 1980-02-29 | 1981-09-25 | Nec Corp | Function test system for tripartite service trunk |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04236552A (ja) * | 1991-01-18 | 1992-08-25 | Nec Corp | 加入者疑似呼装置の通話路形成確認制御方式 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0326588B2 (ja) | 1991-04-11 |
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