JPS5980115A - Circuit for protecting transistor inverter circuit - Google Patents

Circuit for protecting transistor inverter circuit

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JPS5980115A
JPS5980115A JP18682482A JP18682482A JPS5980115A JP S5980115 A JPS5980115 A JP S5980115A JP 18682482 A JP18682482 A JP 18682482A JP 18682482 A JP18682482 A JP 18682482A JP S5980115 A JPS5980115 A JP S5980115A
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JP
Japan
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circuit
current
phase
voltage
output
Prior art date
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Pending
Application number
JP18682482A
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Japanese (ja)
Inventor
坂本 啓二
関 新次
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Fanuc Corp
Original Assignee
Fanuc Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 本発明は、トランジスタインバータ回路の保護回路に関
する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a protection circuit for a transistor inverter circuit.

従来のトランジスタインバータ回路における過電流保護
方法としては、第1図に示すように、各相の電流を合計
した直流電流を検出する方法が川伝られている。第1図
において、1は整流回路、2は平滑用コンデンサ、3は
インバータ回路、4は負荷、5は電流検出抵抗、6は過
電流検出回路である。インバータ回路3においては、R
相出力がトランジスタTR1,TR2により駆動され、
S相出力がトランジスタTR+3 + TR4により駆
動され、T相出力がトランジスタTR5,TR6により
駆動される。各トランジスタTRI、 TR2・・・T
R6には、ダイオードD!、D2・・・D6がそれぞれ
並列に接続される。各相のトランジスタは、それぞれ一
定のシーケンスに従ってオン・オフされ負荷に3相交流
電圧を供給する。
As a conventional overcurrent protection method for a transistor inverter circuit, as shown in FIG. 1, a method of detecting a DC current that is the sum of currents of each phase has been widely used. In FIG. 1, 1 is a rectifier circuit, 2 is a smoothing capacitor, 3 is an inverter circuit, 4 is a load, 5 is a current detection resistor, and 6 is an overcurrent detection circuit. In the inverter circuit 3, R
The phase output is driven by transistors TR1 and TR2,
The S-phase output is driven by transistors TR+3 + TR4, and the T-phase output is driven by transistors TR5 and TR6. Each transistor TRI, TR2...T
Diode D is in R6! , D2...D6 are connected in parallel. The transistors of each phase are turned on and off according to a fixed sequence, respectively, and supply a three-phase AC voltage to the load.

ところで、第1図の回路においては、各相の2つのトラ
ンジスタが同時にオンした場合、例えばトランジスタT
RIとTR2がオンした場合の短絡状態は、電流検出抵
抗5の両端電圧を用いて過電流検出回路6により検出さ
れる。従って、過電流の検出レベルは、正常な状態での
電流最大値をIpとすると、IpXl、5程度に設定さ
れており、これを超える電流が検出された場合に、すべ
てのトランジスタTRt、 TR2・・・TR6の駆動
信号をオフすることにより、トランジスタ・fンバータ
回路3の保護が行われる。しかしながら、前記の保護方
法においては、異常時の過電流の検出が、1.5 X 
I 。
By the way, in the circuit of FIG. 1, if two transistors of each phase are turned on at the same time, for example, the transistor T
A short circuit state when RI and TR2 are turned on is detected by an overcurrent detection circuit 6 using the voltage across the current detection resistor 5. Therefore, the overcurrent detection level is set to about 5, IpXl, where Ip is the maximum current value in a normal state, and when a current exceeding this is detected, all transistors TRt, TR2. ...The transistor/f inverter circuit 3 is protected by turning off the drive signal of TR6. However, in the above protection method, detection of overcurrent during abnormality is limited to 1.5
I.

という通常より大きな電流で行われるために、各トラン
ジスタの定格をそれだけ大きくする必要がある。
Since this is done with a larger current than usual, it is necessary to increase the rating of each transistor accordingly.

本発明の目的は、前記の問題点にかんがみ、トランジス
タインバータ回路における出力の各相において電源の正
側と負側に直接短絡して流れる電流を検出することによ
り通常の電流レベルの大小に無関係に短絡状態を検出す
るレベルを設定することができる保護回路を提供するこ
とにある。
In view of the above-mentioned problems, an object of the present invention is to detect the current flowing through a direct short circuit between the positive and negative sides of the power supply in each output phase of a transistor inverter circuit, regardless of the magnitude of the normal current level. An object of the present invention is to provide a protection circuit that can set a level for detecting a short circuit condition.

本発明においては、整流回路の出力直流電圧の正負両端
に各相の出力回路が並列に設けられ、各相出力回路は前
記直流電圧の正負両端間に直列に接続される2つのスイ
ッチトランジスタを有し、前記2つのスイッチトランジ
スタの接続点に各相の出力端が接続されるトランジスタ
インバータ回路において、各相出力回路における前記接
続点から見て前記直流電圧の正側へ流れる第1の電流前
記直流電圧の負側へ流れる第2の電流および負荷側へ流
れる第3の電流をそれぞれ検出する手段、前記第1の電
流と第3の電流の和および前記第2の電流と第3の電流
の和を求める手段、前記2つの和のそれぞれの絶対値が
ともに所定の値を超えるか否かを判定する手段を設けた
ことを特徴とする。トランジスタインバーター回路の保
護回路が提供される。
In the present invention, output circuits for each phase are provided in parallel at both the positive and negative ends of the output DC voltage of the rectifier circuit, and each phase output circuit has two switch transistors connected in series between the positive and negative ends of the DC voltage. In a transistor inverter circuit in which an output end of each phase is connected to a connection point between the two switch transistors, the first current flows toward the positive side of the DC voltage when viewed from the connection point in each phase output circuit. Means for detecting a second current flowing to the negative side of the voltage and a third current flowing to the load side, a sum of the first current and the third current, and a sum of the second current and the third current. The present invention is characterized in that the present invention is characterized by providing means for determining whether or not the absolute values of the two sums exceed a predetermined value. A protection circuit for a transistor inverter circuit is provided.

本発明の一実施例としてのトランジスタインバータ回路
の保護回路が、第2図、第3図および第4図を用いて以
下に説明される。
A protection circuit for a transistor inverter circuit as an embodiment of the present invention will be described below with reference to FIGS. 2, 3, and 4.

第2図には、本発明による保護回路が設けられるトラン
ジスタインバータ回路が示される。第2図において、1
は整流回路、2は平滑用コンテンツ、3はトランジスタ
インバータ回L  4//i負荷回路である。トランジ
スタインバータ回路3においては、整流回路1の出力直
流電圧の両端にRlS、T相の出力回路が接続される。
FIG. 2 shows a transistor inverter circuit provided with a protection circuit according to the invention. In Figure 2, 1
2 is a rectifier circuit, 2 is a smoothing content, and 3 is a transistor inverter circuit L4//i load circuit. In the transistor inverter circuit 3, RlS and T-phase output circuits are connected to both ends of the output DC voltage of the rectifier circuit 1.

R相出力回路においては、コレクタが前記直流電圧の正
側に接続されるスイッチトランジスタTR1のエミッタ
が電流検出抵抗R,を介して接続点Aに接続され、エミ
ッタが前記直流電圧の負側に接続されるスイッチトラン
ジスタTR2のコレクタは電流検出抵抗R2を介して接
続点Aに接続される。接続点Aはまた電流抵抗Rsf介
して負荷回路4に接続される。
In the R-phase output circuit, the emitter of the switch transistor TR1 whose collector is connected to the positive side of the DC voltage is connected to the connection point A via the current detection resistor R, and the emitter is connected to the negative side of the DC voltage. The collector of switch transistor TR2 is connected to connection point A via current detection resistor R2. Connection point A is also connected to load circuit 4 via current resistor Rsf.

電流検出抵抗R1+ R21R3は同一の抵抗値を有す
る。S相およびT相出力回路も同様に構成される。
Current detection resistors R1+R21R3 have the same resistance value. The S-phase and T-phase output circuits are similarly configured.

第3図には、第2図のトランジスタインバータ回路にお
ける電流の流れる経路が示される。第3図に示される5
つの電流経路II、I2・・・I5のうち、11+ ’
2+ 13+ 14は正常な状態における電流縁1あジ
、I5は異常な状態における電流経路である。
FIG. 3 shows the path through which current flows in the transistor inverter circuit of FIG. 2. In FIG. 5 shown in Figure 3
Of the two current paths II, I2...I5, 11+'
2+ 13+ 14 is a current edge 1 in a normal state, and I5 is a current path in an abnormal state.

従って、本発明による保護回路においては、前記の異常
な電流I6が存在するが否がが直接的に検出される。第
3図に示される電流経路It、 12  に対してはV
l+VaがOとなり、電流経路I3.’14に対しては
V2+V3がOとなる。ところが、異常な電流Igが存
在する場合には前記の2つの和Vi +VsおよびV2
+V3は、両方とも0ではない値をとる。
Therefore, in the protection circuit according to the present invention, whether or not the abnormal current I6 is present is directly detected. For the current path It, 12 shown in FIG.
l+Va becomes O, and current path I3. For '14, V2+V3 becomes O. However, if an abnormal current Ig exists, the above two sums Vi +Vs and V2
Both +V3 take values other than 0.

従って、異常状態、すなわち、1つの相の出力回路にお
ける短絡状態は、前記の2つの和、V1+V3およびV
2+V3のいずれもがOでないことにより検出される。
Therefore, an abnormal condition, i.e. a short circuit condition in the output circuit of one phase, is the sum of the two above, V1+V3 and V
This is detected because none of 2+V3 is O.

第4図には、前記の異常状態の検出を行うための回路の
一構成例が示される。第4図の回路は、加算器11.1
2、ウィンドコンパレータ13゜14、およびアンド回
路15により構成される。
FIG. 4 shows an example of the configuration of a circuit for detecting the above-mentioned abnormal state. The circuit of FIG. 4 is an adder 11.1.
2, window comparators 13 and 14, and an AND circuit 15.

電流検出抵抗の両端電圧■l およびV3が加算器11
に入力され、V2およびv3が加算器12に入力される
。加算器11および12の出力は、それぞれウィンドコ
ンパレータ13および14に入力され、ウィンドコンパ
レータ13および14の出力はアンド回路15に入力さ
れる。ウィンドコンパレータ13.14においては、入
力の絶対値が所定のレベル以下の場合に「0」が出力さ
れ、所定のレベルを超える場合に「1」が出力される。
The voltage across the current detection resistor ■l and V3 are the adder 11
V2 and v3 are input to the adder 12. The outputs of adders 11 and 12 are input to window comparators 13 and 14, respectively, and the outputs of window comparators 13 and 14 are input to AND circuit 15. The window comparators 13 and 14 output "0" when the absolute value of the input is below a predetermined level, and output "1" when it exceeds the predetermined level.

前記の所定のレベルは入力が実質的にOであるか否かを
判定するものであり、ノイズの影響を受けない範囲で極
めて低く設定することが可能である。
The predetermined level is used to determine whether the input is substantially O or not, and can be set extremely low within a range that is not affected by noise.

アンド回路15の出力は、ウィンドコンパレータ13お
よび14の出力がともに「1」の場合、すなわち、 V
1+VaおよびVz+Vsのいずれもが実質的にゼロで
ない場合に%「1」となる。アンド回路15の出力は、
アラーム出力ALとして、各相のスイッチトランジスタ
をオフするために用いられる。
When the outputs of the window comparators 13 and 14 are both "1", the output of the AND circuit 15 is
When both 1+Va and Vz+Vs are not substantially zero, the value is % "1". The output of the AND circuit 15 is
It is used as an alarm output AL to turn off the switch transistors of each phase.

従って、本発明による保護回路においては、異常状態を
極めて低レベルの電流により検出できるために、トラン
ジスタの定格を正常な状態の最大電流Ipに近い値にす
ることができる。
Therefore, in the protection circuit according to the present invention, since an abnormal state can be detected using an extremely low level current, the rating of the transistor can be set to a value close to the maximum current Ip in a normal state.

本発明によれば、トランジスタインバータ回路において
、異常状態をトランジスタの定格に比べて低いレベルで
検出することができ、それにより実質的に低定格のトラ
ンジスタを使用することができる。
According to the present invention, in a transistor inverter circuit, an abnormal state can be detected at a level lower than the rating of the transistor, so that a transistor with a substantially lower rating can be used.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は、従来形の保護回路を有するトランジスタイン
バータ回路を示す図。 第2図は、本発明による保護回路を有するトランジスタ
インバータ回路を示す図。 第3図は、第2図のトランジスタインバータ回路におけ
る異常状態の検出の原理を説明する図、第4図は1本発
明による保護回路における異常状態の検出回路の一構成
例を示す図である。 (符号の説明) 1・・・整流回路、    2・・・平滑用コンデンサ
、3・・・トランジスタインバータ回路、4・・・負荷
回路、    5・・・電流検出抵抗、6・・・過電流
検出回路、11.12・・・加算器、13.14・・・
ウィンドコンパレータ、15・・・アンド回路。
FIG. 1 is a diagram showing a transistor inverter circuit having a conventional protection circuit. FIG. 2 is a diagram showing a transistor inverter circuit having a protection circuit according to the present invention. FIG. 3 is a diagram illustrating the principle of abnormal state detection in the transistor inverter circuit of FIG. 2, and FIG. 4 is a diagram showing an example of the configuration of an abnormal state detection circuit in a protection circuit according to the present invention. (Explanation of symbols) 1... Rectifier circuit, 2... Smoothing capacitor, 3... Transistor inverter circuit, 4... Load circuit, 5... Current detection resistor, 6... Overcurrent detection Circuit, 11.12... Adder, 13.14...
Window comparator, 15...AND circuit.

Claims (1)

【特許請求の範囲】[Claims] 整流回路の出力直流電圧の正負両端に各相の出力回路が
並列に設けられ、各相出力回路は前記直流電圧の正負両
端間に直列に接続される2つのスイッチトランジスタを
有し、前記2つのスイッチトランジスタの接続点に各相
の出力端が接続されるトランジスタインバータ回路にお
いて、各相出力回路における前記接続点から見て前記直
流電圧の正側へ流れる第1の電流前記直流電圧の負側へ
流れる第2の電流および負荷側へ流れる第3の電流をそ
れぞれ検出する手段、前記第1の電流と第3の電流の和
および前記第2の電流と第3の電流の和を求める手段、
前記2つの和のそれぞれの絶対値がともに所定の値を超
えるか否か全判定する手段を設けたことを特徴とする、
トランジスタインバータ回路の保護回路。
Output circuits for each phase are provided in parallel on both positive and negative ends of the output DC voltage of the rectifier circuit, and each phase output circuit has two switch transistors connected in series between the positive and negative ends of the DC voltage, and In a transistor inverter circuit in which an output end of each phase is connected to a connection point of a switch transistor, a first current flowing toward the positive side of the DC voltage as viewed from the connection point in each phase output circuit to the negative side of the DC voltage. means for detecting the second current flowing and the third current flowing toward the load side; means for determining the sum of the first current and the third current; and the sum of the second current and the third current;
It is characterized by providing means for fully determining whether or not the absolute values of each of the two sums exceed a predetermined value.
Protection circuit for transistor inverter circuit.
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