JPS596438B2 - displacement transducer - Google Patents

displacement transducer

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JPS596438B2
JPS596438B2 JP8367576A JP8367576A JPS596438B2 JP S596438 B2 JPS596438 B2 JP S596438B2 JP 8367576 A JP8367576 A JP 8367576A JP 8367576 A JP8367576 A JP 8367576A JP S596438 B2 JPS596438 B2 JP S596438B2
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oscillator
reactance
changeover switch
terminal
down counter
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JP8367576A
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Japanese (ja)
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剛志 津田
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Yokogawa Electric Corp
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Yokogawa Hokushin Electric Corp
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  • Arrangements For Transmission Of Measured Signals (AREA)
  • Transmission And Conversion Of Sensor Element Output (AREA)

Description

【発明の詳細な説明】 本発明は、静電容量、インダクタンスの変化を利用して
機械的変位量を電気信号に変換する変位変換器に関する
ものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a displacement converter that converts an amount of mechanical displacement into an electrical signal using changes in capacitance and inductance.

従来この種の装置に、静電容量あるいはインダクタンス
に交流信号を与え、静電容量あるいはインダクタンスの
変化に基づく電流または電圧の変化から変位を検出する
ようにしたものがある。
Conventionally, there is a device of this type in which an alternating current signal is applied to capacitance or inductance, and displacement is detected from a change in current or voltage based on a change in capacitance or inductance.

しかしながら、このような従来装置にあつては、与える
交流信号の振幅や周波数の変動、電源電圧の変動、ある
いは周囲温度による影響がそのまま誤差になる欠点があ
る。本発明は、これらの欠点がなく、しかも出力信号を
パルス幅信号あるいはアナログ信号で得ることができる
この種の変位変換器を実現しようとするものである。
However, such conventional devices have the drawback that fluctuations in the amplitude and frequency of the applied alternating current signal, fluctuations in the power supply voltage, or the influence of the ambient temperature directly result in errors. The present invention aims to realize a displacement transducer of this type that does not have these drawbacks and can obtain an output signal as a pulse width signal or an analog signal.

第1図は本発明の一実施例を示すプロツク図である。FIG. 1 is a block diagram showing one embodiment of the present invention.

図において0SCは発振器で、トランジスタで構成した
増幅器Aと、コンデンサまたはインダクタンスを代表す
るリアクタンスR1〜現およびリアクタンスR1とR2
の接続を交互に切換える第1の切換スイツチS,から成
る共振回路Fとで構成されており、その発振周波数は、
リアクタンスR1またはR2を含む共振回路Fの回路定
数で決まる。ここで第1のリアクタンスR1には近接し
て機械的変位が与えられる物体(図示せず)が配置され
、また、第2のリアクタンスR2には近接して前記変位
物体と同一材料の固定物体(図示せず)が配置されてお
り、これらは変位検出部を構成している。第2図〜第6
図はこの変位検出部の例を示す構成図である。
In the figure, 0SC is an oscillator, which includes an amplifier A made up of transistors, reactances R1 and R2 representing capacitors or inductances, and reactances R1 and R2.
It consists of a resonant circuit F consisting of a first changeover switch S, which alternately switches the connection of
It is determined by the circuit constant of the resonant circuit F including reactance R1 or R2. Here, an object (not shown) to which mechanical displacement is applied is placed in the vicinity of the first reactance R1, and a fixed object (not shown) made of the same material as the displacement object is placed in the vicinity of the second reactance R2. (not shown) are arranged, and these constitute a displacement detection section. Figures 2 to 6
The figure is a configuration diagram showing an example of this displacement detection section.

第2図は、固定電極21,22に近接して電極23,2
4を配置させ、一方の電極23が変位物体としての役目
をなしており、機械的変位に応じて矢印a方向に変位す
るようになつている。
FIG. 2 shows electrodes 23 and 2 adjacent to fixed electrodes 21 and 22.
4, one electrode 23 serves as a displacement object, and is adapted to be displaced in the direction of arrow a in response to mechanical displacement.

各電極相互間21と23間および22と24間はそれぞ
れリアクタンス(静電容量)Rl,R2を構成しており
、電極23がa方向に変位すると電極相互間21,23
の距離が変化し、第1のリアクタンスR1が変化する。
第3図は、第2図のものにおいて、電極23の変位方向
を矢印a方向としたもので、これによつて電極相互間2
1,23の対向面積が変化し、第1のリアクタンスR1
が変化するものである。
The spaces between each electrode 21 and 23 and between 22 and 24 constitute reactance (capacitance) Rl and R2, respectively, and when the electrode 23 is displaced in the direction a, the space between the electrodes 21 and 23
The distance changes, and the first reactance R1 changes.
In FIG. 3, the displacement direction of the electrode 23 is set in the direction of the arrow a in the one shown in FIG.
1 and 23 change, and the first reactance R1
is subject to change.

第4図は、コイル25,26内に例えばコア棒27,2
8を配置させ、一方のコア棒2rに機械的変位が与えら
れ矢印a方向に変位させることによつてコイル25のリ
アクタンス(インダクタンス)R1を変化させるように
したものである。第5図はコ字形に構成したコア27,
28にコイル25,26を巻回するとともに、コア27
,28の磁極片に近接して鉄片23,24を配置させ、
一方の鉄片23に機械的変位を与え、これを矢印a方向
に変位させることによつてコイル25のリアクタンスを
変化させるようにしたものである。第6図はコイル25
,26に近接して導電性平板23,24を配置させ、一
方の平板23に機械的変位を与え、これを矢印a方向に
変位させることによつてコイル25のリアクタンスを変
化させるようにしたものである。
FIG. 4 shows, for example, core rods 27, 2 inside the coils 25, 26.
8, one core rod 2r is mechanically displaced and displaced in the direction of arrow a, thereby changing the reactance (inductance) R1 of the coil 25. Figure 5 shows a core 27 configured in a U-shape,
The coils 25 and 26 are wound around the core 27.
, 28, the iron pieces 23 and 24 are arranged in close proximity to the magnetic pole pieces of , 28,
The reactance of the coil 25 is changed by mechanically displacing one iron piece 23 and displacing it in the direction of arrow a. Figure 6 shows the coil 25
, 26, and mechanically displaces one of the plates 23 in the direction of arrow a, thereby changing the reactance of the coil 25. It is.

第1図に戻り、PLSは発振器0SC(7)出力端子に
接続されたパルス化回路、UDCはアツプダウンカウン
タである。
Returning to FIG. 1, PLS is a pulsing circuit connected to the output terminal of the oscillator OSC (7), and UDC is an up-down counter.

S2は第2の切換スイツチで、パルス化回路PLSとア
ツプダウンカウンタUDCの間に設けられている。DL
CはアツプダウンカウンタUDCの出力を入力信号とす
るデイジタル論理回路で、ここには予め上限の設定値U
Sと下限の設定値DSとが設定されており、カウンタU
DCの内容がUSまたはDSに達したとき切換スイツチ
Sl,S2および後述する切換スイツチS3を駆動する
。Eは直流電源、Rl,r2はこの直流電源Eに接続さ
れた抵抗、S3はデイジタル論理回路DLCの出力によ
つて駆動される切換スイツチで、これらはパルス幅信号
発生回路を構成している。LPFは切換スイツチS3か
ら得られるパルス幅信号を平滑する低減済波器できる。
このように構成した装置の動作を次に説明する。はじめ
に、切換スイツチSl,S2,S3が接点U側に接続さ
れているものとする(この状態をフエーズ1と呼ぶ)。
このフエーズ1では、発振器0SCは、その帰還回路F
が第1のリアクタンスR1を含んで構成され、発振周波
数F,は第1のリアクタンスR1の変化、すなわち機械
的な変位に対応して変化する。発振器0SCの発振出力
は、パルス化回路PLSでパルス信号となり、これがア
ツプダウンカウンタUDCのアツプ端子Uに印加され計
数(加算)される。この結果、アツプダウンカウンタU
DCの内容は、第7図イに示すように発振周波数f1、
すなわち機械的変位位置に対応した傾斜で増加する。デ
イジタル論理回路DLCはアツプダウンカウンタUDC
の内容を入力としており、これが予め設定された上限の
設定値USに達すると、スイツチS,,S2およびS3
を接点D側に接続させる(この状態をフエーズ2と呼ぶ
)。このフエーズ2では、発振器0SCは、その帰還回
路Fが第2のリアクタンスR2を含んだ構成に変り、そ
の発振周波数は機械的変位とは無関係な一定値F2とな
る。この発振周波数F2は、パルス化回路PLSでパル
ス化された後、第2の切換スイツチS2を介してアツプ
ダウンカウンタUDCのダウン端子Uに印加され計数(
減算)される。この結果、アツプダウンカウンタUDC
の内容は、第r図帽こ示すように今度は一定な傾斜角で
下降する。そして、カウンタUDCの内容が下限設定値
DSになると、デイジタル論理回路DLCはこれを検出
し、切換スイツチSl,S2およびS3を再び端子U側
に接続させ、フエーズ1の状態にする。以後フエーズ1
、フエーズ2が繰返され、論理回路DLCおよび切換ス
イツチS3の出力側から第8図に示すようにフエーズ1
とフエーズ2とに対応したパルス幅Tl,t2を有する
パルス幅信号を得ることができる。ここで、パルス幅t
1は発振器0SCのフエーズ1のときの発振周波数F,
、すなわち機械的変位に対応し、またパルス幅T2はフ
エーズ2のときの発振周波数F2、すなわち一定値とな
る。したがつて、デユーテイレシオ( “1 )が機
械的変位に対応す▲ + ▲るパルス幅信号をスイツ
チS3を介して得ることができる。
S2 is a second changeover switch, which is provided between the pulsing circuit PLS and the up/down counter UDC. DL
C is a digital logic circuit which takes the output of the up-down counter UDC as an input signal, and here the upper limit setting value U is preset.
S and a lower limit set value DS are set, and the counter U
When the contents of DC reach US or DS, changeover switches Sl, S2 and changeover switch S3, which will be described later, are driven. E is a DC power supply, Rl and r2 are resistors connected to the DC power supply E, and S3 is a changeover switch driven by the output of the digital logic circuit DLC, and these constitute a pulse width signal generation circuit. The LPF is a reduced frequency filter that smoothes the pulse width signal obtained from the switch S3.
The operation of the apparatus configured in this way will be explained next. First, it is assumed that the changeover switches Sl, S2, and S3 are connected to the contact U side (this state is called phase 1).
In this phase 1, the oscillator 0SC has its feedback circuit F
includes a first reactance R1, and the oscillation frequency F changes in response to a change in the first reactance R1, that is, a mechanical displacement. The oscillation output of the oscillator 0SC is turned into a pulse signal by the pulse generator PLS, which is applied to the up terminal U of the up down counter UDC and counted (added). As a result, the up-down counter U
The contents of DC are oscillation frequency f1,
That is, it increases with a slope corresponding to the mechanical displacement position. Digital logic circuit DLC is up-down counter UDC
When this reaches the preset upper limit US, switches S, S2 and S3 are input.
is connected to the contact D side (this state is called phase 2). In this phase 2, the oscillator OSC has a configuration in which its feedback circuit F includes the second reactance R2, and its oscillation frequency becomes a constant value F2 independent of mechanical displacement. This oscillation frequency F2 is pulsed by the pulse generator PLS and then applied to the down terminal U of the up/down counter UDC via the second changeover switch S2 to count (
subtraction). As a result, the up-down counter UDC
As shown in Figure R, the content of the arrow now descends at a constant angle of inclination. Then, when the contents of the counter UDC reach the lower limit set value DS, the digital logic circuit DLC detects this and connects the changeover switches Sl, S2 and S3 to the terminal U side again to set the phase 1 state. From now on Phase 1
, Phase 2 are repeated, and Phase 1 is repeated from the output side of the logic circuit DLC and the changeover switch S3 as shown in FIG.
A pulse width signal having pulse widths Tl and t2 corresponding to phase 2 and phase 2 can be obtained. Here, the pulse width t
1 is the oscillation frequency F at phase 1 of the oscillator 0SC,
, that is, it corresponds to the mechanical displacement, and the pulse width T2 becomes the oscillation frequency F2 at the time of phase 2, that is, a constant value. Therefore, a pulse width signal whose duty ratio ("1") corresponds to the mechanical displacement can be obtained via the switch S3.

また、このパルス幅信号を低域淵波器LPFに印加させ
ることにより、この出力端子0UTから機械的変位に対
応した直流電圧を得ることができる。第9図は本発明の
他の実施例を示すプロツク図である。
Further, by applying this pulse width signal to the low frequency filter LPF, a DC voltage corresponding to the mechanical displacement can be obtained from this output terminal 0UT. FIG. 9 is a block diagram showing another embodiment of the present invention.

この実施例では第1のリアクタンスR1と第2のリアク
タンスR2とを機械的変位に対応して互いに差動的に変
化するように構成したものである。第10図〜第14図
はこの場合の変位検出部の例を示す構成図である。
In this embodiment, the first reactance R1 and the second reactance R2 are configured to differentially change with respect to mechanical displacement. FIGS. 10 to 14 are configuration diagrams showing examples of the displacement detection section in this case.

第10図および第11図のものは機械的変位が与えられ
る変位物体20の両側に固定電極23,24を配置させ
たもので、いずれも変位物体20と固定電極23間およ
び変位物体20と固定電極24間で形成されるリアクタ
ンス(静電容量)R,およびR2が互いに機械的変位に
対応して作動的に変化する。第12図〜第14図は変位
物体20の両端または両側にコイル25,26を配置さ
せたもので、変位物体20の変位に対応してそのリアク
タンス(インダクタンス)が差動的に変化する。このよ
うに発振器0SCの共振回路Fに交互に接続される第1
のリアクタンスR1と第2のリアクタンスR2の値を機
械的変位に対応して互いに差動的に変化するように構成
すると、フエーズ1とフエーズ2とのときの発振器0S
Cから得られる発振周波数f1とF2とが互いに機械的
変位に対応して差動的に変化することになる。
10 and 11 have fixed electrodes 23 and 24 arranged on both sides of a displacement object 20 to which mechanical displacement is applied, and both are fixed between the displacement object 20 and the fixed electrode 23 and between the displacement object 20 and the displacement object 20. Reactance (capacitance) R and R2 formed between the electrodes 24 change operationally in response to mechanical displacement. 12 to 14 show coils 25 and 26 arranged at both ends of a displacement object 20, and the reactance (inductance) thereof changes differentially in response to the displacement of the displacement object 20. FIG. In this way, the first
If the values of reactance R1 and second reactance R2 are configured to vary differentially with respect to mechanical displacement, the oscillator 0S in phase 1 and phase 2
The oscillation frequencies f1 and F2 obtained from C vary differentially in response to mechanical displacement.

したがつて、論理回路DLCから得られるパルス幅Tl
,t2が機械的変位に対応して差動的に変化し、変換感
度を向上させることができる。また、この実施例では、
論理回路DLCから得られるパルス幅信号(駆動信号)
と標準周波数発生器CLからの標準周波数とを入力とし
両信号の位相を比較する位相周波数検出器PFDおよび
低域淵波回路LPF2を設け、低域淵波回路LPF2の
出力信号によつて発振器0SCのリアクタンスR3,R
4の定数あるいは発振器0SCの電源(図示せず)を調
整するようにしたもので、論理回路DLCから得られる
パルス幅信号の周期t1+T2を常に標準周波数信号の
周期に一致した一定値に維持するようにしている。この
ように周期t1+T2を一定値に維持することによつて
、パルス幅t1およびまたはT2は正確に変位に対応し
たものとなる。なお、第1図回路および第9図回路にお
いて、フエーズ1とフエーズ2との切換時には発振器の
発振動作が不安定となることがあり得るので、各フエー
ズへの切換直後の発振出力をアツプダウンカウンタへ印
加しないような回路手段を付加させてもよい。
Therefore, the pulse width Tl obtained from the logic circuit DLC
, t2 change differentially in response to mechanical displacement, making it possible to improve conversion sensitivity. Also, in this example,
Pulse width signal (drive signal) obtained from logic circuit DLC
and a standard frequency from a standard frequency generator CL, and a phase frequency detector PFD and a low-frequency edge wave circuit LPF2 are provided, which input the signal and the standard frequency from the standard frequency generator CL, and compare the phases of both signals. The reactance R3,R of
The constant of 4 or the power supply (not shown) of the oscillator 0SC is adjusted so that the period t1+T2 of the pulse width signal obtained from the logic circuit DLC is always maintained at a constant value that matches the period of the standard frequency signal. I have to. By maintaining the period t1+T2 at a constant value in this manner, the pulse width t1 and/or T2 accurately corresponds to the displacement. Note that in the circuits of Figure 1 and Figure 9, the oscillation operation of the oscillator may become unstable when switching between phase 1 and phase 2, so the oscillation output immediately after switching to each phase is measured using an up-down counter. It is also possible to add circuit means that does not apply any voltage to the voltage.

第15図〜第17図は本発明装置に使用可能な発振器0
SCの具体的回路図である。
Figures 15 to 17 show an oscillator 0 that can be used in the device of the present invention.
It is a specific circuit diagram of SC.

各図において第1図あるいは第9図に示した発振器0S
Cの各素子に対応する素子は同一符号を付してある。第
15図のものはコルピツツ形発振回路で、誘性リアクタ
ンスR1およびまたはR2が変位に対応第16図のもの
はハートレ形発振回路で、容量性リアクタンスR1およ
びまたはR2が変位に対応して変化する。第17図のも
のはクラツプ形発振振回路で、第15図回路と同様に誘
導性リアクタンスR1およびまたはR2が変位に対応し
て変化する。
In each figure, the oscillator 0S shown in Figure 1 or Figure 9
Elements corresponding to each element of C are given the same reference numerals. The one in Figure 15 is a Colpitts-type oscillation circuit, in which the inductive reactance R1 and/or R2 changes in response to displacement.The one in Figure 16 is a Hartle-type oscillation circuit, in which capacitive reactance R1 and/or R2 changes in response to displacement. . The circuit shown in FIG. 17 is a Clapp type oscillator circuit, and like the circuit shown in FIG. 15, the inductive reactance R1 and/or R2 changes in response to displacement.

これらの発振回路は、変位検出部の構成、その他により
適宜選択して使用される。
These oscillation circuits are appropriately selected and used depending on the configuration of the displacement detection section and others.

以上説明したように、本発明に係る装置は、発振器の共
振回路に接続されるリアクタン4スを2組用意するとと
もにこのリアクタンスを機械的変位に対応して変化させ
、これを交互に共振回路に接続したとき発振器から得ら
れる2種の周波数信号をアツプダウンカウンタおよび論
理回路を利用して変位に対応するパルス幅信号に変換す
るもので、次に列挙するような特長を有する。
As explained above, the device according to the present invention prepares two sets of reactances connected to the resonant circuit of the oscillator, changes the reactance in response to mechanical displacement, and alternately connects the reactances to the resonant circuit. When connected, two types of frequency signals obtained from an oscillator are converted into a pulse width signal corresponding to displacement using an up-down counter and a logic circuit, and has the following features.

(1)発振器の周囲温度の変化、発振器の電源電圧変動
、あるいは発振器の構成部品の経年変化等による影響は
、フエーズ1とフエーズ2とで同じような割合で誤差を
もたらすが、アツプダウンカウンタで計数することによ
りこれらが相殺されるので出力信号には表われない。
(1) Effects such as changes in the ambient temperature of the oscillator, fluctuations in the oscillator's power supply voltage, or changes in the oscillator's components over time will cause errors at the same rate in Phase 1 and Phase 2, but they will cause errors in the up-down counter. Since these are canceled out by counting, they do not appear in the output signal.

したがつて、周囲温度や発振器の電源電圧変動等による
変換誤差を除去することができる。(;i)変位に対応
した信号をパルス幅信号として得ることができる。
Therefore, conversion errors due to ambient temperature, oscillator power supply voltage fluctuations, etc. can be removed. (;i) A signal corresponding to the displacement can be obtained as a pulse width signal.

また、必要あらば低域済波回路を介して直流信号として
も得ることができる。
Further, if necessary, it can be obtained as a DC signal via a low frequency wave circuit.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例を示すプロツク図、第2図〜
第6図は第1図装置に使用される変位検出部の構成図、
第7図および第8図は第1図装置の動作を説明するため
の波形図、第9図は本発明の他の実施例を示すプロツク
図、第10図〜第14図は第9図装置に使用される変位
検出部の構成図、第15図〜第17図は本発明装置に使
用可能な発振器の具体的回路図である。 0SC・・・・・・発振器、A・・・・・・増幅器、F
・・・・・・共振回路、R1・・・・・・第1のリアク
タンス、R2・・・・・・第2のリアクタンス、R3,
R4・・・・・・リアクタンス、PLS・・・・・・パ
ルス化回路、UDC・・・・・・アツプダウンカウンタ
、DLC・・・・・・論理回路、S1〜S3・・・・・
・切換スイツチ、LPF,LPFl,LPF2・・・・
・・低域淵波回路、CL・・・・・・標準周波数発生器
、PFD・・・・・・位相周波数検出器。
Figure 1 is a block diagram showing one embodiment of the present invention, Figures 2-
FIG. 6 is a configuration diagram of the displacement detection section used in the device shown in FIG.
7 and 8 are waveform diagrams for explaining the operation of the device shown in FIG. 1, FIG. 9 is a block diagram showing another embodiment of the present invention, and FIGS. 10 to 14 are waveform diagrams for explaining the operation of the device shown in FIG. 9. 15 to 17 are specific circuit diagrams of an oscillator that can be used in the device of the present invention. 0SC...Oscillator, A...Amplifier, F
...Resonance circuit, R1...First reactance, R2...Second reactance, R3,
R4...Reactance, PLS...Pulse circuit, UDC...Up/down counter, DLC...Logic circuit, S1-S3...
・Selector switch, LPF, LPFl, LPF2...
...Low-frequency deep wave circuit, CL...Standard frequency generator, PFD...Phase frequency detector.

Claims (1)

【特許請求の範囲】 1 同一環境に配置され機械的変位に対応して一方のみ
が変化するか又は双方が差動的に変化する第1のリアク
タンスと第2のリアクタンス、前記第1のリアクタンス
と第2のリアクタンスのいずれかが第1の切換スイッチ
により交互に切換接続されて共振回路を構成する発振器
、加算端子と減算端子を有するアップダウンカウンタ、
前記発振器の出力端子と前記アップダウンカウンタの入
力端との間に接続され前記第1の切換スイッチが前記第
1のリアクタンスを共振回路に接続したとき前記発振器
の出力端子を前記カウンタの加算端子に接続し前記第2
のリアクタンスを共振回路に接続したとき前記発振器の
出力端子を前記カウンタの減算端子に接続するように前
記第1の切換スイッチと同期して動作する第2の切換ス
イッチ、前記アップダウンカウンタの出力端子に接続さ
れその計数値が予め設定した上限の一定値に達したとき
前記第2の切換スイッチが前記アップダウンカウンタの
減算端子側に切り換わり、下限の一定値に達したとき前
記第2の切換スイッチがアップダウンカウンタの加算端
子側に切り換わるように前記第1および第2の切換スイ
ッチを制御する論理回路を具備し、前記論理回路の出力
端子から前記機械的変位に対応したパルス幅信号を得る
ようにした変位変換器。 2 発振器としてコルピツツ形発振器、ハートレ形発振
器、クラツプ形発振器のいずれかを用いた特許請求の範
囲第1項記載の変位変換器。 3 同一環境に配置され機械的変位に対応して一方のみ
が変化するか又は双方が差動的に変化する第1のリアク
タンスと第2のリアクタンス、前記第1のリアクタンス
と第2のリアクタンスのいずれかが第1の切換スイッチ
により交互に切換接続されて共振回路を構成する発振器
、加算端子と減算端子を有するアップダウンカウンタ、
前記発振器の出力端子と前記アップダウンカウンタの入
力端との間に接続され前記第1の切換スイッチが前記第
1のリアクタンスを共振回路に接続したとき前記発振器
の出力端子を前記カウンタの加算端子に接続し前記第2
のリアクタンスを共振回路に接続したとき前記発振器の
出力端子を前記カウンタの減算端子に接続するように前
記第1の切換スイッチと同期して動作する第2の切換ス
イッチ、前記アップダウンカウンタの出力端子に接続さ
れその計数値が予め設定した上限の一定値に達したとき
前記第2の切換スイッチが前記アップダウンカウンタの
減算端子側に切り換わり、下限の一定値に達したとき前
記第2の切換スイッチがアップダウンカウンタの加算端
子側に切り換わるように前記第1および第2の切換スイ
ッチを制御する論理回路、この論理回路からのパルス幅
信号と標準周波数信号とを入力としパルス幅信号の周期
が標準周波数信号の周期と一致するように前記共振回路
を構成する他の共振素子の値を制御する制御手段を具備
し、前記論理回路の出力端子から周期が一定でかつ前記
機械的変位と一定な関係にあるパルス幅比のパルス幅信
号を得るようにした変位変換器。
[Claims] 1. A first reactance and a second reactance, which are arranged in the same environment and only one of which changes in response to mechanical displacement, or both of which change differentially; an oscillator in which one of the second reactances is alternately connected by a first changeover switch to constitute a resonant circuit; an up/down counter having an addition terminal and a subtraction terminal;
The first changeover switch is connected between the output terminal of the oscillator and the input terminal of the up/down counter, and when the first changeover switch connects the first reactance to the resonant circuit, the output terminal of the oscillator is connected to the addition terminal of the counter. Connect said second
a second changeover switch that operates in synchronization with the first changeover switch so as to connect the output terminal of the oscillator to the subtraction terminal of the counter when the reactance of the up-down counter is connected to the resonant circuit; When the counted value reaches a preset upper limit value, the second changeover switch switches to the subtraction terminal side of the up/down counter, and when the lower limit value reaches the lower limit value, the second changeover switch switches to the subtraction terminal side of the up/down counter. a logic circuit that controls the first and second changeover switches so that the switches are switched to the addition terminal side of the up/down counter; and a pulse width signal corresponding to the mechanical displacement is output from an output terminal of the logic circuit. A displacement transducer designed to obtain 2. The displacement transducer according to claim 1, which uses any one of a Colpitts-type oscillator, a Hartle-type oscillator, and a Clapp-type oscillator as an oscillator. 3 A first reactance and a second reactance that are placed in the same environment and only one of which changes in response to mechanical displacement, or both of which change differentially, or the first reactance and the second reactance. an oscillator which is alternately switched and connected by a first changeover switch to constitute a resonant circuit; an up/down counter having an addition terminal and a subtraction terminal;
The first changeover switch is connected between the output terminal of the oscillator and the input terminal of the up/down counter, and when the first changeover switch connects the first reactance to the resonant circuit, the output terminal of the oscillator is connected to the addition terminal of the counter. Connect said second
a second changeover switch that operates in synchronization with the first changeover switch so as to connect the output terminal of the oscillator to the subtraction terminal of the counter when the reactance of the up-down counter is connected to the resonant circuit; When the counted value reaches a preset upper limit value, the second changeover switch switches to the subtraction terminal side of the up/down counter, and when the lower limit value reaches the lower limit value, the second changeover switch switches to the subtraction terminal side of the up/down counter. A logic circuit that controls the first and second changeover switches so that the switches are switched to the addition terminal side of the up/down counter, and a pulse width signal and a standard frequency signal from this logic circuit are input, and the period of the pulse width signal is input. control means for controlling the values of other resonant elements constituting the resonant circuit so that the period coincides with the period of the standard frequency signal, and the period from the output terminal of the logic circuit is constant and constant with the mechanical displacement. A displacement transducer that obtains a pulse width signal with a pulse width ratio that has a relationship.
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