JPS5963824A - 負荷電流感知機能を有する負荷駆動回路 - Google Patents
負荷電流感知機能を有する負荷駆動回路Info
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- JPS5963824A JPS5963824A JP58135986A JP13598683A JPS5963824A JP S5963824 A JPS5963824 A JP S5963824A JP 58135986 A JP58135986 A JP 58135986A JP 13598683 A JP13598683 A JP 13598683A JP S5963824 A JPS5963824 A JP S5963824A
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- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/18—Modifications for indicating state of switch
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- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
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- G01R19/145—Indicating the presence of current or voltage
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- H—ELECTRICITY
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- H03K17/08—Modifications for protecting switching circuit against overcurrent or overvoltage
- H03K17/082—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit
- H03K17/0822—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit in field-effect transistor switches
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- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/687—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors
- H03K17/6871—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors the output circuit comprising more than one controlled field-effect transistor
- H03K17/6874—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors the output circuit comprising more than one controlled field-effect transistor in a symmetrical configuration
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- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S323/00—Electricity: power supply or regulation systems
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- Emergency Protection Circuit Devices (AREA)
- Protection Of Static Devices (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
- Control Of Stepping Motors (AREA)
- Testing Of Individual Semiconductor Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は泪測技術に関するもので、特に運転中に正確で
連続的な監視を必要とする分野におけるＭ’ｌ測及び制
御に関するものである。更に詳しくは、本発明は耐荷回
路の状態を監視しながら大電流の誘導負荷をスイ，テン
グするための装置に関する。本発明の応用例としては、
運転中の原子力発電所の場合のように、制御源から約手
マイル（約８００メートル）先までの短離の所に接１ｔ
−１．−された交流作動界磁ンレノイドのＦ駆動がある
、、他の応用例としては比絞的犬電流レベルを通常の鳴
理レベルの（ｇ号で制御する用台、および、磯誠１Σ２
触式リレーでは運転中の信頼性が充分でない場合がある
。
連続的な監視を必要とする分野におけるＭ’ｌ測及び制
御に関するものである。更に詳しくは、本発明は耐荷回
路の状態を監視しながら大電流の誘導負荷をスイ，テン
グするための装置に関する。本発明の応用例としては、
運転中の原子力発電所の場合のように、制御源から約手
マイル（約８００メートル）先までの短離の所に接１ｔ
−１．−された交流作動界磁ンレノイドのＦ駆動がある
、、他の応用例としては比絞的犬電流レベルを通常の鳴
理レベルの（ｇ号で制御する用台、および、磯誠１Σ２
触式リレーでは運転中の信頼性が充分でない場合がある
。
配線の長さが１コイル（約１６キロメートル）以上の回
路においては、比較的高いＶペルの交流電流を使用しな
ければならないような制御機１１ヒが存在する。しかし
ながら比較的長大な大電流回路は特別な問題が発生する
。例えば長大な回路（・よ外部環境および回路のインダ
クタンスに起因する太きな過渡電圧および過渡電流を受
けることがある。
路においては、比較的高いＶペルの交流電流を使用しな
ければならないような制御機１１ヒが存在する。しかし
ながら比較的長大な大電流回路は特別な問題が発生する
。例えば長大な回路（・よ外部環境および回路のインダ
クタンスに起因する太きな過渡電圧および過渡電流を受
けることがある。
それでも遠隔地から被石動回路中の電流を正確に測定す
ること／・５必要である。
ること／・５必要である。
（従来技術の説明）
従来、大電流の負荷駆動回路は「Ｕ流回路および駿械接
触式リレー回路を用いて低レベルの論理信号で制御して
いた。かかる回路構成においては信イ・９件および耐ノ
イズ性が重要な要素である。更に、ぜｔ株式リレーはそ
の特性として寿命に限界がｋ）って、リレー回路を＠繁
Ｖこ試験するとりンー接、心が劣化し、よって回路の信
頼性が低下してしまう、、１だ試験Ｌ程では、試験時に
リレーを通常の回路から取り外して負荷に対する影響を
避けなければならない。自己試験による劣化は、高度の
信＝１・＋’ｉ ４４ｆ１：要求する１烏合には一般に
望ましくない。
触式リレー回路を用いて低レベルの論理信号で制御して
いた。かかる回路構成においては信イ・９件および耐ノ
イズ性が重要な要素である。更に、ぜｔ株式リレーはそ
の特性として寿命に限界がｋ）って、リレー回路を＠繁
Ｖこ試験するとりンー接、心が劣化し、よって回路の信
頼性が低下してしまう、、１だ試験Ｌ程では、試験時に
リレーを通常の回路から取り外して負荷に対する影響を
避けなければならない。自己試験による劣化は、高度の
信＝１・＋’ｉ ４４ｆ１：要求する１烏合には一般に
望ましくない。
（発明の概沙）
本発明１でよる回路装置ｒ↓、負荷電流の有無を感知す
るための巻＃ｊｌ司飽オロ鉄心リアクトルと直列に４＆
Ｆ４，−ｒｉｊ能な交ｖＩＬ負荷を制す１１１するソリ
ッドステート負荷駆動回路を有する。負荷電流および負
荷電流’７＋＃祝装置は共に比較的低いノベルの論理信
号により制御される１、出力回路により妖ノベルの割切
１１倫理回路、ｐよひ高レベル電随駆動回路間が重度に
而＾１ｒされている。負荷、１駆動回路はＩυｄ ｌｉ
ｌ注入信列試験枝ｊｆｌすにより負荷駆動回路を劣化す
ることなく試験可能であり、電流は負荷回路に対する影
！）！！を無祝し得る状態で感知可能である。
るための巻＃ｊｌ司飽オロ鉄心リアクトルと直列に４＆
Ｆ４，−ｒｉｊ能な交ｖＩＬ負荷を制す１１１するソリ
ッドステート負荷駆動回路を有する。負荷電流および負
荷電流’７＋＃祝装置は共に比較的低いノベルの論理信
号により制御される１、出力回路により妖ノベルの割切
１１倫理回路、ｐよひ高レベル電随駆動回路間が重度に
而＾１ｒされている。負荷、１駆動回路はＩυｄ ｌｉ
ｌ注入信列試験枝ｊｆｌすにより負荷駆動回路を劣化す
ることなく試験可能であり、電流は負荷回路に対する影
！）！！を無祝し得る状態で感知可能である。
以下、図面を参照して本発明を説明する。
（特定実砲例の説明）
第１図において、本発明による負荷駆動お」：ひ電流感
知回路は、共通接続したゲート′出；１企１６゜１８お
よび共通接続したソース電極２０，２２を有する一対の
ＨＥＸＦＥＴ １２． １４を含み、該ｔｏｐ、ｘＦ
ｇＴ のドレイン電極２４．２６は［ヒ較的にい信月
路３２，３４を斤して電源′３０と直列の負荷２８の両
端に接ｈｌｉされている。信号路３’２．３４―：、代
表例として８００メ一トル程度のより線対により構成さ
れている。負荷２８は代表例として電気機械式ルノイド
の界磁巻線である。電源６０は通常交流電源より成るが
、直流電源でろっても良い。ドレイン電極２４．２６の
間にはダイオードによるクリ、パ回路３６が接続されて
いる。
知回路は、共通接続したゲート′出；１企１６゜１８お
よび共通接続したソース電極２０，２２を有する一対の
ＨＥＸＦＥＴ １２． １４を含み、該ｔｏｐ、ｘＦ
ｇＴ のドレイン電極２４．２６は［ヒ較的にい信月
路３２，３４を斤して電源′３０と直列の負荷２８の両
端に接ｈｌｉされている。信号路３’２．３４―：、代
表例として８００メ一トル程度のより線対により構成さ
れている。負荷２８は代表例として電気機械式ルノイド
の界磁巻線である。電源６０は通常交流電源より成るが
、直流電源でろっても良い。ドレイン電極２４．２６の
間にはダイオードによるクリ、パ回路３６が接続されて
いる。
クリ、パ回路３６は信号路３２．３４に発生する不安な
一過渡電流を抑制する作用を有するが、回路の正常な動
作には必要ないものである。ＨＥｉＸＦＫＴｌ ２−、
＋ ４は、本発明の回路（ガ改において交流信砂お
よび直流信号の両者を導通できるろ端子電界効果トラン
ジスタである。これらの電界効果トランジスタとしては
米国カリフォルニア州、ロスアンジ［ルスのインターナ
／ヨナル・レフティファイ−＼・−７１製造のＩＲＦ
３５０型Ｎチヤネル電界効果トランジスタがＩｆましい
。ソース電極２０．２２は」い）ｆ＋ ｌン、Ｋ１“１
４点５８に接続され、ドレイン電極２４゜２６（ｃｌ：
ｆ＋荷２８とこれに直列の１２０Ｖ、６０Ｈｚ電１１Ｇ
ｉの」：うな交流電源３０とに直列に接続されている１
゜ ＨＥＸＦＥＴ １２． ＋ ４を使用する理由とし
ては、それが大電流通電能力を有すること、順方向にバ
イアスされたとき各々が代表的には０．３オ一ム程度の
低抵抗しか示さないことが挙げられる。
一過渡電流を抑制する作用を有するが、回路の正常な動
作には必要ないものである。ＨＥｉＸＦＫＴｌ ２−、
＋ ４は、本発明の回路（ガ改において交流信砂お
よび直流信号の両者を導通できるろ端子電界効果トラン
ジスタである。これらの電界効果トランジスタとしては
米国カリフォルニア州、ロスアンジ［ルスのインターナ
／ヨナル・レフティファイ−＼・−７１製造のＩＲＦ
３５０型Ｎチヤネル電界効果トランジスタがＩｆましい
。ソース電極２０．２２は」い）ｆ＋ ｌン、Ｋ１“１
４点５８に接続され、ドレイン電極２４゜２６（ｃｌ：
ｆ＋荷２８とこれに直列の１２０Ｖ、６０Ｈｚ電１１Ｇ
ｉの」：うな交流電源３０とに直列に接続されている１
゜ ＨＥＸＦＥＴ １２． ＋ ４を使用する理由とし
ては、それが大電流通電能力を有すること、順方向にバ
イアスされたとき各々が代表的には０．３オ一ム程度の
低抵抗しか示さないことが挙げられる。
狛荷ｗＡ動回路は変圧器４０を介して発振器回路より駆
動され、発振器回路は変圧器の１次巻線４４の両端間Ｆ
接続された電界効果トランジスタ（ＦＫＴ ） ４２を
含む。この発振器回路は、ＦＫＴ４イを駆動するアンド
ゲート４５に印加される発揚型入力４３により約１００
ＫＨｚで動作する。変圧器４０の２次巻線４６は半波
整流回路として働くダイオード４８に接続している。半
波整流きれたｉａ流雷電圧、負荷抵＠５４と並列１ｒ（
２次巻線４６の両端間に接続されたコンデンサ５０によ
りろ波される。発振回路が動作している時、「」荷抵抗
５４の両端間に１有流電圧が発生する。ソース戒ｉ１娠
２０，２２の共通接続点３８はろ彼コノテンサ５０の電
力の端子に接続されている。ゲート電ｔｉ＠１６．１８
が変圧器４０の１次巻線４４を駆動する発振器回路によ
り制御された夫々の隔部［きれ月つ整流された直流電力
により駆動されているので、ンース電４Ｉｊｉ２０．２
２は駆動回路においてのみ必要である。
動され、発振器回路は変圧器の１次巻線４４の両端間Ｆ
接続された電界効果トランジスタ（ＦＫＴ ） ４２を
含む。この発振器回路は、ＦＫＴ４イを駆動するアンド
ゲート４５に印加される発揚型入力４３により約１００
ＫＨｚで動作する。変圧器４０の２次巻線４６は半波
整流回路として働くダイオード４８に接続している。半
波整流きれたｉａ流雷電圧、負荷抵＠５４と並列１ｒ（
２次巻線４６の両端間に接続されたコンデンサ５０によ
りろ波される。発振回路が動作している時、「」荷抵抗
５４の両端間に１有流電圧が発生する。ソース戒ｉ１娠
２０，２２の共通接続点３８はろ彼コノテンサ５０の電
力の端子に接続されている。ゲート電ｔｉ＠１６．１８
が変圧器４０の１次巻線４４を駆動する発振器回路によ
り制御された夫々の隔部［きれ月つ整流された直流電力
により駆動されているので、ンース電４Ｉｊｉ２０．２
２は駆動回路においてのみ必要である。
発振器人力４３は、接続点５３における選択入力端子か
らの通常持続時間が約１ミリ秒の選択人力パルスか、ま
たは単安定マルチバイブレータ４９の非反転出力端子Ｑ
からのリート；線５１を介−ｔ−ルラ、テ入カパルスが
オアゲート４７を介して供給されている時にのみＦＰｎ
Ｔ ４２に入力はれる。
らの通常持続時間が約１ミリ秒の選択人力パルスか、ま
たは単安定マルチバイブレータ４９の非反転出力端子Ｑ
からのリート；線５１を介−ｔ−ルラ、テ入カパルスが
オアゲート４７を介して供給されている時にのみＦＰｎ
Ｔ ４２に入力はれる。
」１記う、、手信号の持続時間は負荷により決まるが、
通常はおよそ１００ミリ秒である。
通常はおよそ１００ミリ秒である。
接続点５３の選択入力線は、試験入力信号および機能人
力信号の両者を与えるために使用される。（幾址人７１
情号は抵抗ｓｓ、ｓ７卦よびコンデンサ５９より成るＲ
ＣＣロースフィルター回路を介して供給はれ、抵抗５７
を介しシーミツトトリガー回；賂６１の入力端子に供給
される。ンーミ、ットトリガー回路６１は入カシ、りに
対する保護として用い、これによりマルチバイブレータ
４９の誤トリガーを防止する。少くとも１ミリ秒、通常
約５ミリ秒の持続時間を有する信号がンーミ、トドリガ
ー６１を介して単安定マルチ−（イブソータ４９に伝送
されて、タイミングコンデンサ６５を作用させ、該タイ
ミングコンデンサ６３によってアゲート４７を作動する
。このようにして、負荷駆動回路は、その負荷駆動機能
の全期間の間マルテバイブンータ４９を作動することな
く、短い（１ミリ秒）試験期間の間アンドゲート４５を
介し発振器回路を作動する１ミリ秒の試験パルスにより
試験することが出来る。
力信号の両者を与えるために使用される。（幾址人７１
情号は抵抗ｓｓ、ｓ７卦よびコンデンサ５９より成るＲ
ＣＣロースフィルター回路を介して供給はれ、抵抗５７
を介しシーミツトトリガー回；賂６１の入力端子に供給
される。ンーミ、ットトリガー回路６１は入カシ、りに
対する保護として用い、これによりマルチバイブレータ
４９の誤トリガーを防止する。少くとも１ミリ秒、通常
約５ミリ秒の持続時間を有する信号がンーミ、トドリガ
ー６１を介して単安定マルチ−（イブソータ４９に伝送
されて、タイミングコンデンサ６５を作用させ、該タイ
ミングコンデンサ６３によってアゲート４７を作動する
。このようにして、負荷駆動回路は、その負荷駆動機能
の全期間の間マルテバイブンータ４９を作動することな
く、短い（１ミリ秒）試験期間の間アンドゲート４５を
介し発振器回路を作動する１ミリ秒の試験パルスにより
試験することが出来る。
本回路の一つのｌ待機は、所要の機能作用を煩うこ七な
ぐ一団して確実に電流をｄ１１］定する能力にある。本
発明によると、このために可飽和Ｉｐ心変圧器である感
知用変圧器５２を設けて、ゲート４）Ｘ動電圧または出
力負荷電流の存在を検出している。
ぐ一団して確実に電流をｄ１１］定する能力にある。本
発明によると、このために可飽和Ｉｐ心変圧器である感
知用変圧器５２を設けて、ゲート４）Ｘ動電圧または出
力負荷電流の存在を検出している。
具体的に云うと、変圧器５２に巻磁心６５ケ使用し、負
荷感知巻線５８の一方の端子５６をトンイン電４４２６
に接続しかつ他方のＡ１１子６０を負荷２８に直列にな
るように接続している。第１のスイッチ６４またはハー
ドワイヤ接続部を用いて負荷に流れる電１’ｊｔ１．全
通す。あるい（は、ゲート′電極ｉ６．４８に接続した
高インピーダンス抵抗６９を第２の変圧器巻祿７０の一
方の端子６８に接続し、その他方の’７ｉｉ６子７２を
電流センサ７８に接続する。この接続は第１のスイッチ
６４を持つ連動スイッチ装置６６の一部である第２のス
イッチ７６全介して行なっても良い。従って、変圧器５
２公１ゲート電流センサおよび負荷電流センサの両方の
機能を果たすことが出来る。あるいは第２のを、線７０
を電流センサ７８にハードワイヤで接続しても良い。他
の実施例Ｐｊよると、別個の変圧器お、１ひピックアッ
プをゲート電流および負荷電流感知用に夫々使用して、
連動スイッチ６６を省略し、４Ｔ、ｊ電流感知作用を同
時に行なっても良い。
荷感知巻線５８の一方の端子５６をトンイン電４４２６
に接続しかつ他方のＡ１１子６０を負荷２８に直列にな
るように接続している。第１のスイッチ６４またはハー
ドワイヤ接続部を用いて負荷に流れる電１’ｊｔ１．全
通す。あるい（は、ゲート′電極ｉ６．４８に接続した
高インピーダンス抵抗６９を第２の変圧器巻祿７０の一
方の端子６８に接続し、その他方の’７ｉｉ６子７２を
電流センサ７８に接続する。この接続は第１のスイッチ
６４を持つ連動スイッチ装置６６の一部である第２のス
イッチ７６全介して行なっても良い。従って、変圧器５
２公１ゲート電流センサおよび負荷電流センサの両方の
機能を果たすことが出来る。あるいは第２のを、線７０
を電流センサ７８にハードワイヤで接続しても良い。他
の実施例Ｐｊよると、別個の変圧器お、１ひピックアッ
プをゲート電流および負荷電流感知用に夫々使用して、
連動スイッチ６６を省略し、４Ｔ、ｊ電流感知作用を同
時に行なっても良い。
感知用変圧器５２を流れる電流の状態・１は試験外線８
０により監視される。バイアス巻線８２により感知用変
圧器５２を飽和状態に近い所望の電流レベルにまで予め
バイアスする。バイアスは負荷感知巻線腺５８あるいは
ゲート感知巻線７ｏに対する増加した電流により鉄心６
６を飽和状態にするよう選択し、よって電圧印加時に大
電流が感知巻線８０を流れるようにする。
０により監視される。バイアス巻線８２により感知用変
圧器５２を飽和状態に近い所望の電流レベルにまで予め
バイアスする。バイアスは負荷感知巻線腺５８あるいは
ゲート感知巻線７ｏに対する増加した電流により鉄心６
６を飽和状態にするよう選択し、よって電圧印加時に大
電流が感知巻線８０を流れるようにする。
試験巻、ｆＭ８０への印加電圧はバッファ８２と、比較
器８６の５α１の入力端子に接続された電流制限抵抗８
４とを介して、通常約１ミリ秒の持続時間を有する試Ｍ
＠ ７Ｘルスにより与えられる。比較器８６の第２の人
力、端子はＶベル設定ポテンンヨメータ８８に接続され
ている。比較器８６の入力）：石ｒ・に接続でれた第１
のダイオード９０は試験線が負となるのを防市する。感
知巻線８０と的列の第２のり°イオード９′２は、好ま
しくない負・（ルスを；Ｌへ断する。
器８６の５α１の入力端子に接続された電流制限抵抗８
４とを介して、通常約１ミリ秒の持続時間を有する試Ｍ
＠ ７Ｘルスにより与えられる。比較器８６の第２の人
力、端子はＶベル設定ポテンンヨメータ８８に接続され
ている。比較器８６の入力）：石ｒ・に接続でれた第１
のダイオード９０は試験線が負となるのを防市する。感
知巻線８０と的列の第２のり°イオード９′２は、好ま
しくない負・（ルスを；Ｌへ断する。
以下動作（でついて説明する。持続時間１ミリ秒の試験
パルスを・４７フア８２を介して感知を線８０に加える
。鉄心６３が飽和がしていない鴨合は、感知巻線８０は
高インピーダンスとなり比・咬＋１ｏ ８６の入力に対
し高い論理レベルの電圧信号をりえる。このレベルは比
較器８６により感知され、ノステノ、１１１力１代抗９
４を介し論理出力信号として１１１力される。該出力１
言号の電圧レベルは試（険・Ｚ）レスの入力から約８０
０マイクロ秒後に読み取られる。一方鉄心６３が飽和し
ている場合は、感知巻庫８０はアースに対して低インビ
ータ“ンスとなり、比較器８６の感知入力をアースの方
へ下げる。この入力レベルは比較器８６により感知され
、出力抵抗９４ ｆｉ−介して論理レベル信号として出
力される。８００マイクロ秒後にンステム出力が読み取
ら：１１− ｌこ時、この！１間なる論理レベルは電流
の存在を表わすものとして検出され認識された３、この
表示出力（件（１；の論理の蛎合は論理１となる。
パルスを・４７フア８２を介して感知を線８０に加える
。鉄心６３が飽和がしていない鴨合は、感知巻線８０は
高インピーダンスとなり比・咬＋１ｏ ８６の入力に対
し高い論理レベルの電圧信号をりえる。このレベルは比
較器８６により感知され、ノステノ、１１１力１代抗９
４を介し論理出力信号として１１１力される。該出力１
言号の電圧レベルは試（険・Ｚ）レスの入力から約８０
０マイクロ秒後に読み取られる。一方鉄心６３が飽和し
ている場合は、感知巻庫８０はアースに対して低インビ
ータ“ンスとなり、比較器８６の感知入力をアースの方
へ下げる。この入力レベルは比較器８６により感知され
、出力抵抗９４ ｆｉ−介して論理レベル信号として出
力される。８００マイクロ秒後にンステム出力が読み取
ら：１１− ｌこ時、この！１間なる論理レベルは電流
の存在を表わすものとして検出され認識された３、この
表示出力（件（１；の論理の蛎合は論理１となる。
以１−木発明を特定の実施例について説明したが、他の
実）ｊ（ｒ＋例も当築者にとっては明白であり、不発明
灯！１−♂１請求の範囲（Ｃ基づいて限定されるべきで
ある１゜
実）ｊ（ｒ＋例も当築者にとっては明白であり、不発明
灯！１−♂１請求の範囲（Ｃ基づいて限定されるべきで
ある１゜
図（・１本発明による負荷、１枢動回）・洛および電流
監視回路のｊｊｉｌ ｊ洛図である。 主な杓５の５（ε明 ＋２．＋４は電界効１ｊトランジスタ；２８は負荷；６
０は電源；３２，３４は信号路；４０は変圧器；４２は
電荷効果トランジスタ；４９は単安定マルテバイプンー
タ；５２は感知用変圧器；６６は連動スイッチ装置；７
８は電流センサ；８６Ｖ１、比較器を表わす。 第１頁の続き ０発 明 者 ケネス・マーク・スコアアメリカ合衆国
マサチュセッッ 州カムブリッジ・キネアート・ ストリート３５１／２番
監視回路のｊｊｉｌ ｊ洛図である。 主な杓５の５（ε明 ＋２．＋４は電界効１ｊトランジスタ；２８は負荷；６
０は電源；３２，３４は信号路；４０は変圧器；４２は
電荷効果トランジスタ；４９は単安定マルテバイプンー
タ；５２は感知用変圧器；６６は連動スイッチ装置；７
８は電流センサ；８６Ｖ１、比較器を表わす。 第１頁の続き ０発 明 者 ケネス・マーク・スコアアメリカ合衆国
マサチュセッッ 州カムブリッジ・キネアート・ ストリート３５１／２番
Claims (1)
- 【特許請求の範囲】 １）論理制御信号に応じて負荷を小動する回路装置にお
いて、入力論理レベル信号に応じて交流電源をオンおよ
びオフにスイ、テノグする電界効果トランジスタ手段を
備え、該′電界効果トランジス′り手段は前記電源およ
び前記負荷と論理に接続され、Ａｉｌ記電源および前記
負荷は第１および第２の端子を有する負荷手段を形成し
、前記電界効果トランジスタ手段は熾１のゲート電極、
第１のノース電極および第１のトンイン電極を持つ第１
の電界効果トランジスタと、第２のゲート電極、第２の
ソース電極および第２のトンイン電極を持つ第２の電界
効果トランジスタとを有し、前記第１のゲート電極は前
記第２のゲート電極に接続さｎ、前記さ１λ１のソース
電極は前記第２のソース電極にＩν続・され、前記第１
のドレイン電極は前記負荷手段の前記第１の端子に接続
され、前記第２のライン電極＆」、［）コ記負荷手段の
前記第２の端子に接続され、よって前記電界効果トラン
ジスタ手段に流れる交シＩＬ電流に対するスイ、テ回路
を形成し、前記′電界トランジスタ手段が前記第１およ
び第２のソース電極と前記第１および第２のゲート電極
との間の電圧変化に応答してスイ、テングを行うことを
特徴とする回：塔装置。 ２）人力論ｆ１１！レベル信号がゲート・ソース回路手
段により発生され、該ゲートソース回路手段が光４辰器
に接続されて発撮器信号をゲートす・る手段と、該ケー
ト手段に接続され前記発捜器信号合−整流する手段とを
有し、前記整流手段はゲート伯’；１／（Ｉｆ、：して
前記第１および第２のゲート電極と第１および第２のソ
ース電極との間に直流信号を印加゛ｒるように接続され
ている、特許請求の範囲第１１臼記載の回路装置。 ３）前記電界効果トランジスタ手段の動作を監視する感
知手段を更に含む、特許請求の範囲第１項また＆ｊ、第
２項記載の回路装置。 ４）前記感知手段が容易に飽和可能な鉄心を持つリアク
トルの第１の電流感知巻線を含み、該第１の巻線は前記
負荷手段および前記電界効果トランジスタ手段に直列に
接続されていて前記負荷手段を流れる電流を特徴する特
許請求の範囲第３項記載の回路装置。 ５）前記感知手段が容易に飽第１１可能な鉄心を持つリ
アクトルの第２の電流感知巻線を含み、該第２の巻線は
前記第１および第２のゲート電極と前記第１および第２
のソース電極との間に接続されて、前記両ゲート電極お
よび前記両ソース電極の間に電圧を発生する電流を特徴
する特許請求の範囲第３項記載の回路装置。 ６）前記感知手段が前記リアクトルの飽和を検知するよ
うに動作する電流検出回路を含み、該電流検出回路は前
記鉄心に設けた第３の電流感知巻線と、トヒ較器と、前
記第３の巻線に試験電流を供給する手段とを有し、前記
第３の巻線は鉄心の非飽、［日時に高インビ・−グノス
を呈すると共に鉄心の飽和時には低インピーダンスを呈
する、唱訂請求の範囲第４項記ｆｌＩＶ、の回路装置。 ７）前記感知手段が前記リアクトルの飽和を検知するよ
うに動作する電流検出回路を含み、該電流検出回路は前
記鉄心に設けた第３の電流感知巻線腺と、比較器と、前
記第３の巻線に試験電流を供給する手段とを有し、前記
第６の巻線は鉄心の非飽和時に高インピーダンスを呈す
るＦ共に鉄心の飽和時には低インピーダンスを呈する、
特許請求の範囲第５項記載の回路装置。 ８）前記ゲート・ソース回路手段が少くとも晟小の持Ｈ
二時間の入力パルスに応じて、予ちめ選択した期間の間
前記ゲー、ト手段をオン状態に保持するタイミング手段
をＷに含む、特許請求の範囲、Ａ′ル２”’： ｔｔ１
４ ＋Ｉ・ｋの回路装置。 ９） Ｒｊ！ｉ＋ｉ１パルスを前記ゲート・ソース回
路手段にｔ）１人する手段と、該試験パルス注入手段に
より印加でれた試験パルスを前記タイミング手段から隅
肉（１して、該タイミング手段が前記ゲート・ソース回
路手段乞ラッチするのを防止する手段とを更に含む、特
許請求の範囲第８項記載の回路装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US06/402,373 US4485342A (en) | 1982-07-27 | 1982-07-27 | Load driving circuitry with load current sensing |
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Publications (2)
| Publication Number | Publication Date |
|---|---|
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| JPH0478052B2 JPH0478052B2 (ja) | 1992-12-10 |
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