JPS5948136U - 自己出力選択形ワンシヨツト回路 - Google Patents

自己出力選択形ワンシヨツト回路

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JPS5948136U
JPS5948136U JP2417783U JP2417783U JPS5948136U JP S5948136 U JPS5948136 U JP S5948136U JP 2417783 U JP2417783 U JP 2417783U JP 2417783 U JP2417783 U JP 2417783U JP S5948136 U JPS5948136 U JP S5948136U
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JP
Japan
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pulse
circuit
output
level
signal
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JP2417783U
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JPS6033631Y2 (ja
Inventor
稔 田中
周次 守尾
Original Assignee
株式会社山武
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はこの考案の一実施例による自己出力選択形ワン
ショット回路の回路図、第２図は第１図の回路の各部に
おける信号波形図である。 Ｅｌ・・・直流電源、Ｕｌ・・・コンパレータ、ＳＥＮ
・・・第１の入力信号、ＳＷ・・・第２の入力信号、Ｖ
ｏｕ・・・出力信号、Ｕ２・・・フリップフロップ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第１のパルス入力信号と直流バイアス電圧とを重畳し、
    該第１のパルス入力信号に応じて第１のレベルと第２の
    レベルを有する信号を出力するバイアス回路と、前記第
    １のパルス入力信号を遅延させるとともに、その遅延し
    たパルスの定常状態におけるレベルが前記第１のレベル
    と前記第２のレベルの間にある遅延パルスを出力する第
    １の遅れ回路と、前記バイアス回路からの出力信号を第
    １の入力端に、また前記第１の遅れ回路からの遅延パル
    スを第２の入力端に受け、前記第１および第２の入力端
    に供給される信号がそのレベルの大きさを逆転させてい
    る期間に相当するパルス幅の出力信号を出力端から発生
    するコンパレータと、前記第１の入力信号およびこれと
    は別の第２のパルス入力信号をセット入力端子およびリ
    セット入力端子にそれぞれ受けるフリップフロップ回路
    と、該フリップフロップ回路の出力信号を前記コンパレ
    ータの出力パルス幅より遅延させる第２の遅れ回路と、
    該第２の遅れ回路の出力によってオン、オフが制御され
    るスイッチング回路とを備え、前記第１および第２のパ
    ルス入力信号の間で論理積が成立したときに前記スイッ
    チング回路の出力により前記コンパレータからの出力が
    阻止されることを特徴とする自己出力選択形ワンショッ
    ト回路。
JP2417783U 1983-02-21 1983-02-21 自己出力選択形ワンシヨツト回路 Expired JPS6033631Y2 (ja)

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JPS5948136U true JPS5948136U (ja) 1984-03-30
JPS6033631Y2 JPS6033631Y2 (ja) 1985-10-07

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