JPS5941554B2 - 電子時計 - Google Patents
電子時計Info
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- JPS5941554B2 JPS5941554B2 JP53011689A JP1168978A JPS5941554B2 JP S5941554 B2 JPS5941554 B2 JP S5941554B2 JP 53011689 A JP53011689 A JP 53011689A JP 1168978 A JP1168978 A JP 1168978A JP S5941554 B2 JPS5941554 B2 JP S5941554B2
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- JP
- Japan
- Prior art keywords
- circuit
- pulse
- counter
- frequency
- gate
- Prior art date
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- Expired
Links
- 238000012360 testing method Methods 0.000 claims description 15
- 230000010355 oscillation Effects 0.000 claims description 2
- 238000007689 inspection Methods 0.000 description 16
- 239000004973 liquid crystal related substance Substances 0.000 description 7
- 238000012937 correction Methods 0.000 description 5
- 230000005540 biological transmission Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
- 238000009412 basement excavation Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 238000003908 quality control method Methods 0.000 description 1
- 239000002699 waste material Substances 0.000 description 1
Classifications
-
- G—PHYSICS
- G04—HOROLOGY
- G04C—ELECTROMECHANICAL CLOCKS OR WATCHES
- G04C10/00—Arrangements of electric power supplies in time pieces
- G04C10/04—Arrangements of electric power supplies in time pieces with means for indicating the condition of the power supply
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Electric Clocks (AREA)
Description
【発明の詳細な説明】
本発明は、検査用の制御回路を電子回路に内蔵した電子
時計に関するものであり、電子時計の検査工程の簡略化
、時間の節減な図ることを目的とする。
時計に関するものであり、電子時計の検査工程の簡略化
、時間の節減な図ることを目的とする。
電子時計の検査は、品質管理上から非常に重要であり、
比較的、作業性と能率の悪い作業である。
比較的、作業性と能率の悪い作業である。
従来は、人手により外部操作手段を操作して、修正する
ことにより、回路の動作や表示素子の検査を行なってい
る。
ことにより、回路の動作や表示素子の検査を行なってい
る。
例えば、分表示の検査には、６０回以上も修正信号を入
力する必要があり、更に、時、日、月と検査を繰り返す
ために非常に能率が悪くなる。
力する必要があり、更に、時、日、月と検査を繰り返す
ために非常に能率が悪くなる。
また、近年の電子時計の多機能化に伴なう検査項目の増
加により、ますます検査作業の合理化が迫まられている
。
加により、ますます検査作業の合理化が迫まられている
。
そこで、従来より、検査作業の能率化を進める工夫がな
されている。
されている。
一例としては、修正モードにおいて、修正スイッチをあ
らかじめ決められた時間押し続けることによって、自動
的に表示がある周波数で進む早送り機構を設けることな
どがある。
らかじめ決められた時間押し続けることによって、自動
的に表示がある周波数で進む早送り機構を設けることな
どがある。
本発明は、前記の事情を鑑みてなされたものであり、検
査の能率化をさらに進めたものである。
査の能率化をさらに進めたものである。
すなわち、通常の時計、修正モードに設定する外部操作
手段とは異なる外部操作手段により設定される検査モー
ドを持ち、該検査モードにおいては各カウンターの入力
に設けられたゲート回路を通して、検査用のクロックパ
ルスが並列に入力される。
手段とは異なる外部操作手段により設定される検査モー
ドを持ち、該検査モードにおいては各カウンターの入力
に設けられたゲート回路を通して、検査用のクロックパ
ルスが並列に入力される。
以下に、実施例として液晶表示素子を用いたデジタル時
計を挙げ説明する。
計を挙げ説明する。
第１図は、本発明の実施例の電子時計の回路図である。
１の発掘回路、２０分周回路、３の１秒カウンター、４
の１０秒カウンター、５の分カウンタ−，６０時カウン
ター、７０日カウンター、８の月カウンタ−，９の液晶
１駆動回路、１０の液晶表示素子、１１の制御端子、１
２．１３のＡＮＤゲート、１４の微分回路、１５ａ、ｂ
のトランスミッションゲート、１６〜２０のＯＲゲート
、２１のラッチ回路により構成されている。
の１０秒カウンター、５の分カウンタ−，６０時カウン
ター、７０日カウンター、８の月カウンタ−，９の液晶
１駆動回路、１０の液晶表示素子、１１の制御端子、１
２．１３のＡＮＤゲート、１４の微分回路、１５ａ、ｂ
のトランスミッションゲート、１６〜２０のＯＲゲート
、２１のラッチ回路により構成されている。
通常の時計モードでは発振回路１で作られた基準信号は
、分周回路２によって分周され、１秒カウンター３．１
０秒カウンター４と月カウンタ−８まで計数され、各々
のカウンターの出力は、液晶駆動回路９を通じて液晶表
示素子１０を１駆動する。
、分周回路２によって分周され、１秒カウンター３．１
０秒カウンター４と月カウンタ−８まで計数され、各々
のカウンターの出力は、液晶駆動回路９を通じて液晶表
示素子１０を１駆動する。
検査時は、時計モードと異なる検査モードとするために
、実施例では、制御端子１１をｈｉｇｈ にするとＡＮ
Ｄゲート１２の出力はｌｏｗとなり、時計モードにおい
て入力した分周回路の出力は遮断される。
、実施例では、制御端子１１をｈｉｇｈ にするとＡＮ
Ｄゲート１２の出力はｌｏｗとなり、時計モードにおい
て入力した分周回路の出力は遮断される。
また、分周回路からの５１２Ｈｚの信号によって微分回
路１４において、微分された信号パルスにより、すべて
のカウンター３〜８がリセットされ、すべての表示はＯ
となり、同時に、ラッチ回路２１もセットされ、ラッテ
出力はｌａｗに初期設定される。
路１４において、微分された信号パルスにより、すべて
のカウンター３〜８がリセットされ、すべての表示はＯ
となり、同時に、ラッチ回路２１もセットされ、ラッテ
出力はｌａｗに初期設定される。
さらに、ＡＮＤゲート１３の制御端子１１から結ばれた
ゲートが、ｈｉｇｈ となるので、トランスミッショ
ンゲート１５ａは、４Ｈｚ信号の流れるゲートがＯＮと
なる。
ゲートが、ｈｉｇｈ となるので、トランスミッショ
ンゲート１５ａは、４Ｈｚ信号の流れるゲートがＯＮと
なる。
従って、４Ｈｚの検査用のクロックパルスが、各カウン
ター３〜８の入力に設けられたＯＲゲート１６〜２０を
通じて、同時に入力される。
ター３〜８の入力に設けられたＯＲゲート１６〜２０を
通じて、同時に入力される。
そこで、秒、分、時、日、月の各表示の１の位は１秒間
に、４回の割合で進む。
に、４回の割合で進む。
このように検査パルスを各カウンターに並列に入力して
、検査する場合には、各カウンタ 。
、検査する場合には、各カウンタ 。
−の１サイクルを検査するのに要する所要時間は、１サ
イクルに要するパルス数の最大値によって決まる。
イクルに要するパルス数の最大値によって決まる。
通常の時計では、秒及び分カウンターの６０個が最大で
あるから、検査時間は、６０／４＝１５秒となる。
あるから、検査時間は、６０／４＝１５秒となる。
ところが、各表示の１の位の検査は、 。最初のＯ〜９
までで済んでしまうので、この後の１の位の検査は、時
間の浪費となる。
までで済んでしまうので、この後の１の位の検査は、時
間の浪費となる。
そこで、実施例では、１秒カウンターの出力によって検
査用のクロックパルスの周波数を切換えている。
査用のクロックパルスの周波数を切換えている。
即ち、検査用のクロックパルスが１０個入為と、１秒力
。
。
ランター３から、１パルスが出力され、ラッチ回路２１
は、リセットされて、出力はｈｉｇｈ にかわる。
は、リセットされて、出力はｈｉｇｈ にかわる。
従って、トランスミッションゲート１５ｂは、３２Ｈ２
がＯＮとなり、４Ｈｚのパルスに代って、３２Ｈｚの信
号が各カウンター３〜８に入力され、各表示は、８倍の
速度で進むことになり、秒、分、時、成力等の１０の位
の表示の検査を迅速に行なうことができる。
がＯＮとなり、４Ｈｚのパルスに代って、３２Ｈｚの信
号が各カウンター３〜８に入力され、各表示は、８倍の
速度で進むことになり、秒、分、時、成力等の１０の位
の表示の検査を迅速に行なうことができる。
更に、検査用のクロックパルスが入力して、全部で６０
パルス入力すると１０秒カウンターから１パルスが出力
され、再びラッチ回路２１がセットされ、３２Ｈｚから
４Ｈｚに切換えられる。
パルス入力すると１０秒カウンターから１パルスが出力
され、再びラッチ回路２１がセットされ、３２Ｈｚから
４Ｈｚに切換えられる。
検査用クロックパルスには、検査が容易な周波数の信号
を用いる必要があるが、実施例では、分局の途中の３２
Ｈｚと４Ｈｚの信号を用いて、回路の簡略化を図ってい
る。
を用いる必要があるが、実施例では、分局の途中の３２
Ｈｚと４Ｈｚの信号を用いて、回路の簡略化を図ってい
る。
このように検査用制御回路を設けることにより、電子回
路中の素子数は増加する。
路中の素子数は増加する。
そこで、回路の負担について考えてみると、該制御回路
は、１２．１３のＡＮＤゲート、１４の微分回路、１５
ａ、ｂのトランスミッションゲート、１６〜２０のＯＲ
ゲート、２１のラッチ回路などから構成される。
は、１２．１３のＡＮＤゲート、１４の微分回路、１５
ａ、ｂのトランスミッションゲート、１６〜２０のＯＲ
ゲート、２１のラッチ回路などから構成される。
従って、必要な素子数は、約７０素子である。
通常の基本的な電子時計の必要素子数は３０００〜４０
００素子であるから、制御回路の負担は、全体の２係強
であり、更に、近年の多機能化時計に於いては、その比
率はより小さくなる。
００素子であるから、制御回路の負担は、全体の２係強
であり、更に、近年の多機能化時計に於いては、その比
率はより小さくなる。
このようにして、簡単な制御回路を内蔵することで、単
純な操作により、検査用のクロックパルスが各カウンタ
ーに同時に入力されるので、各表示を同時に検査できる
。
純な操作により、検査用のクロックパルスが各カウンタ
ーに同時に入力されるので、各表示を同時に検査できる
。
従って、従来のように、人手により複雑な操作を行なっ
て、各表示を順次検査しなければならない電子時計と異
なり、大幅な検査時間の短縮が可能となり、合理化が図
られる。
て、各表示を順次検査しなければならない電子時計と異
なり、大幅な検査時間の短縮が可能となり、合理化が図
られる。
第１図は、本発明の実施例の回路図。
１・・・発振回路、２・・・分局回路、３・・・１秒カ
ウンター、４・・・１０秒カウンター、５・・・分カウ
ンタ−，６・・・時カウンタ−，７・・・日カウンター
、８・・・月カウンタ−，９・・・液晶駆動回路、１０
・・・液晶表示素子。
ウンター、４・・・１０秒カウンター、５・・・分カウ
ンタ−，６・・・時カウンタ−，７・・・日カウンター
、８・・・月カウンタ−，９・・・液晶駆動回路、１０
・・・液晶表示素子。
Claims (1)
- １ 発振回路、分周回路、秒、分、時等の複数のカウン
ター回路、表示素子駆動回路及び表示装置よりなる電子
時計において、前記秒、分、時等の複数のカウンター回
路の入力に検査用クロックパルスを加えるためのゲート
回路、前記検査用クロックパルスの供給を制御する制御
回路を有し、前記検査用クロックパルスは前記分周回路
の途中段より得られた第１の周波数の第１のパルス及び
第２の周波数の第２のパルスよりなり、前記制御回路は
、制御端子の信号によって前記第１のパルスを前記複数
のカウンター回路のゲート回路に同時に加え、前記秒カ
ウンター回路の出力信号によって前記第１のパルスに換
えて前記第２のパルスを前記複数のカウンター回路のゲ
ートに同時に加えることを特徴とする電子時計。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53011689A JPS5941554B2 (ja) | 1978-02-03 | 1978-02-03 | 電子時計 |
| US06/009,724 US4250523A (en) | 1978-02-03 | 1979-02-05 | Electronic timepiece |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53011689A JPS5941554B2 (ja) | 1978-02-03 | 1978-02-03 | 電子時計 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54104873A JPS54104873A (en) | 1979-08-17 |
| JPS5941554B2 true JPS5941554B2 (ja) | 1984-10-08 |
Family
ID=11784985
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53011689A Expired JPS5941554B2 (ja) | 1978-02-03 | 1978-02-03 | 電子時計 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4250523A (ja) |
| JP (1) | JPS5941554B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55166084A (en) * | 1979-06-12 | 1980-12-24 | Seiko Epson Corp | Electronic watch |
| US7455447B2 (en) * | 2006-05-19 | 2008-11-25 | Mediatek Inc. | Method and apparatus for a portable device |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51104376A (ja) * | 1975-03-11 | 1976-09-16 | Citizen Watch Co Ltd | |
| FR2308992A1 (fr) * | 1975-04-25 | 1976-11-19 | Soprogespar | Pendule electronique a remise a l'heure capacitive |
| JPS5277774A (en) * | 1975-12-24 | 1977-06-30 | Seiko Epson Corp | Electronic watch |
-
1978
- 1978-02-03 JP JP53011689A patent/JPS5941554B2/ja not_active Expired
-
1979
- 1979-02-05 US US06/009,724 patent/US4250523A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| US4250523A (en) | 1981-02-10 |
| JPS54104873A (en) | 1979-08-17 |
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