JPS5934758A - Facsimile device - Google Patents

Facsimile device

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JPS5934758A
JPS5934758A JP57145785A JP14578582A JPS5934758A JP S5934758 A JPS5934758 A JP S5934758A JP 57145785 A JP57145785 A JP 57145785A JP 14578582 A JP14578582 A JP 14578582A JP S5934758 A JPS5934758 A JP S5934758A
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JP
Japan
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output
information
image information
input
common bus
Prior art date
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Pending
Application number
JP57145785A
Other languages
Japanese (ja)
Inventor
Ichiro Miyagawa
一郎 宮川
Nobukiyo Sakai
阪井 宣清
Satoru Ishihara
哲 石原
Kotaro Suzuki
孝太郎 鈴木
Sumio Ogawara
小川原 澄夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic System Solutions Japan Co Ltd
Original Assignee
Matsushita Graphic Communication Systems Inc
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Filing date
Publication date
Application filed by Matsushita Graphic Communication Systems Inc filed Critical Matsushita Graphic Communication Systems Inc
Priority to JP57145785A priority Critical patent/JPS5934758A/en
Publication of JPS5934758A publication Critical patent/JPS5934758A/en
Pending legal-status Critical Current

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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N1/00Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof

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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Facsimiles In General (AREA)
  • Communication Control (AREA)

Abstract

PURPOSE:To input and output picture information and coding information on a common bus, by connecting several adaptors to the common bus of a microcomputer system in a facsimile device and giving command information to each adaptor. CONSTITUTION:The system comprising a central processing unit CPU 1, including the microprocessor, an ROM2 and an RAM3 is connected with the common bus 4, and a system interface adaptor (SIA)10, a memory interface adaptor (MIA)11, a band compressing and expansion adaptor (BCEA)12, and a communication interface adaptor (CIA)13 are connected to the common bus as I/O devices in an address space of the system respectively, and the initial set is attained from the CPU1 to a command register of the adaptors 10, 11, 13 at the G2 transmission, and the picture information from a scanner 6 is written in a line memory 7, and transmitted to the CIA 13 from a common bus control section 112 with the DMA transfer or the program transfer and the data is transmitted from an MODEM 8.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、制御系を改良したファクシミリ装置に関する
ものである。
DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a facsimile machine with an improved control system.

従来例の構成とその問題点 従来のファクシミリ装置においては、(イ)装置の制御
系および符号化・復υ化部をラシタA rJシックのみ
で構成したり、(ロ)高速1イ1を宏する?’l’ >
;化・復号化部をランダムロジックで構成する−・力、
高速性を要しないその他の制御部をマイクロコンピュー
タ・システムで構成したり、(ハ)装置の制御系および
符号化・複−υ化部をバイポーラのピッl−スライス型
マイクロブセソ゛す゛を組み合わ萌た高速処理可能なマ
イクロコンピュータ・シスデJ・f J7fi 成した
りしていた。
Conventional configuration and its problems In conventional facsimile machines, (a) the control system and the encoding/decoding section of the device are constructed only from lascita A rJ thick, and (b) high-speed 1-1 is do? 'l' >
The encoding/decoding section is composed of random logic.
Other control sections that do not require high speed can be configured with a microcomputer system, or (c) the control system and encoding/multiplexing section of the device can be configured with a bipolar pill-slice type microprocessor. A microcomputer system capable of processing the J.F. J7fi was created.

しかし、(イ)の場合には、複i′11な制御が困1)
’M)であるという欠点があった。また、(ロ)の場合
にdl、高速な回線速度(48K B P S / s
ec )に適応できないと言う欠点があった。さらに、
(イ)、(ロ)お上ひe→の場合とも、ハードウェアが
複雑になり、コストが高くなったり、σし用件がなく、
機種71Jに大幅なハードウェアの設計変更をイj′う
必要がある′;りの欠点があった。
However, in the case of (a), complex control is difficult1)
'M). In addition, in the case of (b), DL, high line speed (48K BPS/s
The disadvantage was that it could not be adapted to ec). moreover,
In both cases of (a) and (b), the hardware becomes complicated, the cost increases, and there is no need for σ.
Model 71J had the drawback of requiring major hardware design changes.

発明の目的 本発明は、前記従来の欠点を解消するへくなされたもの
で、複雑な制御をソフトウェアのみにょって容易に実現
でき、高速な回線速度にも適応でき、ハード回路を小規
模とすることができ、かつスキャナーやプロッタのh式
の相違、速度および画幅の和iへ10等にもソフトウェ
アのみによって対応でき、θし用件があり、複数機種に
対しバードウテアを共通化し、機種毎に制御系のハード
ウェアを大幅に設計変更する必要をなくすことができる
ファクシミリ装置を提供することを目的とする。
OBJECTS OF THE INVENTION The present invention has been devised to solve the above-mentioned conventional drawbacks, and is capable of easily implementing complex control using only software, adapting to high line speeds, and reducing the size of the hardware circuit. In addition, it is possible to deal with differences in scanners and plotters' h formulas, speeds, and image widths such as 10, etc., using only software, and there are requirements for θ. An object of the present invention is to provide a facsimile machine that can eliminate the need for major design changes to control system hardware.

発明の構成 本発明のファクシミリ装置は、中火処理装置、ROMお
よびRAMを有してなるマイクロコンピュータ・システ
ムと、原稿を読取走査するスキャナと、記録を行うブロ
ックと、ラインメモリと、モデムと、それぞれ大規模集
積回路からなり、前記マイクロコンピュータ帝システム
のアドレス空間内にある入出力機器として同コンピュー
タ・システムの共通バスに接続されたシステム・インタ
フェーヌーアダプタ、メモリeインタフェース中アダプ
タ、帯域圧縮・伸長アダプタおよび通信インタフェース
・アダプタとを有してなり、前記システム・インタフェ
ース・アダプタは、前記スキャナおよびr+iJ ;¥
己メモリ・イノタフエース・7′タフ′夕からそれぞれ
告、用シリアル人カポ−1をJ出して画情報(本明細書
においては、イ゛1号化されない画情報を指すものとす
る)をシリアルに人力’i ii’+’、、lj!I 
RI2ブロックおよび前記メモリ・インクツゴース・ア
ダプタへそれぞれ虎用シリアル出勾ボートを通して画情
報をシリアルに出力用能、かつ前記画情報の入出力間に
、画幅変換、1111“1“1171線%反変換、1ラ
イン読取時間変換、1ライン記g:A ll、1i間変
換および画像縮小処理を失行呵能であり、前記メモリ・
インタフェース・アタブタハ、Iil 記ンステム・イ
ンタフェース・アダプタに21 L 1.’l用シリア
ル人出力ボートを通して画情報をシリアルに人出ノ月り
能、前記ラインメモリをパラレルに直拐アクセス可能、
前記共通バスに対し画情報をパラレルに入出力可能、か
つ人力した画情報に文字情報を挿入可能であり、前記帯
域圧縮・伸長アクブタは、1)1(記メモリ・インタフ
ェース・アダツブりに列し+、llシリアル入出力ボー
トを通して画情報をシリアルに入出力iiJ能、かつ前
記共通バスに符号化情報をパラレルに入出力可能である
とともに、111丁記画情報および符号化情報の人出方
間に、−次元符号化、二次元符号化、−次元復号化およ
び二次元復号化、処理を行うようになっており、前記通
信インタフェース・アダプタは、前記モデムに苅し専用
シリアル入出力ボートを通してデータをシリアルに人出
力1げ能、かつ前記共通ハスに対しデータをパラレルに
入出ノ月1丁能であり、前記データの人出方間に、ファ
クシミリ伝送手順におけるところの、・要求される装置
の識別と選択のだめのメツセージ前手順、メソセージ伝
送、並びにメツセージの終了と確認および複葉1・゛ギ
メント手順を含むメツセージ後手順に関するデータ処理
を行うようになっており、さらに前記各アダプタには、
前記共通バスに接続され、1〕II記各アダプタの動作
を制御するコマンド情報を前記共jmバヌを通して前記
中央処理装置により設定されるコマンド・レジスタと、
前記共通バスに接続され、前記各アダプタの内部ステー
タス情[[M−1−るステータス・レジスタとが設けら
れているものであり、+)il前記イク17コンピユー
タ・システムの中央処理装置1′1は、1iil記各ア
ダプタに設ケられたコマンド・レジスタに、各アダプタ
の動作モート゛および動作開始・終了を指・J′。
Structure of the Invention The facsimile apparatus of the present invention includes a microcomputer system having a medium-heat processing device, a ROM, and a RAM, a scanner for reading and scanning a document, a block for recording, a line memory, a modem, A system interface adapter, a memory e-interface adapter, and a band compression/expansion adapter each consisting of a large-scale integrated circuit and connected to the common bus of the computer system as input/output devices within the address space of the microcomputer system. adapter and a communication interface adapter, and the system interface adapter includes the scanner and r+iJ;
From self-memory, InnotaFace, and 7'Tough' evening, take out the Serial Capo-1 and serialize the image information (in this specification, it refers to the image information that is not coded as I). Human power 'i ii'+',, lj! I
Capable of serially outputting image information to the RI2 block and the memory ink storage adapter through the tiger serial exit boat, and between inputting and outputting the image information, image width conversion, 1111 "1" 1171 line % inverse conversion, 1 line reading time conversion, 1 line notation g:All, 1i conversion, and image reduction processing are apraxic, and the memory
Interface Attachment, Iil System Interface Adapter 21 L 1. The image information can be serially accessed through the serial output board, and the line memory can be directly accessed in parallel.
It is possible to input and output image information to and from the common bus in parallel, and it is also possible to insert character information into manually generated image information. It is possible to input and output image information serially through the serial input/output port, and to input and output encoded information in parallel to the common bus, and also to input and output encoded information in parallel to the common bus. The communication interface adapter performs -dimensional encoding, two-dimensional encoding, -dimensional decoding, and two-dimensional decoding processing, and the communication interface adapter transmits data to the modem through a dedicated serial input/output port. It is possible to input and output data serially, and to input and output data to and from the common hub in parallel. each adapter is adapted to process data relating to pre-message procedures for identification and selection, message transmission, and post-message procedures including message termination and confirmation and biplane one-giment procedures;
a command register connected to the common bus and set by the central processing unit through the common bus for command information for controlling the operation of each adapter in 1) II.
The central processing unit 1'1 of the computer system is connected to the common bus and is provided with a status register containing internal status information of each adapter. 1) specifies the operating mode and start/end of each adapter in the command register provided in each adapter.

するコマンド情報をりえるのみて、ソアクンミリ画情報
を直接処理することなく、スキャナ、ゾ゛IJツタおよ
びモデムとのデータインターフェースをに−fうことか
でき、まだ、1’+il記共1山バス−1,に、画情報
および杓り′化情報の両刃を容易に人出力できるもので
ある。
It is possible to create a data interface with a scanner, an IJ ivy, and a modem without directly processing the image information by simply returning the command information to be used, and still using only one bus. -1, it is possible to easily output both the image information and the processed information.

実施例の説明 1は汎用マイクロブロセノザからなる中火処理装置(以
]−1CPUと略記する)、2は)(OM、3はRAM
、4は[)II記CPU1、ROM2およ0・RAM3
等からなるマイクロコンビュークーンステl、の共通バ
スである。
Description of Examples 1 is a medium heat processing device (hereinafter abbreviated as 1CPU) consisting of a general-purpose microbrosenoza, 2 is an OM, and 3 is a RAM.
, 4 is [) II CPU1, ROM2 and 0/RAM3
It is a common bus for the Microcombus Kuhnste l, which consists of

5は記録をイ1うプロッタ、6は読取走査を行うスキャ
ナ、アは最大64にビットのラインメモリ、8はモデム
、9は水晶発振器、16は共通ハス4に接続されたダイ
レクト・メモリ・アクセス・コントローラである(息子
、DMACと略記する)。
5 is a plotter for recording, 6 is a scanner for reading and scanning, 8 is a modem, 9 is a crystal oscillator, 16 is a direct memory access connected to common bus 4・It is a controller (abbreviated as son, DMAC).

10はシステム・インタフェース・アダプタ(以1・S
IAと略記する)、11はメモリ・インタフェース・ア
ダプタ(以下、MIAと略記する)12は帯域圧縮・伸
長アクブタ(以下、BCF、Aと略記する)、13は通
信インクフェース・アダプタ(以下、CIAJ略記する
)であり、これらの4つのアダプタ10〜13は、それ
ぞれ大規模集積回路(1以−1−1LSIと略記する)
がらなり、前if己マイクロコンヒ0.−ターシヌテム
のアトルヌ空間内にあるl10(!−して、共通バス4
に接続されている。
10 is a system interface adapter (hereinafter referred to as 1.S)
11 is a memory interface adapter (hereinafter abbreviated as MIA), 12 is a bandwidth compression/expansion adapter (hereinafter abbreviated as BCF, A), and 13 is a communication interface adapter (hereinafter abbreviated as CIAJ). These four adapters 10 to 13 are each a large-scale integrated circuit (abbreviated as 1-1-1LSI).
Garanari, if the previous microconhi 0. - l10 (!- and the common bus 4
It is connected to the.

+fir記5IA10は、画情報制御部101、タイマ
102およびクロック発生部103等を弔−〇崖導体基
板に一体的に集積形成してなるものであシ、前記画情報
制御部101、タイマ102およびクロック発生部10
3には、共通バス4に接続されるコマンド・レジスタお
よびステータス・レジスタ(図示せず)が設けられてい
る。
The IA 10 is formed by integrally forming an image information control section 101, a timer 102, a clock generation section 103, etc. on a conductor substrate. Clock generator 10
3 is provided with a command register and a status register (not shown) connected to the common bus 4.

そして、この5IA10は、スキャナ6および前記MI
A11からそれぞれi、l、1用シリアル人勾丁−1・
を通して画情報をシリアルに人ノ月す能、+1il記ブ
ロック5および1)七1己MIA11へそれぞれjl、
す11シリアル人カポー1−をjn して画情報をシリ
アルに出力iiJ能、かつ前記画情報の人出方間に、画
幅変換、副走査密度変換、1ライン1:・超IV、II
、’i問お」、び記録時間変換、並0・に画像縮小等の
処理を実(+’するほか5.iL!録ザンソ°りンク・
り1Jツクの速11コの設定等を行うようになっている
This 5IA10 is connected to the scanner 6 and the MI
Serial holder for i, l, 1 from A11-1.
Serially send picture information to Hitotsuki Noh, +1ilki block 5 and 1) 71st self MIA11 jl, respectively.
11 Serial person capo 1-jn and output image information serially iiJ function, and the output of the image information includes image width conversion, sub-scanning density conversion, 1 line 1: ・Super IV, II
, 'I Questions', Recording Time Conversion, Image Reduction, etc.
It is designed to set 11 speeds for 1J and 1J.

まだ、この5IA10の動作の開始・終rおよび動作モ
ードは、CPU1により共通ハス4を通して前記コマン
ド・レジスタに設定されるコマンド情報によって制御さ
れるようになっている。
Still, the start and end of the operation of the 5IA 10 and the operation mode are controlled by the command information set in the command register by the CPU 1 through the common lotus 4.

前記MIA11は、ライ/メモリ制1j11部111、
MIA共通バス制御部112およびギヤ′ノクク制御部
113等を中−の半+4体基板に一体的に(I偵形成し
てなるものであり、1)II記M I A J’X1l
nハス制御部112およびキャラクタ制御部113には
、共通バス4に接続されるコマンI・・レジメタおよび
ステータス・レジスタ(図示せず)が設けられている。
The MIA 11 includes a lie/memory system 1j11 section 111,
The MIA common bus control section 112, gear control section 113, etc. are integrally formed on a medium-sized semi-circular board, and 1) II.
The n lotus control section 112 and the character control section 113 are provided with a command I register and a status register (not shown) connected to the common bus 4.

そして、このMIAl 1は、5IA10に対l−専専
用シリアル大人出力ボートを通して画情報をシリアルニ
人出力可能、ラインメモリ7を4ビットパラレルに直接
アクセス可能、かつ共通ハス4に対し画情報を8ビソト
パランルに入出力ロ■能であり前記人出力の速度変換を
行うことができるほか、人力しだ画情報に、キャラクタ
制御部113から出力される文字情報を挿入可能となっ
ている。
The MIAl 1 can output image information serially to the 5IA10 through a dedicated serial adult output port, can directly access the line memory 7 in 4-bit parallel, and can output image information to the common lotus 4 in 8-bit parallel format. In addition to being capable of input/output functions and converting the speed of the human output, it is also possible to insert character information output from the character control section 113 into the human input drawing information.

寸だ、このMIAl 1の動作の開始・終了および動作
モートは、CPU1によりJI、通ハス4を通してこの
MIAllの前記コマンド・レジスタに設定されるコマ
ンド情報に是づいて制御される。
In fact, the start and end of the operation of this MIAll 1 and the operation mode are controlled by the CPU 1 through the JI and communication hub 4 based on command information set in the command register of this MIAll 1.

1iJii3B G E A 12は、符号化・復号化
部121およびBCEA共通バス制御部122等を単一
の゛1′導体阜、板に一体的に集積形成してなり、前記
共通バス制御部122には、共通バス4に接続されるコ
マンド′・レジスタおよびステータス・レジスタ(図示
せず)が設けられている。
1iJii3B GEA 12 is formed by integrally forming an encoding/decoding section 121, a BCEA common bus control section 122, etc. on a single conductor board, and the common bus control section 122 is provided with a command' register and a status register (not shown) connected to the common bus 4.

そして、とのBCEAl2は、MIAl 1に対しりy
用シリアル人出カポ−1−を通して画情+13をシリア
ルに双方向に入出力1す能、かつ」1.1山ハメ4に符
ツ・化情報を8ビツトパラレルにメ’I )j 11’
tl Uこ入出力il目止であるとともに、1)II記
自画情報よび?’lシ’化情報の人出方間に、符υ化・
1171合化部121により、CG’ I T T勧告
T、4による一次几rlシじ化、−1次元符号化、−次
元復号化および二4次几復シ3化処理を行うようになっ
ている。
And BCEAl2 with is y for MIAl1
It is possible to serially input and output image information +13 in both directions through the serial output capo 1-1, and to input and output mark information to 1.1 mount 4 in 8-bit parallel.
tl U This is an input/output il index, and 1) II self-portrait information? In terms of how information is converted into 'l',
The 1171 combining unit 121 performs linear simplification, −1-dimensional encoding, −-dimensional decoding, and 24-dimensional decoding according to CG' I T T Recommendation T, 4. There is.

”lk、コ(7) B CE A 12 (7)動f’
l’7)開始”終ri;−よひ動作モー1−は、CPU
1により11通ノ・ス4を通してこのBCEAl 2の
前記コマン1−′・レジスタに設定されるコマンド゛情
報によ−)て制d111さノ土る。
``lk, ko (7) B CE A 12 (7) dynamic f'
l'7) Start ``End ri;-Yohi operation mode 1- is CPU
The command d111 is controlled by the command (according to the information) set in the command 1-' register of this BCEAL 2 through the 11th communication No. 1 by No. 1.

n1Hac I A 13は、モテム制御部131およ
びCIAI通ハス制御部132 !!;からなり、[)
II記j1、通バス制御部132には、共通ノ・ス4に
それぞれ接続サレるコマンド・レジスタおよびステータ
ス・レジスタ(図示せず)が1没けられている。
The n1Hac IA 13 is the Motem control section 131 and the CIAI communication control section 132! ! ; Consists of [)
II.J1, the bus control unit 132 is provided with a command register and a status register (not shown) which are connected to the common node 4, respectively.

ソシテ、こ(7)CIA13rj、モテム8に7.1し
データを専用シリアル人出カポ−1−を通してシリアル
に入出力iiJ能、かつ共託バス4に対し7デークをパ
ラレルに人出力11■能であり、1iil記データの人
出方間に、GGITT勧<1;、 7 、30のファク
シミリ伝送手順のフゴイズB(安水される装置の識別と
選択のためのメツセージ前手順)、フェイスC(メツセ
ージ伝送)、フェイスD(メノセーンの終了と確認およ
び複葉1・−ギメント手順を含むメツセージ前手順)の
データ処理をイ1うようになっている。
(7) CIA13rj, 7.1 data to Motem 8, serial input/output function through dedicated serial output capo-1-, and human output 11■ function with 7 disks parallel to consignment bus 4. 1iii, and between the output of the data, the facsimile transmission procedure of GGITT Recommendation <1; (message transmission), face D (pre-message procedure including message termination and confirmation and biplane 1-giment procedure).

件だ、このClA13の動作モーl−′は、CPU1に
より共通ハス4を通してこのClA13の前記コマンド
・レジスタに書き込寸れるコマンド情報によって制御さ
れる。
The operating mode l-' of this ClA 13 is controlled by command information written by the CPU 1 into the command register of this ClA 13 through the common lot 4.

なお、A−には何れもデータの侶3線を示しており、A
はスキャナ6から画情報制御部101への信号線、Bは
画情報制御部101からブロック5への信号線、C(l
Sl:画情報制御部101からラインメモリ制御部11
1への信号線、Dはラインメモリ制御部111から画情
報制御部−01への信号線、Eはラインメモリ7とライ
ンメモリ制御部111との間の信号線、Fは共通バス4
とMIA共通ハス制σ111部112お」、ひAヤノク
タ制6印部113との間の(t!’ ;〕線、Gはライ
ンメ士り制r1111部111と符写化・複合化部12
1との間の(1、ジノ線、Hは共通ハス4とB CE 
A Jl、涌ハス制(14部122との間のイriυ線
、工は」1.:通ハス4とCI A It、通ハス制御
部132との間のイ1.シシ線、Kに1、」1.1山ハ
ス4と)lAMl 1との間の信υ線をボしている、。
In addition, A- shows the third line of data, and A-
is a signal line from the scanner 6 to the image information control unit 101, B is a signal line from the image information control unit 101 to the block 5, and C(l
Sl: From the image information control unit 101 to the line memory control unit 11
1, D is a signal line from line memory control unit 111 to image information control unit-01, E is a signal line between line memory 7 and line memory control unit 111, and F is common bus 4.
and the MIA common lotus system σ111 part 112 O', the (t!';) line between the HiA Yanokta system 6 mark part 113, G is the line meshiri system r111 part 111 and the encoding/compounding part 12
1 (1, Gino line, H is common lotus 4 and B CE
A Jl, Waku lotus system (14 part 122, Iriυ line, work is 1.: I1.Shishi line, K between Toru lotus 4 and CI A It, Toru lotus control part 132, 1.) ,' 1. The line between the mountain lotus 4 and ) lAMl 1 is crossed.

次に、ファクシミリ装置の」11、木切(′1である馬
1.11・、′:1コピーモード11j」、DiC稿送
イ1jモーr n、’;および原(Y:i°j受信受信
モー金時として、本実b(li例の動1′1を説明する
Next, the facsimile machine's ``11, Kikiri ('1 is the horse 1.11, ':1 copy mode 11j'', DiC draft sending mode 1j mode n,'; and original (Y:i°j reception As a reception mode, the operation 1'1 of the example B(li) will be explained.

Cl1it稿コピー・モー1・時J 捷す、CPU1により、5IA10およ(J’MIA1
1のコマンド・レジスタK j助作モート(7) 初1
!Jl設定が行われる。すなわち、5IA10のコマノ
ド゛・レジスタには、1ライン読+1y時間および記録
時間(0,125〜32 m5ec )、記録速1*:
 (2,1MH2〜16.4KH2)、−1:走査画幅
(32〜8192ピッl−)、縮小のイJ’ jjjl
lおよびコピー・モー1を指示するコマンド゛情報が1
1トき込−1ノしる。′!jだ、MIAl 2のコマン
ド・レジスタには、画情報の入力ボートおよび出カポ−
1・を5IA10に指定するコラン1−゛情報、並ひに
主走査画幅(32〜8192ピノ1−)および文字情報
に関する設定を指示するコマンド情報が書き込−1:れ
る。
Cl1it draft copy mode 1 time J cut, 5IA10 and (J'MIA1
1 command register K j assistant work mote (7) first 1
! Jl setting is performed. That is, in the command register of 5IA10, 1 line reading + 1y time and recording time (0,125 to 32 m5ec), recording speed 1*:
(2,1MH2 ~ 16.4KH2), -1: Scanning image width (32 ~ 8192 pi), reduction iJ' jjjjl
command that instructs l and copy mode 1, information is 1
1 entry - 1 entry. ′! The command register of MIAl 2 contains input ports and output ports for image information.
Column 1-' information for specifying 1. to 5IA10, as well as command information for instructing settings regarding the main scanning image width (32 to 8192 pino 1-) and character information are written.

ぞして、動作の開始、終了は、5IA10およびMIA
l 1のコマンド・レジスタに設けられたベージピッ1
−に、CPU1により、それぞわ+1111、○″ が
設定されることによりイーtわれる。
Therefore, the start and end of the operation are 5IA10 and MIA.
Page pin 1 provided in the l 1 command register
- is set by the CPU 1 to +1111 and ○'', respectively, so that it is eaten.

このコピー・モード時のデータの流れは次のようになる
The data flow in this copy mode is as follows.

スキャナ6からの自情報は、5IA10の画情報制御部
+部101にハシ1−′シエイクにより、シリアルに人
力され、この人力された画情報が前記初期設定に基づい
て、そのまま、または同制御部101において画幅変換
および画像縮小処理を行われた後、同制御部101から
MIAllのラインメモリ制御部111にハンドシェイ
クによりシリアルに出力される。
The own information from the scanner 6 is serially manually inputted to the image information control unit + unit 101 of the 5IA10 by a shake 1-', and this manually inputted image information is input as is or to the same control unit based on the initial settings. After image width conversion and image reduction processing are performed in step 101, the control section 101 serially outputs the image to the line memory control section 111 of MIAll by handshaking.

、前4、記ラインメモリ制御部111に人力された画情
報は、niI記初期設定により文字情報の挿入か指示さ
れていない場合には、文字情報との合成をイ1われるこ
となく、寸だ前記初1jil 、没′、eにより文字情
報の挿入が指jJ’Zされている場合には、回”ンイノ
メモリ制御部111においてキャ゛ノクク11.(11
1部113から出力される文字情報と合成されて、ライ
ンメモリ了に男き込外れる。このようにして゛ラインメ
モリ了に一時蓄えられた画情報は、次に、山ひ゛ンイン
メモリ制徊1部111に読み出され、5IA10の画情
報制御部101にハシ1−ンゴイクによりf1■度人力
され、同制御部101からフIノック5にハンドシェイ
クにより1llll力される。
If the image information manually entered into the line memory control unit 111 described in Section 4 above is not instructed to insert text information according to the initial settings described in niI, the image information inputted manually to the line memory control unit 111 will be combined with the text information without being prompted. If the insertion of character information is specified by the above-mentioned initialization 1jil, decrement', and e, the insertion memory control unit
It is combined with the character information output from the first part 113 and written into the line memory. The image information temporarily stored in the line memory in this way is then read out to the main in-memory control unit 111, and then manually inputted to the image information control unit 101 of the 5IA10 by hand. , the control unit 101 applies a power to the knock 5 by handshaking.

なお、前記各プlフック間のハシ1−シェイクは、それ
ぞれのブロックを’i!:i視することにより(iわh
る。
In addition, the Hashi 1-shake between each of the above-mentioned hooks changes each block to 'i! :By looking at it (iwah
Ru.

以」−の結果、このコピー・モード11.lJのデータ
の流れは、 A −+ C→E→E→D→B となる。
As a result of this copy mode 11. The data flow of lJ is A −+ C→E→E→D→B.

こ、こにおいて、画情報がラインメモリ7に−,−1,
j蓄えられることから、スキャナ6とプロッタ6の速度
が異っていても、コピー動作が支障なく行われる。
Here, the image information is stored in the line memory 7 as -, -1,
Since the data is stored, even if the speeds of the scanner 6 and the plotter 6 are different, the copying operation can be performed without any problem.

丑だ、スキャナ6から5IA10への画情報の人力に際
しては、原稿の副走査送りを行うだめのパルスが5IA
10からスキャナ6に出力される。
Unfortunately, when manually transmitting image information from scanner 6 to 5IA10, the pulse for sub-scanning the document is 5IA.
10 and output to the scanner 6.

寸だ、同様にして、5IA1oからブ゛ロノタ5への画
情報の出力に際しては、記録紙の副)1ミ査送りをイI
うだめのパルスが、5IA10からプロッタ5へ出力さ
れる。そして、タイマ102は、1)11記各場合のパ
ルス数を、副走査送りの制御等のために旧敵する。なお
、クロック発生部103は、水晶発IMg g+ 9の
出力に基づいて、r)il 記パルス痔の出力に必要な
りロックを発生するものである。
In the same way, when outputting image information from the 5IA1o to the Bronota 5, turn on the 1-mm feed of the recording paper.
Udame pulses are output from 5IA10 to plotter 5. Then, the timer 102 sets the number of pulses in each case of 1) 11 for controlling sub-scanning feed and the like. Note that the clock generating section 103 generates a lock based on the output of the crystal IMg g+ 9 when necessary for the output of the pulse hemorrhoid.

〔原稿送信モード時および原稿受信モート′時〕原稿の
送信および受信は、GCITT勧告T。
[When in original sending mode and original receiving mode] Transmission and reception of originals are in accordance with GCITT Recommendation T.

3の文忠伝送用クループ2(以下、G2と略記する)に
標i’f、6.化されている符号化を伴わない画情報伝
送と、CCITT勧告T、4の文書伝送用クループ3(
以−ト、G3と略記する)に標準化されている符号化情
報伝送とのいずれかが選択されて、次のように行われる
Marking i'f, 6. image information transmission without encoding, and document transmission group 3 of CCITT Recommendation T, 4 (
One of the standardized encoded information transmissions (hereinafter abbreviated as G3) is selected and carried out as follows.

(イ)G2送送信 寸ず、CPU1により、」いIDハス4を通しで5IA
10、M I A 11およびClA13のコマンド”
・レジヌクに初期設定が(jわれる。
(a) G2 transmission without transmission, CPU 1 sends 5IA through ID number 4.
10, MIA 11 and ClA 13 commands”
・Initial settings are changed to Resinuku.

すなわち、5IA10のコマンド・レジスタには、1ラ
イン読取時間、−1−走査1+l+i幅、−1,走−を
両端カッI−のイJ無、画像線1小のイ1’ :Qll
l、および送(1,モート゛を指示するコラン1−情報
か設定され、MIAllのコマンド・レジスタには、画
情報の人力;に−1・をS工A10に、画情報の出カポ
−1−を」1、通バス4にそれぞれ指定するコマンド情
報1.+1< U’にi(]12査画幅および文字情報
に関する設定をイー1゛うコマンド情報がどき込1れる
。さらに、ClA13のコマンド・レジスタには、G2
送伯モー1−を指示するコマンド情報が書き込まれる。
That is, the command register of 5IA10 contains 1 line reading time, -1 - scan 1 + l + i width, -1, scan - with both ends cut I-, A1' of image line 1: Qll
1, and send (1, mode 1) information is set, and the command register of MIAll is set to 1-1 for image information; 1, and command information 1.+1<U' that specifies the settings for i(]12 scan width and character information, respectively. In the register, G2
Command information instructing the send mode 1- is written.

丑だ、動作の開始、終了は、前記コピー・モード時と同
様に、5IA10およびMIAllのコマンド・レジス
タに設けられているベーンヒノ1゛に、CPU1により
、それぞれ’1”、”O”が設定されることにより行わ
れる。
Unfortunately, to start and end the operation, as in the copy mode, the CPU 1 sets '1' and 'O' in the 5IA10 and MIAll command registers, respectively. This is done by

この02送信時には、データの流れは次のようになる。At the time of this 02 transmission, the data flow is as follows.

スキャナ6からの画情報は、前記コピ一時の場合と同様
の経緯をたどって、ラインメモリ7に書き込捷れ、同メ
モリ7に一時蓄えられた後、再ひラインメモリ制御部1
11に読み出され、bi I A共通バス制御部112
でシリアル/パラレル変換される。そして、同共通ハス
制御部112からバイト単位で共通バス4を通してCI
A共通/ペヌ制御部132に転送される。
The image information from the scanner 6 is written to the line memory 7 in the same way as in the case of copying, and after being temporarily stored in the same memory 7, it is written again to the line memory control unit 1.
11, and the bi I A common bus control unit 112
Serial/parallel conversion is performed. Then, from the same common bus control unit 112, the CI
It is transferred to the A common/penu control unit 132.

ここにおいて、各共通バス制御部112A、122およ
び132からのデータの転送および各共通バス制御部1
12 、122および132へのデータの転送において
は、CPU1を介して行うプロクラムモード転送と、C
PU1を介することなく、RAM3.Thの間で直接転
送を行うダイレクト・メモリ・アクセス(以下、DMA
と略記する)転送との両方が可能である(なお、DMA
転送の制御時においては、高速性が必要とされないので
、1述のMIA共通バスrlII蹄11部112からC
I A I、仙バヌ制御部132への画情報の転「久に
t、)iil記ゾ゛11クラl、モード転送呼/こはD
MA転送の何れによ−1でもよい(なお、1)11記D
MA転送の場合、画情報はF −+ K 、K −+ 
Iの経路を辿ることになる)、。
Here, data transfer from each common bus control unit 112A, 122 and 132 and each common bus control unit 1
12, 122, and 132, program mode transfer is performed via the CPU 1, and
RAM3. without going through PU1. Direct memory access (hereinafter referred to as DMA) that performs direct transfer between
(abbreviated as DMA) is possible.
When controlling transfer, since high speed is not required, the MIA common bus rlII hoof 11 section 112 to C
I A I, transfer of image information to the control unit 132 for a long time) iii.
-1 may be used for any MA transfer (note 1) 11 D
In the case of MA transfer, the image information is F −+ K, K −+
I will follow the route of I).

そして、CIA共通ハス制御部132へ転送された画情
報は、モデム制御部131により、シリアルにモデム8
に出力される。
Then, the image information transferred to the CIA common lotus control unit 132 is sent to the modem 8 serially by the modem control unit 131.
is output to.

すなわち、この場合のデータの流れは、A −+ C−
+ E→E→F→(K→に→)I→Jのようになる。
That is, the data flow in this case is A − + C −
+ E → E → F → (K → ni →) I → J.

(ロ)  G3送信時 丑ず、CPU1により、5IA10.MIAl 1 、
BCIi:AI 2およびClA13のコマン1−′・
レジスタに初期設定が行われる。
(b) When transmitting G3, CPU1 automatically sends 5IA10. MIAl 1,
BCIi: AI 2 and ClA13 command 1-'.
Initial settings are made to the registers.

すなわち、S工A10のコマン1−′・レジスタには、
前記G2送信時と同一のコマンド情報情報が、11き込
まれる%、M I A 11のコマンド′・レジスタに
も画情報の出力ボートをBCEAl 2に指定する以外
は、前記G2送信時と同じコマンド情報が書き込まれる
。BCEA12のコマンド・レジスタには、−次元11
号化または二次元r1号化の選1ツクと、それに心安な
設定をイ1うコマンド情報情報が書き込寸しル。さらに
、ClA13のコマン1−゛・レジスタには、G3送伯
モードを指示するコマンド情報がノ)き込まれる。
In other words, in the command 1-' register of S engineer A10,
The same command information as at the time of G2 transmission is read in 11%, and the same command as at the time of G2 transmission is used, except that the command register of MIA 11 also specifies the image information output port to BCEA12. Information is written. The BCEA12 command register contains -dimension 11
There is a selection of encoding or two-dimensional R1 encoding, and command information that allows for safe settings. Furthermore, command information instructing the G3 transfer mode is written into the command 1-' register of the ClA 13.

寸だ、動作開始、終了は、5IA10.MIAllおよ
びBCEAl 2のコマンド−レジスタに設けられてい
るページビットに、CPU1により、パ1 ′′、°′
0”がそれぞれ設定されることにより行われる。
The start and end of operation is 5IA10. The page bits provided in the command registers of MIAll and BCEAl2 are set by the CPU 1 to
This is done by setting each value to 0''.

このG3送信時には、データの流れは次のようになる。During this G3 transmission, the data flow is as follows.

スキャナ6からの画情報は、1111記コピ一時秒よび
G2送信時と同一の経緯を経てラインメモリ7に書キ込
まれる。このラインメモリ7に一時蓄えられた画情報は
、再びラインメモリ制御部111に2み出され、BCE
Al 2の符号化・復号化部121に入力され、回部1
21てitシ;化されてイ“1号化情報に変換される。
The image information from the scanner 6 is written into the line memory 7 through the same process as in the 1111 copy one second and G2 transmission. The image information temporarily stored in the line memory 7 is read out again to the line memory control unit 111, and the BCE
It is input to the encoding/decoding unit 121 of Al 2, and
21 and converted into 1 code information.

前記符号化情報は、BCEA共通ハス制可1部122に
よりシリアル/パラレル変換され、D MA転送により
HA M 3を経111シてClA13へ転送され、さ
らに同ClA13からモテノ・8へ出力される。
The encoded information is serial/parallel converted by the BCEA common hash control unit 122, transferred to the ClA 13 via the HAM 3 by DMA transfer 111, and further outputted from the ClA 13 to the Moteno-8.

すなわち、この場合のデータの流れfl:j:、A −
+ C−+ E−+E→G→H→に→に→工→Jのよう
になる。
That is, the data flow fl:j:, A −
+ C-+ E-+E → G → H → ni → ni → engineering → J.

(/→ G2受イFi時 まず、CPU1により、S I A 10 、1/I 
I A11およびClA13のコマンド゛・レジメタに
初期設定が行われる。
(/→ When receiving G2, first, CPU1 sends SIA 10, 1/I
Initial settings are made to the command registers of IA11 and ClA13.

すなわち、5IA10のコマンI−・レジスタには、1
ライン記録時間、1°疋査11bi幅、111−杏1′
百1゜ガイ;1加(各ラインの両側に自信υを1.1加
する処理)の有無、記録ザンプリンタ・クロックの速度
および受信モードを指示するコマンド情報がfi!き込
まれ黴。’!?v、MIAllのコマン1−′・レジス
タには、出力ボートを5IA10に指定するコマンド情
報、並びに主走査画幅および文字情報に関する指示を行
うコマンド情報が見(き込捷れる。さらに、ClA13
のコマントルジヌタには、G2受信モードを指示するコ
マンド情報がすtき込まれる。
In other words, the command I register of 5IA10 contains 1
Line recording time, 1° width 11bi width, 111-1'
Command information that instructs the presence or absence of 1.1 addition (processing of adding 1.1 confidence υ to both sides of each line), the speed of the recording printer clock, and the reception mode is fi! Introduced mold. '! ? In the command 1-' register of v and MIAll, command information for specifying the output port as 5IA10, as well as command information for instructing the main scanning image width and character information, can be found (written in the command 1-' register. Furthermore, ClA13
Command information instructing the G2 reception mode is inserted into the command input field.

また、動作の開始、終了は、5IA10およびMIAl
 1のコマンド・レジスタのベージビットに、CPU1
により、1 ”または”Q”かそれぞれ設定されること
により行われる。
In addition, the start and end of the operation are controlled by 5IA10 and MIA1.
The page bit of the command register of CPU1 is set to
This is done by setting 1'' or ``Q'' respectively.

このG2受伯時に(4、データの流れは次のようになる
When receiving this G2 title (4), the data flow will be as follows.

モデム8からのデータは、ClA13のモデム制御部1
31にシリアル人力され、CIA共通バス制御部132
によりシリアル/パラレル変換すれ、同制御部132か
らプログラムモード転送まだはDMA転送により、MI
Al 1の共通バス制御部112にバイト単位で転送さ
れる。このようにしてMIA共通バス制御部112に転
送されてきたデータは、間部112によりパラレル/シ
リアル変換された」二、ラインメモリ制御部111によ
り、そのまま、まだはキャラクタ開側1部113から出
力される文字情報と合成されて、ラインメモリTにp引
き込まれる。
The data from the modem 8 is sent to the modem control unit 1 of the ClA 13.
31, and the CIA common bus control unit 132
The control unit 132 performs serial/parallel conversion, transfers the program mode, and transfers the MI by DMA transfer.
The data is transferred to the common bus control unit 112 of Al 1 in units of bytes. The data thus transferred to the MIA common bus control unit 112 is converted into parallel/serial data by the intermediate unit 112.2.The data is output from the character open side 1 part 113 as it is by the line memory control unit 111. It is combined with the character information displayed and drawn into the line memory T.

このラインメモリ7に一時蓄えられた画情報は、丙ひラ
インメモリ制御部111に読み出され、5IA10の画
情報制御部101にハン1”シゴイクによりシリアルに
入力され、さらに同画情報制御部101からブロック5
にハントシェイクに」二す出力される。
The image information temporarily stored in the line memory 7 is read out to the second line memory control unit 111, serially inputted to the image information control unit 101 of the 5IA10 by hand 1'', and further inputted to the image information control unit 101 of the 5IA10. from block 5
"Hunt Shake" is output.

すなわち、この場合のデータの流れは、J→工→F+E
→E→(K−+に→)D→Bとなる。
In other words, the data flow in this case is J → Engineering → F+E
→E → (to K-+ →) D → B.

に)  G3受イFr lL’1 捷ず、5IA10.MIAll 、BCEA12および
ClA13のコマンド・レジスタに初期設定が行われる
) G3 receiver Fr lL'1 not switched, 5IA10. The command registers of MIAll, BCEA12 and ClA13 are initialized.

すなわち、5IA10のコマン1−′・レジメタンζは
、G2受信時と同一のコマンド’lT’i報が21き込
まれ、MIAllのコマン1〜′・レジヌクにも、画情
報の人カポ−)iBcEA12にするほかは、G2受信
時と同一のコラン1−′情報が設定される。捷7’(、
BCEA12のコマンド・レジスタには、−次元復号化
捷だは二次元符号化の選択およびその選択に必安な設定
を指示するコマンド情報、ClA13のコマンド・レジ
スタK ii 、G3 受(7モート゛を指示するコラ
ン1−゛情報が書き込まれる。
That is, the same command 'lT'i information 21 as when receiving G2 is input to the command 1-'/regimetan ζ of 5IA10, and the command 1-'/regimetan ζ of MIAll is also input with the picture information person capo-)iBcEA12. Other than that, the same colan 1-' information as when receiving G2 is set. Sho 7'(,
The command register of BCEA12 contains command information that instructs the selection of -dimensional decoding or two-dimensional encoding and the settings required for that selection, and the command register K ii of ClA13, G3 receiver (instructs 7 mode). Coran 1-' information is written.

また、動作の開始2終了は、5IA10.MIAllお
j:びBcEA12のコマンド・レジスタのベージビッ
トに、CPU1により、1”′まだは”o”がそれぞれ
設定されることにより行われる。
Also, the start and end of the operation are 5IA10. This is done by setting the page bits of the command registers of MIAll and BcEA12 to 1" and "o", respectively, by the CPU 1.

このG3受(?i11.’+のデータの流れは次のよう
になる。
The data flow of this G3 receiver (?i11.'+ is as follows.

モデム8からの符号化情報は、ClA13のモデム制■
1部131にシリアルに人力され、続いてCIA共通バ
ス制御部132によりシリアル/パラレル変換され、さ
らにプロクラムモード転送またはDMA転送によりBC
KA12の共通バス制御部122にバイト単位で転送さ
れる。
The encoded information from modem 8 is the modem system of ClA13.
It is serially input to the first part 131, then serial/parallel converted by the CIA common bus control part 132, and then converted to BC by program mode transfer or DMA transfer.
The data is transferred to the common bus control unit 122 of the KA 12 in units of bytes.

1)11記BCEAノ1戦バス制御部122に転送され
た符号化情報は、r1号化・復υ化部121により、復
号化され、さらにこの復号化された画情報r[、MIA
l 1のラインメモリ制御部111にシリアルに出力さ
れる。こうしてラインメモリ制犯1部111に人力され
た1Illl ’l’+’1報は、・区、リンな場合に
Qよギヤラフ制御部113から出力される文字情報と合
成され、また必要ない場合にはl’+il記文字情報と
の合成を行われることなく、同ラインメモリ制御部11
1から前記G2受伯時と同一の経1.jpをたど−)で
プロッタ6に出力される。
1) The encoded information transferred to the 11th BCEA No. 1 bus control unit 122 is decoded by the r1 encoding/decoding unit 121, and the decoded image information r[, MIA
It is serially output to the line memory control unit 111 of l1. In this way, the 1Illll 'l'+'1 report manually inputted to the line memory crime prevention section 111 is combined with the character information output from the gear rough control section 113 when ・ku, rin, and when unnecessary. is not synthesized with the character information written in l'+il, and the same line memory control unit 11
1 to the same time as when receiving the G2 Baku 1. jp -) is output to the plotter 6.

すなわち、この場合のデータの流れは J→工→(K→に→) H−> G −> ’E→E→
D −> Bとなる。
In other words, the data flow in this case is J → Engineering → (K → Ni →) H −> G −>'E → E →
D -> B.

なお、+iiJ記コピ一時、送fii時、受イ+:il
+、’、において5IA10、MIAl 1、BCE図
12およびClA13の内部ヌデータヌは、各アダプタ
10〜13に設ケられている+′Iij記ステータス・
レジスタにそれぞれ保持される。そして、CPU’1は
それらのヌデータヌ・レジヌクを監視しながう、各アダ
プタ10〜13の開脚を(−jう。
In addition, when copying +iiJ, when sending fii, receiving +:il
5IA10, MIAl 1, BCE Figure 12 and ClA13's internal data in +, ', +'Iij status status installed in each adapter 10 to 13.
Each is held in a register. Then, the CPU'1 monitors the open legs of each adapter 10 to 13 (-j).

第2図は、本発明のファクシミリ装Mを符す変換機とし
て用いた実施例のブ「1ツク図を示す。
FIG. 2 shows a block diagram of an embodiment in which the facsimile device M of the present invention is used as a converter.

蓄積交換機雪の、ある符号化方式の端本からのデータを
人力し、このデータを−l、メモリに蓄積してから、異
なる符号化方式の端末へ出力する場合には、rj号変換
を行う必要がある。この第2図の¥施例は、−次元符号
化方式で人力したデータをニニ次元イで1弓化力式に変
換して出力する場合の例である。
If you want to manually input data from a fragment of a certain encoding method using a storage-and-exchange machine, store this data in memory, and then output it to a terminal with a different encoding method, perform rj conversion. There is a need. The embodiment shown in FIG. 2 is an example in which data manually generated using a -dimensional encoding method is converted into a one-dimensional power equation in two dimensions and output.

同図において(I ) 、 (II )は、それそわa
iiL−4第1図における5IA10.MIAll、B
CEAl 2 、ClA13およびラインメモリ7から
なるゾロツクと同一構成のブロックである。
In the same figure, (I) and (II) are
ii 5IA10. in L-4 Figure 1. MIAll, B
This block has the same configuration as Zoroku, consisting of CEAl 2 , ClA 13, and line memory 7.

そして、これらのブロック(、J ) 、 (口)の5
IA10.MIAll 、BCEAl2およびClA1
3は、汎用マイクロプロセッサからなるCPU1 、R
OM2およびRAM3等により構成されるマイクロコン
ピュータ・システムのアドレス空間内にあるIloとし
て、前記マイクロコンピュータ・システムの共通バヌ4
に接続されている。
And 5 of these blocks (,J), (mouth)
IA10. MIAll, BCEAl2 and ClA1
3 is a general-purpose microprocessor CPU1, R
The common vane 4 of the microcomputer system is Ilo in the address space of the microcomputer system composed of OM2, RAM3, etc.
It is connected to the.

8aはモデムであり、ブIlツク(])におけるClA
13に、前記第1図におけるモテノ、8の]J7)合と
同様に接続されている。6 fr、l、スN−ヤナてあ
り、ブロック(十)におけるS:[Aloに、前記;)
1,1図の場合と同様に接続されている。6は/”IJ
、、夕、8bはモデムであり、それぞれゾl−t ツク
(11)おける5IA10.ClA13にl′I′lI
記第1図の記音1図様に接続されている。
8a is a modem, and ClA in the block (])
13 is connected in the same way as the connection 8]J7) in FIG. 6 fr, l, S N-yana, S in block (10): [Alo, said;)
1. They are connected in the same way as in Figure 1. 6 is /”IJ
, , and 8b are modems, respectively, and 5IA10. l'I'lI to ClA13
It is connected to Figure 1 of Figure 1.

14はフロッピ・ディスク制御装置(榎1・、FDOど
略記する)、15はlJシ月1バス・インターソゴース
(息子、GPIBと略記する)であり、この両者はそれ
ぞれJl、通ハス4に18K・、“lされている1゜々
お、以−1・、ブロックl)に属する回路および信号線
のrjチには(1)を、ブロック(11)に属する回路
およびイt1−′Ij線の?r+’ ;jには(11)
をそれぞれイ:Iすものとする。
14 is a floppy disk controller (abbreviated as Enoki 1, FDO, etc.), 15 is a lJ Shigetsu 1 bus intersogos (Son, abbreviated as GPIB); 18K., "1" is applied to the circuits and signal lines belonging to block l), and (1) is applied to the circuits and signal lines belonging to block (11). ?r+' of the line; for j (11)
Assume that A and I are respectively A and I.

本実施例においては、初期設定どして、ブロック(])
を03受1ハかつ一次元復シノモーl−に、まだブロッ
ク(JI )をG3送イ1jかつ1次几ri ’Iノ化
モードに設定する。ただし、5IA10(ff)の画情
報のシリアル出力ポートは、5IA10(]■)に指定
するものとする。ここで、Lは5IA10(]、 )か
らS工A1o(I)への侶υ°線を示す。
In this example, initial settings are used to block (])
The block (JI) is set to 03 receiver 1c and one-dimensional reciprocal mode l-, and the block (JI) is set to G3 sender i1j and first-order reciprocal mode. However, the serial output port of the image information of 5IA10(ff) is designated as 5IA10(]■). Here, L indicates the line υ° from 5IA10(], ) to S engineering A1o(I).

本実施例におけるデータの流れは、次のようになる。The data flow in this embodiment is as follows.

モデム8aからの一次元杓号化情報は、ClA13(1
)および共通ハヌ4を経てRAM3に一旦蓄積される。
The one-dimensional encoded information from the modem 8a is ClA13 (1
) and is temporarily stored in the RAM 3 via the common Hanu 4.

次に、前記−次元r1号化情報は、RAM3から1;シ
゛dみ出され、BCEAl2(]−)に転送され、この
BCIi:AI 2 (王)により復す化される。この
復−号化によって得られた画情報は、MIAll(T)
、RAM7(I)および5IA1o (]、’ )を経
て、5IA10(]])に人力される。
Next, the -dimensional r1 encoded information is extracted from the RAM3, transferred to BCEAl2(]-), and decoded by this BCIi:AI2(King). The image information obtained by this decoding is MIAll(T)
, RAM7(I) and 5IA1o(],'), and is inputted to 5IA10(]]).

そして、前記画情報は、次に、MIAll(1)および
RA M 7 (lll−)を経てBCEAl2(II
)に人力され、ここで二次元符号化された後、共通バヌ
4を経て一旦RA”M 3に蓄積され、しかる後にCI
 A 13 (II )に入力され、このClA13(
II)か(、失デム8bに出力される。
The image information then passes through MIAll(1) and RAM 7(llll-) to BCEAl2(II).
), and after being two-dimensionally encoded here, it is stored in RA"M 3 via common vanu 4, and then CI
A 13 (II), and this ClA13 (
II) or (, is output to the lost dem 8b.

なお、」−述のデータ転送において、1:’+l速11
V、送を要する場合には、DMAC16を11、曲ハス
4ンζ1゛へ続することにより、D M A転送り(=
よるラーーーータ転14を行うことができる。
In addition, in the data transfer mentioned above, 1:'+l speed 11
If V, transfer is required, DMAC16 is connected to 11, music 4, ζ1゛, DMA transfer (=
It is possible to perform a rotation 14 according to the following.

寸だ、共iMパス4に出力されだデ タを、Fl)01
4によりフロッピティクスに蓄t11iL;/こり、G
PIB16により外部GPIBを通して他のシステムに
蓄積してもよい。
The data output to iM path 4, Fl) 01
4 stores t11iL;/stiffness in floppics, G
The PIB 16 may also store data in other systems through an external GPIB.

本実施例によるおけるデータの/%j f’1才F、J
(1)II (II )→K(寸だはM、N)→K(捷
たはM、N)→H(1)−→G(’l)→E(1)→F
、 (I )→D(1)→L−+G (If )→1!
; (II )→J≦(1,)→C(ffl)→H(,
11)→KiたはM。
/%j f'1 years old F, J of the data according to this example
(1) II (II) → K (Size is M, N) → K (Switch is M, N) → H (1) - → G ('l) → E (1) → F
, (I)→D(1)→L−+G(If)→1!
; (II)→J≦(1,)→C(ffl)→H(,
11) →Ki or M.

N)→K(またはλ(、N)II (11)IJ (I
I )のようになる。
N)→K(or λ(,N)II (11)IJ (I
I).

発明の効果 以上のように本発明は、マイクロコンビヨーク・システ
ムの共仙バヌに、それぞれLSIからなる4つのアダプ
タ、SIA、MIA、BCEAおよびGIAを接続し、
前記マイクロコンビューク・システムのCPUは、前記
各アクブタに設けられたコマ71−・レジスタに、各ア
クブタの動作モー1−′および動作開始、終了を指示す
るコマンド情報をりえるのみで、ファクシミリ画情報を
直接処理することなく、スキャナ、ゾ11ツクおよびモ
チJ、とのデータインターフゴースをイ1うことかでき
、また、1)jj記」1、曲ハス上に、画情報および符
す化情報の両方を容易に人出力できる/こめ、(イ)復
層1な制御をラフ1−トエアのみによって容ルhに実現
できる。。
Effects of the Invention As described above, the present invention connects four adapters, SIA, MIA, BCEA, and GIA, each consisting of an LSI, to the co-sensor vanu of a microcombi yoke system.
The CPU of the microcombuque system only sends command information instructing the operation mode 1-' and the start and end of each actuator to the frame 71- register provided in each actuator, and then sends a facsimile. It is possible to perform data interface with the scanner, Zo11tsuku, and Mochi J without directly processing the image information. (1) Retrospective control can be realized in a simple manner using only rough information. .

(IJ)l′、′、′I速な回線速1庚(例えば、最大
56KBPS / sec )にも適応できる。
(IJ)l',','It is also applicable to line speeds of 1 (for example, up to 56 KBPS/sec).

(ハ)ハート゛回路を小規模とすることができる。(c) The heart circuit can be made smaller.

哄) スキャナの方式の相違や、プロッタの速度おJ−
ひ画幅の和1v1等にも、ソフトウェアのみによって対
応11f能であるので、lJt用性があり、複数の機種
に対し制御系のハードウェアを共通化することができ、
機種hJ’に制御系のハルドウエアを大幅に設rl変更
する必要がなくなる。
哄) Differences in scanner methods, plotter speeds, etc.
Since it is capable of handling 1v1, etc., the sum of the stroke widths, it is compatible with 11f only by software, so it is compatible with lJt, and the control system hardware can be shared among multiple models.
There is no need to significantly change the control system hardware for model hJ'.

(1=)  パーツリールコンピュータ、ワードプロセ
ノザ等の装置と接続し、これらの装置から出力される文
字情報と画像を容易に合成できる。
(1=) By connecting to devices such as parts reel computers and word processors, it is possible to easily synthesize character information and images output from these devices.

(へ)1)1■記各アタプ゛りを複数個用いることによ
り、他機種との同時交信、データ交換、G 2 /c 
332換、および符号変換等を容易に(Iうことがてき
4る7、等の優れた効果をtl)もれるものである。
(f) 1) By using multiple of each of the adapters described in 1), simultaneous communication with other models, data exchange, G2/c
This makes it possible to easily perform H.332 conversion, code conversion, etc. (excellent effects such as I can do 4, 7, etc.).

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例VCよるファクシミIJ装置
の11112図、第2図d1本発明の曲の実/l(1例
のファクシミリ装置のブrJ ツク図である。 1・・・CPU、2・・・・・・ROM、3 ・・・R
AM、4・・・・・・共通バス、5・・・・・・プロッ
タ、6・・・・・スキャナ、7・・・・・ラインメモリ
、a、sa、ab・・・・・・モデム、10・・・・・
SIA、11  ・・・・MIA、12・・・・BCE
A、13・・・・CIA。
Fig. 1 is a 11112 diagram of a facsimile IJ device according to an embodiment of the present invention, and Fig. 2 is a diagram of a facsimile IJ device according to an embodiment of the present invention. , 2...ROM, 3...R
AM, 4...Common bus, 5...Plotter, 6...Scanner, 7...Line memory, a, sa, ab...Modem , 10...
SIA, 11...MIA, 12...BCE
A, 13...CIA.

Claims (1)

【特許請求の範囲】[Claims] 中火熱j211装置1イ、ROMおよびRAMを有して
なるマイクロコンピュータ・システムと、原稿全読取走
査するヌギャナと、記録を行うプロッタと、ラインメモ
リと、モデムと、それぞれ大規模集積回路からなり、+
)iJ記マイクロコンピュータ・システムのアドレス空
間内にある入出力間agとして同コンピュータ・システ
ムの共通バスに接続サレfcシヌテムeインタフェース
・アクブタ、メモリ・インタフェース・アダプタ、帯域
部線・伸1%アクブタおよび通信インタフェース・アダ
プタとを有してなす、14jl’if己シヌテム・イン
タフェース・アダ” 夕ハ、+iiJ 記スギャナおよ
び前記メモリ・インタフェース・アクブタからそれぞれ
専用シリアル入カポ−I・を通して画情報をシリアルに
入力可能、前記プoソタオよヒf?iJ WEメモリ・
インタフェース・アダプタへそれぞれ専用シリアル出カ
ポ−1−を通して画情報をシリアルに出力1り能、かつ
前記画情報の入出力間に、1;I+i幅変換、副疋N’
E線14.曵変換、1ライン読取時間変換、1ライン記
もAll、11間変換および画像縮小処理を実イー1゛
11■能であり、前記メモリ・インタフェース・アタブ
タIti 、前記シスデj・・インタフェース・アクブ
タに21L’、I♂用シリアル人出力ボートを通して画
情報をシリアルに人出力ul能、前記ラインメモリをノ
くラレルに直接アクセスi4J能、前記共通ハスに対し
画情報をパラレルに入出力可能、かつ人力した画情報に
文字情報を挿入可能であり、前記帯域1工縮・イ中艮ア
タブタは、1)IIa己メセメモリンタフェース・アク
ツブりに21 L ’、’t: Jllシリアル人出力
ポートを通して画情報をシリアルに入出力可能、かつ前
記共Mlハメにr1餞化情報をパラレルに入出力可能で
あるとともに、前記画情報および符号化情報の入出力間
に、−次几イ″′1シじ化、二次元符号化、−次元復号
化および二次元符号化処理を行うようになっており、前
記通イ1−1インタフェース・アダプタは、nil記モ
デJ・に対しF、JI川フシリアル入出力ボート通して
データをシリアルに人出力r4J能、かつ前記共通バス
に対しデータをパラレルに人出力ijJ能であシ、前記
データの入出力間に、ファクシミリ伝送手順におけると
ころの、要求される装置の識別と選択のだめのメソセー
ジ前手順、メソセージ伝送、並びにメソセージの終了と
確認および複葉ドキメント手順を含むメツセージ後手順
に関するデータ処理を行うように々っており、さらに前
記各アダプタには、前記共通バスに接続され、前記各ア
ダプタの動作を制御するコマンド゛情報を1)IJ記共
通バスを通して前記中火処理装置により設定されるコマ
ンド・レジメタと、前記共通ハスに接続され、前記各ア
ダプタの内部ステータス情報全保持するステータス・レ
ジメタとが設けられているファクシミリ装置。
The medium heat j211 device 1a consists of a microcomputer system having ROM and RAM, a scanner for reading and scanning the entire manuscript, a plotter for recording, a line memory, a modem, and large-scale integrated circuits, respectively. +
) Connected to the common bus of the computer system as an input/output ag in the address space of the microcomputer system, memory interface adapter, bandwidth line extension 1% adapter, and The image information is serially input from the memory interface adapter and the memory interface adapter through the dedicated serial input capo-I, respectively. Possible, the said Posotaoyohi f?iJ WE memory.
It is possible to serially output image information to the interface adapter through the dedicated serial output capacitor 1-, and between the input and output of the image information, 1; I + i width conversion, sub-channel N'
E line 14. It is possible to perform conversion, 1-line reading time conversion, 1-line writing, conversion between All and 11, and image reduction processing, and the memory interface adapter Iti, the system data j... interface actuator can perform 21L', Ability to serially output image information through the serial output port for I♂, I4J ability to access the line memory directly to the parallel, input/output of image information to and from the common lotus in parallel, and input/output manually. It is possible to insert character information into the image information, and the above-mentioned band 1 processing/intermediate attachment is: 1) IIa self-memory interface active 21 L','t: Inserts the image information through the Jll serial output port. It is possible to input and output serially, and it is possible to input and output r1 encoding information in parallel to the above-mentioned Ml connection, and between the input and output of the image information and the encoded information, It is designed to perform two-dimensional encoding, -dimensional decoding, and two-dimensional encoding processing. The data can be output serially to the common bus, and the data can be output in parallel to the common bus. each adapter is configured to perform data processing for pre-message procedures of selection, message transmission, and post-message procedures including message termination and confirmation and biplane documentation procedures; , command information for controlling the operation of each adapter; 1) a command register set by the medium heat treatment device through the IJ common bus; A facsimile machine equipped with a status register.
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