JPS5920779U - 検波回路 - Google Patents

検波回路

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Publication number
JPS5920779U
JPS5920779U JP11524682U JP11524682U JPS5920779U JP S5920779 U JPS5920779 U JP S5920779U JP 11524682 U JP11524682 U JP 11524682U JP 11524682 U JP11524682 U JP 11524682U JP S5920779 U JPS5920779 U JP S5920779U
Authority
JP
Japan
Prior art keywords
circuit
current mirror
input terminal
mirror circuit
output
Prior art date
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Pending
Application number
JP11524682U
Other languages
English (en)
Inventor
日下部　哲男
Original Assignee
株式会社東芝
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Filing date
Publication date
Application filed by 株式会社東芝 filed Critical 株式会社東芝
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Publication of JPS5920779U publication Critical patent/JPS5920779U/ja
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  • Processing Of Color Television Signals (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の検波回路を示す回路図、第２図はこの考
案に係る検波回路の一実施例を示す回路図、第３図は第
２図に示す回路の効果を説明する為に示す第１図の回路
のブロック図、第４図は同じく第２図の回路のブロック
図である。 １１・・・差動幅増幅回路、１２・・・ダブルバランス
型差動増幅回路、２１〜２３・・・カレントミラー回路
、１１１・・・定電流源、Ｑ２１〜Ｑ３５・・・トラン
ジスタ、Ｒ□１．Ｒ２□〜Ｒ２６・・・抵抗、Ｅｌｌ、
Ｅ２１．Ｅ２２・・・定電圧源、ＳＷ・・・サンプリン
グスイッチ、Ｃ１１・・・コンデンサ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 差動対を成すトランジスタのエミッタの共通接続点を定
    電流源に接続し一方の入力端には第１の信号を印加し他
    方の入力端には基準電圧を印加して成る差動増幅回路及
    び該差動増幅回路の各トランジスタのコレクタに各差動
    対を成すトランジスタのエミッタの共通接続点を接続し
    一方の入力端には第２の信号を印加し他方の入力端には
    第２の基準電圧が印加されるダブルバランス型差動増幅
    回路を有する掛算回路と、この掛算回路の一方の出力端
    に入力端が接続される第１のカレントミラー回路と、前
    記掛算回路の他方の出力端に入力端が接続される第２の
    カレントミラー回路と、入力端にこの第２の力υントミ
    ラー回路の出力端が接続され出力端が前記第１のカレン
    トミラー回路の出力端に接続される第３のカレントミラ
    ー回路と、前記第１１第３の、カレントミラー回路の出
    力端の共通接続点に流れる電流を電圧に変換する変換回
    路とを具備した検波回路。
JP11524682U 1982-07-29 1982-07-29 検波回路 Pending JPS5920779U (ja)

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JP11524682U JPS5920779U (ja) 1982-07-29 1982-07-29 検波回路

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JP11524682U JPS5920779U (ja) 1982-07-29 1982-07-29 検波回路

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JPS5920779U true JPS5920779U (ja) 1984-02-08

Family

ID=30266098

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