JPS58147312U - 増幅回路 - Google Patents

増幅回路

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Publication number
JPS58147312U
JPS58147312U JP4348582U JP4348582U JPS58147312U JP S58147312 U JPS58147312 U JP S58147312U JP 4348582 U JP4348582 U JP 4348582U JP 4348582 U JP4348582 U JP 4348582U JP S58147312 U JPS58147312 U JP S58147312U
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JP
Japan
Prior art keywords
amplifier circuit
differential amplifier
current path
circuit
output
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Pending
Application number
JP4348582U
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English (en)
Inventor
隆一 福田
Original Assignee
日本コロムビア株式会社
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Publication date
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Priority to JP4348582U priority Critical patent/JPS58147312U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案の前提となった加算増幅回路を示す回路
図、第2図及び第3図はそれぞれ本考案の一実施例を示
す回路図である。 図中、51及び52は差動増幅回路、63はカレントミ
ラー回路である。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第1の差動増幅回路と、第2の差動増幅回路と、カレン
    トミラー回路から成り、第1の差動増幅回路の一方の出
    力電流路に直列に第2の差動増幅回路を接続し、該第2
    の差動増幅回路の一方の出力電流路をカレントミラー回
    路の入力電流路に接続し、上記カレントミラー回路の出
    力電流路と前記第1の差動増幅回路の他方の出力電流路
    を直列接続して、前記両差動増幅回路の加算出力を得る
    様にした加算増幅回路に於て、第1及び第2の差動増幅
    回路のそれぞれの第1の入力端子に入力信号を印加し、
    第1の差動増幅回路又は第2の差動増幅回路のうちの一
    方の差動増幅回路の第2の入力端子には前記加算出力を
    分圧した信号を印加し、他方の差動増幅回路の第2の入
    力端子の交流信号を接地することを特徴とする増幅回路
JP4348582U 1982-03-27 1982-03-27 増幅回路 Pending JPS58147312U (ja)

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JP4348582U JPS58147312U (ja) 1982-03-27 1982-03-27 増幅回路

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JP4348582U JPS58147312U (ja) 1982-03-27 1982-03-27 増幅回路

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JPS58147312U true JPS58147312U (ja) 1983-10-04

Family

ID=30054570

Family Applications (1)

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JP4348582U Pending JPS58147312U (ja) 1982-03-27 1982-03-27 増幅回路

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JP (1) JPS58147312U (ja)

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