JPS59191674U - 対数表示回路 - Google Patents

対数表示回路

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JPS59191674U
JPS59191674U JP8616483U JP8616483U JPS59191674U JP S59191674 U JPS59191674 U JP S59191674U JP 8616483 U JP8616483 U JP 8616483U JP 8616483 U JP8616483 U JP 8616483U JP S59191674 U JPS59191674 U JP S59191674U
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JP
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logarithmic
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circuit
circuits
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JP8616483U
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Inventor
誠司 田村
Original Assignee
株式会社　ムサシ電機計器製作所
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  • Measuring Instrument Details And Bridges, And Automatic Balancing Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は一般的な対数表示回路を示した回路図、第２図
は特殊用途における基本的な対数表示を行。 う回路図、第３図は従来の代表的なアナログ割算による
対数表示を行う回路図、第４図は本考案による対数表示
回路を示した回路図、第５図は本考案の対数表示回路を
高電圧絶縁抵抗計に応用した回路図である。 １０．１２，１５．１７・・・周波数変換回路、Ａ工〜
Ａｍ、Ｂ□〜Ｂｍ・・・倍電圧整流回路、１１゜１３、
　１６．　１８・・・対数変換回路、１４．１９・・・
増幅器。

Claims (1)

    【実用新案登録請求の範囲】
  1. ２つの入力系統の夫々に、電気信号を周波数に変換する
    周波数変換回路と、該周波数変換回路から出力される周
    波数の所定周波数領域をその領域毎に対数的に電気信号
    に変換を行う所定数の整流回路から成る対数変換回路と
    を設け、前記２つの入力系統の対数変換回路は互いに極
    性を異にされ、一方の入力系統の対数変換回路において
    所定数の整流回路の夫々の出力を加算した値と他方の入
    力系統の対数変換回路において所定数の整流回路の夫々
    の出力を加算した値とを合成することにより対数表示さ
    せることを特徴とする対数表示回路。
JP8616483U 1983-06-06 1983-06-06 対数表示回路 Granted JPS59191674U (ja)

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JP8616483U JPS59191674U (ja) 1983-06-06 1983-06-06 対数表示回路

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JPS59191674U true JPS59191674U (ja) 1984-12-19
JPH0338706Y2 JPH0338706Y2 (ja) 1991-08-15

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