JPS59178979A - インバ−タ装置の保護回路 - Google Patents
インバ−タ装置の保護回路Info
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- JPS59178979A JPS59178979A JP58052114A JP5211483A JPS59178979A JP S59178979 A JPS59178979 A JP S59178979A JP 58052114 A JP58052114 A JP 58052114A JP 5211483 A JP5211483 A JP 5211483A JP S59178979 A JPS59178979 A JP S59178979A
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- JP
- Japan
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- inverter
- output waveform
- circuit
- waveform
- quasi
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
- H02M7/44—Conversion of dc power input into ac power output without possibility of reversal by static converters
- H02M7/48—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/53—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
- H02M7/537—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only, e.g. single switched pulse inverters
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Protection Of Static Devices (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は半導体スイッチング素子を構成要素とづるイン
バータ装置の保護回路に関するものである。
バータ装置の保護回路に関するものである。
背景技術
従来、例えば負荷としてコンヒコークや通信機等が接続
される電源システムには一般にインバータ装置を具備し
た定周波定電圧電源装置が用いＣ〕れＣいるが、そこに
用いられている半ｉＤ体スイッｆ−ング素Ｆ−（例えば
トランジスタ、リイリスタ）簀に故障が牛じたような場
合には、負荷への給電を停止づることなくバイパス回路
を介して商用゛心源電圧を直）′Ａするとか、予備の電
源装置との切育えを（ｊなう等の対策が必要になる。
される電源システムには一般にインバータ装置を具備し
た定周波定電圧電源装置が用いＣ〕れＣいるが、そこに
用いられている半ｉＤ体スイッｆ−ング素Ｆ−（例えば
トランジスタ、リイリスタ）簀に故障が牛じたような場
合には、負荷への給電を停止づることなくバイパス回路
を介して商用゛心源電圧を直）′Ａするとか、予備の電
源装置との切育えを（ｊなう等の対策が必要になる。
また一方、定周波定電圧電源装置に電力を供給している
商用電源に停電事故等の故障が発生した」閉合には直り
に一］−記定周波定電Ｆ［電源装置をバッテリ電源に切
替えて連続して運転を継続さける必要がある。
商用電源に停電事故等の故障が発生した」閉合には直り
に一］−記定周波定電Ｆ［電源装置をバッテリ電源に切
替えて連続して運転を継続さける必要がある。
１・１つて、−１記いずれの場合にも切替動１′１が即
応して行なわれるＪ：うに無停電電源システム構成がと
られている。
応して行なわれるＪ：うに無停電電源システム構成がと
られている。
しかしながら、インバータ装置に、１）いては、でこに
用いられ（いるスイッチング素子が古（障したり、ノイ
ズ等によって指令伝号（スイッチング制御′ａｌｌ信号
）に無関係にＯＮ又＋；ｋ ＯＦ 「してしまうよ−）
な誤動作を起したりした場合に備えて保護回路か設けら
れているが、その事故検出速度が遅く、対策に遅れが生
じスイッチング索ｒが破壊される等の問題があった。
用いられ（いるスイッチング素子が古（障したり、ノイ
ズ等によって指令伝号（スイッチング制御′ａｌｌ信号
）に無関係にＯＮ又＋；ｋ ＯＦ 「してしまうよ−）
な誤動作を起したりした場合に備えて保護回路か設けら
れているが、その事故検出速度が遅く、対策に遅れが生
じスイッチング索ｒが破壊される等の問題があった。
すなわち、従来のインバータの保護回路では、スイッチ
ング素子の制御Ｉ倍信号合成して作成したインバータ出
力波形と同様のスイッチング形態を有する擬似的な信号
と、実際の・インバータ出力波形とを比較することによ
って１．インバータ克了のスイッング状態を監視する方
法をとるものが一般に用いられているが、インバータ出
力波形はスイッチング素子等の系の「れにより、擬似的
（こ作成した波形とは若干の位相差が生じ、モのため誤
った判Ｗ１をしないようにコンデレザＣ１抵抗Ｒによっ
てその位相差を補正していたので、事故検出速度が遅く
なってしまっていた。
ング素子の制御Ｉ倍信号合成して作成したインバータ出
力波形と同様のスイッチング形態を有する擬似的な信号
と、実際の・インバータ出力波形とを比較することによ
って１．インバータ克了のスイッング状態を監視する方
法をとるものが一般に用いられているが、インバータ出
力波形はスイッチング素子等の系の「れにより、擬似的
（こ作成した波形とは若干の位相差が生じ、モのため誤
った判Ｗ１をしないようにコンデレザＣ１抵抗Ｒによっ
てその位相差を補正していたので、事故検出速度が遅く
なってしまっていた。
従って、検出時間を短縮する対策が切望されていた。
発明の開示
本発明の目的は上記従来の問題点を解）肖し、・インバ
ータ装置の故障時の検出を高速に行える保護回路を提供
することにある。
ータ装置の故障時の検出を高速に行える保護回路を提供
することにある。
一１記の目的を）構成するために、本発明のインバータ
装置の保護回路は、インバータを構成する半席“１ホス
イツヂング系了の制御をｆ’Ｊ ’（’ｌ：うインバー
タスイッチング制御回路の出力信号り日ら、インバータ
出力波形と等しい位相関係とスイッチング形態とを有す
る１疑似インバータ出力波形を作成し、該擬似インバー
タ出力波形を基にインパーク出力波形の遅れ分くスイッ
チング素子等の系にＪ：って生り゛る遅り分）に相当す
るパルス幅を有りる信シ３を作成し、該信号とインバー
タ出力波形又は擬似インバータ出力波形を合成し遅れ時
間を補１［シた波形を形成し、該補正した波形と擬似イ
ンバータ出力波形又はインバータ出力波形どを比較り−
ることにより−ｒインバータ装置一異常を検出するよう
に構＠Ｌ／こ 。
装置の保護回路は、インバータを構成する半席“１ホス
イツヂング系了の制御をｆ’Ｊ ’（’ｌ：うインバー
タスイッチング制御回路の出力信号り日ら、インバータ
出力波形と等しい位相関係とスイッチング形態とを有す
る１疑似インバータ出力波形を作成し、該擬似インバー
タ出力波形を基にインパーク出力波形の遅れ分くスイッ
チング素子等の系にＪ：って生り゛る遅り分）に相当す
るパルス幅を有りる信シ３を作成し、該信号とインバー
タ出力波形又は擬似インバータ出力波形を合成し遅れ時
間を補１［シた波形を形成し、該補正した波形と擬似イ
ンバータ出力波形又はインバータ出力波形どを比較り−
ることにより−ｒインバータ装置一異常を検出するよう
に構＠Ｌ／こ 。
このように構成した本発明の保護回路によれば、インバ
ータ出力波形の遅れ分をディジタル的に補１１］シてい
るので、検出時間の高速化がはかれ、従って事故に即応
した対策く例えばインバータスイッチング制御回路から
の半導体スイッチング素子のＯＮ信号発生をス！へツブ
する）が取れるので、半導体スイッチング素子の破Ｊａ
う防止できる。
ータ出力波形の遅れ分をディジタル的に補１１］シてい
るので、検出時間の高速化がはかれ、従って事故に即応
した対策く例えばインバータスイッチング制御回路から
の半導体スイッチング素子のＯＮ信号発生をス！へツブ
する）が取れるので、半導体スイッチング素子の破Ｊａ
う防止できる。
発明を実施するだめの最良の形態
以下、本発明を実施例によって詳細に説明する。
第１図は本発明の保護回路を備えたインパーク装置の概
略構成を示すブロック図、第２図はその動作を説明する
ための波形図である。図に（！３いて、１はインバータ
装置で、電源部２と、半導体スイッチング素子によって
形成されるブリッジインバータ回路３、及び′インバー
タスイッチング制御回路４を備えて構成されている。５
はインパーク装置の出）ｊ線で、図示を省略したが変圧
器、フィルタ、スイッチを介して負荷に接続されている
。Ｇ（、Ｌ擬似インバータ出力波形作成回路で、インバ
ータスイッチング制御回路４の出力傾ｇ ４人力してブ
リッヂインバータ回路３の出力波形（以下、−インバー
タ出力波形△と記″ｔＪ−）と擬似づ゛る出ツノ波形（
以下、擬似インバータ出力波形ＩＢと記す）を作成づ゛
る。７は微分信号発生回路で、擬似インバータ出力波形
Ｂを基にインバータ出力波形Ａの遅れ分に（目当するパ
ルス幅を有する微分信号ｃ及びＤを上記半導体スイッチ
ング素子のスイッチング（こ同門しＣ発生づる。８は補
正波形形成回路て、上記微分信号Ｃ及びＤと、インバー
タ出力波形Ａ又は擬似インバータ出力波形Ｂとを合成し
遅れ時間を補ｊ１−シた波形（遅れ補正インバータ出カ
波形Ｅ又（よ）Ｙれ補止擬似インバータ出力波形ＩＥ
” ）を形成する。、９は比較回路で、上記遅れ補正イ
ンバータ出力波形［と擬似インバータｊ［ｉカ波形［３
とを又は遅れ補正擬似インバータ出力波形Ｅ′とインバ
ータ出力波形△どを比較し、インバータに出力異常が発
生したとき−に異常検出信号に又（、ま「−を出力覆る
。第２図から明らかなように異常発生と同時に異常検出
信号が発生している。この異常検出１昌シ゛冊又は「−
一（こよってインバータ装置の動作を拌止したり、スイ
ッチを聞いて負部を切り離す哲の苅策を施し、インバー
タ装置の保ｉ隻を？ｊなう、２次に本発明の保護回路を
侑えたインバータ装置の見体的回路椙成について、第５
図に示り一実施例の回路図で説明する。第３図において
、前出のものと同一符号のものは同−又は均等部分を示
りものとする。なお、３１明並びに図面を簡略（（７Ｊ
−るために三相交流出ノｊを発生するイ〕・′パーク装
置を示し、かつ比較回路では遅れ補■−インバータ出力
波形Ｅと擬似インバータ出力波形［３とを比較リイン場
合を示したが、本発明の保護回路（，１弔相又（，１多
１［１のインバータ装置に適用でさるし、また比較回路
において遅れ補正１疑似インバータ出力波形「−どイン
バータ出力波形△とを比較り−るように（１４成しても
よいことは言うまてしないことである。
略構成を示すブロック図、第２図はその動作を説明する
ための波形図である。図に（！３いて、１はインバータ
装置で、電源部２と、半導体スイッチング素子によって
形成されるブリッジインバータ回路３、及び′インバー
タスイッチング制御回路４を備えて構成されている。５
はインパーク装置の出）ｊ線で、図示を省略したが変圧
器、フィルタ、スイッチを介して負荷に接続されている
。Ｇ（、Ｌ擬似インバータ出力波形作成回路で、インバ
ータスイッチング制御回路４の出力傾ｇ ４人力してブ
リッヂインバータ回路３の出力波形（以下、−インバー
タ出力波形△と記″ｔＪ−）と擬似づ゛る出ツノ波形（
以下、擬似インバータ出力波形ＩＢと記す）を作成づ゛
る。７は微分信号発生回路で、擬似インバータ出力波形
Ｂを基にインバータ出力波形Ａの遅れ分に（目当するパ
ルス幅を有する微分信号ｃ及びＤを上記半導体スイッチ
ング素子のスイッチング（こ同門しＣ発生づる。８は補
正波形形成回路て、上記微分信号Ｃ及びＤと、インバー
タ出力波形Ａ又は擬似インバータ出力波形Ｂとを合成し
遅れ時間を補ｊ１−シた波形（遅れ補正インバータ出カ
波形Ｅ又（よ）Ｙれ補止擬似インバータ出力波形ＩＥ
” ）を形成する。、９は比較回路で、上記遅れ補正イ
ンバータ出力波形［と擬似インバータｊ［ｉカ波形［３
とを又は遅れ補正擬似インバータ出力波形Ｅ′とインバ
ータ出力波形△どを比較し、インバータに出力異常が発
生したとき−に異常検出信号に又（、ま「−を出力覆る
。第２図から明らかなように異常発生と同時に異常検出
信号が発生している。この異常検出１昌シ゛冊又は「−
一（こよってインバータ装置の動作を拌止したり、スイ
ッチを聞いて負部を切り離す哲の苅策を施し、インバー
タ装置の保ｉ隻を？ｊなう、２次に本発明の保護回路を
侑えたインバータ装置の見体的回路椙成について、第５
図に示り一実施例の回路図で説明する。第３図において
、前出のものと同一符号のものは同−又は均等部分を示
りものとする。なお、３１明並びに図面を簡略（（７Ｊ
−るために三相交流出ノｊを発生するイ〕・′パーク装
置を示し、かつ比較回路では遅れ補■−インバータ出力
波形Ｅと擬似インバータ出力波形［３とを比較リイン場
合を示したが、本発明の保護回路（，１弔相又（，１多
１［１のインバータ装置に適用でさるし、また比較回路
において遅れ補正１疑似インバータ出力波形「−どイン
バータ出力波形△とを比較り−るように（１４成しても
よいことは言うまてしないことである。
本実施例におい′Ｃは、ブリッジインバータ回路ζ３の
スイッチング素子としてトランジスタＱ＋＝−Ｑ６を用
い、擬似インバータ出力波形作成回路６（Ｊアンド回路
を用いている。微分信弓光生回路７は２つの微分回路７
−１．７−２を用いて（ｈ１成し、でれぞれ擬似インバ
ータ出力波形Ｂから微分信シ３Ｃ１（）を発生Ｊる。補
正波形形成回路８１よインバータ出力波形Ａと微分信号
Ｃとの論理和をとるＯＲ回路と、そのＯＲ回路出力と微
分信号りどの論理積をとるＡＮＤ回路によって構成され
、ＡＮＤ回路の出ツノとして遅れ補正インバータ出力波
形「か１゛１られる。比較回路９は遅れｔｉｌｉ 、ｉ
Ｊ−インバータ出力波形［どＩｂＴ似インバータ出カ波
形）−３どの不一致を検出覆るエクスクルシブＯＲ回路
によ）で（１゛４成され、インパークに出力異常が発生
しＩこ場合に５５：富検出信号１：を出力する。
スイッチング素子としてトランジスタＱ＋＝−Ｑ６を用
い、擬似インバータ出力波形作成回路６（Ｊアンド回路
を用いている。微分信弓光生回路７は２つの微分回路７
−１．７−２を用いて（ｈ１成し、でれぞれ擬似インバ
ータ出力波形Ｂから微分信シ３Ｃ１（）を発生Ｊる。補
正波形形成回路８１よインバータ出力波形Ａと微分信号
Ｃとの論理和をとるＯＲ回路と、そのＯＲ回路出力と微
分信号りどの論理積をとるＡＮＤ回路によって構成され
、ＡＮＤ回路の出ツノとして遅れ補正インバータ出力波
形「か１゛１られる。比較回路９は遅れｔｉｌｉ 、ｉ
Ｊ−インバータ出力波形［どＩｂＴ似インバータ出カ波
形）−３どの不一致を検出覆るエクスクルシブＯＲ回路
によ）で（１゛４成され、インパークに出力異常が発生
しＩこ場合に５５：富検出信号１：を出力する。
なお、第３図にお（〕る１ ０ Ｂ、ｉ変月−器、、
１−１ ｉ；じノｒルタ、１２（よスイッチ（ＡＣ８Ｗ
）、１３は負？・らて゛ある。全体のＩＭ成並ひに動１
’ｌ： ｌ；Ｉ、第１［λｊ、第２図で説明したので、
ここでは省略で−る、。
１−１ ｉ；じノｒルタ、１２（よスイッチ（ＡＣ８Ｗ
）、１３は負？・らて゛ある。全体のＩＭ成並ひに動１
’ｌ： ｌ；Ｉ、第１［λｊ、第２図で説明したので、
ここでは省略で−る、。
以ト説明しｌｃよう（ご、本発明の保Ｊ回６″ｆｆ ｉ
；Ｌ論即回路によって構成され、インバータ出力波形の
遅４１分（、Ｌディジタル的に補１ＦされるのＣ１以１
−検出が高速化され、従来の問題点は全て解消される。
；Ｌ論即回路によって構成され、インバータ出力波形の
遅４１分（、Ｌディジタル的に補１ＦされるのＣ１以１
−検出が高速化され、従来の問題点は全て解消される。
第１図は本発明の保護回路を備えたインパーク装置のブ
ロフク図、第２図は本発明の詳細な説明りるための波形
図、第３図は本発明の−９１，’ 、ｊＪ７例の具体的
４１へ成を示す回路図である。 １・・・・・・インバータ装置、 ３・・−・・・ブリッジインバータ回路、４・・・・・
・インバータスイッチング制御回路、６・・・・・・擬
似インバータ出力波形イ１成回路、７・・・・・・微分
信＠発生回路、 ８・・・・・・補正波形形成回路、 ９・・・・・・比較回路。 出願人 ［］本電気枯器株式会ｌ／１
ロフク図、第２図は本発明の詳細な説明りるための波形
図、第３図は本発明の−９１，’ 、ｊＪ７例の具体的
４１へ成を示す回路図である。 １・・・・・・インバータ装置、 ３・・−・・・ブリッジインバータ回路、４・・・・・
・インバータスイッチング制御回路、６・・・・・・擬
似インバータ出力波形イ１成回路、７・・・・・・微分
信＠発生回路、 ８・・・・・・補正波形形成回路、 ９・・・・・・比較回路。 出願人 ［］本電気枯器株式会ｌ／１
Claims (1)
- 【特許請求の範囲】 １ 、 ｒ＋’導体スイッチング素子によって形成され
るブリッジインバータ回路と、該ブリッジインバータ回
路【こ電力を供給する電源部と、上記半導体スイッチン
グ素子を制御するインバータスイッチング制御回路とを
備えて構成されるインバータ装置にｄ３りる保護回路で
あって、 上記インバータスイッチング制御回路の出カイへ号を入
力して上記ブリッジインバータ回路の出力波形と擬似づ
−る出力波形を作成り−る擬似インバータ出力波形作成
回路と、 該波形作成回路からの擬似インバータ出力波形を基にブ
リッジインバータ回路の出力波形の遅れツ）（こ相当す
るパルス幅を有する微分１言８をｊ記半導体スイッチン
グ素子のスイッチングに同期させ１発生する遅れ補正用
微分信号発生回路と、該微分信号発生回路の出力波形と
上記ブリッジインバータ回路の出力波形又は擬似インバ
ータ出力波形とを合成し遅れ時間を補正した波形を形成
する補正波形形成回路と、 該補正波形形成回路によって補正されたブリッジインパ
ーク回路の出力波形と擬似インバータ出力波形とを又は
補正された擬似インバータ出力波形とブリッジインバー
タ回路の出力波形とを比較する比較回路と、 を備え、該比較回路の出力によってインバータ装置の動
作を停止させるように構成したことを特徴どり−るイン
バータ装置の保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58052114A JPS59178979A (ja) | 1983-03-28 | 1983-03-28 | インバ−タ装置の保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58052114A JPS59178979A (ja) | 1983-03-28 | 1983-03-28 | インバ−タ装置の保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59178979A true JPS59178979A (ja) | 1984-10-11 |
Family
ID=12905834
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58052114A Pending JPS59178979A (ja) | 1983-03-28 | 1983-03-28 | インバ−タ装置の保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59178979A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE10216986A1 (de) * | 2002-04-16 | 2003-10-30 | Heidenhain Gmbh Dr Johannes | Verfahren zum Überprüfen eines Umrichters |
-
1983
- 1983-03-28 JP JP58052114A patent/JPS59178979A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE10216986A1 (de) * | 2002-04-16 | 2003-10-30 | Heidenhain Gmbh Dr Johannes | Verfahren zum Überprüfen eines Umrichters |
| US6825647B2 (en) | 2002-04-16 | 2004-11-30 | Dr. Johannas Heidenhain Gmbh | Method for testing a frequency converter |
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