JPS5913377A - 半導体圧力変換素子の受圧ダイヤフラム形成方法 - Google Patents

半導体圧力変換素子の受圧ダイヤフラム形成方法

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JPS5913377A
JPS5913377A JP12275782A JP12275782A JPS5913377A JP S5913377 A JPS5913377 A JP S5913377A JP 12275782 A JP12275782 A JP 12275782A JP 12275782 A JP12275782 A JP 12275782A JP S5913377 A JPS5913377 A JP S5913377A
Authority
JP
Japan
Prior art keywords
etching
silicon
type
junction
diaphragm
Prior art date
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Pending
Application number
JP12275782A
Other languages
English (en)
Inventor
Yoshihiro Shigeta
善弘 重田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Corporate Research and Development Ltd
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Filing date
Publication date
Application filed by Fuji Electric Corporate Research and Development Ltd filed Critical Fuji Electric Corporate Research and Development Ltd
Priority to JP12275782A priority Critical patent/JPS5913377A/ja
Publication of JPS5913377A publication Critical patent/JPS5913377A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/84Types of semiconductor device ; Multistep manufacturing processes therefor controllable by variation of applied mechanical force, e.g. of pressure

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は半専体圧カセンサにおけるシリコンク1イヤフ
、ラムの起わい部の形成方法に関するb圧力センサは従
来からプロセス工業を始めとして、広い分野で使用され
ている基本的なセンサの一つであり、近年高鞘度化、小
型化に向って開発が進んで℃・る。従来の圧力センサは
ズルトンイk、ベローズや金属タイヤフラムと差動トラ
ンスやメ1 /Lストレンゲージを組合わゼた方式であ
ったが、最近は半導体1c技術を応用した拡散形半導体
圧カセンザが盛んに用いられるようになってきているa
シリコンなとの半導体にひずみを〃Jえると金属如比し
て100倍程鹿の大きな抵抗変化を生ずるので、このこ
とを潤用して半導体ストレンゲージを圧力センサに適用
することが考えられるが、このとき最も理想的には、圧
力を受けてひずみを生ずる起わい体そのものをシリコン
単結晶板からつくり、これに不純物を拡散1−ストレン
グージを形成する方法をとることである。この圧力セン
サは半導体の加工技術およびZC技術の進歩光iAKよ
って展進が可能になったものであり、シリコン単結晶板
の表面忙はストレングージ抵抗が拡散形成され、裏面は
凹形K〈り抜がれて薄くなった部分がダイヤプラムとな
るので、このタイヤプラムとストレンゲージが完全に一
体と11って圧力−ひずみ変換が行なわハる・すなわち
圧力が印加されるとタイヤフラムが変形しゲージ抵抗に
ひずみが発生ずる0このためゲージにはピエゾ抵抗効果
による大きな抵抗変化が起り、圧力に比例したブリッジ
出力が得られるのである。この圧力センサのダイヤフラ
ムの加工をICと同じフォトリンゲラフィブロセスを用
いて行なえば鍋梢度化、小型化および大量生産による低
価格化が期待できる。
従来からシリコン単結晶板をタイ7フラムとして形成す
る方法は例えば第1図に示す如(シリコン基板1の片面
に先づ5lo2またはAuなどの保護m2を設け5次に
凹部3を形成すべき部分の保護膜2を遺択工、チング除
去した体、シリコン基板のもう一方の面にガラス板4を
ワックス5で固定し、弗硝酸のようなシリコンエツチン
グ液を用いて凹部3が所望の厚さになるまでエツチング
すること忙よりタイ7フラムを形成するのが114であ
る。
しかしながらこのようなシリコンタイ7フラムの製造方
法には、シリコン基板1の厚さのバラツキおよびエツチ
ング後の組成や温度がタイヤスラムの厚さの精度に大き
く影曽する。
例えば厚さが380±10μmのシリコン基板がら凹部
3の厚さ25μmのダイヤフラムを形成する場合に得ら
れる厚さの精度は、25±10μm以上となり非常忙悪
い結果となるばかりでなく、エツチング液の組成や温度
によっても工、チング量が変わるので。
作業条件の制御が非常に難しい等の欠点がある。
また、シリコン基板如不純物濃度の異なる半導体層を設
けてエツチング速度を変えること忙より、タイ7フラム
の凹部を形成する方法もあるが、この方法も使用するエ
ツチング液のateに制約があり、液の管理がむずかし
いことおよび凸部の厚さの精度の点で満足すべき結果が
得られていない。
本発明は上述の欠点を除去し、ダイヤフラム凹部の厚さ
の精度が極めて高い形成方法を提供することを目的とす
る〇 以下実施例に基き本発明の詳細な説明する・第2図は本
発明の実施例を示すもので、P型シリコン基板6KNm
シリコン7を、形成すべき凹部の厚さの分だけ気相成長
させ1次にP型シリコン基板6のもう一方の面に5lo
2tたはAuなどの保護膜2を設けた後、凹部を形成す
る部分にある保護膜2を選択エツチング除去する。しか
る後上記のPN接合を有するシリコンウェハを保持台8
にパツキン9を介して取付けた状態でエツチング110
に装入するとともに、適量のエツチング液1]を入れる
。エツチング液11は保@膜2を侵さず、シリコンウェ
ハのみエツチングする液を選ぶことが必要であり、バ、
キン9はNff1シリコン成長層の露出面をこのエツチ
ング液から保護するために用し・る。かくして予め設け
たt極12を外部電源13にリード接続しPWシIIコ
ン基板すとN型シリコン成長層7からなるPN接合kC
@源13がら逆バイアスをかけておくと、PN接合部で
はP型シリコ:/基&b(7)エツチングが進行し遂に
Nmンリコン成長層に到達したとき、すなわちP型シリ
コン基板すが、エツチング除去されPN接合を肩するシ
リコンウェハに凹部が形成されたとき、N、 & 12
と1源13を結ぶ回路に電流が流れるようKなる。した
がってこの回路忙電流が流れ始めるときの信号を検出し
て、その時点でシリコンウェハをエツチング槽から引上
げれば所望の厚さを有するンリフンダイヤスラムを得る
ことができる。
第3図は、第2図の実施例の変形例を示すものであるが
、タイヤ7ラム形成方法は基本的には第2図の場合と同
じである。但し第3図にはシリコン基板の接合構造のみ
を表わし、エツチング槽、1、極などは図示してない。
第3図が第2図と異なる点は、N形シリコン基板14に
P型シリコン15とN型シリコン16を2段気相成長さ
せたことであへ電源13により順方向型7圧をPN接合
の順電圧降下(0,7V)以上加えれば、N型シリコン
基板14がエツチング除去されエツチング液がP型シリ
コン15に到達したときに電流が流れるのでこれを検出
すればよい。
以上説明したように1本発明によれば、半導体圧力変換
素子の起わい体にシリコン単結晶板そのものを用いてタ
イヤフラムを形成する方法として、シリコン基板上に気
相成長により±1μmの誤差で逆導電型のシリコン層を
設け、この気相成長したシリコン層の厚さ分だけを正確
にエツチングすることができタイヤフラノ、の尚白部は
任意にしかも所望の厚さを精度よく設定することができ
る。着た本発明は前記エツチング除去の終点の医定には
、シリコンのPN接合の性質を利用して、P型又はN型
の一方のシリコノ層が除去されたときに電気的な導通が
得られるようにしであるので、エツチング量の過不足を
生ずることなく極めて精度の高いタイヤフラム凹部の厚
さを形成することができるという大きな効果を有する。
このエツチングの方法は所望の厚さを得るためにエツチ
ングの過程でその都度測長する必要もなく自動的に行な
われるから、この作業が簡単になり、し、かも高能率で
あるという利点をも持っている◇ 元来半導体圧力實換素子における受圧部の感度は起わい
体薄白部の〜さの二乗に逆比例し、この厚さのバラツキ
は直接感度のノ・ラツキとして現われてくるので、この
厚さを精度よ(形成できる本発明は極めて優れた方法と
いえる。
【図面の簡単な説明】
第1図は従来のダイヤフラム形成方法を示す半導体基板
の断面図、第2図は本発明によるタイヤフラム形成方法
を示す断面図、第3図は第2図の変形例を示す半導体基
板の断面図である。 1.6.14・・・シリフン基板、7,15.16・・
・気相生長シリコン層、2・・・保膿膜、8・・・保持
台、9・・・パラ片ン、lO・・・エツチング411.
11・・・エツチング液、12・・・電極、13・・・
算源□

Claims (1)

    【特許請求の範囲】
  1. 半導体基板上に該半導体基板と通導IM型を有する半導
    体ノーを設けてPN接合を形成し、前記PN接合も・備
    えた半導体基板を、前記半導体層のみ半導体エツチング
    液から保護して該エツチング液に浸漬するとともに、前
    記PN接合に電、圧を負荷することにより、前記半導体
    基板が所定駄エツチング除去されたときに生ずる電流を
    検出して工ヵチ昏ングトの終点を決定することを%la
    とする半導体圧力変換素子の受圧タイヤフラム形成方法
JP12275782A 1982-07-14 1982-07-14 半導体圧力変換素子の受圧ダイヤフラム形成方法 Pending JPS5913377A (ja)

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ID=14843854

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06268238A (ja) * 1993-03-10 1994-09-22 Nippondenso Co Ltd 半導体歪みセンサ及びその製造方法
US5525549A (en) * 1992-04-22 1996-06-11 Nippondenso Co., Ltd. Method for producing an acceleration sensor
US5643803A (en) * 1992-09-18 1997-07-01 Nippondenso Co., Ltd. Production method of a semiconductor dynamic sensor
US5949118A (en) * 1994-03-14 1999-09-07 Nippondenso Co., Ltd. Etching method for silicon substrates and semiconductor sensor
US6284670B1 (en) 1997-07-23 2001-09-04 Denso Corporation Method of etching silicon wafer and silicon wafer

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