JPS59121420A - Ｃｍｏｓ型集積回路の入力回路 - Google Patents
Ｃｍｏｓ型集積回路の入力回路Info
- Publication number
- JPS59121420A JPS59121420A JP23175382A JP23175382A JPS59121420A JP S59121420 A JPS59121420 A JP S59121420A JP 23175382 A JP23175382 A JP 23175382A JP 23175382 A JP23175382 A JP 23175382A JP S59121420 A JPS59121420 A JP S59121420A
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- input
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4063—Device-to-bus coupling
- G06F13/4068—Electrical coupling
- G06F13/4072—Drivers or receivers
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はＣＭＯ８型集槙回路の入力回路に関する。
従来、バス線から送られてくる外部信号を集積回路から
成る内部回路に伝達するの［０ＭＯ８型インバータが用
いられてきた〇 集積回路間を相互に接続し、高インピーダンス状態をも
つ外部データバス回路では、入力回路がＣＭＯＳインバ
ータである場合、高インピーダンス状態によるゲートフ
ローティング及び貫通電流による誤動作を防止する目的
から高インピーダンス状態時でも、ゲートフローティン
グにならないような処置が必要であった。
成る内部回路に伝達するの［０ＭＯ８型インバータが用
いられてきた〇 集積回路間を相互に接続し、高インピーダンス状態をも
つ外部データバス回路では、入力回路がＣＭＯＳインバ
ータである場合、高インピーダンス状態によるゲートフ
ローティング及び貫通電流による誤動作を防止する目的
から高インピーダンス状態時でも、ゲートフローティン
グにならないような処置が必要であった。
第１図は従来の集積回路の入力回路の一例のブロック図
である。
である。
集積回路１０．１０’、１１はバス線１で相互に接続さ
れ、集積回路１０あるいは１０′の信号は出力インバー
タ２あるいは２′からバス線１を介して集積回路１１の
インバータ３に入力される。インバータ２，２′が共に
駆動を停止してバス線が高インピーダンス状態でも入力
インバータ３０入力がゲートフローティングにならない
ようにバス線１にプルアップ抵抗４を付加して信号レベ
ルを確定していた。
れ、集積回路１０あるいは１０′の信号は出力インバー
タ２あるいは２′からバス線１を介して集積回路１１の
インバータ３に入力される。インバータ２，２′が共に
駆動を停止してバス線が高インピーダンス状態でも入力
インバータ３０入力がゲートフローティングにならない
ようにバス線１にプルアップ抵抗４を付加して信号レベ
ルを確定していた。
第２図は従来の集積回路の入力回路の他の例のブロック
図である。
図である。
この例はプルアップ抵抗を集積回路１１内に設けたもの
で、これ以外は第１図に示すものと同じである。
で、これ以外は第１図に示すものと同じである。
第１図に示すように、プルアップ抵抗４を集積回路の外
に設ける場合には部品増加を招き、第２図に示すように
プルアップ抵抗を集積回路内に設ける場合、直流電流が
グルアッグ抵抗４Ｖｃ定常的に流れることがあるため、
消費電流が増加するという欠点があった。
に設ける場合には部品増加を招き、第２図に示すように
プルアップ抵抗を集積回路内に設ける場合、直流電流が
グルアッグ抵抗４Ｖｃ定常的に流れることがあるため、
消費電流が増加するという欠点があった。
本発明は上記欠点を除去し、プルアップ抵抗全使用せず
、定常的な直流電流が流れることなく、バス線のレベル
を確定できる工うにしたＣ Ｍ ＯＳ型集積回路の入力
回路を提供するものである。
、定常的な直流電流が流れることなく、バス線のレベル
を確定できる工うにしたＣ Ｍ ＯＳ型集積回路の入力
回路を提供するものである。
本発明のＣＭＯ８型Ｏ８回路の入力回路は、バス線に接
続して外部信号を内部回路−一伝達する少くとも１つの
ＣＭ ＯＳ型インバータと、前記インバータの出力の一
部を入力してその出力を前記インバータの入力端に入力
して正帰還をかける付加の０ＭＯ８型インバータと全含
んで構成される。
続して外部信号を内部回路−一伝達する少くとも１つの
ＣＭ ＯＳ型インバータと、前記インバータの出力の一
部を入力してその出力を前記インバータの入力端に入力
して正帰還をかける付加の０ＭＯ８型インバータと全含
んで構成される。
次ＶｃＸ発明の実施例について図面を用いて説明する。
第３因は本発明の一実施例のブロック図である。
バス線１は出力インバータ２．２′により駆動され、集
積回路１０．１０’の信号は集積回路１１０入カインバ
ータ３ＦＣ入力される。この発明では、帰還インバータ
５を追加し、入力インバータ３の出力の一部が＃還イン
バータ５１Ｃ入力され、帰還インバータ５の出力が入力
インバータ３ｉＣ入力されるように接続することにより
入力回路を構成する。
積回路１０．１０’の信号は集積回路１１０入カインバ
ータ３ＦＣ入力される。この発明では、帰還インバータ
５を追加し、入力インバータ３の出力の一部が＃還イン
バータ５１Ｃ入力され、帰還インバータ５の出力が入力
インバータ３ｉＣ入力されるように接続することにより
入力回路を構成する。
次に、この実施例の動作について説明する。まず、集積
回路（以下ＩＣと記す）１０もしくに１０′の情報をＩ
ＣＩＩに伝達する場合を考える。
回路（以下ＩＣと記す）１０もしくに１０′の情報をＩ
ＣＩＩに伝達する場合を考える。
出力インバータ２あるいは２′がバス線１を駆動してそ
の電位（情報）を入力インバータ３が蛍信してＩＣＩＩ
内に取込む。この時、出力インバータ２もしくは２′と
帰還インバータ５との競合駆動が生じるが、出力インバ
ータ２もしくは２′の駆動能力を帰還インバータ５のそ
れ工９も数倍大きくしておけば、上記競合が生じても必
ず出力インバータ２もしくは２′の駆動能力が優り、Ｉ
Ｃ１Ｏあるいは１０′の情報が正しく伝達される。
の電位（情報）を入力インバータ３が蛍信してＩＣＩＩ
内に取込む。この時、出力インバータ２もしくは２′と
帰還インバータ５との競合駆動が生じるが、出力インバ
ータ２もしくは２′の駆動能力を帰還インバータ５のそ
れ工９も数倍大きくしておけば、上記競合が生じても必
ず出力インバータ２もしくは２′の駆動能力が優り、Ｉ
Ｃ１Ｏあるいは１０′の情報が正しく伝達される。
この競合駆動は正帰還ループにより一瞬のうちに終り、
帰還インバータ５の出力電位と出力インバータ２もしく
は２′の出力電位は共に同じになるため、定常的な直流
電流が流れることはない０従って＃還インバータ５の付
加ＩＣ，Ｃる消費電力の増加はない。
帰還インバータ５の出力電位と出力インバータ２もしく
は２′の出力電位は共に同じになるため、定常的な直流
電流が流れることはない０従って＃還インバータ５の付
加ＩＣ，Ｃる消費電力の増加はない。
次に、出力インバータ２及び２′が共に駆動を停止した
場合、部ち一般に云う筒インピーダンスＩｃなろうとし
た場合分考える０この時には、出力インバータ３と帰還
インバータ５とで構成される正帰還の保持回路に高イン
ピーダンス直前の伝達情報が保持されており、その内容
が帰還インノく一タ５全通してパス＃ｌｌＣ出力される
。従って、出力インバータ２，２′が共に駆動を停止し
てもノ（ス線１μ昼インピーダンス状態にはならずに電
位が確定される。従って、入力インバータ３０入力はゲ
ートフローティングには決してならず誤動作を生じない
。
場合、部ち一般に云う筒インピーダンスＩｃなろうとし
た場合分考える０この時には、出力インバータ３と帰還
インバータ５とで構成される正帰還の保持回路に高イン
ピーダンス直前の伝達情報が保持されており、その内容
が帰還インノく一タ５全通してパス＃ｌｌＣ出力される
。従って、出力インバータ２，２′が共に駆動を停止し
てもノ（ス線１μ昼インピーダンス状態にはならずに電
位が確定される。従って、入力インバータ３０入力はゲ
ートフローティングには決してならず誤動作を生じない
。
以上詳細に説明したように、本発明によれば、プルアッ
プ抵抗を使用せず、定常的な直＃ＬＴＩＬ流が流れるこ
となくバス線のレベルを確定できるＣＭＯ８型集績回路
の入力回路が得られるのでその効果は大きい。
プ抵抗を使用せず、定常的な直＃ＬＴＩＬ流が流れるこ
となくバス線のレベルを確定できるＣＭＯ８型集績回路
の入力回路が得られるのでその効果は大きい。
第１図は従来の集積回路の入力回路の一例のブロック図
、第２図は従来の集積回路の入力回路の他の例のブロッ
ク図、第３図はＸ発明の一実施例のブロック図である。 １・・・・・・バス線、２，２’・・・・・・出力イン
バータ、３・・・・・・入力インバータ、４・・・・・
・プルアップ抵抗、５・・・・・・焔還インバータ、１
０．１０’ 、１１・・・・・・集積回路。
、第２図は従来の集積回路の入力回路の他の例のブロッ
ク図、第３図はＸ発明の一実施例のブロック図である。 １・・・・・・バス線、２，２’・・・・・・出力イン
バータ、３・・・・・・入力インバータ、４・・・・・
・プルアップ抵抗、５・・・・・・焔還インバータ、１
０．１０’ 、１１・・・・・・集積回路。
Claims (1)
- バス線１ｃ接続して外部信号を内部回路へ伝達する少く
とも１つの０ＭＯ８型インバータと、前記インバータと
、前記インバータの出力の一部ケ入力してその出力ｋ
Ｍ ｇｄインバータの入力端に入力して正帰還をかける
付加のＣＩＶＩＩ ＯＳ型インバータとを含むこと全特
徴とするＣＭＯ８型集槓回路の入力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23175382A JPS59121420A (ja) | 1982-12-27 | 1982-12-27 | Ｃｍｏｓ型集積回路の入力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23175382A JPS59121420A (ja) | 1982-12-27 | 1982-12-27 | Ｃｍｏｓ型集積回路の入力回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59121420A true JPS59121420A (ja) | 1984-07-13 |
| JPS6312287B2 JPS6312287B2 (ja) | 1988-03-18 |
Family
ID=16928490
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23175382A Granted JPS59121420A (ja) | 1982-12-27 | 1982-12-27 | Ｃｍｏｓ型集積回路の入力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59121420A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0292625A1 (en) * | 1986-03-07 | 1988-11-30 | The Singer Company | Level clamp for three-state CMOS bus structure |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5750032A (en) * | 1980-09-09 | 1982-03-24 | Matsushita Electric Ind Co Ltd | Integrated circuit |
| JPS592409A (ja) * | 1982-06-28 | 1984-01-09 | Fujitsu Ltd | 帰還型ラツチ付入力回路 |
-
1982
- 1982-12-27 JP JP23175382A patent/JPS59121420A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5750032A (en) * | 1980-09-09 | 1982-03-24 | Matsushita Electric Ind Co Ltd | Integrated circuit |
| JPS592409A (ja) * | 1982-06-28 | 1984-01-09 | Fujitsu Ltd | 帰還型ラツチ付入力回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0292625A1 (en) * | 1986-03-07 | 1988-11-30 | The Singer Company | Level clamp for three-state CMOS bus structure |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6312287B2 (ja) | 1988-03-18 |
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