JPS5911946B2 - Operation specification method - Google Patents

Operation specification method

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JPS5911946B2
JPS5911946B2 JP11510275A JP11510275A JPS5911946B2 JP S5911946 B2 JPS5911946 B2 JP S5911946B2 JP 11510275 A JP11510275 A JP 11510275A JP 11510275 A JP11510275 A JP 11510275A JP S5911946 B2 JPS5911946 B2 JP S5911946B2
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JP
Japan
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calculation
function
key
functions
address
Prior art date
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JP11510275A
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Japanese (ja)
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JPS5238858A (en
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将之 羽方
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KASHIO KEISANKI KK
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KASHIO KEISANKI KK
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Description

【発明の詳細な説明】 この発明は複数種類の演算機能を有する電子式卓上計算
機に於いて、演算機能を選択的に切換え指定し、且つ実
行し得るようにした演算指定方式に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an operation designation method that enables selective switching and designation of arithmetic functions in an electronic desktop calculator having a plurality of types of arithmetic functions.

最近、単なる四則演算機能に加えて各種の演算機能、例
えば開平計算、n乗計算、正角函数計算、あるいは期間
計算、期日計算、利率計算等の演算機能を有する電子式
卓上計算機が開発され、実用化されている。
Recently, electronic desktop calculators have been developed that have various arithmetic functions such as square root calculation, n-th power calculation, conformal function calculation, period calculation, due date calculation, and interest rate calculation in addition to the simple four arithmetic calculation functions. It has been put into practical use.

この種の電子式卓上計算機に於いて、各種の演算機能を
選択指定し且つ実行させるための演算指定方式は、例え
ば演算機能の実行を指令するファンクションキーを、演
算機能の種類の数と同数設けて、1つの演算機能と1つ
のファンクションキーとを夫々対応させたものがある。
In this type of electronic desktop calculator, the calculation specification method for selecting and specifying various calculation functions and executing them is, for example, by providing the same number of function keys as the number of types of calculation functions. In some cases, one arithmetic function corresponds to one function key.

このようなものにあつては、演算機能の増加に伴いファ
ンクションキーの数も厖大なものとなるので、形状が極
めて大型化すると共にキー操作時の誤操作率も高くなり
、又価格的にも高価なものにならざるを得ない。又他の
演算指定方式としては、2つの実行すべき演算機能を1
つのファンクションキーに対応させ、2つの演算機能の
うちどちらの演算機能を選、択するかを指定する例えば
「エキストラ」キーを設け、ファンクションキーが押圧
操作される前に「エキストラ」キーが押圧操作されたか
否かによつてファンクションキーの演算機能の二者択一
、即ち選択が行われる、所謂ダブルフアンクシヨンフ
方式が開発されている。
In such devices, the number of function keys increases as the number of calculation functions increases, resulting in extremely large shapes, a high probability of incorrect key operations, and high prices. It has to become something. Another method for specifying calculations is to specify two calculation functions to be executed in one
For example, an "extra" key is provided, and the "extra" key is pressed before the function key is pressed. This is a so-called double function function in which the function key is selected depending on whether the function key is pressed or not.
A method has been developed.

しかしこの方式に於いても、1つのファンクションキー
に対応し得る演算機能の種類は2種類に限定されるので
、演算機能の種類が増加するとファンクションキーの数
も増加せざるを得ず、又1つのファンクションキーを5
押圧操作する時、必らず「エキストラ」キーを事前に
押圧操作すべきか否かの注意を払わねばならない等の欠
点を有している。ク この発明は上記の点に鑑みてなされたもので、実行すべ
き演算機能を予め選択的に切換え指定し、その演算機能
の実行開始を指令するためには、すべての演算機能に共
通な単一の共通フアンクシヨンキ一を操作するだけで実
行開始を可能にすることにより、演算を実行させる操作
を極めて単純化でき、誤操作の少ない、小型化可能な演
算指定方式を提供するものである。
However, even in this method, the types of calculation functions that can correspond to one function key are limited to two types, so as the types of calculation functions increase, the number of function keys must also increase. 5 function keys
This method has drawbacks such as the need to pay attention to whether or not to press the "extra" key before pressing the "extra" key. This invention has been made in view of the above points, and in order to selectively switch and designate the arithmetic function to be executed in advance and to command the start of execution of the arithmetic function, it is necessary to use a common function for all the arithmetic functions. By making it possible to start execution simply by operating one common function key, the operation for executing an operation can be extremely simplified, and an operation specification method that can be made smaller and less prone to erroneous operations is provided.

以下この発明の一実施例を図面を参照して説明する。An embodiment of the present invention will be described below with reference to the drawings.

1は例えば6進のカウンタ回路で、このカウンタ回路1
は後述する制御ユニツト10から供給されるクロツクパ
ルス信号を計数し、その計数値を3ビツト構成で出力す
る。
1 is a hexadecimal counter circuit, for example, and this counter circuit 1
counts clock pulse signals supplied from a control unit 10, which will be described later, and outputs the counted value in a 3-bit configuration.

2はデコーダ回路で、このデコーダ回路2にはカウンタ
回路1の計数値出力信号が供給され、その出力端子21
,22,23・・・26から走査信号Sl,S2・・・
S6がカウンタ回路1の計数値に対応して順次得られる
ように構成されている。
2 is a decoder circuit, the count value output signal of the counter circuit 1 is supplied to this decoder circuit 2, and its output terminal 21
, 22, 23...26 to scan signals Sl, S2...
It is configured such that S6 is obtained sequentially in accordance with the count value of the counter circuit 1.

3は演算選択部で、この演算選択部3は電子式卓上計算
機のキーボード上に設けられた例えばスライドスイツチ
で構成され、その固定接点31,32・・・36に対応
するキーボード上の夫々の位置には演算機能を示す文字
・記号等が印されており、例えば固定接点31にはn乗
計算を示す「An」が印され、固定接点32には期日計
算を示す「DATE]等が印され、固定接点33には開
平計算を示す「f]等が印され、他の固定接点にも必要
な文字・記号等が印されている。
Reference numeral 3 denotes an operation selection section, and this operation selection section 3 is composed of, for example, a slide switch provided on the keyboard of an electronic desk calculator, and the respective positions on the keyboard corresponding to the fixed contacts 31, 32, . . . , 36 are are marked with characters, symbols, etc. indicating calculation functions; for example, the fixed contact 31 is marked with "An" indicating n-th power calculation, and the fixed contact 32 is marked with "DATE" etc. indicating date calculation. , the fixed contact 33 is marked with a mark such as "f" indicating square root calculation, and the other fixed contacts are also marked with necessary characters, symbols, etc.

そしてこれら各固定接点31,32・・・36は、デコ
ーダ回路2の出力端子2,,22・・・26から走査信
号Sl,S2・・・S6が夫々供給されており、これに
よつて各固定接点3,,32・・・36はカウンタ回路
1の各計数値1,2,・・・6と夫々対応するようにな
つている。37は可動接点で、この可動接点37を所望
の固定接点位置にセツトすることにより演算機能の選択
指定操作を行うようになつている。
These fixed contacts 31, 32...36 are supplied with scanning signals Sl, S2...S6 from the output terminals 2, 22...26 of the decoder circuit 2, respectively. The fixed contacts 3, 32, . . . , 36 correspond to the respective counts 1, 2, . . . , 6 of the counter circuit 1, respectively. Reference numeral 37 denotes a movable contact, and by setting the movable contact 37 at a desired fixed contact position, an operation for selecting and specifying an arithmetic function is performed.

即ち可動接点37には、セツトされた固定接点の演算機
能に対応する走査信号が供給される。41,42,43
はアンドゲートで、これらのアンドゲート41,42,
43にはカウンタ回路1の各計数値を構成するビツト信
号及び可動接点37を介して得られるデコーダ回路2か
らの走査信号が供給されると共に、前記キーボード上に
設けられた「S」キー5から得られる、演算の実行開始
を指令するためのスタート信号が供給される。
That is, the movable contact 37 is supplied with a scanning signal corresponding to the calculation function of the set fixed contact. 41, 42, 43
is an and gate, and these AND gates 41, 42,
43 is supplied with bit signals constituting each count value of the counter circuit 1 and a scanning signal from the decoder circuit 2 obtained via the movable contact 37. The obtained start signal for instructing the start of execution of the calculation is supplied.

アンドゲート41,42,43からの出力信号はアドレ
スデコーダ6に供給され、アドレスデコーダ6はアンド
ゲート41,42,43からの出力信号をアドレス信号
に変換してアドレスレジスタ7に供給する。8は各種の
演算機能を実行するためのプログラムを固定的に記憶す
るプログラム固定記憶装置(以下これをROMユニツト
と呼ぶ)で、このROMユニツト8には、固定接点21
,22・・・26に示された演算機能を実行するための
プログラムが、各固定接点に対応したカウンタ回路1の
計数値を夫々スタートアドレスとする位置に記憶されて
いる。
The output signals from the AND gates 41 , 42 , 43 are supplied to an address decoder 6 , and the address decoder 6 converts the output signals from the AND gates 41 , 42 , 43 into address signals and supplies them to the address register 7 . Reference numeral 8 denotes a fixed program storage device (hereinafter referred to as a ROM unit) that permanently stores programs for executing various arithmetic functions.
, 22, . . . , 26 are stored at positions whose start addresses are the count values of the counter circuit 1 corresponding to the respective fixed contacts.

ROMユニツト8はアドレスレジスタ7からアドレス信
号が供給されると、そのアドレス信号によつて指定され
たアドレス内に記憶されている命令(1ステツプの命令
)をインストラクシヨンレジスタ9に読み出す。10の
制御ユニツトで、この制御ユニツト10は、インストラ
クシヨンレジスタ9内の命令を解読し、各種の演算を行
う演算ユニツト11に対して、インストラクシヨンレジ
スタ9に記憶されている命令を実行するに必要な制御信
号を発生する。
When the ROM unit 8 is supplied with an address signal from the address register 7, it reads into the instruction register 9 the instruction (one-step instruction) stored within the address specified by the address signal. This control unit 10 decodes the instructions in the instruction register 9 and executes the instructions stored in the instruction register 9 to the arithmetic unit 11 that performs various operations. generates the necessary control signals.

又制御ユニツト10は次ぎのステツプの命令を実行する
ために、アドレスレジスタ7に対してインクリメント信
号等を供給してROMユニツト8のアドレスを更新する
。制御ユニツト10はROMユニツト8からのプログラ
ムによつて制御信号を発生するだけでなく、通常の電子
式卓上計算機と同一の各種のフアンクシヨンキ一部12
からの信号によつても制御信号を発生し、又演算ユニツ
ト11には数値入力部13により演算に必要な数値情報
が入力される。
The control unit 10 also updates the address of the ROM unit 8 by supplying an increment signal etc. to the address register 7 in order to execute the next step instruction. The control unit 10 not only generates control signals according to the program from the ROM unit 8, but also generates various functions 12 that are the same as those of a normal electronic desktop calculator.
A control signal is also generated by a signal from the computer, and numerical information necessary for calculation is input to the calculation unit 11 through a numerical input section 13.

これら制御ユニツト10、演算ユニツ口1、フアンクシ
ヨンキ一部12、数値入力部13等は全く通常の技術に
より構成されるので詳細な説明を省く。以上のような構
成から成るこの実施例の動作を、開平計算、例えば/「
の計算を例として説明する。
These control unit 10, arithmetic unit port 1, function key part 12, numerical input part 13, etc. are constructed using completely conventional techniques, and detailed explanations thereof will be omitted. The operation of this embodiment with the above configuration can be performed using square root calculation, for example /
The calculation will be explained as an example.

先ず演算選択部3の可変接点37を開平計算に対応した
固定接点33にセツトする。これによりアンドゲート4
1,42,43には、カウンタ回路1からの計数値出力
信号に加えて、固定接点37を介して得られる走査信号
S3(この走査信号S3が得られるタイミングはカウン
タ回路1の計数値が″31のときである)が供給される
。次ぎに数値入力部13から数値゛5nを入力すると、
この数値゛51は演算ユニツト11に供給される。ここ
でSキー5を操作すると、Sキー5からの操作信号がア
ンドゲート41,42,43に供給されることとなり、
アンドゲート41,42,43は走査信号S3が得られ
たタイミングに於けるカウンタ回路1の計数値゛011
1(2進表示)をアドレスデコーダ6に供給する。従つ
てアドレスレジスタ7は、″0111に対応したアドレ
ス信号をROMユニツト8に供給して、開平計算を行う
ためのプログラムのスタートアドレスを指定する。この
スタートアドレス内に記憶されている1ステツプの命令
はインストラクシヨンレジスタ9に読み出された後、制
御ユニツ口0で解読されて演算ユニツ口1に制御信号が
供給される。制御ユニツト10は次ぎのステツプの命令
を実行するためアドレスレジスタ7にインクリメント信
号を供給し、ROMユニツト8の次ぎのアドレスを指定
する。このようにして開平計算のためのプログラムが演
算ユニツト11で順次実行され、Δの計算が行なわれる
。その演算結果は図示しない表示装置に送られて表示さ
れる。向上記した実施例では演算選択部3をスライドス
イツチとしたが、ロータリースイツチ等でも構成できる
ことは明らかであり、又この演算選択部3の固定接点の
数は演算機能の数に応じて任意に増減可能であり、又演
算機能の具体的内容も必要に応じて種々変更可能であり
、その他の回路構成もこの発明の要旨を逸脱しない範囲
で種々変形可能なこと勿論である。
First, the variable contact 37 of the calculation selection section 3 is set to the fixed contact 33 corresponding to the square root calculation. This allows AND gate 4
1, 42, and 43, in addition to the count value output signal from the counter circuit 1, a scanning signal S3 obtained via the fixed contact 37 (the timing at which this scanning signal S3 is obtained is determined by the count value of the counter circuit 1 is 31) is supplied.Next, when the numerical value ``5n'' is input from the numerical input section 13,
This numerical value "51" is supplied to the arithmetic unit 11. If the S key 5 is operated here, the operation signal from the S key 5 will be supplied to the AND gates 41, 42, and 43.
AND gates 41, 42, and 43 are the count value ゛011 of the counter circuit 1 at the timing when the scanning signal S3 is obtained.
1 (binary representation) is supplied to the address decoder 6. Therefore, the address register 7 supplies an address signal corresponding to "0111" to the ROM unit 8 to designate the start address of the program for performing square root calculation.The one-step instruction stored in this start address is read out to the instruction register 9, decoded by the control unit port 0, and a control signal is supplied to the arithmetic unit port 1.The control unit 10 reads the instruction to the address register 7 in order to execute the next step instruction. An increment signal is supplied to specify the next address in the ROM unit 8. In this way, the program for square root calculation is sequentially executed in the calculation unit 11, and the calculation of Δ is performed.The calculation result is displayed on a display (not shown). In the embodiment described above, the operation selection section 3 is a slide switch, but it is obvious that it can also be configured with a rotary switch, etc., and the number of fixed contacts of the operation selection section 3 is determined by The number of functions can be increased or decreased arbitrarily according to the number of functions, the specific contents of the calculation functions can be changed variously as necessary, and other circuit configurations can be variously modified without departing from the gist of the present invention. Of course.

本発明は以上詳細に説明したように、複数種類の演算機
能を有する電子式卓上計算機に、前記複数種類の演算機
能のうち、当該実行すべき演算機能を選択的に指定する
、例えばスライドスイツチから成る演算選択スイツチと
、該スイツチの切換え位置を検出するための演算機能の
種類に対応する値を計数する計数手段と、該計数手段の
内容をデコードしてタイミング信号を発生するデコード
手段と、演算機能に対する演算実行を指示するための単
一のキーとを設け、該キーが操作された際、前記演算選
択スイツチの切換え位置に対応するタイミングで前記計
数手段の計数内容を先頭アドレスとしてアドレス指定手
段に導入して選択された演算を実行するようにしたから
、演算の実行を開始する際の操作が極めて簡単となり、
誤操作が確実に防止できるとともに、簡単な回路構成で
実現でき、電子式卓上計算機の小型化にも寄与できるな
ど、種々の利点がある。
As explained in detail above, the present invention provides an electronic desktop calculator having multiple types of calculation functions, which selectively specifies the calculation function to be executed among the plurality of types of calculation functions, for example, from a slide switch. an arithmetic selection switch, a counting means for counting a value corresponding to the type of arithmetic function for detecting the switching position of the switch, a decoding means for decoding the contents of the counting means to generate a timing signal, and an arithmetic operation and a single key for instructing the execution of a calculation for a function, and when the key is operated, the counting contents of the counting means are set as a leading address at a timing corresponding to a switching position of the calculation selection switch, and addressing means is provided. Since the selected operation is executed by introducing the
It has various advantages, such as being able to reliably prevent erroneous operations, being implemented with a simple circuit configuration, and contributing to miniaturization of electronic desktop calculators.

【図面の簡単な説明】[Brief explanation of the drawing]

図は本発明の一実施例の全体の回路構成を示す回路系統
図である。 1・・・・・・カウンタ回路、3・・・・・・演算選択
部、5・・・・・・「S」キー、8・・・・・・ROM
ユニツト、10・・・・・・制御ユニツト。
The figure is a circuit system diagram showing the entire circuit configuration of an embodiment of the present invention. 1...Counter circuit, 3...Calculation selection section, 5..."S" key, 8...ROM
Unit, 10...Control unit.

Claims (1)

【特許請求の範囲】[Claims] 1 複数種類の演算機能を有する電子式卓上計算機に於
いて、前記複数種類の演算機能のうちの所望の演算機能
を選択的に切換える演算選択スイッチと、前記演算機能
の種類に対応する値を計数する計数手段と、該計数手段
の計数内容をデコードし計数内容に対応するタイミング
信号を発生し、該タイミング信号を前記演算選択スイッ
チに印加して切換え位置を検出するためのデコード手段
と、前記演算機能を実行するためのプログラムを記憶す
る記憶手段と、該記憶手段のアドレスを指定するための
アドレス指定手段と、該アドレス指定手段で指定された
記憶手段のプログラムを実行する演算手段と、前記演算
機能に対する演算実行を指示するための単一のキーと、
該キーが操作された際、前記演算選択スイッチの切換え
位置に対応するタイミングで前記計数手段の計数内容を
前記アドレス指定手段に入力しアドレスを設定する手段
とを具備し、前記演算選択スイッチによつて選択された
演算機能を前記キーの操作により実行することを特徴と
する演算指定方式。
1. In an electronic desktop calculator having multiple types of calculation functions, a calculation selection switch that selectively switches a desired calculation function among the plurality of types of calculation functions, and a calculation function that counts a value corresponding to the type of calculation function. a decoding means for decoding the counting contents of the counting means to generate a timing signal corresponding to the counting contents and applying the timing signal to the calculation selection switch to detect a switching position; A storage means for storing a program for executing a function, an addressing means for specifying an address of the storage means, an arithmetic means for executing a program of the storage means designated by the addressing means, and the arithmetic operation. a single key for instructing the execution of calculations for functions;
means for inputting the counted contents of the counting means into the addressing means at a timing corresponding to the switching position of the calculation selection switch when the key is operated, and setting the address by the calculation selection switch. An operation specification method characterized in that the operation function selected by the key is executed by operating the key.
JP11510275A 1975-09-23 1975-09-23 Operation specification method Expired JPS5911946B2 (en)

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Publication Number Publication Date
JPS5238858A JPS5238858A (en) 1977-03-25
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