JPS59112363U - パルス信号成形回路 - Google Patents

パルス信号成形回路

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Publication number
JPS59112363U
JPS59112363U JP497083U JP497083U JPS59112363U JP S59112363 U JPS59112363 U JP S59112363U JP 497083 U JP497083 U JP 497083U JP 497083 U JP497083 U JP 497083U JP S59112363 U JPS59112363 U JP S59112363U
Authority
JP
Japan
Prior art keywords
transistor
output terminal
pulse signal
shaping circuit
resistor
Prior art date
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Pending
Application number
JP497083U
Other languages
English (en)
Inventor
勇 金田
阿部　良三
桜井　正樹
遊佐　康弘
Original Assignee
日本ビクター株式会社
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Filing date
Publication date
Application filed by 日本ビクター株式会社 filed Critical 日本ビクター株式会社
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Publication of JPS59112363U publication Critical patent/JPS59112363U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本出願人が先に提案した円盤状情報記録媒体再
生装置の要部のブロック系統図、第２図Ａ−Ｃは第１図
示の装置において高速再生する場合に用いる信号の波形
図、第３図は第１図中制御回路の具体的回路で本出願人
が先に提案したパルス信号成形回路の回路図、第４図は
本考案回路の　　　゛一実施例の回路図である。 ７ｔ、　７２・・・パルス信号入力端子、７゜・・・パ
ルス信号出力端子、８．９・・・ＦＥＴ、　ｒ□ｓ　ｒ
２・・・内蔵抵抗、Ｒ１，Ｒ，・・・外付抵抗、Ｄ・・
・ダイオード、Ｖｃｃ・・・電源。

Claims (1)

    【実用新案登録請求の範囲】
  1. 互いに極性の異なるパルスで駆動される２つのトランジ
    スタの夫々の出力端を第１、第２の抵抗を夫、々介して
    電源に接続し、該トランジスタのうちの一方のトランジ
    スタの出力端を第３の抵抗を介して電源に、他方のトラ
    ンジスタの出力端を第４の抵抗を介して該一方のトラン
    ジスタの出力端に夫々接続し、該第３の抵抗と第４の抵
    抗との接続点により上記互いに極性の異なるパルスを合
    成した両極性をもつパルスを取出すパルス信号成形回路
    において、上記一方のトランジスタの出力端と、上記第
    ３の抵抗と第４の抵抗との接続点との間に、上記他方の
    トランジスタがオンの時、上記一方のトランジスタの出
    力端から上記他方のトランジスタの出力端に電源が流れ
    ない向きにダイオードを接続してなるパルス信号成形回
    路。
JP497083U 1983-01-18 1983-01-18 パルス信号成形回路 Pending JPS59112363U (ja)

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JP497083U JPS59112363U (ja) 1983-01-18 1983-01-18 パルス信号成形回路

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JPS59112363U true JPS59112363U (ja) 1984-07-28

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ID=30136566

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