JPS59103589U - ゲ−ト補助タ−ンオフサイリスタのゲ−ト制御装置 - Google Patents

ゲ−ト補助タ−ンオフサイリスタのゲ−ト制御装置

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Publication number
JPS59103589U
JPS59103589U JP19755182U JP19755182U JPS59103589U JP S59103589 U JPS59103589 U JP S59103589U JP 19755182 U JP19755182 U JP 19755182U JP 19755182 U JP19755182 U JP 19755182U JP S59103589 U JPS59103589 U JP S59103589U
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JP
Japan
Prior art keywords
gate
thyristor
control device
auxiliary turn
gate control
Prior art date
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Pending
Application number
JP19755182U
Other languages
English (en)
Inventor
湯谷　俊一
Original Assignee
三菱電機株式会社
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Publication date
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Priority to JP19755182U priority Critical patent/JPS59103589U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はゲート補助ターンオフサイリスタを用いたチョ
ッパ装置の回路図、第２図及び第３図は波形タイムチャ
ート、第４図はこの考案によるゲート補助ターンオフサ
イリスタのゲート制御装置の実施例を示すブロック図、
第５図は上記実施例−の具体的ブロック図、第６図は上
記実施例における各相液形のタイムチャートである。 図において、８・・・オンゲート信号発生器、１１・・
・電圧変成器、１２０・・・演算増巾器、１２１・・・
比較器、１２２・・・ワンショットマルチバイブレータ
、１２３・・・ゲート素子、１２４・・・オフゲート信
号発生器、１２５・・・オンゲート信号発生器。なお、
図中、同一符号は同−又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. ゲート補助ターンオフサイリスタの転流回路に挿入され
    た転流コンデンサに対して並列に電圧変成器を接続する
    と共に該電圧変成器の出力が負から正へ零点を通過する
    時点を検出する比較器を設け、この比較器の出力を用５
    てオフゲート信号発生器を駆動させることを特徴とする
    ゲート補助ターンオフサイリスタのゲート制御装置。
JP19755182U 1982-12-27 1982-12-27 ゲ−ト補助タ−ンオフサイリスタのゲ−ト制御装置 Pending JPS59103589U (ja)

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JP19755182U JPS59103589U (ja) 1982-12-27 1982-12-27 ゲ−ト補助タ−ンオフサイリスタのゲ−ト制御装置

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JP19755182U JPS59103589U (ja) 1982-12-27 1982-12-27 ゲ−ト補助タ−ンオフサイリスタのゲ−ト制御装置

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JPS59103589U true JPS59103589U (ja) 1984-07-12

Family

ID=30422964

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JP19755182U Pending JPS59103589U (ja) 1982-12-27 1982-12-27 ゲ−ト補助タ−ンオフサイリスタのゲ−ト制御装置

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