JPS5839616U - 突入電流抑制回路 - Google Patents

突入電流抑制回路

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Publication number
JPS5839616U
JPS5839616U JP13277981U JP13277981U JPS5839616U JP S5839616 U JPS5839616 U JP S5839616U JP 13277981 U JP13277981 U JP 13277981U JP 13277981 U JP13277981 U JP 13277981U JP S5839616 U JPS5839616 U JP S5839616U
Authority
JP
Japan
Prior art keywords
inrush current
pair
suppression circuit
current suppression
transistor
Prior art date
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Pending
Application number
JP13277981U
Other languages
English (en)
Inventor
英次 藤原
Original Assignee
日本電気株式会社
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Publication date
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Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図及び第２図はそれぞれ従来の突入電流抑制回路を
示す回路図、第３図は本考案の一実施例による突入電流
抑制回路を示す回路図である。　　　１・・・直流電源
、２・・・電源スィッチ、３・・・コンデンサ、４・・
・抵抗器、５・・・コンデンサ入力形の電源装置（負荷
）、６・・・継電器、７・・・サイリスタ、８　　”・
・・抵抗器、９・・・コンデンサ、１０・・・トランジ
スタ、１１・・・抵抗器、ＩＮｌ及び■Ｎ２・・・突入
電流抑制回路の一対の入力端子、ＯＵＴ、及び０ＵＴ２
・・・突入電流抑制回路の一対の出力端子。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力電源に接続される一対の入力端子と負荷に接続され
    る一対の出力端子とを有し、上記入力電源投入時の上記
    負荷への過大突入電流を抑制する突入電流抑制回路にお
    いて、上記一対の入力端子の一方にエミッタを接続され
    かつ上記一対の出力端子の一方にコレクタを接続された
    トランジスタと、上記一対の入力端子の他方と上記一対
    の出力端子の他方との間を接続する接続線と上記トラン
    ジスタのベースとの間に接続された抵抗とを有すること
    を特徴とする突入電流抑制回路。
JP13277981U 1981-09-07 1981-09-07 突入電流抑制回路 Pending JPS5839616U (ja)

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JP13277981U JPS5839616U (ja) 1981-09-07 1981-09-07 突入電流抑制回路

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JP13277981U JPS5839616U (ja) 1981-09-07 1981-09-07 突入電流抑制回路

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JPS5839616U true JPS5839616U (ja) 1983-03-15

Family

ID=29926288

Family Applications (1)

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JP13277981U Pending JPS5839616U (ja) 1981-09-07 1981-09-07 突入電流抑制回路

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0370024U (ja) * 1989-11-13 1991-07-12
JP2010250650A (ja) * 2009-04-17 2010-11-04 Seiko Epson Corp 定電圧供給装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5582318A (en) * 1978-12-15 1980-06-21 Matsushita Electric Ind Co Ltd Regulated power supply circuit

Patent Citations (1)

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