JPS5823398A - メモリ内容保護機構付マイクロコンピュ−タ - Google Patents
メモリ内容保護機構付マイクロコンピュ−タInfo
- Publication number
- JPS5823398A JPS5823398A JP56121326A JP12132681A JPS5823398A JP S5823398 A JPS5823398 A JP S5823398A JP 56121326 A JP56121326 A JP 56121326A JP 12132681 A JP12132681 A JP 12132681A JP S5823398 A JPS5823398 A JP S5823398A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- read
- data
- damp
- contents
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C7/00—Arrangements for writing information into, or reading information out from, a digital store
- G11C7/24—Memory cell safety or protection circuits, e.g. arrangements for preventing inadvertent reading or writing; Status cells; Test cells
Landscapes
- Storage Device Security (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本尭明は、内蔵するＲＯＭ（読み出し専用メモリ）等に
格納された情報のダンプを禁止する機構を有するマイタ
ルコンビ龜−夕に８１スル。
格納された情報のダンプを禁止する機構を有するマイタ
ルコンビ龜−夕に８１スル。
ｉイタ胃コンビ凰−夕に内蔵されるＲＯＭにはプＷグラ
ム中データが格納されているが、これらのプＷダラムや
データが第３者に知られると、該マイタ讐コンビ風−夕
を使用し喪製品例えばテレビゲーム等か模倣される恐れ
があるＯでＲＯＭ内容の機密保■は極めて重大な意味含
有する。一方、マイタＷＸンビ凰−夕の動作試験あるい
は内蒙プ四グラムのデバッグのえめに指定された番地の
ＲＯＭ内容を出力するデータダンプ機構は必１［０もの
と１れて−ゐ。
ム中データが格納されているが、これらのプＷダラムや
データが第３者に知られると、該マイタ讐コンビ風−夕
を使用し喪製品例えばテレビゲーム等か模倣される恐れ
があるＯでＲＯＭ内容の機密保■は極めて重大な意味含
有する。一方、マイタＷＸンビ凰−夕の動作試験あるい
は内蒙プ四グラムのデバッグのえめに指定された番地の
ＲＯＭ内容を出力するデータダンプ機構は必１［０もの
と１れて−ゐ。
従来−！イタｗ：Ｉンビ島−夕には特に上述のデータダ
ンプ機構の動作を禁止する手段が設けられておらず、し
たが）で、当事者以外の者がマイタ田コンビ畠−夕のソ
ツ）會エアを知ることが可能であう大丸め、蒙！イタ璽
フンビエータを使用した部品が直ちに模倣されるという
不部会があった。
ンプ機構の動作を禁止する手段が設けられておらず、し
たが）で、当事者以外の者がマイタ田コンビ畠−夕のソ
ツ）會エアを知ることが可能であう大丸め、蒙！イタ璽
フンビエータを使用した部品が直ちに模倣されるという
不部会があった。
本出願人は、前述の従来法における間一点を解決す為た
めに、１ナップマイタリコンビ島−夕にデータダンプ禁
止機構（読出し禁止機−を設けたメモり内容１ｌＩＩ機
構付マイ？ロコンビエータを既に提案し九（特ｌｌ＠第
５６−４５６２５号）。このマイタｗ：Ｉンビ島−＃に
よれば、動作試験あるいは内蔵プログラムのデバッグが
終了してデータのダンプが不要に＊−ｊ九時点でデータ
Ｏダンプを禁止することが可能と傘〉、マイク田コンビ
轟−タを使用し九−品が模倣されゐことは紡止噛れる。
めに、１ナップマイタリコンビ島−夕にデータダンプ禁
止機構（読出し禁止機−を設けたメモり内容１ｌＩＩ機
構付マイ？ロコンビエータを既に提案し九（特ｌｌ＠第
５６−４５６２５号）。このマイタｗ：Ｉンビ島−＃に
よれば、動作試験あるいは内蔵プログラムのデバッグが
終了してデータのダンプが不要に＊−ｊ九時点でデータ
Ｏダンプを禁止することが可能と傘〉、マイク田コンビ
轟−タを使用し九−品が模倣されゐことは紡止噛れる。
本＊＠０主九る目的は、前述のデータダンプ機構機構を
Ｐ翼ＯＭ（書込み可能請出し専用メモ９）を１ＩＩｖｈ
て構成する仁とＫｌる。
Ｐ翼ＯＭ（書込み可能請出し専用メモ９）を１ＩＩｖｈ
て構成する仁とＫｌる。
本ａ＠０倫０ｌｆＩＩ／ＩＦｉ、前述０１０ＭおよびＰ
ＲＯＭを紫外線照射によ）消去可能なＩＰＲＯＭ（消＊
および書込み可能奉読出し専用メモリ）を用いて構成す
ることＫある。
ＲＯＭを紫外線照射によ）消去可能なＩＰＲＯＭ（消＊
および書込み可能奉読出し専用メモリ）を用いて構成す
ることＫある。
デー＃およびプラダラム格納用のＲＯＭとデータダンプ
機構機構用ｏｐｖｔｏｙをｌＰＲＯＭで構成した揚台、
第５者がデータメンプ蒙止＃／Ａ構用の鳶デ’ＩＯＭｃ
Ｉ内容を書き替えることによりデータダンプ禁止機能を
破壊してＲＯＭに格納されているデータ★九はプログラ
ムを読出す危険性がある。
機構機構用ｏｐｖｔｏｙをｌＰＲＯＭで構成した揚台、
第５者がデータメンプ蒙止＃／Ａ構用の鳶デ’ＩＯＭｃ
Ｉ内容を書き替えることによりデータダンプ禁止機能を
破壊してＲＯＭに格納されているデータ★九はプログラ
ムを読出す危険性がある。
この危険１１Ｋかんがみ、本発ＷＩＩの更に他の目的は
、デーＪｌシよびプ冑グツム格納用のＩＣＰＲＯＭとデ
ータダンプ機構機構用０１ｅＰＲＯＭｔ−近接して配置
す石ことによシ、データダンプ禁止機構用の鵞ＰＩＯＨ
の内容を単独で清＊″ｅｌｌないようにし、第３者によ
るデー＃壕九はプログラムの読出し防止を確実化するこ
とにある。
、デーＪｌシよびプ冑グツム格納用のＩＣＰＲＯＭとデ
ータダンプ機構機構用０１ｅＰＲＯＭｔ−近接して配置
す石ことによシ、データダンプ禁止機構用の鵞ＰＩＯＨ
の内容を単独で清＊″ｅｌｌないようにし、第３者によ
るデー＃壕九はプログラムの読出し防止を確実化するこ
とにある。
以下、本発明の実施例を図１ｆｉｔ−用いて説明する。
嬉１■は本鶴嘴〇一実施例に係る１チップ！イタｗ】ン
ビ畠−夕を示す千ｗｍ”ｔ’ある。嬉１図にお−で、！
イタＷ″：Ｉンビ＆−＃ＩＫはプログラムやデー＃が格
納畜れ九ＩＩＯＭ（読出し専用メ４１）２、ＩＩＩ＄Ｌ
禁止機構であるメンブイ率−ブルッラグ３、中央処理装
置４、および１ムＭ（ツンダムーアタ七ス・メ４９）ｓ
が搭載されて％／％ゐ。
ビ畠−夕を示す千ｗｍ”ｔ’ある。嬉１図にお−で、！
イタＷ″：Ｉンビ＆−＃ＩＫはプログラムやデー＃が格
納畜れ九ＩＩＯＭ（読出し専用メ４１）２、ＩＩＩ＄Ｌ
禁止機構であるメンブイ率−ブルッラグ３、中央処理装
置４、および１ムＭ（ツンダムーアタ七ス・メ４９）ｓ
が搭載されて％／％ゐ。
１０Ｍ！シよびダンプイネーブルッッダ墨はそれぞれ１
傭しか図示されて％ｆｌｋいが、懐数傭搭載されてもよ
−。
傭しか図示されて％ｆｌｋいが、懐数傭搭載されてもよ
−。
ダンブイ率−プルッラダ５は後述の如（、ＰＲＯＭ番：
ｂｖｈは１ＦＲＯＭを眉−で構成されている。
ｂｖｈは１ＦＲＯＭを眉−で構成されている。
１０Ｍ２は！スタＢＯＭに限らず、ＰＩＯＭＴ。
るーは罵ＰＩＯＭであうてもよい。
１０Ｍ２およびメンブイ率−プルプラダ！ｉがそれぞれ
ＮＩＰ罵ＯＭで構成畜れてｉる揚台、メンブイボープル
ＮＯＭＰＲＯＭの内容Ｏみを紫外線照射によりて清★す
為ことによ、９．１０Ｍ２０内専を嬉基者が読出すこと
を防止す為丸めに、囮示の如（１０Ｍ２とメンプイネー
ブルブッダ墨は近接して配置されてダンブイ率−プルプ
ラグｓ内のＩＰＩＯＭＯ内容Ｏみを単独で消★で亀ない
ようＫｔりて−る。すなわち、ダンブイ率−プルフラグ
６内０１ＦＲＯＭＯ内容を紫外線照射によシ清資しよう
とすると％１０Ｍ２（ヒの場合やはシＩＦＲＯＭ）Ｋ％
影響を与え、ＲＯＭ２１１り内容〇一部ああいは全てが
同時に消＊されるので、ＲＯＭ２の内容を嬉墨者が読出
すこと社防止される。
ＮＩＰ罵ＯＭで構成畜れてｉる揚台、メンブイボープル
ＮＯＭＰＲＯＭの内容Ｏみを紫外線照射によりて清★す
為ことによ、９．１０Ｍ２０内専を嬉基者が読出すこと
を防止す為丸めに、囮示の如（１０Ｍ２とメンプイネー
ブルブッダ墨は近接して配置されてダンブイ率−プルプ
ラグｓ内のＩＰＩＯＭＯ内容Ｏみを単独で消★で亀ない
ようＫｔりて−る。すなわち、ダンブイ率−プルフラグ
６内０１ＦＲＯＭＯ内容を紫外線照射によシ清資しよう
とすると％１０Ｍ２（ヒの場合やはシＩＦＲＯＭ）Ｋ％
影響を与え、ＲＯＭ２１１り内容〇一部ああいは全てが
同時に消＊されるので、ＲＯＭ２の内容を嬉墨者が読出
すこと社防止される。
１Ｉ１２１１１は１１１ｍ１に示しえ凰Ｏ麗２およびメ
ングイ本−ブ＃７ラダ！！Ｏｗ１辺を概略的に示すプリ
ッタ線図でＴｏ号。第２１１において、凰ＯＭ２、各ピ
ッ）に対応する竜ンスアンプ６、メンプイネーブルツラ
ダ器、アントゲ−）７１３力／（ソファアンプ８および
出力端子９が＠されている。データ入力端子（図示せず
）から、ダンプすぺｌｋＲＯＭの単一〇ｖ−ド★たは所
窺範りｎＤＩｌ黴のワードを指定する・アドレス情報お
よびダンプ指令が入力されると、中央処理装置４（第１
図）の働ＩＫよｐ蒙アドレス情報ＫＮ応す、＆ワードの
ダンプが行なわれゐが一ζＯ場合、メンブイ本−プルフ
ラグ３０出力（１点）が低レベルの場合は各アンドゲー
ジ７が閉じられているため読み出し専ｊＩｙｔ％１２か
らＯダンプ出力Ｆｉ出力端子９に伝達されない６これに
対し、ダンブイ卑−プルフラグ３の出力点ｅが高レベル
Ｏ場合は冬アンドグー）７が開かれ、請み出し専喝メ令
９２から０ｗ４み出しデータはセンスアンプ遥から出力
パツツテアンプ８を経て出力端子９に一出力される。
ングイ本−ブ＃７ラダ！！Ｏｗ１辺を概略的に示すプリ
ッタ線図でＴｏ号。第２１１において、凰ＯＭ２、各ピ
ッ）に対応する竜ンスアンプ６、メンプイネーブルツラ
ダ器、アントゲ−）７１３力／（ソファアンプ８および
出力端子９が＠されている。データ入力端子（図示せず
）から、ダンプすぺｌｋＲＯＭの単一〇ｖ−ド★たは所
窺範りｎＤＩｌ黴のワードを指定する・アドレス情報お
よびダンプ指令が入力されると、中央処理装置４（第１
図）の働ＩＫよｐ蒙アドレス情報ＫＮ応す、＆ワードの
ダンプが行なわれゐが一ζＯ場合、メンブイ本−プルフ
ラグ３０出力（１点）が低レベルの場合は各アンドゲー
ジ７が閉じられているため読み出し専ｊＩｙｔ％１２か
らＯダンプ出力Ｆｉ出力端子９に伝達されない６これに
対し、ダンブイ卑−プルフラグ３の出力点ｅが高レベル
Ｏ場合は冬アンドグー）７が開かれ、請み出し専喝メ令
９２から０ｗ４み出しデータはセンスアンプ遥から出力
パツツテアンプ８を経て出力端子９に一出力される。
ダンブイ率−ブルツラダ５は例えば第３図のようＷｃｍ
；ｐｌＯＭｔ−用いて構成され、例えば１チャン本Ｎ形
ＯＦＡＭＯＩＩ（フローテインダゲー）φ７パランシエ
注入ｊ１ＭＯＩ））ランジス＃２０、Ｍｏ１）アンプＸ
＃２１，２２、！＞Ａ−１２５゜２４およびノアゲート
２５．２４’を具備するＯ第ｉｌｌＯｍｌ路において、
ダンプ指令に応じて）ランジスタ２１のゲーを信−ＩＲ
／Ｗが高レベルとなるが、ζＯと１１１ムＭ０８）ラン
ジスタ２０がオンしｃｓＰれｉ（１点の電位は低レベル
になｐ１ｂ点の電位は高レベルになる。インバー＃２４
およびノアゲー）２５．２４は内部璽ジッタとのレベル
合せを行なう九めＯ寞畠フラップフ田ツブ回路を構成し
、この場合Ｃ点の信号すなわちダンブイ車−プル儒号は
１点の電位に応じて高レベルとなるから前述の第２図０
１１１１におけるアンドゲージ７が開かれ、し九がって
ダンプ可能となる。ｔえ、ＦＡＭＯｌｌ）テンジスタ２
０がオフであれば１点の電位は高レベルになシ、シ九が
つて電点のダンブイ本−ブル信号は低レベルと攻シダン
プ不可能になる。したがって、ＦＡＸＯ８シランジスタ
２０に紫外線を照射すると、読み出し専用メモリ２（８
１図）がＦＡ旧ｌによるｌＰＲＯＭであればそＯ内容が
消＊されると同時にＦＡＭＯＩ）ランジス＃２０≠のし
きい値電圧がコン）Ｗ−ルゲー）に印加されている電圧
よ）低くなりて導通（オン）シ、ダンプ可能となる。し
たがりて、予め紫外線照射し九読み出し専用メ令す２に
必ｗ！なプ胃グテムおよびデータを書龜込み、動作ｓｇ
およびデバッグ等が終了してアンプの必要がなくなりえ
時点で、トランジスタ２１４Ｄゲー）信号鴨を低レベル
にして）ランジスタ２１を伸導通（オフ）Ｋしてか亀、
ＦＡＭＯＩ）ランジス＃２０のドレインに高電圧０１号
Ｗ１を印加することによ〉蒙１ムＭｏ１）ランジス＃２
０に書書込みを行ない＠ｙムＭ０８シツンジスタ２０を
非導週にすゐ。これにより、１点は高レベルと１に砂、
し九がうてチップイ本−ブルフッグ墨の出力信号（・１
＃）紘低レベルと１に５てダンプが禁止される。
；ｐｌＯＭｔ−用いて構成され、例えば１チャン本Ｎ形
ＯＦＡＭＯＩＩ（フローテインダゲー）φ７パランシエ
注入ｊ１ＭＯＩ））ランジス＃２０、Ｍｏ１）アンプＸ
＃２１，２２、！＞Ａ−１２５゜２４およびノアゲート
２５．２４’を具備するＯ第ｉｌｌＯｍｌ路において、
ダンプ指令に応じて）ランジスタ２１のゲーを信−ＩＲ
／Ｗが高レベルとなるが、ζＯと１１１ムＭ０８）ラン
ジスタ２０がオンしｃｓＰれｉ（１点の電位は低レベル
になｐ１ｂ点の電位は高レベルになる。インバー＃２４
およびノアゲー）２５．２４は内部璽ジッタとのレベル
合せを行なう九めＯ寞畠フラップフ田ツブ回路を構成し
、この場合Ｃ点の信号すなわちダンブイ車−プル儒号は
１点の電位に応じて高レベルとなるから前述の第２図０
１１１１におけるアンドゲージ７が開かれ、し九がって
ダンプ可能となる。ｔえ、ＦＡＭＯｌｌ）テンジスタ２
０がオフであれば１点の電位は高レベルになシ、シ九が
つて電点のダンブイ本−ブル信号は低レベルと攻シダン
プ不可能になる。したがって、ＦＡＸＯ８シランジスタ
２０に紫外線を照射すると、読み出し専用メモリ２（８
１図）がＦＡ旧ｌによるｌＰＲＯＭであればそＯ内容が
消＊されると同時にＦＡＭＯＩ）ランジス＃２０≠のし
きい値電圧がコン）Ｗ−ルゲー）に印加されている電圧
よ）低くなりて導通（オン）シ、ダンプ可能となる。し
たがりて、予め紫外線照射し九読み出し専用メ令す２に
必ｗ！なプ胃グテムおよびデータを書龜込み、動作ｓｇ
およびデバッグ等が終了してアンプの必要がなくなりえ
時点で、トランジスタ２１４Ｄゲー）信号鴨を低レベル
にして）ランジスタ２１を伸導通（オフ）Ｋしてか亀、
ＦＡＭＯＩ）ランジス＃２０のドレインに高電圧０１号
Ｗ１を印加することによ〉蒙１ムＭｏ１）ランジス＃２
０に書書込みを行ない＠ｙムＭ０８シツンジスタ２０を
非導週にすゐ。これにより、１点は高レベルと１に砂、
し九がうてチップイ本−ブルフッグ墨の出力信号（・１
＃）紘低レベルと１に５てダンプが禁止される。
以上Ｏ説明から明らかなように、本発明によれば、デー
タダンプ機構Ｏ動作を禁止することがで暑るので・当時
者以外の者がメ４１内容を知ることはで自ず、！イタｗ
コンＩｉ’ａ−夕を用い一＊Ｉ！品Ｏ模倣は防止畜れゐ
。
タダンプ機構Ｏ動作を禁止することがで暑るので・当時
者以外の者がメ４１内容を知ることはで自ず、！イタｗ
コンＩｉ’ａ−夕を用い一＊Ｉ！品Ｏ模倣は防止畜れゐ
。
畜ｂｖｃ、デー＃およびプ冒グツム格納用のメ令すと請
出し禁止機構眉メ令りを共ＫＩＦＲＯＭとして、ナツプ
上に近接して配置しえことによシ鋺出し禁止機構用メ篭
りの内容のみの破壊を不可能にし、それによ〉上記模倣
の切土は確実化される。
出し禁止機構眉メ令りを共ＫＩＦＲＯＭとして、ナツプ
上に近接して配置しえことによシ鋺出し禁止機構用メ篭
りの内容のみの破壊を不可能にし、それによ〉上記模倣
の切土は確実化される。
第１図は本発明の一実施例に係る１チップマイタＷコン
ビ島−夕を示す平面図、第２図は第１図に示し九１０１
１２およびダンブイ率−プルフラグ３０周辺を概略的に
示すブ田ツタ纏図、そして第ＳＶａは嬉１図および第２
ＷＡＫ示し九メンブイネーブルフラグｓ０１例を示す藺
路図である。 １・・・ｉイタＷ：Ｉンビ纂−タ、２・−・読出し専用
メ毫り、ト・・メンブイ本−プルフラグ、４・・・中央
格塩装置、５・・・ランダム・アタセスーメモリ、６・
・・センスアンプ、７・・・アントゲ−）、８・・・出
力Ｉ＜ツファ、！・・・出力端子、２０・・・ＦＡＭＯ
Ｉ）ランジスタ、２１．２２・・・Ｍｏ８）ランジスタ
、２５゜２４・・・インバー責、２５．２６・−・ノア
グー４０時許巖緘人 富士通株式★社 特許出販代場人 弁理士 青水 朗 弁理士画舘和之 弁理士内田幸男 弁理士山口昭之
ビ島−夕を示す平面図、第２図は第１図に示し九１０１
１２およびダンブイ率−プルフラグ３０周辺を概略的に
示すブ田ツタ纏図、そして第ＳＶａは嬉１図および第２
ＷＡＫ示し九メンブイネーブルフラグｓ０１例を示す藺
路図である。 １・・・ｉイタＷ：Ｉンビ纂−タ、２・−・読出し専用
メ毫り、ト・・メンブイ本−プルフラグ、４・・・中央
格塩装置、５・・・ランダム・アタセスーメモリ、６・
・・センスアンプ、７・・・アントゲ−）、８・・・出
力Ｉ＜ツファ、！・・・出力端子、２０・・・ＦＡＭＯ
Ｉ）ランジスタ、２１．２２・・・Ｍｏ８）ランジスタ
、２５゜２４・・・インバー責、２５．２６・−・ノア
グー４０時許巖緘人 富士通株式★社 特許出販代場人 弁理士 青水 朗 弁理士画舘和之 弁理士内田幸男 弁理士山口昭之
Claims (1)
- 【特許請求の範囲】 ｔ プＷグチふ會九はデー＃會格納する少なくとも１つ
ＯＩＩ出し専用メモリ、蒙続出し専用メ啼すＯ内容を出
力するデータダンプ機構、および蒙データメンプ機構Ｏ
動作を禁止させる請出し禁止機構を＾備する！イタｍＷ
ンビ、−＃において、譲請出し禁止機構社会なくとも１
つの書込み可能読出し専用メ令りを用いて構成されたこ
とを特徴とするメ４９内容保■−構付！イクーコンビ凰
−タ・ ２ 蒙プ田ダラム可能読出し専用メ啼りは１ピツ）のデ
ータを格納するメ令すであることを特徴とする特許請京
Ｏ範囲＃ｌＫ１項記載のマイタ田コンビ島−夕。 工 蒙請轡し専用メ号９ｓＰよび該書込み可能読出し専
用メ毫９（Ｄ＋１ｋくとも１つは消去可能なメ篭りであ
ることを特徴とする特許請求の範囲第１項紀ｌ！Ｏマイ
クロコンビ＾−タ。 ４ 該続出し専用メモリおよび該書込み可能続出し専用
メ号９ＩＩｉ紫外線照射により消去可能なメ−％りであ
）、該書込み可能読出し専用メモリは該読出Ｕ専用メ毫
りの近傍に配置されて、それぞれ革独に消失できないよ
うにし九ことを特徴とする特許請求の１１１１１１１１
項記載のマイタＷ；ンビーータＯ
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56121326A JPS5823398A (ja) | 1981-08-04 | 1981-08-04 | メモリ内容保護機構付マイクロコンピュ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56121326A JPS5823398A (ja) | 1981-08-04 | 1981-08-04 | メモリ内容保護機構付マイクロコンピュ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5823398A true JPS5823398A (ja) | 1983-02-12 |
Family
ID=14808477
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56121326A Pending JPS5823398A (ja) | 1981-08-04 | 1981-08-04 | メモリ内容保護機構付マイクロコンピュ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5823398A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62211756A (ja) * | 1986-03-12 | 1987-09-17 | Casio Comput Co Ltd | Ｉｃカ−ドのテスト方式 |
| US5377343A (en) * | 1990-07-19 | 1994-12-27 | Kabushiki Kaisha Toshiba | Security circuit for protecting data stored in an internal memory of a microcomputer |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5674899A (en) * | 1979-11-20 | 1981-06-20 | Mitsubishi Electric Corp | Memory information protecting circuit |
-
1981
- 1981-08-04 JP JP56121326A patent/JPS5823398A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5674899A (en) * | 1979-11-20 | 1981-06-20 | Mitsubishi Electric Corp | Memory information protecting circuit |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62211756A (ja) * | 1986-03-12 | 1987-09-17 | Casio Comput Co Ltd | Ｉｃカ−ドのテスト方式 |
| US5377343A (en) * | 1990-07-19 | 1994-12-27 | Kabushiki Kaisha Toshiba | Security circuit for protecting data stored in an internal memory of a microcomputer |
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