JPS58173481A - 電子式タイマ - Google Patents
電子式タイマInfo
- Publication number
- JPS58173481A JPS58173481A JP5681782A JP5681782A JPS58173481A JP S58173481 A JPS58173481 A JP S58173481A JP 5681782 A JP5681782 A JP 5681782A JP 5681782 A JP5681782 A JP 5681782A JP S58173481 A JPS58173481 A JP S58173481A
- Authority
- JP
- Japan
- Prior art keywords
- block
- internal connection
- front surface
- group
- connection terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G04—HOROLOGY
- G04F—TIME-INTERVAL MEASURING
- G04F1/00—Apparatus which can be set and started to measure-off predetermined or adjustably-fixed time intervals without driving mechanisms, e.g. egg timers
- G04F1/005—Apparatus which can be set and started to measure-off predetermined or adjustably-fixed time intervals without driving mechanisms, e.g. egg timers using electronic timing, e.g. counting means
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/14—Structural association of two or more printed circuits
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Measurement Of Predetermined Time Intervals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は電子式タイマに関する。
従来の電子式タイマは、１個のハウジング内に収納さね
、仕様が興るごとに興る構造に設計され、製作されてい
たから、機種の種類か膨大化し、部品管理、生産工程等
が煩雑になるばかりでなく、生産計画、商品管理、商品
流通等も煩雑になる欠点があった。
、仕様が興るごとに興る構造に設計され、製作されてい
たから、機種の種類か膨大化し、部品管理、生産工程等
が煩雑になるばかりでなく、生産計画、商品管理、商品
流通等も煩雑になる欠点があった。
本発明の目的は、１記に鑑み、全体を第１゜第２及び第
３のブロックに分割構成することにより、可及的少い種
類のブロックの組合せにより仕様の □多様な変化に対
応しうる電子式タイマを提供することにある。
３のブロックに分割構成することにより、可及的少い種
類のブロックの組合せにより仕様の □多様な変化に対
応しうる電子式タイマを提供することにある。
本発明の第１ブロツクには端子部が内蔵され、第２ブロ
ツクとの間の電気的及び機械的結合状態が規定されてい
る。端子部の内容は例えはブレード端子形、ネジ端子形
、レール取付形、ピン形などであり、通常の端子数は８
Ｐである。いずれの内容のものであっても第２ブロツク
と着脱自在に連結して使用することができる。
ツクとの間の電気的及び機械的結合状態が規定されてい
る。端子部の内容は例えはブレード端子形、ネジ端子形
、レール取付形、ピン形などであり、通常の端子数は８
Ｐである。いずれの内容のものであっても第２ブロツク
と着脱自在に連結して使用することができる。
本発明の第２ブロツクには、電源回路と出力部が内蔵さ
れ、第１ブロツクと第３ブロツクの間の電気的及び機械
的結合状態が規定されている。ｌｌ電源回路２本の入力
線と２本の出力線をもつ４端子回路で構成され、その内
容は、例えば、交流入力をコンデンサにより電圧降下さ
せ、整流器で直流に整流し、平滑用コンデンサにより脈
流を平滑化するＣ−ドロップ形、交流又は直流入力を抵
抗器により電圧降下させ、整流器で整流し、コンデンサ
で平滑化するｈ−ドロップ形、安定化電源回路を備えた
定電圧形、トランスにより変圧したのち整流と平滑化を
行うトランス形などである。また、出力部は２本の入力
線とオン、オフ、コモンの３本の出力線をもつが、２本
の入力線のうちの１本を電源回路の出力線に内部接続す
る場合は、１１Ｌ３ブロツクに接続される端子数が１個
減少する。
れ、第１ブロツクと第３ブロツクの間の電気的及び機械
的結合状態が規定されている。ｌｌ電源回路２本の入力
線と２本の出力線をもつ４端子回路で構成され、その内
容は、例えば、交流入力をコンデンサにより電圧降下さ
せ、整流器で直流に整流し、平滑用コンデンサにより脈
流を平滑化するＣ−ドロップ形、交流又は直流入力を抵
抗器により電圧降下させ、整流器で整流し、コンデンサ
で平滑化するｈ−ドロップ形、安定化電源回路を備えた
定電圧形、トランスにより変圧したのち整流と平滑化を
行うトランス形などである。また、出力部は２本の入力
線とオン、オフ、コモンの３本の出力線をもつが、２本
の入力線のうちの１本を電源回路の出力線に内部接続す
る場合は、１１Ｌ３ブロツクに接続される端子数が１個
減少する。
その内容は、例えば、２本の入力線にリレーの励磁コイ
ルを接続しそのリレー接点を出力線に接続するリレー形
、入力１１にホトカプラの発光素子を接続しその受光素
子を出力線に接続するホトカプラ形、入力線に発光素子
を接続し、出力回路に光トリガ形サイリスタを接続した
サイリスタ形などがある。いずれの内容のものであって
も、第１ブロツク及び１！３ブロツクと着脱自在に連結
して使用することができる。
ルを接続しそのリレー接点を出力線に接続するリレー形
、入力１１にホトカプラの発光素子を接続しその受光素
子を出力線に接続するホトカプラ形、入力線に発光素子
を接続し、出力回路に光トリガ形サイリスタを接続した
サイリスタ形などがある。いずれの内容のものであって
も、第１ブロツク及び１！３ブロツクと着脱自在に連結
して使用することができる。
本発明の第３ブロツクには、制御回路と入力回路が内蔵
され、その制御回路と接続された表示部、設定部が前面
に配設され、第２ブロツクとの間の電気的及び機械的結
合状態か規定されている。制御回路の内容は、例えば、
コンデンサの充放１１に要する時定数を利用する（３−
Ｒ形タイマにおいてはＣ−Ｒ充放電回路であり、その場
合の表示部として発光ダイオードの１個又は複数個によ
るものがあり、設定部としては可変抵抗器によるアナロ
グ形設定回路がある。また、発振器と、その発振回路の
出力であるクロックパルスを計数するカウンタを備えた
デジタル形タイマに°おける制御回路は、発振器とカウ
ンタであり、そめ場合の表示部としては数字表示器によ
るものがあり、設定部としてはデジタル設定器又はキー
ボードがある。入力回路は制御回路の作動を開始させる
入力信号を与えるための回路で、外部端子に入力信号を
そのまま制御回路に伝達する回路と禁示する回路とがあ
る。いずれの内容のものであっても、第２ブロツクと着
脱自在に連結して使用することかできる。
され、その制御回路と接続された表示部、設定部が前面
に配設され、第２ブロツクとの間の電気的及び機械的結
合状態か規定されている。制御回路の内容は、例えば、
コンデンサの充放１１に要する時定数を利用する（３−
Ｒ形タイマにおいてはＣ−Ｒ充放電回路であり、その場
合の表示部として発光ダイオードの１個又は複数個によ
るものがあり、設定部としては可変抵抗器によるアナロ
グ形設定回路がある。また、発振器と、その発振回路の
出力であるクロックパルスを計数するカウンタを備えた
デジタル形タイマに°おける制御回路は、発振器とカウ
ンタであり、そめ場合の表示部としては数字表示器によ
るものがあり、設定部としてはデジタル設定器又はキー
ボードがある。入力回路は制御回路の作動を開始させる
入力信号を与えるための回路で、外部端子に入力信号を
そのまま制御回路に伝達する回路と禁示する回路とがあ
る。いずれの内容のものであっても、第２ブロツクと着
脱自在に連結して使用することかできる。
なお、計時時間の刻々の表示はこれを省くこともできる
。
。
次に、本発明の実施例を図面に基いて説明する。
第１図に各ブロックに分割した状態の平面図の部分切欠
断面図を示し、第２図Ｋｍｌｌ１図と同じ状態の側面図
の断面図を示゛シ、第３図に正面図を示しＪ第４図に電
気回路のブロック図を示す。
断面図を示し、第２図Ｋｍｌｌ１図と同じ状態の側面図
の断面図を示゛シ、第３図に正面図を示しＪ第４図に電
気回路のブロック図を示す。
１１１ブロツクｌＯは、背面１１に複数個の外部接続用
端子１２・・・１２が設けられ、前面１３は全体として
着脱方向と直交する平面に形成され、複数個の内部接続
用端子１４・・・１４が配設されている。外部接続用端
子数は８個でそのうち２個が電源口路用、３個が出力部
用、３個が入力回路用に当てられている。
端子１２・・・１２が設けられ、前面１３は全体として
着脱方向と直交する平面に形成され、複数個の内部接続
用端子１４・・・１４が配設されている。外部接続用端
子数は８個でそのうち２個が電源口路用、３個が出力部
用、３個が入力回路用に当てられている。
第２ブロツク２０は、背面２１が第１ブロツクの前面１
３と対面するよう全体として平面に形成され、第１ブロ
ツクの内部接続用各端子１４・・・１４と対偶をなす接
続端子２２が設けられ、左右両側面中央部にカギ形の係
止部２３．２３か形成されていてｊｌｌブロックの凹所
１５に嵌り込むようになっている。ブロックを形成する
ハウジング内には電源回路及び出力部を構成する回路袋
＠２４か保持さ、ｔＩでいる。前面２５も全体として看
鋭方向と直交する平面に形成され、複数個の内部接続用
端子２６が配設されている。
３と対面するよう全体として平面に形成され、第１ブロ
ツクの内部接続用各端子１４・・・１４と対偶をなす接
続端子２２が設けられ、左右両側面中央部にカギ形の係
止部２３．２３か形成されていてｊｌｌブロックの凹所
１５に嵌り込むようになっている。ブロックを形成する
ハウジング内には電源回路及び出力部を構成する回路袋
＠２４か保持さ、ｔＩでいる。前面２５も全体として看
鋭方向と直交する平面に形成され、複数個の内部接続用
端子２６が配設されている。
第３ブロツク３０は、背面３１が第２ブロツクの前面２
５と対面するよう全体として平面に形成され、第２ブロ
ツクの前面に設けられた内部接続用各端子２６と対偶を
なす接続−子３２が設けらね、左右両側面中央部にカギ
形の係止部３３．３３が形成されていて１ｇ２ブロツク
の凹所２７に嵌り込むようになっている。ブロックを形
成するハウジング内には制御回路及び入力回路を構成す
る回路袋＠３４が保持されている。前面３５には時間を
設定するためのダイヤル３６、作動状態を表示する表示
ランプ３７．３Ｂが配設されている。
５と対面するよう全体として平面に形成され、第２ブロ
ツクの前面に設けられた内部接続用各端子２６と対偶を
なす接続−子３２が設けらね、左右両側面中央部にカギ
形の係止部３３．３３が形成されていて１ｇ２ブロツク
の凹所２７に嵌り込むようになっている。ブロックを形
成するハウジング内には制御回路及び入力回路を構成す
る回路袋＠３４が保持されている。前面３５には時間を
設定するためのダイヤル３６、作動状態を表示する表示
ランプ３７．３Ｂが配設されている。
を記の構成によれば、１１！１ブロツクとして外部接続
端子の内容が異るものを例えば４１に１１製作し、第２
ブロツクとして電源回路又は出力部の内容か興るものを
例えは６種類製作し、第３ブロツクとして制御回路、表
示部又は設定部の内容が興るものを例えば３種類製作し
ておけば、各ブロックの組合せにより４Ｘ６Ｘ３＝７２
通りの商品を得ることができる。
端子の内容が異るものを例えば４１に１１製作し、第２
ブロツクとして電源回路又は出力部の内容か興るものを
例えは６種類製作し、第３ブロツクとして制御回路、表
示部又は設定部の内容が興るものを例えば３種類製作し
ておけば、各ブロックの組合せにより４Ｘ６Ｘ３＝７２
通りの商品を得ることができる。
図面はいずれも本発明実施例を示すものであって、Ｉ８
】図及びＩＪ１２図は各ブロックに分解した状態の平面
図の部分切欠断面図、側面図の断面図、第３図は正面図
、＄４＠は電気回路ブロック図を示す。 ｌＯ・・・第１ブロツク ２０・・−２ブロツク ３０・・・賛、３ブロツク １２・・外部接続用端子群 １４・、、 ’ｌ＋ ｌの内部接続用端子群２２・・・
算２の ｌＩ ２６・・・第３の ｌｌ ３２・・・第４の 〃
】図及びＩＪ１２図は各ブロックに分解した状態の平面
図の部分切欠断面図、側面図の断面図、第３図は正面図
、＄４＠は電気回路ブロック図を示す。 ｌＯ・・・第１ブロツク ２０・・−２ブロツク ３０・・・賛、３ブロツク １２・・外部接続用端子群 １４・、、 ’ｌ＋ ｌの内部接続用端子群２２・・・
算２の ｌＩ ２６・・・第３の ｌｌ ３２・・・第４の 〃
Claims (1)
- 【特許請求の範囲】 （υ 下記μ）φ１（Ｃ）より成る電子式タイマ、四
背面に外部接続用端子群が設けられ、所定形状をした第
１の前面の所定位ＩＥＫ上記各端子群のそれぞれと対応
する第１の内部接続用端子群が設けられた第１ブロツク
。 −） 上記Ｉｌｌの前面と対面する背面に上記第１の内
部接続用端子群と着脱口°在に接続されるＩ８２の内部
接続用端子群が設けらｔＩ、その第２の内部接続用端子
に接続された電源回路及び出力部を内蔵し、所定形状を
した第２の前面の所定位置に、Ｌ配電源回路の出力線、
上記出力部の入力線及び必委により上記ｓｌの内部接続
用端子群に直接接続される内部連絡線よりなる１８３の
内部接続用端子群が設けられた第２ブロツク。 枳）１記第２の前面と対面する背面に上記第３の内部接
続用端子群と着脱自在に接続される第４の内部接続用端
子群が設けられ、その第４の内部接続用端子に接続され
た制御回路、入力回路が内蔵されその制御回路と接続さ
れた表示部、設定部が前面に配設されている第３ブロツ
ク。 （２＋ ｆ記１ｊ１ブロックの第１の前面と１記第２
ブロツクの背面の間、並びにｔ記Ｉ８２ブロックの第２
の前面と上記ｓ３ブロックの背面の間に、着脱自在の恢
め込み装置をそれぞれ設けた特許請求の範囲一１．項記
載の電子式タイマ。 （３） 上記第１．第２及びＩＩ３ブロックの横断面
形状が同一である、特許請求の範ＩＩ第１項又は第２項
記載の電子式タイマ。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5681782A JPS58173481A (ja) | 1982-04-05 | 1982-04-05 | 電子式タイマ |
| DE19823246841 DE3246841A1 (de) | 1981-12-18 | 1982-12-17 | Auf-zu-regelvorrichtung |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5681782A JPS58173481A (ja) | 1982-04-05 | 1982-04-05 | 電子式タイマ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58173481A true JPS58173481A (ja) | 1983-10-12 |
Family
ID=13037923
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5681782A Pending JPS58173481A (ja) | 1981-12-18 | 1982-04-05 | 電子式タイマ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58173481A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0192050U (ja) * | 1987-12-10 | 1989-06-16 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4424105Y1 (ja) * | 1966-06-09 | 1969-10-13 |
-
1982
- 1982-04-05 JP JP5681782A patent/JPS58173481A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4424105Y1 (ja) * | 1966-06-09 | 1969-10-13 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0192050U (ja) * | 1987-12-10 | 1989-06-16 |
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