JPS58152034U - 検出スイツチ回路 - Google Patents

検出スイツチ回路

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Publication number
JPS58152034U
JPS58152034U JP5015282U JP5015282U JPS58152034U JP S58152034 U JPS58152034 U JP S58152034U JP 5015282 U JP5015282 U JP 5015282U JP 5015282 U JP5015282 U JP 5015282U JP S58152034 U JPS58152034 U JP S58152034U
Authority
JP
Japan
Prior art keywords
terminals
output transistor
switch circuit
terminal
supplied
Prior art date
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Pending
Application number
JP5015282U
Other languages
English (en)
Inventor
清 谷川
Original Assignee
富士電機株式会社
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Filing date
Publication date
Application filed by 富士電機株式会社 filed Critical 富士電機株式会社
Priority to JP5015282U priority Critical patent/JPS58152034U/ja
Publication of JPS58152034U publication Critical patent/JPS58152034U/ja
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  • Switches That Are Operated By Magnetic Or Electric Fields (AREA)
  • Electronic Switches (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の近接スイッチ回路図、第２図、第３図、
第４図は本考案の実施例である近接スイッチ回路図を示
している。 １・・・近接スイッチ、２・・・検出コイル、３・・・
コンデンサ、４・・・センサ回路、５．　６．　１６．
　１７゜２２・・・抵抗、７．　８．　１４．　１５．
　２１．　２３・・・トランジスタ、９・・・ツェナー
ダイオード゛、１０・・・負荷、１１・・・直流電源、
１２．　１３．　１８．　１９゜２０・・・ダイオード
。

Claims (3)

    【実用新案登録請求の範囲】
  1. （１）電源と負荷の直列回路が接続されるべき第１、第
    ２の端子および電源が接続されるべき第３の端子と、前
    記第１、第２の端子間に接続された第１の出力用トラン
    ジスタと定電圧素子の直列回路からなるスイッチング回
    路と、前記第１の出力用トランジスタのオフ時には前記
    第１、第２の端子間電圧または第１、第３の端子間電圧
    により給電され、オン時には前設定電圧素子に発生する
    電圧降下により給電され、物体を検知して前記第１の出
    力用トランジスタを制御する出力を発生する検出回路と
    、前記第３の端子よりベース電流が供給され、前記第１
    の出力用トランジスタのオン時に少なくとも前記定電圧
    素子をバイパスして前記第１、第２の端子間を導通させ
    る第２の出力用トランジスタとを備えたことを特徴とす
    る検出スイッチ回路。
  2. （２）実用新案登録請求の範囲第１項に記載の無接点ス
    イッチ回路において、前記第２の出力用トランジスタは
    そのコレクタ、エミッタ端子が前記第１、第２の端子間
    に接続され、第３の端子より供給されるベース電流が前
    記検出回路の出力により制御されることを特徴とする検
    出スイッチ回路。
  3. （３）実用新案登録請求の範囲第１項に記載の無接点ス
    イッチ回路において、前記第２の出力用トランジスタは
    そのコレクタ、エミッタ端子が前記定電圧素子の端子間
    に並列接続されることを特徴とする検出スイッチ回路。
JP5015282U 1982-04-07 1982-04-07 検出スイツチ回路 Pending JPS58152034U (ja)

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