JPS58147356U - ２値化回路 - Google Patents

２値化回路

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JPS58147356U
JPS58147356U JP4273982U JP4273982U JPS58147356U JP S58147356 U JPS58147356 U JP S58147356U JP 4273982 U JP4273982 U JP 4273982U JP 4273982 U JP4273982 U JP 4273982U JP S58147356 U JPS58147356 U JP S58147356U
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JP
Japan
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circuit
determination
black
level
signal
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JP4273982U
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JPS6336764Y2 (ja
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純一 佐藤
成田　龍爾
藍原　政芳
Original Assignee
日本アイ・ビ−・エム株式会社
株式会社東芝
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の２値回路のブロック図、第２図ａ−ｄは
第１図の２値化回路の動作説明図、第３図は本考案に係
る２値化回路の一実施例を示すブロック図、第４図ａ　
”−ｅは第３図の２値化回路の動作説明図である。 １・・・・・・可変利得増幅回路、３・・・・・・比較
回路、４・・・・・・スライス回路、ＡＭＰａ、　ＡＭ
Ｐｂ・・・・・・増幅器、ＰＤ・・・・・・ピーク検出
器、ＰＳ・・・・・・フォトセル、ＣＯＭＰ・・・・・
・比較器、ＦＦ・・・・・・フリップフロップ回路、Ｉ
Ｎ・・・・・・インバータ。

Claims (3)

    【実用新案登録請求の範囲】
  1. （１）　　画信号の白ピークレベルを保持しこれにより
    可変利得増幅回路を制御し、その出力レベルを比較器で
    白黒判定して２値化する２値化回路において、前記可変
    利得増幅回路の手前で前記画信号を直接白黒判定する第
    １の判定回路と、該判定回路の黒判定或は前記比較器の
    黒判定のいずれに対しても黒と判定する第２の判定回路
    とを具えたことを特徴とする２値化回路。
  2. （２）第１の判定回路は判定レベルが画信号の黒レベル
    よりも僅かに高いスライス回路である実用新案登録請求
    の範囲第１項記載の２値化回路。
  3. （３）第２の判定回路は前記比較器の判定信号に応じて
    動作すると共に、前記第１の判定回路から黒レベルの信
    号が入力されたときには優先的に黒レベルの信号を出力
    するフリップフロップ回路である実用新案登録請求の範
    囲第１項記載の２値化回路。
JP4273982U 1982-03-26 1982-03-26 ２値化回路 Granted JPS58147356U (ja)

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JP4273982U JPS58147356U (ja) 1982-03-26 1982-03-26 ２値化回路

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JP4273982U JPS58147356U (ja) 1982-03-26 1982-03-26 ２値化回路

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JPS58147356U true JPS58147356U (ja) 1983-10-04
JPS6336764Y2 JPS6336764Y2 (ja) 1988-09-29

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