JPS58119727A - Power source malfunction detecting circuit - Google Patents

Power source malfunction detecting circuit

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JPS58119727A
JPS58119727A JP91282A JP91282A JPS58119727A JP S58119727 A JPS58119727 A JP S58119727A JP 91282 A JP91282 A JP 91282A JP 91282 A JP91282 A JP 91282A JP S58119727 A JPS58119727 A JP S58119727A
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JP
Japan
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voltage
power supply
signal
timer
comparator
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Application number
JP91282A
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Japanese (ja)
Inventor
裕之 秋山
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Fujifilm Business Innovation Corp
Original Assignee
Fuji Xerox Co Ltd
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Publication date
Application filed by Fuji Xerox Co Ltd filed Critical Fuji Xerox Co Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 本発明は交流電源の欠損および電圧低下を検出するため
の電源異常検出回路に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a power supply abnormality detection circuit for detecting AC power supply failure and voltage drop.

たとえばμ−cpu <マイクロコンピュータ)を使用
した電子機器の多くは、商用電源を用いて安定化した直
流電源を作成し、電子回路を動作させている。このよう
な電子機器では、商用電源あるいは交流電源の段階で電
源の異常を検出することができれば、直流電源にその影
響が波及する以前に、電源異常に対する対策をとること
ができる。
For example, many electronic devices using a μ-CPU (microcomputer) use a commercial power source to create a stabilized DC power source to operate the electronic circuit. In such electronic devices, if an abnormality in the power supply can be detected at the stage of commercial power supply or AC power supply, countermeasures can be taken against the power supply abnormality before its influence spreads to the DC power supply.

すなわち例えば、電源を電池に切り換えたり、処理中の
データを不揮発性のメモリに一時的に蓄える等の手段を
とり、電子機器の保3を図ることができる。
That is, for example, it is possible to protect the electronic device by switching the power source to a battery or temporarily storing data being processed in a non-volatile memory.

交流電源の異常として電子機器に問題となる代表的なも
のは、欠損(電源の瞬断)あるいは電源電圧の低下であ
る。この2つの異常を検出する従来の電源異常検出回路
は、これらの異常をそれぞれ独立した回路部分で検出し
ていた。従って回路部品の点数を削減することが困難で
あり、回路の価格の低下と信頼性の向上を図ることがで
きにくいという問題があった。
Typical alternating current power supply abnormalities that cause problems in electronic devices are failures (momentary power interruptions) or drops in power supply voltage. A conventional power supply abnormality detection circuit that detects these two abnormalities uses independent circuit parts to detect these abnormalities. Therefore, there is a problem in that it is difficult to reduce the number of circuit components, and it is difficult to reduce the cost and improve the reliability of the circuit.

本発明はこのような事情に鑑みてなされたもので、欠損
および電圧低下を1つの回路で有機的に検出することの
できる電源異常検出回路を提供することを目的とする。
The present invention has been made in view of the above circumstances, and it is an object of the present invention to provide a power supply abnormality detection circuit that can organically detect defects and voltage drops with one circuit.

本発明では交流電圧を全波あるいは半波整流する整流手
段と、整流後の電圧を低電圧異常の基準となる所定の電
圧と比較するコンパレータと、コンパレータの出力電圧
によってトリガされ少なくとも次にトリガが行われる可
能性のある時間よりも長いパルス幅でパルス信号を出力
するタイマとを電源異常検出回路に具備させ、タイマの
出力信号の波形により欠損および電圧低下を検出させる
こととして、回路の簡略化を図り前記した目的を達成す
る。
The present invention includes a rectifying means for full-wave or half-wave rectification of AC voltage, a comparator for comparing the rectified voltage with a predetermined voltage serving as a reference for low voltage abnormality, and a comparator that is triggered by the output voltage of the comparator and at least the next trigger. The circuit is simplified by equipping the power supply abnormality detection circuit with a timer that outputs a pulse signal with a pulse width that is longer than the time that is likely to occur, and detecting defects and voltage drops based on the waveform of the timer's output signal. To achieve the above objectives.

以下実施例につき本発明の詳細な説明する。The present invention will be described in detail below with reference to Examples.

第1図は本実施例の電源異常検出回路の動作原理を説明
するためのブロック図である。この回路では、商用電源
から供給される入力電圧1を全波た整流信号3を低下検
出部4に供給する。低下検出部4では、基準電圧発生器
5から供給される基準電圧信号6と電圧レベルの比較を
行う。基準電圧信号6は、電圧低下の異常の有無を判別
する基準となる所定レベルの直流電圧を表わしている。
FIG. 1 is a block diagram for explaining the operating principle of the power supply abnormality detection circuit of this embodiment. In this circuit, a full-wave rectified signal 3 of an input voltage 1 supplied from a commercial power source is supplied to a drop detection section 4. The drop detection section 4 compares the voltage level with the reference voltage signal 6 supplied from the reference voltage generator 5. The reference voltage signal 6 represents a DC voltage at a predetermined level that serves as a reference for determining whether there is an abnormality in voltage drop.

低下検出部4により異常な電圧低下が検出されると、低
下検出信号7が検出信号発生器8に供給される。検出信
号発生器8はこれを基にして、例えば第2図すに示すよ
うなL(ロー)レベル(OV)に保たれた信号(電圧低
下信号)を検出信号9として出力する。
When an abnormal voltage drop is detected by the drop detector 4, a drop detection signal 7 is supplied to the detection signal generator 8. Based on this, the detection signal generator 8 outputs a signal (voltage drop signal) maintained at the L (low) level (OV) as shown in FIG. 2, for example, as the detection signal 9.

低下検出部4が電圧低下を検出しなかった場合には、そ
の出力信号10が欠損検出部11に供給される。欠損検
出部11では、欠損の有無を判別し、判別信号12を検
出信号発生器8に供給する。
If the drop detection section 4 does not detect a voltage drop, its output signal 10 is supplied to the loss detection section 11 . The defect detection section 11 determines whether there is a defect or not, and supplies a discrimination signal 12 to the detection signal generator 8 .

検出信号発生器8では、欠損が存在する場合、例えば第
2図に示すようにその近傍でHレベル(電源電圧Vcc
)に変化する信号(欠損信号)を検出信号10として出
力する。また欠損が存在しない正常な場合には、例えば
同図aに示すようにHレベルに保たれた信号(正常信号
)を検出信号10として出力する。これらの検出信号1
0はμ−CPU等に供給され、電源の異常が監視される
In the detection signal generator 8, when there is a defect, the signal becomes H level (power supply voltage Vcc) in the vicinity of the defect, as shown in FIG.
) is output as the detection signal 10 (missing signal). In addition, in a normal case where there is no defect, a signal kept at the H level (normal signal) is outputted as the detection signal 10, for example, as shown in FIG. These detection signals 1
0 is supplied to the μ-CPU and the like, and abnormalities in the power supply are monitored.

第3図はこの電源異常検出回路を具体的に表わしたもの
である。全波整流器2は入力電圧(第4図a)を全波整
流する(同図b)。全波整流器2の出力側には、2つの
分圧抵抗21.22が直列に接続されており、これらの
接続点23に分圧された整流信号3が現われる。整流信
号3は、過電流阻止用の抵抗24を介して、コンパレー
タ25の0入力端子に供給される。コンパレータ25の
θ入力端子は、アノード側を設置したツェナーダイオー
ド26のカソードに接続されている。ツェナーダイオー
ド26のカソードは、抵抗27を介して電圧Vccの直
流電源(図示せず)に接続されている。ツェナーダイオ
ード26によって、コンバレー25のθλ入力端子は基
準電圧信号6が供給される。
FIG. 3 specifically shows this power supply abnormality detection circuit. The full-wave rectifier 2 performs full-wave rectification of the input voltage (FIG. 4a) (FIG. 4b). Two voltage dividing resistors 21 and 22 are connected in series on the output side of the full-wave rectifier 2, and a voltage-divided rectified signal 3 appears at a connection point 23 between them. The rectified signal 3 is supplied to the 0 input terminal of the comparator 25 via the overcurrent blocking resistor 24. The θ input terminal of the comparator 25 is connected to the cathode of a Zener diode 26 whose anode side is provided. The cathode of the Zener diode 26 is connected via a resistor 27 to a DC power supply (not shown) having a voltage Vcc. The θλ input terminal of the compare 25 is supplied with the reference voltage signal 6 by the Zener diode 26 .

今、八り電圧1が異常に低下しているとする。Suppose now that the voltage 1 is abnormally low.

この場合、整流信号3のピーク電圧は基準電圧信号6の
それよりも低くなっている。従ってコン/<レータ25
は、Lレベルに保持された低下検出信号7(第5図81
)を出力する。低下検出信号7は、再トリガ単安定マル
チバイブレータ28の入力端子INに供給される。再ト
リガ単安定マルチバイブレータ28は、この場合、出力
端子OUTから常にLレベルの信号を出力信号29とし
て出力する。信号29は、電流制限用の抵抗31を介し
てトランジスタ32のベースに供給される。トランジス
タ32は検出信号9を出力するコレクタが抵抗33を介
して前記直流電源に接続されており、エミッタが接地さ
れている。従って出り信号29としてLレベルの信号が
供給されると、トランジスター32は導通し、コレクタ
から検出信号9としてLレベルの電圧低下信号(第5図
a2)が出力される。
In this case, the peak voltage of the rectified signal 3 is lower than that of the reference voltage signal 6. Therefore con/<lator 25
is the drop detection signal 7 held at L level (Fig. 5 81
) is output. The drop detection signal 7 is supplied to the input terminal IN of the retrigger monostable multivibrator 28 . In this case, the retrigger monostable multivibrator 28 always outputs an L level signal as the output signal 29 from the output terminal OUT. Signal 29 is supplied to the base of transistor 32 via a current limiting resistor 31. The transistor 32 has a collector that outputs the detection signal 9 connected to the DC power supply via a resistor 33, and an emitter that is grounded. Therefore, when an L level signal is supplied as the output signal 29, the transistor 32 becomes conductive, and an L level voltage drop signal (FIG. 5 a2) is output from the collector as the detection signal 9.

次に入力電圧1が正常な場合について説明する。Next, a case where input voltage 1 is normal will be explained.

この場合、整流信号3のピーク電圧は、基準電圧信号6
のそれよりも高くなってりる。従ってコンパレータ25
は、基準電圧信号の表わす電圧VRよりも整流信号3の
それが高い期間において、出力信号10としてパルス電
圧を出りする(第5図b1)。このパルス電圧は商用電
源の半サイクルを周期として、規則正しく発生する。出
力信号10は、再トリガ単安定マルチバイブレータ28
の入力端子INに供給される。再トリガ単安定マルチバ
イブレータ28は、パルス電圧が印加されるごとに、抵
抗35およびコンデンサ36により定まる時点数でパル
ス信号を作成する。このパルス信号は商用電源の半サイ
クルよりも長い約0.8サイクル分のパルス幅をもって
おり、出力信号10による再トリガによってこのパルス
幅が連続的に延長される。従って出力信号10として半
サイクルを周期とした規則正しいパルス列が供給された
とき、再トリガ単安定マルチバイブレータ28の出力端
子01JTからは、出力信号29としてHレベルに保持
された信号が出力される。このとき、トランジスタ32
のコレクタには、出力信号9として電源電圧Vccに保
持された正、常信号最後に入力電圧1に1サイクル分の
欠損がある場合について説明する。第5図C1に示すよ
うに、コンパレータ25は欠損の生じているサイクルに
ついてパルス電圧を出力しない。従って出力信号10の
欠損の生じている部分はLレベルに保持される。この出
力信号1o、tj再トリガ単安定マルチバイブレータ2
8に供給されると、欠損の生じている部分で出力信号2
9がLレベルに低下する。
In this case, the peak voltage of the rectified signal 3 is the reference voltage signal 6
It is higher than that of . Therefore, comparator 25
outputs a pulse voltage as the output signal 10 during a period in which the rectified signal 3 is higher than the voltage VR represented by the reference voltage signal (FIG. 5b1). This pulse voltage is generated regularly with a period of half a cycle of the commercial power supply. The output signal 10 is a retrigger monostable multivibrator 28
is supplied to the input terminal IN of. Retrigger monostable multivibrator 28 produces a pulse signal at a number of times determined by resistor 35 and capacitor 36 each time a pulse voltage is applied. This pulse signal has a pulse width of approximately 0.8 cycles, which is longer than a half cycle of the commercial power supply, and this pulse width is continuously extended by retriggering by the output signal 10. Therefore, when a regular pulse train with a period of half a cycle is supplied as the output signal 10, the output terminal 01JT of the retrigger monostable multivibrator 28 outputs a signal held at H level as the output signal 29. At this time, the transistor 32
A case will be explained in which there is a one-cycle loss in the input voltage 1 at the end of the positive and normal signal held at the power supply voltage Vcc as the output signal 9 at the collector of the output signal 9. As shown in FIG. 5 C1, the comparator 25 does not output a pulse voltage for the cycle in which the loss occurs. Therefore, the portion of the output signal 10 where the loss occurs is held at L level. This output signal 1o, tj retrigger monostable multivibrator 2
8, the output signal 2 is output at the part where the defect occurs.
9 drops to L level.

従ってトランジスタ32のコレクタには、出力信号9と
してこの部分が同様にLレベルに低下した欠損信号(第
5図C2)が現われる。
Therefore, at the collector of the transistor 32, a defective signal (C2 in FIG. 5) in which this portion similarly falls to the L level appears as the output signal 9.

以上説明したように本発明によればリトリガブルなタイ
マで電源の欠損を判別するので、タイマの時定数を適宜
調整することにより、電子機器の使用上支障の生じない
程度の欠損は、これを検出しないようにすることができ
る。
As explained above, according to the present invention, a retriggerable timer is used to determine a power failure, so by appropriately adjusting the time constant of the timer, a loss that does not cause any trouble in the use of electronic equipment can be detected. You can prevent it from happening.

なお実施例ではタイマとして再トリガ単安定マルチバイ
ブレータを使用したが、これに限定されるものではない
In the embodiment, a retrigger monostable multivibrator is used as the timer, but the timer is not limited to this.

【図面の簡単な説明】[Brief explanation of the drawing]

図面は本発明の一実施例を説明するためのもので、第1
図は電源異常検出回路の動作原理を説明するためのブロ
ック図、第2図はこの回路の出力信号の各種電圧波形図
、第3図は電源異常検出回路の回路図、第4図は入力電
圧と金波整流後の電圧の波形図、第5゛図はコンパレー
タとトランジスタの出力側に各場合に表われる電圧波形
図である。 1・・・・・・入力端子 2・・・・・・全波整流器5
・・・・・・基準電圧発生器 25・・・・・・コンパ
レータ26・・・・・・ツェナーダイオード 28・・・・・・再トリガ単安定マルチバイブレータ3
2・・・・・・トランジスタ 35・・・・・・抵抗3
6・・・・・・コンデンサ 出  願  人 富士ゼロックス株式会社 代  理  人 弁理士  山  内  梅  雄
The drawings are for explaining one embodiment of the present invention.
The figure is a block diagram for explaining the operating principle of the power supply abnormality detection circuit, Figure 2 is a diagram of various voltage waveforms of the output signals of this circuit, Figure 3 is a circuit diagram of the power supply abnormality detection circuit, and Figure 4 is the input voltage. Figure 5 is a voltage waveform diagram that appears on the output side of the comparator and transistor in each case. 1... Input terminal 2... Full wave rectifier 5
...Reference voltage generator 25 ... Comparator 26 ... Zener diode 28 ... Retrigger monostable multivibrator 3
2...Transistor 35...Resistor 3
6...Applicant for capacitor Umeo Yamauchi, patent attorney representing Fuji Xerox Co., Ltd.

Claims (1)

【特許請求の範囲】 1、異常検出を行おうとする交流電源から得られる電圧
を全波あるいは半波整流する整流手段と、前記手段によ
り得られた整流後の電圧を電源電圧低下の異常判断の基
準となる基準電圧と比較し、整流後の電圧がこの基準電
圧よりも高いときトリガパルスを発生させるコンパレー
タと、トリガパルスを入力し、全波整流が行われた場合
には交流電源の半サイクル分以上の、また半波整流が行
われた場合には交流電源の1サイクル分以上の時間幅を
もったパルスを発生させるリトリガブルなタイマとを具
備し、前記タイマの出力信号の波形により電源の電圧低
下および欠損を検出することを特徴とする電源異常検出
回路。 2、タイマが再トリガ単安定マルチバイブレータである
ことを特徴とする特許請求の範囲第1項記載の電源異常
検出回路。
[Claims] 1. Rectifying means for full-wave or half-wave rectification of the voltage obtained from the AC power source for which abnormality detection is to be performed, and rectifying the voltage obtained by the means for abnormality judgment of power supply voltage drop. A comparator that compares with a standard reference voltage and generates a trigger pulse when the voltage after rectification is higher than this reference voltage, and a comparator that inputs the trigger pulse and generates a half cycle of the AC power supply if full-wave rectification is performed. It is equipped with a retriggerable timer that generates a pulse with a time width of 1 minute or more, or 1 cycle or more of the AC power supply when half-wave rectification is performed, and the waveform of the output signal of the timer is used to control the power supply. A power supply abnormality detection circuit characterized by detecting voltage drops and defects. 2. The power supply abnormality detection circuit according to claim 1, wherein the timer is a retrigger monostable multivibrator.
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