JPS58104033U - スイツチ回路の駆動回路 - Google Patents

スイツチ回路の駆動回路

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JPS58104033U
JPS58104033U JP116082U JP116082U JPS58104033U JP S58104033 U JPS58104033 U JP S58104033U JP 116082 U JP116082 U JP 116082U JP 116082 U JP116082 U JP 116082U JP S58104033 U JPS58104033 U JP S58104033U
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JP
Japan
Prior art keywords
circuit
field effect
effect transistors
switch circuit
buffer amplifier
Prior art date
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Pending
Application number
JP116082U
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English (en)
Inventor
稲生　清春
奥住　俊樹
Original Assignee
横河電機株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図および第２図は従来例の要部スイッチ駆　　　゛
□動回路図。第３図は従来例のマルチプレクサの要部回
路図。第コ゛図は従来例のマルチプレクサの要部回路構
成図。第４図は本考案第二実施例の要部、回路構成図。 第５図は第４図にＸ印で示した点の入力あるいは出力信
号波形を示す動作タイムチャート。第６図は本考案第二
実施例の要部回路構成図。第７図は電流制限抵抗Ｒ６を
付加する場合の回路構成図。 １．１ｔ〜Ｉｎ−ＦＥＴ、２．ｚｌ〜ｚｎ）９−・・ト
ランジスタ、３．　３１〜３ｎ・・・ダイオード、４゜
４□〜４ｎ・・・コンデンサ、５・・・バッファアンプ
、７・・・信号線、１０・・・制御回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. ドレイン・ソース間の信号通路をゲートに与えられる制
    御信号により開閉するように構成された複数の電界効果
    ・トランジスタを含み、上記信号通路の一方が上記複数
    の電界効果トランジスタについて共通端子に接続されて
    構成されたスイッチ回路を駆動する回路であって、上記
    共通端子を入力とし出力が上記複数の電界効果トランジ
    スタの各ゲートに抵抗を介して接続されたバッファアン
    プを含むスイッチ回路の駆動回路に、おいて、バッファ
    アンプの出力と上記各電界効果トランジスタをＯＦＦ状
    態にする電位点との間に別のスイッチ回路を備え、上記
    複数の電界効果トランジスタの−うが開放され他の一つ
    が閉成される期間にわたり上記側のスイッチ回路を導通
    状態とするように制御する制御回路を備えたことを特徴
    とするスイッチ回路の駆動回路。
JP116082U 1982-01-07 1982-01-07 スイツチ回路の駆動回路 Pending JPS58104033U (ja)

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JPS58104033U true JPS58104033U (ja) 1983-07-15

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