JPH1198824A - Ｄｃ−ｄｃコンバータ - Google Patents
Ｄｃ−ｄｃコンバータInfo
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- JPH1198824A JPH1198824A JP25825197A JP25825197A JPH1198824A JP H1198824 A JPH1198824 A JP H1198824A JP 25825197 A JP25825197 A JP 25825197A JP 25825197 A JP25825197 A JP 25825197A JP H1198824 A JPH1198824 A JP H1198824A
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Abstract
(57)【要約】
【課題】 ＤＣ−ＤＣコンバータにおいて、ＦＥＴ（Ｆ
ｉｅｌｄ−Ｅｆｆｅｃｔ−Ｔｒａｎｓｉｓｔｏｒ）を効
率良く使用する。 【解決手段】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧するＤＣ−
ＤＣコンバータにおいて、ＦＥＴを複数用い、負荷電流
を検出する手段と、この検出した電流が予め設定した値
以上になると信号を出力する手段とを具備し、この信号
によりコンバ−タに使用するＦＥＴを切替える。
ｉｅｌｄ−Ｅｆｆｅｃｔ−Ｔｒａｎｓｉｓｔｏｒ）を効
率良く使用する。 【解決手段】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧するＤＣ−
ＤＣコンバータにおいて、ＦＥＴを複数用い、負荷電流
を検出する手段と、この検出した電流が予め設定した値
以上になると信号を出力する手段とを具備し、この信号
によりコンバ−タに使用するＦＥＴを切替える。
Description
【０００１】
【発明の属する技術分野】本発明は、電池等を電源と
し、直流電圧を昇圧若しくは降圧し、別の電圧に変換す
るＤＣ−ＤＣコンバータに係り、負荷の変動が多い機器
に関するものである。
し、直流電圧を昇圧若しくは降圧し、別の電圧に変換す
るＤＣ−ＤＣコンバータに係り、負荷の変動が多い機器
に関するものである。
【０００２】
【従来の技術】図６は、従来のＤＣ−ＤＣコンバータの
一実施例を示す回路図である。
一実施例を示す回路図である。
【０００３】図６において、入力電圧ＶＩＮをインダク
タ（コイル）１と電界効果トランジスタ（以下ＦＥＴと
する）２、ダイオード３、コンデンサ４で昇圧し、出力
電圧ＶＯＵＴを得ている。
タ（コイル）１と電界効果トランジスタ（以下ＦＥＴと
する）２、ダイオード３、コンデンサ４で昇圧し、出力
電圧ＶＯＵＴを得ている。
【０００４】また、この出力電圧ＶＯＵＴは負荷５に接
続されている。
続されている。
【０００５】尚、従来技術の実開昭５８−１８５９９１
号公報に記載の技術と同等の回路図、図７のように、イ
ンダクタ１に電磁結合された２次巻線６とダイオード
７、コンデンサ８を有する場合でも図６に適用すること
ができるため、図６に基づいて従来技術の説明を行う。
号公報に記載の技術と同等の回路図、図７のように、イ
ンダクタ１に電磁結合された２次巻線６とダイオード
７、コンデンサ８を有する場合でも図６に適用すること
ができるため、図６に基づいて従来技術の説明を行う。
【０００６】図６において、昇圧動作を行う場合、ＦＥ
Ｔ２（ＮチャネルＦＥＴ）のゲートに制御パルスを加え
ると、制御パルスがＨＩＧＨの期間インダクタ１にエネ
ルギーを蓄え、制御パルスがＬＯＷの期間ダイオード３
を通して負荷５に電力が供給される。
Ｔ２（ＮチャネルＦＥＴ）のゲートに制御パルスを加え
ると、制御パルスがＨＩＧＨの期間インダクタ１にエネ
ルギーを蓄え、制御パルスがＬＯＷの期間ダイオード３
を通して負荷５に電力が供給される。
【０００７】このときの各ポイントの波形を図８に示
す。
す。
【０００８】ａはＦＥＴ２のゲートに与えられるパルス
波形を示し、ｂはインダクタ１とＦＥＴ２のドレイン接
続点の電圧波形を示し、ｃはインダクタ１に流れる電流
波形を示したものである。
波形を示し、ｂはインダクタ１とＦＥＴ２のドレイン接
続点の電圧波形を示し、ｃはインダクタ１に流れる電流
波形を示したものである。
【０００９】このことから、ＦＥＴ２は理想的にはゲー
トに加えられた制御パルスがＨＩＧＨのときにはドレイ
ン・ソースの抵抗値が０Ωで、電圧降下の０Ｖとなるこ
とが望ましく、かつ制御パルスと同期している（時間的
に遅れがない）ことが要求される。
トに加えられた制御パルスがＨＩＧＨのときにはドレイ
ン・ソースの抵抗値が０Ωで、電圧降下の０Ｖとなるこ
とが望ましく、かつ制御パルスと同期している（時間的
に遅れがない）ことが要求される。
【００１０】しかしながら、実際にはＦＥＴ２のゲート
には入力容量と呼ばれるコンデンサがあり、ＦＥＴ２の
ゲート電圧波形及びインダクタ１とＦＥＴ２のドレイン
接続点の波形は、それぞれｄ及びｅの波形となる。
には入力容量と呼ばれるコンデンサがあり、ＦＥＴ２の
ゲート電圧波形及びインダクタ１とＦＥＴ２のドレイン
接続点の波形は、それぞれｄ及びｅの波形となる。
【００１１】また、この入力容量は電流が多く流せるＦ
ＥＴほど大きい。
ＥＴほど大きい。
【００１２】
【発明が解決しようとする課題】しかし、上記従来技術
に開示されている技術内容では、使用するＦＥＴを最大
負荷と考えて選定するために軽負荷時（負荷に流れる電
流が少ないとき）の入力電力：出力電力の変換効率をゲ
ートの入力容量による遅れや、波形のなまりにより悪く
し、あらゆる負荷に対応させる場合に無駄な電力を消費
してしまうといった欠点があった。
に開示されている技術内容では、使用するＦＥＴを最大
負荷と考えて選定するために軽負荷時（負荷に流れる電
流が少ないとき）の入力電力：出力電力の変換効率をゲ
ートの入力容量による遅れや、波形のなまりにより悪く
し、あらゆる負荷に対応させる場合に無駄な電力を消費
してしまうといった欠点があった。
【００１３】本発明は上記課題を解決する為に、負荷に
合わせた電流供給能力を持つＦＥＴを使用し、低負荷時
の効率を低下させず、広範囲の負荷に供給可能なＤＣ−
ＤＣコンバータを提供することを目的としている。
合わせた電流供給能力を持つＦＥＴを使用し、低負荷時
の効率を低下させず、広範囲の負荷に供給可能なＤＣ−
ＤＣコンバータを提供することを目的としている。
【００１４】
【課題を解決するための手段】請求項１記載のＤＣ−Ｄ
Ｃコンバータは、直流電圧をコイルとダイオードとＦＥ
Ｔとコンデンサを使用して、昇圧若しくは降圧するＤＣ
−ＤＣコンバータにおいて、ＦＥＴを複数用い、負荷電
流を検出する手段と、この検出した電流が予め設定した
値以上になると信号を出力する手段とを具備し、この信
号によりコンバータに使用するＦＥＴを切替えることを
特徴とするＤＣ−ＤＣコンバータである。
Ｃコンバータは、直流電圧をコイルとダイオードとＦＥ
Ｔとコンデンサを使用して、昇圧若しくは降圧するＤＣ
−ＤＣコンバータにおいて、ＦＥＴを複数用い、負荷電
流を検出する手段と、この検出した電流が予め設定した
値以上になると信号を出力する手段とを具備し、この信
号によりコンバータに使用するＦＥＴを切替えることを
特徴とするＤＣ−ＤＣコンバータである。
【００１５】請求項２記載のＤＣ−ＤＣコンバータは、
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧するＤＣ−ＤＣコンバータ
において、ＦＥＴを複数用い、負荷電流を検出する手段
と、この検出した電流が予め設定した値以上になると信
号を出力する手段とを具備し、この信号によりコンバー
タに使用するＦＥＴ数を増加させることを特徴とするＤ
Ｃ−ＤＣコンバータである。
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧するＤＣ−ＤＣコンバータ
において、ＦＥＴを複数用い、負荷電流を検出する手段
と、この検出した電流が予め設定した値以上になると信
号を出力する手段とを具備し、この信号によりコンバー
タに使用するＦＥＴ数を増加させることを特徴とするＤ
Ｃ−ＤＣコンバータである。
【００１６】請求項３記載のＤＣ−ＤＣコンバータは、
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧する請求項１乃至２に記載
のＤＣ−ＤＣコンバータにおいて、ＦＥＴを複数用い、
入力電流を検出する手段と、この検出した電流が予め設
定した値以上になると信号を出力する手段とを具備し、
この信号によりコンバータに使用するＦＥＴをコントロ
ールすることを特徴とするＤＣ−ＤＣコンバータであ
る。
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧する請求項１乃至２に記載
のＤＣ−ＤＣコンバータにおいて、ＦＥＴを複数用い、
入力電流を検出する手段と、この検出した電流が予め設
定した値以上になると信号を出力する手段とを具備し、
この信号によりコンバータに使用するＦＥＴをコントロ
ールすることを特徴とするＤＣ−ＤＣコンバータであ
る。
【００１７】請求項４記載のＤＣ−ＤＣコンバータは、
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧する請求項１乃至２に記載
のＤＣ−ＤＣコンバータにおいて、ＦＥＴを複数用い、
負荷の状態を示す入力手段とを備え、前記入力手段で入
力された信号によりコンバータに使用するＦＥＴをコン
トロールすることを特徴とするＤＣ−ＤＣコンバータで
ある。
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧する請求項１乃至２に記載
のＤＣ−ＤＣコンバータにおいて、ＦＥＴを複数用い、
負荷の状態を示す入力手段とを備え、前記入力手段で入
力された信号によりコンバータに使用するＦＥＴをコン
トロールすることを特徴とするＤＣ−ＤＣコンバータで
ある。
【００１８】請求項５記載のＤＣ−ＤＣコンバータは、
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧する請求項１乃至２に記載
のＤＣ−ＤＣコンバータにおいて、ＦＥＴを複数用い、
出力電流を検出する手段と、この検出した電流が予め設
定した値以上になると信号を出力する手段を具備し、こ
の信号によりコンバータに使用するＦＥＴをコントロー
ルすることを特徴とするＤＣ−ＤＣコンバータである。
直流電圧をコイルとダイオードとＦＥＴとコンデンサを
使用して、昇圧若しくは降圧する請求項１乃至２に記載
のＤＣ−ＤＣコンバータにおいて、ＦＥＴを複数用い、
出力電流を検出する手段と、この検出した電流が予め設
定した値以上になると信号を出力する手段を具備し、こ
の信号によりコンバータに使用するＦＥＴをコントロー
ルすることを特徴とするＤＣ−ＤＣコンバータである。
【００１９】
【発明の実施の形態】以下、本発明の請求項１〜５に関
して図１〜図５に示す実施例についてこの発明を詳述す
る。
して図１〜図５に示す実施例についてこの発明を詳述す
る。
【００２０】尚、これによってこの発明は限定されるも
のではない。
のではない。
【００２１】図１は本発明の請求項１のＤＣ−ＤＣコン
バータの回路図である。
バータの回路図である。
【００２２】図１においてＦＥＴ２−１は電流供給能力
が大きいもの、ＦＥＴ２ー２は電流供給能力が小さいも
のである。
が大きいもの、ＦＥＴ２ー２は電流供給能力が小さいも
のである。
【００２３】後述する電流検出部７にて検出した負荷電
流が、予め設定した値であれば、後述する制御部８にて
ＨＩＧＨの信号を制御パルスＢに出力し、制御パルスＢ
から電流供給能力の小さいＦＥＴ２−２のゲートにＨＩ
ＧＨの信号を与える。
流が、予め設定した値であれば、後述する制御部８にて
ＨＩＧＨの信号を制御パルスＢに出力し、制御パルスＢ
から電流供給能力の小さいＦＥＴ２−２のゲートにＨＩ
ＧＨの信号を与える。
【００２４】制御パルスＢからＦＥＴ２−２のゲートに
ＨＩＧＨの信号を与えることで、電流供給能力の小さい
ＦＥＴ２−２だけを使用する。
ＨＩＧＨの信号を与えることで、電流供給能力の小さい
ＦＥＴ２−２だけを使用する。
【００２５】また、検出した負荷電流が予め設定した値
以上であれば、ＨＩＧＨの信号を制御パルスＡに出力
し、制御パルスＡから電流供給能力の大きいＦＥＴ２−
１のゲートにＨＩＧＨの信号を与える。
以上であれば、ＨＩＧＨの信号を制御パルスＡに出力
し、制御パルスＡから電流供給能力の大きいＦＥＴ２−
１のゲートにＨＩＧＨの信号を与える。
【００２６】制御パルスＡからＦＥＴ２−１のゲートに
ＨＩＧＨの信号を与えることで、電流供給能力の大きい
ＦＥＴ２−１だけを使用する。
ＨＩＧＨの信号を与えることで、電流供給能力の大きい
ＦＥＴ２−１だけを使用する。
【００２７】以上の動作によって、負荷電流が予め設定
した値以上になると、コンバータに使用するＦＥＴを切
替えることができる。
した値以上になると、コンバータに使用するＦＥＴを切
替えることができる。
【００２８】図２は本発明の請求項２のＤＣ−ＤＣコン
バータの回路図である。
バータの回路図である。
【００２９】図２においてＦＥＴ２−１とＦＥＴ２−２
は電流供給能力が同じものである。
は電流供給能力が同じものである。
【００３０】後述する電流検出部７で検出した入力電流
が予め設定した値であれば、後述する制御部８でＨＩＧ
Ｈの信号を制御パルスＡだけに出力し、制御パルスＡか
らＦＥＴ２−１のゲートにＨＩＧＨの信号を与える。
が予め設定した値であれば、後述する制御部８でＨＩＧ
Ｈの信号を制御パルスＡだけに出力し、制御パルスＡか
らＦＥＴ２−１のゲートにＨＩＧＨの信号を与える。
【００３１】制御パルスＡからＦＥＴ２−１のゲートに
ＨＩＧＨの信号を与えることで、ＦＥＴ１つだけを使用
する。
ＨＩＧＨの信号を与えることで、ＦＥＴ１つだけを使用
する。
【００３２】また、電流検出部７で検出した入力電流が
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡ、Ｂに出力し、制御パルスＡ、Ｂから
ＦＥＴ２−１、ＦＥＴ２−２双方のゲートにＨＩＧＨの
信号を与える。
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡ、Ｂに出力し、制御パルスＡ、Ｂから
ＦＥＴ２−１、ＦＥＴ２−２双方のゲートにＨＩＧＨの
信号を与える。
【００３３】制御パルスＡ、ＢからＦＥＴ２−１、ＦＥ
Ｔ２−２双方のゲートにＨＩＧＨの信号を与えること
で、ＦＥＴ２つを使用する。
Ｔ２−２双方のゲートにＨＩＧＨの信号を与えること
で、ＦＥＴ２つを使用する。
【００３４】以上の動作によって、負荷電流が予め設定
した値以上になると、コンバータに使用するＦＥＴ数を
増加することができる。
した値以上になると、コンバータに使用するＦＥＴ数を
増加することができる。
【００３５】図３は本発明の請求項３のＤＣ−ＤＣコン
バータの回路図である。
バータの回路図である。
【００３６】図３においてインダクタ１の手前に電流検
出抵抗９を設け、電流検出部７により電流を検出し、検
出した値を制御部８に出力する。
出抵抗９を設け、電流検出部７により電流を検出し、検
出した値を制御部８に出力する。
【００３７】制御部８では、電流検出部７から入力され
た値に応じて、制御パルスＡ、Ｂに出力するパルスをコ
ントロールする。
た値に応じて、制御パルスＡ、Ｂに出力するパルスをコ
ントロールする。
【００３８】まず、ＦＥＴ２−１の電流供給能力が大き
く、ＦＥＴ２−２の電流供給能力が小さい場合の動作に
ついて説明を行う。
く、ＦＥＴ２−２の電流供給能力が小さい場合の動作に
ついて説明を行う。
【００３９】電流検出部７で検出した入力電流が予め設
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＢに出力し、制御パルスＢから電流供給能力の小さ
いＦＥＴ２−２のゲートにＨＩＧＨの信号を与える。
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＢに出力し、制御パルスＢから電流供給能力の小さ
いＦＥＴ２−２のゲートにＨＩＧＨの信号を与える。
【００４０】また、電流検出部７で検出した入力電流が
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡに出力し、制御パルスＡから電流供給
能力の大きいＦＥＴ２−１のゲートにＨＩＧＨの信号を
与える。
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡに出力し、制御パルスＡから電流供給
能力の大きいＦＥＴ２−１のゲートにＨＩＧＨの信号を
与える。
【００４１】次に、ＦＥＴ２−１とＦＥＴ２−２の電流
供給能力が同じである場合の動作について説明を行う。
供給能力が同じである場合の動作について説明を行う。
【００４２】電流検出部７で検出した入力電流が予め設
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＡだけに出力し、制御パルスＡからＦＥＴ２−１の
ゲートにＨＩＧＨの信号を与える。
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＡだけに出力し、制御パルスＡからＦＥＴ２−１の
ゲートにＨＩＧＨの信号を与える。
【００４３】また、電流検出部７で検出した入力電流が
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡ、Ｂに出力し、制御パルスＡ、Ｂから
ＦＥＴ２−１、ＦＥＴ２−２双方のゲートにＨＩＧＨの
信号を与える。
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡ、Ｂに出力し、制御パルスＡ、Ｂから
ＦＥＴ２−１、ＦＥＴ２−２双方のゲートにＨＩＧＨの
信号を与える。
【００４４】以上の動作によって、入力電流が予め設定
した値以上になると、コンバータに使用するＦＥＴを切
替え／或いはＦＥＴ数を増加させることができる。
した値以上になると、コンバータに使用するＦＥＴを切
替え／或いはＦＥＴ数を増加させることができる。
【００４５】図４は本発明の請求項４のＤＣ−ＤＣコン
バータの回路図である。
バータの回路図である。
【００４６】図４において負荷５−１はプリンタやモー
タ等の負荷が大きいもの、負荷５ー２は液晶等の負荷が
小さいものである。
タ等の負荷が大きいもの、負荷５ー２は液晶等の負荷が
小さいものである。
【００４７】図４において負荷５−１、負荷５−２の一
端にスイッチ１０−１、１０−２を設けている。
端にスイッチ１０−１、１０−２を設けている。
【００４８】負荷５−１を使用するときには、負荷オン
信号１１がスイッチ１０−１をオンにし、負荷オン信号
１１から制御部８に信号を出力する。
信号１１がスイッチ１０−１をオンにし、負荷オン信号
１１から制御部８に信号を出力する。
【００４９】また、負荷５−２を使用するときには、負
荷オン信号１２がスイッチ１０−２をオンにし、負荷オ
ン信号１２から制御部８に信号を出力する。
荷オン信号１２がスイッチ１０−２をオンにし、負荷オ
ン信号１２から制御部８に信号を出力する。
【００５０】制御部８では、負荷オン信号１１、１２か
ら信号を入力されたときに、制御パルスＡ、Ｂに出力す
るパルスをコントロールする。
ら信号を入力されたときに、制御パルスＡ、Ｂに出力す
るパルスをコントロールする。
【００５１】まず、ＦＥＴ２−１の電流供給能力が大き
く、ＦＥＴ２−２の電流供給能力が小さい場合の動作を
説明する。
く、ＦＥＴ２−２の電流供給能力が小さい場合の動作を
説明する。
【００５２】制御部８では、負荷オン信号１１から信号
が入力されると、ＨＩＧＨの信号を制御パルスＡに出力
し、制御パルスＡから電流供給能力の大きいＦＥＴ２−
１のゲートにＨＩＧＨの信号を与える。
が入力されると、ＨＩＧＨの信号を制御パルスＡに出力
し、制御パルスＡから電流供給能力の大きいＦＥＴ２−
１のゲートにＨＩＧＨの信号を与える。
【００５３】また、制御部８で負荷オン信号１２から信
号が入力されると、ＨＩＧＨの信号を制御パルスＢに出
力し、制御パルスＢから電流供給能力の小さいＦＥＴ２
−２のゲートにＨＩＧＨの信号を与える。
号が入力されると、ＨＩＧＨの信号を制御パルスＢに出
力し、制御パルスＢから電流供給能力の小さいＦＥＴ２
−２のゲートにＨＩＧＨの信号を与える。
【００５４】次に、ＦＥＴ２−１と、ＦＥＴ２−２の電
流供給能力が同じである場合の動作を説明する。
流供給能力が同じである場合の動作を説明する。
【００５５】制御部８では、負荷オン信号１１から信号
が入力されると、ＨＩＧＨの信号を制御パルスＡ、Ｂに
出力し、制御パルスＡ、ＢからＦＥＴ２−１、ＦＥＴ２
−２双方のゲートにＨＩＧＨの信号を与える。
が入力されると、ＨＩＧＨの信号を制御パルスＡ、Ｂに
出力し、制御パルスＡ、ＢからＦＥＴ２−１、ＦＥＴ２
−２双方のゲートにＨＩＧＨの信号を与える。
【００５６】また、制御部８では、負荷オン信号１２か
ら信号が入力されると、ＨＩＧＨの信号を制御パルスＡ
だけに出力し、制御パルスＡからＦＥＴ２−１のゲート
にＨＩＧＨの信号を与える。
ら信号が入力されると、ＨＩＧＨの信号を制御パルスＡ
だけに出力し、制御パルスＡからＦＥＴ２−１のゲート
にＨＩＧＨの信号を与える。
【００５７】以上の動作によって、負荷の状態を示す信
号により、コンバータに使用するＦＥＴを切替え／或い
はＦＥＴ数を増加させることができる。
号により、コンバータに使用するＦＥＴを切替え／或い
はＦＥＴ数を増加させることができる。
【００５８】図５は本発明の請求項５のＤＣ−ＤＣコン
バータの回路図である。
バータの回路図である。
【００５９】図５において負荷５の手前に電流検出抵抗
９を設け、電流検出部７により出力電流を検出し、検出
した値を制御部８に出力する。
９を設け、電流検出部７により出力電流を検出し、検出
した値を制御部８に出力する。
【００６０】制御部８では、電流検出部７から入力され
た値に応じて、制御パルスＡ、Ｂに出力するパルスをコ
ントロールする。
た値に応じて、制御パルスＡ、Ｂに出力するパルスをコ
ントロールする。
【００６１】まず、ＦＥＴ２−１の電流供給能力が大き
く、ＦＥＴ２−２の電流供給能力が小さい場合の動作に
ついて説明を行う。
く、ＦＥＴ２−２の電流供給能力が小さい場合の動作に
ついて説明を行う。
【００６２】電流検出部７で検出した出力電流が予め設
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＢに出力し、制御パルスＢから電流供給能力の小さ
いＦＥＴ２−２のゲートにＨＩＧＨの信号を与える。
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＢに出力し、制御パルスＢから電流供給能力の小さ
いＦＥＴ２−２のゲートにＨＩＧＨの信号を与える。
【００６３】また、電流検出部７で検出した出力電流が
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡに出力し、制御パルスＡから電流供給
能力の大きいＦＥＴ２−１のゲートにＨＩＧＨの信号を
与える。
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡに出力し、制御パルスＡから電流供給
能力の大きいＦＥＴ２−１のゲートにＨＩＧＨの信号を
与える。
【００６４】次に、ＦＥＴ２−１とＦＥＴ２−２の電流
供給能力が同じである場合の動作について説明を行う。
供給能力が同じである場合の動作について説明を行う。
【００６５】電流検出部７で検出した出力電流が予め設
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＡだけに出力し、制御パルスＡからＦＥＴ２−１の
ゲートにＨＩＧＨの信号を与える。
定した値であれば、制御部８でＨＩＧＨの信号を制御パ
ルスＡだけに出力し、制御パルスＡからＦＥＴ２−１の
ゲートにＨＩＧＨの信号を与える。
【００６６】また、電流検出部７で検出した出力電流が
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡ、Ｂに出力し、制御パルスＡ、Ｂから
ＦＥＴ２−１、ＦＥＴ２−２双方のゲートにＨＩＧＨの
信号を与える。
予め設定した値以上であれば、制御部８でＨＩＧＨの信
号を制御パルスＡ、Ｂに出力し、制御パルスＡ、Ｂから
ＦＥＴ２−１、ＦＥＴ２−２双方のゲートにＨＩＧＨの
信号を与える。
【００６７】以上の動作によって、出力電流が予め設定
した値以上になると、コンバータに使用するＦＥＴを切
替え／或いはＦＥＴ数を増加させることができる。
した値以上になると、コンバータに使用するＦＥＴを切
替え／或いはＦＥＴ数を増加させることができる。
【００６８】尚、本発明それぞれの実施例での各ポイン
トの波形は従来技術で説明を行った図８の波形と形状が
同様であるため説明を省略する。
トの波形は従来技術で説明を行った図８の波形と形状が
同様であるため説明を省略する。
【００６９】
【発明の効果】請求項１〜５記載の発明によれば、供給
する電流の大きさに応じて使用するＦＥＴを切替えた
り、使用するＦＥＴの数を増減させることにより、効率
よくＦＥＴを使用することで、広範囲の負荷に供給可能
とすることができる。
する電流の大きさに応じて使用するＦＥＴを切替えた
り、使用するＦＥＴの数を増減させることにより、効率
よくＦＥＴを使用することで、広範囲の負荷に供給可能
とすることができる。
【図１】請求項１によるＤＣ−ＤＣコンバータの回路図
である。
である。
【図２】請求項２によるＤＣ−ＤＣコンバータの回路図
である。
である。
【図３】請求項３によるＤＣ−ＤＣコンバータの回路図
である。
である。
【図４】請求項４によるＤＣ−ＤＣコンバータの回路図
である。
である。
【図５】請求項５によるＤＣ−ＤＣコンバータの回路図
である。
である。
【図６】従来技術によるＤＣ−ＤＣコンバータの回路図
（その１）である。
（その１）である。
【図７】従来技術によるＤＣ−ＤＣコンバータの回路図
（その２）である。
（その２）である。
【図８】従来技術或いは本発明におけるＤＣ−ＤＣコン
バータの各部分の波形を示したタイミングチャートであ
る。
バータの各部分の波形を示したタイミングチャートであ
る。
１ インダクタ ２、２−１、２−２ ＦＥＴ ３、３−１、３−２、７ ダイオ−ド ４、４−１、４−２ コンデンサ ５、５−１、５−２ 負荷 ６ ２次巻線 ７ 電流検出部 ８ 制御部 ９ 電流検出抵抗 １０−１、１０−２ スイッチ １１、１２ 負荷オン信号
Claims (5)
- 【請求項１】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧するＤＣ−
ＤＣコンバータにおいて、ＦＥＴを複数用い、負荷電流
を検出する手段と、この検出した電流が予め設定した値
以上になると信号を出力する手段とを具備し、この信号
によりコンバータに使用するＦＥＴを切替えることを特
徴とするＤＣ−ＤＣコンバータ。 - 【請求項２】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧するＤＣ−
ＤＣコンバータにおいて、ＦＥＴを複数用い、負荷電流
を検出する手段と、この検出した電流が予め設定した値
以上になると信号を出力する手段とを具備し、この信号
によりコンバータに使用するＦＥＴ数を増加させること
を特徴とするＤＣ−ＤＣコンバータ。 - 【請求項３】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧する請求項
１乃至２に記載のＤＣ−ＤＣコンバータにおいて、ＦＥ
Ｔを複数用い、入力電流を検出する手段と、この検出し
た電流が予め設定した値以上になると信号を出力する手
段とを具備し、この信号によりコンバータに使用するＦ
ＥＴをコントロールすることを特徴とするＤＣ−ＤＣコ
ンバータ。 - 【請求項４】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧する請求項
１乃至２に記載のＤＣ−ＤＣコンバータにおいて、ＦＥ
Ｔを複数用い、負荷の状態を示す入力手段とを備え、前
記入力手段で入力された信号によりコンバータに使用す
るＦＥＴをコントロールすることを特徴とするＤＣ−Ｄ
Ｃコンバータ。 - 【請求項５】 直流電圧をコイルとダイオードとＦＥＴ
とコンデンサを使用して、昇圧若しくは降圧する請求項
１乃至２に記載のＤＣ−ＤＣコンバータにおいて、ＦＥ
Ｔを複数用い、出力電流を検出する手段と、この検出し
た電流が予め設定した値以上になると信号を出力する手
段を具備し、この信号によりコンバータに使用するＦＥ
Ｔをコントロールすることを特徴とするＤＣ−ＤＣコン
バータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25825197A JPH1198824A (ja) | 1997-09-24 | 1997-09-24 | Ｄｃ−ｄｃコンバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25825197A JPH1198824A (ja) | 1997-09-24 | 1997-09-24 | Ｄｃ−ｄｃコンバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1198824A true JPH1198824A (ja) | 1999-04-09 |
Family
ID=17317639
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25825197A Pending JPH1198824A (ja) | 1997-09-24 | 1997-09-24 | Ｄｃ−ｄｃコンバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1198824A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE102010024482A1 (de) * | 2010-06-21 | 2011-12-22 | Texas Instruments Deutschland Gmbh | Elektronische Vorrichtung zur geschalteten DC-DC-Umwandlung und Verfahren zum Betreiben dieser Vorrichtung |
| JP2012151953A (ja) * | 2011-01-18 | 2012-08-09 | Fujitsu General Ltd | 電源装置およびこれを備えた空気調和機 |
-
1997
- 1997-09-24 JP JP25825197A patent/JPH1198824A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE102010024482A1 (de) * | 2010-06-21 | 2011-12-22 | Texas Instruments Deutschland Gmbh | Elektronische Vorrichtung zur geschalteten DC-DC-Umwandlung und Verfahren zum Betreiben dieser Vorrichtung |
| US8816656B2 (en) | 2010-06-21 | 2014-08-26 | Texas Instruments Deutschland Gmbh | Electronic device for switched DC-DC conversion having high-efficiency at high load and low load and method for operating the same |
| DE102010024482B4 (de) | 2010-06-21 | 2020-07-16 | Texas Instruments Deutschland Gmbh | Elektronische Vorrichtung zur geschalteten DC-DC-Umwandlung und Verfahren zum Betreiben dieser Vorrichtung |
| JP2012151953A (ja) * | 2011-01-18 | 2012-08-09 | Fujitsu General Ltd | 電源装置およびこれを備えた空気調和機 |
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