JPH11224220A - メモリ管理方式 - Google Patents

メモリ管理方式

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Publication number
JPH11224220A
JPH11224220A JP10026865A JP2686598A JPH11224220A JP H11224220 A JPH11224220 A JP H11224220A JP 10026865 A JP10026865 A JP 10026865A JP 2686598 A JP2686598 A JP 2686598A JP H11224220 A JPH11224220 A JP H11224220A
Authority
JP
Japan
Prior art keywords
page
area
queue
management area
physical address
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP10026865A
Other languages
English (en)
Inventor
Hidetomo Sanpei
英智 三瓶
Koji Okamura
浩司 岡村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP10026865A priority Critical patent/JPH11224220A/ja
Publication of JPH11224220A publication Critical patent/JPH11224220A/ja
Pending legal-status Critical Current

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  • Memory System (AREA)
  • Memory System Of A Hierarchy Structure (AREA)

Abstract

(57)【要約】 【課題】連続した実メモリ領域を必要とする計算機シス
テムに於いて、処理オーバヘッドおよび必要な資源量を
抑えた使用ページの局所化機能を有するメモリ管理機構
を提供する。 【解決手段】実メモリをある物理アドレスで二つの領域
に分離し、各領域毎に異なった整列方法を適用する。二
つの領域は、物理アドレスをキーにして各ページを厳密
に整列する領域(高精度管理領域)と、物理アドレスが
ある範囲内であるページを一単位として整列を行う領域
(低精度管理領域)に分けられ、できるだけ低精度領域
のメモリを割り当てるようにすることで使用メモリを局
所化する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】この発明は電子計算機システ
ムにおけるメモリ管理方式に関し、特に実メモリの割り
当て方式に関する。
【0002】
【従来の技術】仮想記憶方式を採用した電子計算機シス
テムでは、通常、連続した仮想アドレスに対応する実メ
モリは連続である必要がない。しかし、I/Oのように
ハードウェアが直接メモリにアクセスする場合は物理ア
ドレスを使用するため、物理アドレスの連続したメモリ
が必要になる。
【0003】通常このように物理アドレスの連続した領
域が必要となった場合、実メモリの使用状況が格納され
ているテーブルを検索し、要求された大きさの連続した
空きメモリが存在する場合はこれを割り当て、存在しな
かった場合はメモリ上の情報を他のメモリに移動するこ
とで連続した空きメモリ領域を生成し、これを割り当て
るという方法が使用される。
【0004】しかし、この方法では実メモリ上の情報を
移動する処理に時間を要し、また生成された連続空きメ
モリ領域が物理アドレスでアクセスされるようになると
移動ができなくなることから、この領域がさらに連続し
た実メモリ確保の障害となる可能性がある。
【0005】このため従来は実メモリを管理するページ
テーブルを整列しておき、使用される実メモリを局所化
するという方法が使用されていた。
【0006】
【発明が解決しようとする課題】上記の方式では全ての
ページテーブル操作に対して整列が実行されるため、ペ
ージテーブル数が多い場合は処理のオーバヘッドとなっ
ていた。また、このオーバヘッドを避けるためにハッシ
ュを利用すると、ハッシュのために多くのメモリが必要
となり、ユーザの使用できる資源を圧迫する結果となっ
ていた。
【0007】
【課題を解決するための手段】上記の問題を解決するた
めに、実メモリをある物理アドレスで二つの領域に分離
し、各領域毎に異なった整列方法を適用する。
【0008】二つの領域は、物理アドレスをキーにして
各ページを厳密に整列する領域(高精度管理領域)と、
物理アドレスがある範囲内であるページを一単位として
整列を行う領域(低精度管理領域)に分けられ、できる
だけ低精度領域のメモリを割り当てるようにすることで
使用メモリを局所化する。
【0009】高精度管理領域のページは一つのキュー
と、ハッシュで管理され、キューに属するページは全て
物理アドレス順に整列されている。ハッシュは物理アド
レスをキーとして、対応する範囲にページがあればその
ページを、対応する範囲にページがなければ近傍のハッ
シュを指している。
【0010】高精度管理領域からメモリを確保する際は
キューの最後に繋がれているページを外し、当該ページ
の物理アドレスに対応するハッシュが当該ページを指し
ていればハッシュが隣接したページか、近傍のハッシュ
を指すように更新する。
【0011】高精度管理領域のメモリを解放する際は、
物理ページに対応するハッシュから近傍のページを得
て、キューを検索することで戻すべき位置を見つける。
物理アドレスに対応するハッシュが他のハッシュを指し
ていた場合は当該ページを指すように更新する。
【0012】低精度管理領域のページはある物理アドレ
ス範囲に対応した複数のキューで管理される。ページは
キューの上では整列されない。低精度管理領域には、空
きページを持つキューへのヒントが存在する。
【0013】低精度管理領域からメモリを確保する際は
ヒントの指すキューに繋がれているページを外す。キュ
ーがからになった場合はヒントを更新する。
【0014】低精度管理領域のメモリを解放する際は、
物理アドレスの対応するキューにページを戻し、ヒント
が現在操作しているキューよりも高精度管理領域側を指
している場合は更新する。
【0015】
【発明の実施の形態】本発明の実施例について図面を参
照して詳細に説明する。
【0016】図1は本発明の実施例を示すブロック図で
あり、物理メモリ1は固定長のページに分割される。各
ページは対応するページテーブル8を有し、物理アドレ
スが境界値9よりもより小さい領域を高精度管理領域、
大きい領域を低精度管理領域として管理する。高精度管
理領域のページは物理アドレスをキーとするハッシュ7
を持つ。低精度管理領域はある範囲の物理アドレス毎に
キュー4を持ち、ページはその物理ページに対応したキ
ューに繋がれている。空きページを持つキューへのヒン
ト5と空きページ数を示すフリーカウント10が存在す
る。
【0017】メモリ確保手段2は、はじめに低精度管理
領域の空きページ数を調べ、空きページが存在する場合
はヒント5の指すキューからページを確保する。確保し
たページが当該キューの最後のページであった場合は、
ヒント5が現在のキューよりもひとつ高精度管理領域側
のキューを指すように更新する。
【0018】低精度管理領域に空きページが存在しない
場合は高精度管理領域のキューの最後尾に存在するペー
ジを確保する。確保したページに対応するハッシュ7が
確保したページを指していた場合は、ハッシュの指すペ
ージを自分に隣接したページに更新する。ハッシュの対
応する物理アドレス範囲内にページが存在しないときは
隣接するハッシュを指すように更新する。
【0019】ページ解放手段3は、ページテーブルを調
べ、低精度管理領域のページである場合は低精度管理キ
ュー4のなかで対応するものにページを繋ぐ。ヒントが
いま操作したキューよりも高精度管理領域側のキューを
指していた場合は、ヒントが現在操作したキューを指す
ように更新する。
【0020】高精度管理領域のページである場合は、ペ
ージに対応するハッシュから、解放するページを挿入す
べき位置の近傍に存在するページを見つけ、物理アドレ
スをキーにしてキューをたどり、ページを挿入すべき位
置に隣接したページを見つけ、繋ぐ。
【0021】
【発明の効果】本発明により、キューのエレメントを整
列しておく必要がある場合であっても、エレメントの使
用頻度等を考慮して厳密に整列しておく領域と、ある単
位で整列されていればいい領域を分離することで整列に
必要なオーバヘッドおよび資源量を軽減することが可能
となる。
【図面の簡単な説明】
【図1】本発明の実施例のブロック図。
【図2】メモリ確保処理を示すフローチャート。
【図3】メモリ解放処理を示すフローチャート。
【符号の説明】
1…実メモリ、 2…メモリ確保手段、
3…メモリ解放手段、4…低精度管理キュー、5…ヒン
ト、6…高精度管理キュー、7…ハッシュ、8…ページ
テーブル、 9…境界、 10…フリーカウント。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】実メモリを管理するページテーブルを、物
    理アドレスに応じて二つの領域に分割し、各領域毎に異
    なった整列方法を適用することを特徴とするメモリ管理
    方式。
JP10026865A 1998-02-09 1998-02-09 メモリ管理方式 Pending JPH11224220A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP10026865A JPH11224220A (ja) 1998-02-09 1998-02-09 メモリ管理方式

Applications Claiming Priority (1)

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JP10026865A JPH11224220A (ja) 1998-02-09 1998-02-09 メモリ管理方式

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Publication Number Publication Date
JPH11224220A true JPH11224220A (ja) 1999-08-17

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ID=12205192

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Application Number Title Priority Date Filing Date
JP10026865A Pending JPH11224220A (ja) 1998-02-09 1998-02-09 メモリ管理方式

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JP (1) JPH11224220A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100381647B1 (ko) * 1999-10-15 2003-04-26 세이코 엡슨 가부시키가이샤 데이터 전송 제어 장치 및 전자 기기
KR100381645B1 (ko) * 1999-10-15 2003-04-26 세이코 엡슨 가부시키가이샤 데이터 전송 제어 장치 및 전자기기

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US6810445B1 (en) 1999-10-15 2004-10-26 Seiko Espon Corporation Data transfer control device and electronic equipment
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