JPH11150538A - Ａｔｍ交換機 - Google Patents
Ａｔｍ交換機Info
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- JPH11150538A JPH11150538A JP31385197A JP31385197A JPH11150538A JP H11150538 A JPH11150538 A JP H11150538A JP 31385197 A JP31385197 A JP 31385197A JP 31385197 A JP31385197 A JP 31385197A JP H11150538 A JPH11150538 A JP H11150538A
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- atm switch
- loss rate
- cac
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Abstract
(57)【要約】
【課題】 ３段構成のＡＴＭ交換機では、各段でＣＡＣ
を行っているが、中間段のＡＴＭスイッチにＣＡＣ装置
を備えることにより、ハードウェアが複雑化し、ＡＴＭ
交換機の高速化が妨げられる。 【解決手段】 中間段のＡＴＭスイッチにはＣＡＣ装置
を設けず、その代わりに、出力段のＡＴＭスイッチの入
力に中間段のＡＴＭスイッチのための仮想ＣＡＣ装置を
設ける。
を行っているが、中間段のＡＴＭスイッチにＣＡＣ装置
を備えることにより、ハードウェアが複雑化し、ＡＴＭ
交換機の高速化が妨げられる。 【解決手段】 中間段のＡＴＭスイッチにはＣＡＣ装置
を設けず、その代わりに、出力段のＡＴＭスイッチの入
力に中間段のＡＴＭスイッチのための仮想ＣＡＣ装置を
設ける。
Description
【０００１】
【発明の属する技術分野】本発明はＡＴＭ(Asynchronou
s Transfer Mode)に利用する。本発明は３段構成のＡＴ
Ｍ交換機に利用するに適する。特に、ＣＡＣ(Connectio
n Admission Control)技術に関する。
s Transfer Mode)に利用する。本発明は３段構成のＡＴ
Ｍ交換機に利用するに適する。特に、ＣＡＣ(Connectio
n Admission Control)技術に関する。
【０００２】
【従来の技術】従来のＡＴＭ交換機を図６および図７を
参照して説明する。図６は従来のＡＴＭ交換機の要部構
成図である。図７はＣＡＣについて説明するための図で
ある。図６において、符号１−１〜１−ｋは小型のＡＴ
Ｍ交換機ＡＨＭ(ATM Handring Module) であり、一般的
にはＵＰＣ(Usage Parameter Control) やヘッダコンバ
ータ等の複雑な処理を行う。一方、符号３の大型のＡＴ
Ｍ交換機ＡＭＣ(ATM Module Connector)は、セルのルー
ティングを高速に行うジャンクタである。
参照して説明する。図６は従来のＡＴＭ交換機の要部構
成図である。図７はＣＡＣについて説明するための図で
ある。図６において、符号１−１〜１−ｋは小型のＡＴ
Ｍ交換機ＡＨＭ(ATM Handring Module) であり、一般的
にはＵＰＣ(Usage Parameter Control) やヘッダコンバ
ータ等の複雑な処理を行う。一方、符号３の大型のＡＴ
Ｍ交換機ＡＭＣ(ATM Module Connector)は、セルのルー
ティングを高速に行うジャンクタである。
【０００３】図６に示すように、小型のＡＴＭ交換機で
あるＡＨＭ１−１〜１−Ｋ、２−１〜２−Ｋと、大型か
つ高速のＡＴＭ交換機であるＡＭＣ３とを組合わせて拡
張することにより、小型から大型までのＡＴＭ交換機を
柔軟に実現することができる。
あるＡＨＭ１−１〜１−Ｋ、２−１〜２−Ｋと、大型か
つ高速のＡＴＭ交換機であるＡＭＣ３とを組合わせて拡
張することにより、小型から大型までのＡＴＭ交換機を
柔軟に実現することができる。
【０００４】新しいコネクションの接続要求が発生した
ときに、そのコネクションが接続可能か否かを判断する
ことはＣＡＣと呼ばれ、従来のＡＴＭ交換機では、一段
目のＡＨＭ１−１〜１−Ｋの出力、ＡＭＣ３の出力、三
段目のＡＨＭ２−１〜２−Ｋの出力でそれぞれセルの品
質劣化が生じる可能性があるため、それぞれの箇所で行
われる。そのため、ＣＡＣ装置７により３箇所のポイン
トのトラヒック状況をチェックしている。
ときに、そのコネクションが接続可能か否かを判断する
ことはＣＡＣと呼ばれ、従来のＡＴＭ交換機では、一段
目のＡＨＭ１−１〜１−Ｋの出力、ＡＭＣ３の出力、三
段目のＡＨＭ２−１〜２−Ｋの出力でそれぞれセルの品
質劣化が生じる可能性があるため、それぞれの箇所で行
われる。そのため、ＣＡＣ装置７により３箇所のポイン
トのトラヒック状況をチェックしている。
【０００５】図７には、そのＣＡＣの例を示す。品質劣
化点のバッファのキューの書込みのセルトラヒックをモ
ニタし、ある周期Ｔ内の到着セル数の度数分布を計算し
ておく。新しいコネクションのピークレートＰをもと
に、当該度数分布をオフセットし、分布がキュー長Ｑよ
りも越えている部分の期待値からセル損失率を推定す
る。
化点のバッファのキューの書込みのセルトラヒックをモ
ニタし、ある周期Ｔ内の到着セル数の度数分布を計算し
ておく。新しいコネクションのピークレートＰをもと
に、当該度数分布をオフセットし、分布がキュー長Ｑよ
りも越えている部分の期待値からセル損失率を推定す
る。
【０００６】
【発明が解決しようとする課題】このような従来のＡＴ
Ｍ交換機では、ＡＭＣ３は高速なリンクで接続されてお
り、また、経済化のため、できるだけシンプルなハード
ウェアにより実現することが必要である。そのＡＭＣ３
にＣＡＣ装置を設けることは、シンプルなハードウェア
の実現に逆行することになる。
Ｍ交換機では、ＡＭＣ３は高速なリンクで接続されてお
り、また、経済化のため、できるだけシンプルなハード
ウェアにより実現することが必要である。そのＡＭＣ３
にＣＡＣ装置を設けることは、シンプルなハードウェア
の実現に逆行することになる。
【０００７】また、ＡＭＣ３の代わりに、クロスコネク
ト装置等を用いると、ＡＭＣ３でのＣＡＣの回答を得る
のに、ＯｐＳ（オペレーションシステム）を経由して行
うため、長い時間が必要であり、呼接続時間が長くな
る。
ト装置等を用いると、ＡＭＣ３でのＣＡＣの回答を得る
のに、ＯｐＳ（オペレーションシステム）を経由して行
うため、長い時間が必要であり、呼接続時間が長くな
る。
【０００８】そのために、ＡＭＣ３を品質劣化ポイント
としないため、速度を２倍にあげる方法もあるが経済上
問題となる。
としないため、速度を２倍にあげる方法もあるが経済上
問題となる。
【０００９】本発明は、このような背景に行われたもの
であって、シンプルで経済的なＡＭＣを備えたＡＴＭ交
換機を提供することを目的とする。本発明は、高速なＡ
ＴＭ交換機を提供することを目的とする。
であって、シンプルで経済的なＡＭＣを備えたＡＴＭ交
換機を提供することを目的とする。本発明は、高速なＡ
ＴＭ交換機を提供することを目的とする。
【００１０】
【課題を解決するための手段】本発明は、ＡＭＣにはＣ
ＡＣ装置が存在せず、代わりに３段目のＡＨＭの入力に
仮想的なバッファを設けることを最も主要な特徴とす
る。従来の技術とは、ＡＭＣではＣＡＣを行わなくてよ
い点が異なる。
ＡＣ装置が存在せず、代わりに３段目のＡＨＭの入力に
仮想的なバッファを設けることを最も主要な特徴とす
る。従来の技術とは、ＡＭＣではＣＡＣを行わなくてよ
い点が異なる。
【００１１】すなわち、本発明はＡＴＭ交換機であっ
て、入力ハイウェイをそれぞれ収容する１以上の入力段
ＡＴＭスイッチと、この入力段ＡＴＭスイッチが入力回
線に接続された主ＡＴＭスイッチと、この主ＡＴＭスイ
ッチの出力回線に接続され出力ハイウェイをそれぞれ収
容する１以上の出力段ＡＴＭスイッチと、新たなコネク
ションの受付可否の判定制御を行うＣＡＣ手段とを備え
たＡＴＭ交換機である。
て、入力ハイウェイをそれぞれ収容する１以上の入力段
ＡＴＭスイッチと、この入力段ＡＴＭスイッチが入力回
線に接続された主ＡＴＭスイッチと、この主ＡＴＭスイ
ッチの出力回線に接続され出力ハイウェイをそれぞれ収
容する１以上の出力段ＡＴＭスイッチと、新たなコネク
ションの受付可否の判定制御を行うＣＡＣ手段とを備え
たＡＴＭ交換機である。
【００１２】ここで、本発明の特徴とするところは、前
記出力段ＡＴＭスイッチの入力には、仮想的なバッファ
と、この仮想的なバッファのセル損失率を推定する手段
とを備え、前記ＣＡＣ手段は、この仮想的なバッファの
セル損失率にしたがって前記主ＡＴＭスイッチのＣＡＣ
を行う手段を含むところにある。
記出力段ＡＴＭスイッチの入力には、仮想的なバッファ
と、この仮想的なバッファのセル損失率を推定する手段
とを備え、前記ＣＡＣ手段は、この仮想的なバッファの
セル損失率にしたがって前記主ＡＴＭスイッチのＣＡＣ
を行う手段を含むところにある。
【００１３】前記仮想的なバッファは、前記入力に到来
するセル数を計数する手段と、この計数結果を前記主Ａ
ＴＭスイッチのセル読出速度以下の速度で減算する手段
とを備えることが望ましい。これにより、実際のバッフ
ァを設けることなく、仮想的なバッファを構成すること
ができる。
するセル数を計数する手段と、この計数結果を前記主Ａ
ＴＭスイッチのセル読出速度以下の速度で減算する手段
とを備えることが望ましい。これにより、実際のバッフ
ァを設けることなく、仮想的なバッファを構成すること
ができる。
【００１４】前記推定する手段は、前記減算する手段の
減算結果と前記仮想的なバッファのサイズとを比較する
手段と、この比較結果にしたがって前記仮想的なバッフ
ァの損失セル数を計数する手段とを備え、この損失セル
数を到着セル数により除することによりセル損失率を推
定する手段を含むことが望ましい。
減算結果と前記仮想的なバッファのサイズとを比較する
手段と、この比較結果にしたがって前記仮想的なバッフ
ァの損失セル数を計数する手段とを備え、この損失セル
数を到着セル数により除することによりセル損失率を推
定する手段を含むことが望ましい。
【００１５】すなわち、前記減算結果が前記仮想的なバ
ッファのサイズよりも大きい場合には、この仮想的なバ
ッファからセルがオーバーフローしていることを示して
いる。したがって、このときの損失セル数を到着セル数
により除することによりセル損失率を推定することがで
きる。
ッファのサイズよりも大きい場合には、この仮想的なバ
ッファからセルがオーバーフローしていることを示して
いる。したがって、このときの損失セル数を到着セル数
により除することによりセル損失率を推定することがで
きる。
【００１６】前記仮想的なバッファのサイズは、前記主
ＡＴＭスイッチのバッファのサイズ以下に設定されるこ
とが望ましい。これにより、仮想的なバッファのサイズ
をＣＡＣを行う上で安全側に設定することができる。
ＡＴＭスイッチのバッファのサイズ以下に設定されるこ
とが望ましい。これにより、仮想的なバッファのサイズ
をＣＡＣを行う上で安全側に設定することができる。
【００１７】前記ＣＡＣを行う手段は、前記仮想的なバ
ッファのセル損失率推定値を平滑化するローパスフィル
タを含むことが望ましい。これにより、今回推定したセ
ル損失率推定値をそのままＣＡＣに適用する場合に比較
し、例えば、バースト的な一時的なトラヒックの増加の
影響を除去したＣＡＣを行うことができる。平滑化の程
度は、そのＡＴＭ交換機が収容している回線のトラヒッ
ク特性その他を配慮して適宜設定されることがよい。
ッファのセル損失率推定値を平滑化するローパスフィル
タを含むことが望ましい。これにより、今回推定したセ
ル損失率推定値をそのままＣＡＣに適用する場合に比較
し、例えば、バースト的な一時的なトラヒックの増加の
影響を除去したＣＡＣを行うことができる。平滑化の程
度は、そのＡＴＭ交換機が収容している回線のトラヒッ
ク特性その他を配慮して適宜設定されることがよい。
【００１８】前記ＣＡＣを行う手段は、受付可否判定の
対象となるコネクションのピークセルレートにしたがっ
て前記仮想的なバッファに負荷を加える手段を含む構成
としたり、受付可否判定の対象となるコネクションのピ
ークセルレートにしたがって前記仮想的なバッファのバ
ッファサイズを短くする手段を含む構成とすることもで
きる。これにより、ユーザの申告などによりあらかじめ
ピークセルレートがわかっている場合には、これを加味
したＣＡＣを行うことができる。
対象となるコネクションのピークセルレートにしたがっ
て前記仮想的なバッファに負荷を加える手段を含む構成
としたり、受付可否判定の対象となるコネクションのピ
ークセルレートにしたがって前記仮想的なバッファのバ
ッファサイズを短くする手段を含む構成とすることもで
きる。これにより、ユーザの申告などによりあらかじめ
ピークセルレートがわかっている場合には、これを加味
したＣＡＣを行うことができる。
【００１９】
【発明の実施の形態】発明の実施の形態を図１ないし図
５を参照して説明する。図１は本発明第一実施例のＡＴ
Ｍ交換機の要部構成図である。図２は本発明第一実施例
の仮想ＣＡＣ装置の概念図である。図３は本発明第一実
施例の仮想ＣＡＣ装置の要部ブロック構成図である。図
４は本発明第二実施例の仮想ＣＡＣ装置の要部ブロック
構成図である。図５は本発明第三実施例の仮想ＣＡＣ装
置の要部ブロック構成図である。
５を参照して説明する。図１は本発明第一実施例のＡＴ
Ｍ交換機の要部構成図である。図２は本発明第一実施例
の仮想ＣＡＣ装置の概念図である。図３は本発明第一実
施例の仮想ＣＡＣ装置の要部ブロック構成図である。図
４は本発明第二実施例の仮想ＣＡＣ装置の要部ブロック
構成図である。図５は本発明第三実施例の仮想ＣＡＣ装
置の要部ブロック構成図である。
【００２０】本発明はＡＴＭ交換機であって、図１に示
すように、入力ハイウェイ４−１1〜４−２K をそれぞ
れ収容する入力段ＡＴＭスイッチであるＡＨＭ１−１〜
１−Ｋと、このＡＨＭ１−１〜１−Ｋが入力回線に接続
された主ＡＴＭスイッチであるＡＭＣ３と、このＡＭＣ
３の出力回線に接続され出力ハイウェイ５−１1 〜５−
２K をそれぞれ収容する出力段ＡＴＭスイッチであるＡ
ＨＭ２−１〜２−Ｋと、新たなコネクションの受付可否
の判定制御を行うＣＡＣ手段であるＣＡＣ装置７および
仮想ＣＡＣ装置６とを備えたＡＴＭ交換機である。
すように、入力ハイウェイ４−１1〜４−２K をそれぞ
れ収容する入力段ＡＴＭスイッチであるＡＨＭ１−１〜
１−Ｋと、このＡＨＭ１−１〜１−Ｋが入力回線に接続
された主ＡＴＭスイッチであるＡＭＣ３と、このＡＭＣ
３の出力回線に接続され出力ハイウェイ５−１1 〜５−
２K をそれぞれ収容する出力段ＡＴＭスイッチであるＡ
ＨＭ２−１〜２−Ｋと、新たなコネクションの受付可否
の判定制御を行うＣＡＣ手段であるＣＡＣ装置７および
仮想ＣＡＣ装置６とを備えたＡＴＭ交換機である。
【００２１】ここで、本発明の特徴とするところは、図
２に示すように、ＡＨＭ２−１〜２−Ｋの入力には、仮
想的なバッファＢと、この仮想的なバッファＢのセル損
失率を推定する手段であるセル損失率推定部１５とを備
え、仮想ＣＡＣ装置６は、この仮想的なバッファＢのセ
ル損失率にしたがってＡＭＣ３のＣＡＣを行うところに
ある。
２に示すように、ＡＨＭ２−１〜２−Ｋの入力には、仮
想的なバッファＢと、この仮想的なバッファＢのセル損
失率を推定する手段であるセル損失率推定部１５とを備
え、仮想ＣＡＣ装置６は、この仮想的なバッファＢのセ
ル損失率にしたがってＡＭＣ３のＣＡＣを行うところに
ある。
【００２２】仮想的なバッファＢは、図３に示すよう
に、前記入力に到来するセル数を計数し、この計数結果
をＡＭＣ３のセル読出速度以下の速度で減算する手段で
あるカウンタ１１を備える。
に、前記入力に到来するセル数を計数し、この計数結果
をＡＭＣ３のセル読出速度以下の速度で減算する手段で
あるカウンタ１１を備える。
【００２３】セル損失率推定部１５は、カウンタ１１の
計数値と仮想的なバッファＢのサイズとを比較する手段
である比較器１２と、この比較結果にしたがって仮想的
なバッファＢの損失セル数を計数する手段であるカウン
タ１３とを備え、この損失セル数をカウンタ１４により
計数された到着セル数により除することによりセル損失
率を推定する。仮想的なバッファＢのサイズは、ＡＭＣ
３のバッファのサイズ以下に設定される。
計数値と仮想的なバッファＢのサイズとを比較する手段
である比較器１２と、この比較結果にしたがって仮想的
なバッファＢの損失セル数を計数する手段であるカウン
タ１３とを備え、この損失セル数をカウンタ１４により
計数された到着セル数により除することによりセル損失
率を推定する。仮想的なバッファＢのサイズは、ＡＭＣ
３のバッファのサイズ以下に設定される。
【００２４】仮想ＣＡＣ装置６は、仮想的なバッファＢ
のセル損失率推定値を平滑化するローパスフィルタ１６
を含み、コネクション受付判定部２０は、この平滑化さ
れたセル損失率推定値をＡＭＣ３のセル損失率推定値と
して採用し、ＣＡＣを実行する。
のセル損失率推定値を平滑化するローパスフィルタ１６
を含み、コネクション受付判定部２０は、この平滑化さ
れたセル損失率推定値をＡＭＣ３のセル損失率推定値と
して採用し、ＣＡＣを実行する。
【００２５】図４に示すように、本発明第二実施例で
は、仮想ＣＡＣ装置６は、受付可否判定の対象となるコ
ネクション（以下、これを被ＣＡＣコネクションとい
う）のピークセルレートにしたがって仮想的なバッファ
Ｂに負荷を加える手段であるトリガ発生器１７を含む構
成とする。
は、仮想ＣＡＣ装置６は、受付可否判定の対象となるコ
ネクション（以下、これを被ＣＡＣコネクションとい
う）のピークセルレートにしたがって仮想的なバッファ
Ｂに負荷を加える手段であるトリガ発生器１７を含む構
成とする。
【００２６】また、図５に示すように、本発明第三実施
例では、仮想ＣＡＣ装置６は、被ＣＡＣコネクションの
ピークセルレートにしたがって仮想的なバッファＢのバ
ッファサイズを短くする手段であるしきい値変更部１８
を含む構成とする。
例では、仮想ＣＡＣ装置６は、被ＣＡＣコネクションの
ピークセルレートにしたがって仮想的なバッファＢのバ
ッファサイズを短くする手段であるしきい値変更部１８
を含む構成とする。
【００２７】
【実施例】（第一実施例）本発明第一実施例を図１ない
し図３を参照して説明する。図１に示す本発明第一実施
例のＡＴＭ交換機は、図６に示した従来のＡＴＭ交換機
と同様に、ＡＨＭ１−１〜１−Ｋ、ＡＭＣ３、ＡＨＭ２
−１〜２−Ｋにより構成される。ＡＭＣ３には、ＣＡＣ
装置が備えられておらず、代わりに３段目のＡＨＭ２−
１〜２−Ｋの入力に仮想ＣＡＣ装置６を備えている。
し図３を参照して説明する。図１に示す本発明第一実施
例のＡＴＭ交換機は、図６に示した従来のＡＴＭ交換機
と同様に、ＡＨＭ１−１〜１−Ｋ、ＡＭＣ３、ＡＨＭ２
−１〜２−Ｋにより構成される。ＡＭＣ３には、ＣＡＣ
装置が備えられておらず、代わりに３段目のＡＨＭ２−
１〜２−Ｋの入力に仮想ＣＡＣ装置６を備えている。
【００２８】図２に示すように、ＡＨＭ２−１〜２−Ｋ
に入力される有効セルは、有効セル検出部１０により仮
想的なバッファＢにトリガとして入力される。仮想的な
バッファＢは速度ｖ′で読み出され、そのキュー長は
Ｑ′である。
に入力される有効セルは、有効セル検出部１０により仮
想的なバッファＢにトリガとして入力される。仮想的な
バッファＢは速度ｖ′で読み出され、そのキュー長は
Ｑ′である。
【００２９】ここで、ｖを実際のＡＭＣ３の読出し速度
とし、Ｑを実際のＡＭＣ３の出力バッファのサイズとす
れば、 ｖ′≦ｖ Ｑ′≦Ｑ とすることにより、ＡＭＣ３よりも先に仮想ＣＡＣ装置
６で品質の劣化を検出することができる。
とし、Ｑを実際のＡＭＣ３の出力バッファのサイズとす
れば、 ｖ′≦ｖ Ｑ′≦Ｑ とすることにより、ＡＭＣ３よりも先に仮想ＣＡＣ装置
６で品質の劣化を検出することができる。
【００３０】図３に示すように、ＡＭＣ３から有効セル
が有効セル検出部１０に到着する毎に、カウンタ１１に
トリガが入力され、カウンタ１１はカウントアップされ
る。また、このカウンタ１１はｖ′で減算されるマイナ
スにならないカウンタである。このカウンタ１１の計数
値を比較器１２でしきい値Ｑ′と比較する。このとき、
カウンタ１１の計数値がしきい値Ｑ′よりも大きい場合
には、仮想的なバッファＢのサイズよりも大きい数のセ
ルが到着していることを表し、これは仮想的なバッファ
Ｂのオーバーフローを意味する。この損失セル数ｎはカ
ウンタ１３により計数される。
が有効セル検出部１０に到着する毎に、カウンタ１１に
トリガが入力され、カウンタ１１はカウントアップされ
る。また、このカウンタ１１はｖ′で減算されるマイナ
スにならないカウンタである。このカウンタ１１の計数
値を比較器１２でしきい値Ｑ′と比較する。このとき、
カウンタ１１の計数値がしきい値Ｑ′よりも大きい場合
には、仮想的なバッファＢのサイズよりも大きい数のセ
ルが到着していることを表し、これは仮想的なバッファ
Ｂのオーバーフローを意味する。この損失セル数ｎはカ
ウンタ１３により計数される。
【００３１】また、カウンタ１４は、有効セル検出部１
０に到着した有効セル数Ｎを計数しており、セル損失率
推定部１５により、 ｎ／Ｎ によってセル損失率推定値が求められる。なお、周期Ｔ
毎にカウンタ１３および１４はリセットされるので、時
間Ｔ内のセル損失率推定値が求められる。
０に到着した有効セル数Ｎを計数しており、セル損失率
推定部１５により、 ｎ／Ｎ によってセル損失率推定値が求められる。なお、周期Ｔ
毎にカウンタ１３および１４はリセットされるので、時
間Ｔ内のセル損失率推定値が求められる。
【００３２】さらに、この時間Ｔ内のセル損失率推定値
は、ローパスフィルタ１６に入力され、 ＣＬＲ＝α・ＣＬＲ′＋（１−α）・ｎ／Ｎ （０≦α≦１） により平滑化される。ただし、ＣＬＲ′は前回推定され
平滑化されたセル損失率推定値であり、αはＡＴＭ交換
機が収容する回線のトラヒック特性その他により適宜設
定される係数である。αを“１”に近づけると、前回推
定され平滑化されたセル損失率推定値（ＣＬＲ′）の影
響を大きく受けた値が今回の平滑化されたセル損失率推
定値ＣＬＲとなり、逆に、αを“０”に近づけると、今
回の平滑化以前の推定されたセル損失率推定値（ｎ／
Ｎ）の影響を大きく受けた値が今回の平滑化されたセル
損失率推定値ＣＬＲとなる。この平滑化されたセル損失
率推定値ＣＬＲにしたがってコネクション受付判定部２
０はＡＭＣ３のコネクション受付け判定を行う。
は、ローパスフィルタ１６に入力され、 ＣＬＲ＝α・ＣＬＲ′＋（１−α）・ｎ／Ｎ （０≦α≦１） により平滑化される。ただし、ＣＬＲ′は前回推定され
平滑化されたセル損失率推定値であり、αはＡＴＭ交換
機が収容する回線のトラヒック特性その他により適宜設
定される係数である。αを“１”に近づけると、前回推
定され平滑化されたセル損失率推定値（ＣＬＲ′）の影
響を大きく受けた値が今回の平滑化されたセル損失率推
定値ＣＬＲとなり、逆に、αを“０”に近づけると、今
回の平滑化以前の推定されたセル損失率推定値（ｎ／
Ｎ）の影響を大きく受けた値が今回の平滑化されたセル
損失率推定値ＣＬＲとなる。この平滑化されたセル損失
率推定値ＣＬＲにしたがってコネクション受付判定部２
０はＡＭＣ３のコネクション受付け判定を行う。
【００３３】（第二実施例）本発明第二実施例を図４を
参照して説明する。本発明第二実施例では、被ＣＡＣコ
ネクションのピークセルレートに基づき、トリガ発生器
１７は、周期的にカウンタ１１をカウントアップする。
例えば、被ＣＡＣコネクションが１５Ｍｂ／ｓの場合
は、トリガ発生器１７は、１０セルに１回（１５０Ｍｂ
／ｓ毎）、カウンタ１１をカウントアップするためのト
リガを出力するようにする。
参照して説明する。本発明第二実施例では、被ＣＡＣコ
ネクションのピークセルレートに基づき、トリガ発生器
１７は、周期的にカウンタ１１をカウントアップする。
例えば、被ＣＡＣコネクションが１５Ｍｂ／ｓの場合
は、トリガ発生器１７は、１０セルに１回（１５０Ｍｂ
／ｓ毎）、カウンタ１１をカウントアップするためのト
リガを出力するようにする。
【００３４】これにより計算されたセル損失率推定値
（ｎ／Ｎ）をさらにローパスフィルタ１６により平滑化
したセル損失率推定値ＣＬＲにしたがってコネクション
受付判定部２０によりコネクション受付け判定を行うこ
とにより、あらかじめ申告されるピークセルレートをＣ
ＡＣに反映させることができる。
（ｎ／Ｎ）をさらにローパスフィルタ１６により平滑化
したセル損失率推定値ＣＬＲにしたがってコネクション
受付判定部２０によりコネクション受付け判定を行うこ
とにより、あらかじめ申告されるピークセルレートをＣ
ＡＣに反映させることができる。
【００３５】（第三実施例）本発明第三実施例を図５を
参照して説明する。本発明第三実施例では、被ＣＡＣコ
ネクションのピークセルレートに基づき、しきい値変更
部１８は、しきい値Ｑ′の値を変更する。本発明第二実
施例では、カウンタ１１に負荷を加えることにより、被
ＣＡＣコネクションのピークセルレートをＣＡＣに反映
させたが、本発明第三実施例では、このように、しきい
値Ｑ′の値を変更することにより、被ＣＡＣコネクショ
ンのピークセルレートをＣＡＣに反映させる。
参照して説明する。本発明第三実施例では、被ＣＡＣコ
ネクションのピークセルレートに基づき、しきい値変更
部１８は、しきい値Ｑ′の値を変更する。本発明第二実
施例では、カウンタ１１に負荷を加えることにより、被
ＣＡＣコネクションのピークセルレートをＣＡＣに反映
させたが、本発明第三実施例では、このように、しきい
値Ｑ′の値を変更することにより、被ＣＡＣコネクショ
ンのピークセルレートをＣＡＣに反映させる。
【００３６】すなわち、しきい値Ｑ′の値を小さくする
ことは、本発明第二実施例におけるカウンタ１１に負荷
を加えることに等価である。図５の例では、仮想的なバ
ッファＢのサイズを表すしきい値Ｑ′を ＰＣＲ（ピークセルレート）／ｖ′・Ｑ′ だけ短くし、これにより計算されるセル損失率推定値
（ｎ／Ｎ）をさらにローパスフィルタ１６により平滑化
したセル損失率推定値ＣＬＲにしたがってコネクション
受付判定部２０によりコネクション受付け判定を行うこ
とにより、あらかじめ申告されるピークセルレートをＣ
ＡＣに反映させることができる。
ことは、本発明第二実施例におけるカウンタ１１に負荷
を加えることに等価である。図５の例では、仮想的なバ
ッファＢのサイズを表すしきい値Ｑ′を ＰＣＲ（ピークセルレート）／ｖ′・Ｑ′ だけ短くし、これにより計算されるセル損失率推定値
（ｎ／Ｎ）をさらにローパスフィルタ１６により平滑化
したセル損失率推定値ＣＬＲにしたがってコネクション
受付判定部２０によりコネクション受付け判定を行うこ
とにより、あらかじめ申告されるピークセルレートをＣ
ＡＣに反映させることができる。
【００３７】
【発明の効果】以上説明したように、本発明によれば、
シンプルで経済的なＡＭＣを備えることができる。これ
により、高速なＡＴＭ交換機を実現することができる。
シンプルで経済的なＡＭＣを備えることができる。これ
により、高速なＡＴＭ交換機を実現することができる。
【図１】本発明第一実施例のＡＴＭ交換機の要部構成
図。
図。
【図２】本発明第一実施例の仮想ＣＡＣ装置の概念図。
【図３】本発明第一実施例の仮想ＣＡＣ装置の要部ブロ
ック構成図。
ック構成図。
【図４】本発明第二実施例の仮想ＣＡＣ装置の要部ブロ
ック構成図。
ック構成図。
【図５】本発明第三実施例の仮想ＣＡＣ装置の要部ブロ
ック構成図。
ック構成図。
【図６】従来のＡＴＭ交換機の要部構成図。
【図７】ＣＡＣについて説明するための図。
１−１〜１−Ｋ、２、２−１〜２−Ｋ ＡＨＭ ３ ＡＭＣ ４−１1 〜４−２K 入力ハイウェイ ５−１1 〜５−２K 出力ハイウェイ ６ 仮想ＣＡＣ装置 ７ ＣＡＣ装置 １０ 有効セル検出部 １１、１３、１４ カウンタ １２ 比較器 １５ セル損失率推定部 １６ ローパスフィルタ １７ トリガ発生器 １８ しきい値変更部 ２０ コネクション受付判定部 Ｂ 仮想的なバッファ
Claims (7)
- 【請求項１】 入力ハイウェイをそれぞれ収容する１以
上の入力段ＡＴＭスイッチと、この入力段ＡＴＭスイッ
チが入力回線に接続された主ＡＴＭスイッチと、この主
ＡＴＭスイッチの出力回線に接続され出力ハイウェイを
それぞれ収容する１以上の出力段ＡＴＭスイッチと、新
たなコネクションの受付可否の判定制御を行うＣＡＣ(C
onnection Admission Control)手段とを備えたＡＴＭ交
換機において、 前記出力段ＡＴＭスイッチの入力には、仮想的なバッフ
ァと、この仮想的なバッファのセル損失率を推定する手
段とを備え、 前記ＣＡＣ手段は、この仮想的なバッファのセル損失率
にしたがって前記主ＡＴＭスイッチのＣＡＣを行う手段
を含むことを特徴とするＡＴＭ交換機。 - 【請求項２】 前記仮想的なバッファは、前記入力に到
来するセル数を計数する手段と、この計数結果を前記主
ＡＴＭスイッチのセル読出速度以下の速度で減算する手
段とを含む請求項１記載のＡＴＭ交換機。 - 【請求項３】 前記推定する手段は、前記減算する手段
の減算結果と前記仮想的なバッファのサイズとを比較す
る手段と、この比較結果にしたがって前記仮想的なバッ
ファの損失セル数を計数する手段とを備え、この損失セ
ル数を到着セル数により除することによりセル損失率を
推定する手段を含む請求項１または２記載のＡＴＭ交換
機。 - 【請求項４】 前記仮想的なバッファのサイズは、前記
主ＡＴＭスイッチのバッファのサイズ以下に設定された
請求項３記載のＡＴＭ交換機。 - 【請求項５】 前記ＣＡＣを行う手段は、前記仮想的な
バッファのセル損失率推定値を平滑化するローパスフィ
ルタを含む請求項１または３記載のＡＴＭ交換機。 - 【請求項６】 前記ＣＡＣを行う手段は、受付可否判定
の対象となるコネクションのピークセルレートにしたが
って前記仮想的なバッファに負荷を加える手段を含む請
求項１記載のＡＴＭ交換機。 - 【請求項７】 前記ＣＡＣを行う手段は、受付可否判定
の対象となるコネクションのピークセルレートにしたが
って前記仮想的なバッファのバッファサイズを短くする
手段を含む請求項１記載のＡＴＭ交換機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31385197A JP3088986B2 (ja) | 1997-11-14 | 1997-11-14 | Ａｔｍ交換機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31385197A JP3088986B2 (ja) | 1997-11-14 | 1997-11-14 | Ａｔｍ交換機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11150538A true JPH11150538A (ja) | 1999-06-02 |
| JP3088986B2 JP3088986B2 (ja) | 2000-09-18 |
Family
ID=18046278
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31385197A Expired - Fee Related JP3088986B2 (ja) | 1997-11-14 | 1997-11-14 | Ａｔｍ交換機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3088986B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100800696B1 (ko) * | 2001-12-11 | 2008-02-01 | 삼성전자주식회사 | 비동기 전송 방식에서 가변 비트율 트래픽에 대한효율적인 호 수락 제어 방법 |
| JP2017112549A (ja) * | 2015-12-17 | 2017-06-22 | 日本電信電話株式会社 | シミュレーション装置、シミュレーション方法及びシミュレーションプログラム |
-
1997
- 1997-11-14 JP JP31385197A patent/JP3088986B2/ja not_active Expired - Fee Related
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100800696B1 (ko) * | 2001-12-11 | 2008-02-01 | 삼성전자주식회사 | 비동기 전송 방식에서 가변 비트율 트래픽에 대한효율적인 호 수락 제어 방법 |
| JP2017112549A (ja) * | 2015-12-17 | 2017-06-22 | 日本電信電話株式会社 | シミュレーション装置、シミュレーション方法及びシミュレーションプログラム |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3088986B2 (ja) | 2000-09-18 |
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