JPH1049269A - Ｐｃカード - Google Patents
ＰｃカードInfo
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- JPH1049269A JPH1049269A JP8209698A JP20969896A JPH1049269A JP H1049269 A JPH1049269 A JP H1049269A JP 8209698 A JP8209698 A JP 8209698A JP 20969896 A JP20969896 A JP 20969896A JP H1049269 A JPH1049269 A JP H1049269A
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- Japan
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- card
- terminal
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- system device
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Abstract
(57)【要約】
【課題】 ＰＣカードをホストシステム装置に接続した
状態で、ＰＣカードにリセットをかけることができると
共にホストシステム装置の電源における消費電流を削減
することができるＰＣカードを得る。 【解決手段】 ホストシステム装置に接続して使用する
ＰＣカードであって、ＰＣカード側のコネクタには、ア
ース端子に接続される第１の端子及び第２の端子が設け
られ、ホストシステム装置側には、ホストシステム装置
のコネクタにおける、上記第１の端子及び第２の端子が
接続される各端子のそれぞれの電圧レベルから、ＰＣカ
ードの接続の有無を検出する接続検出手段が設けられて
なるＰＣカードにおいて、上記第１の端子及び第２の端
子におけるアース端子への接続を、外部からの操作によ
って制御するスイッチング手段を備える。
状態で、ＰＣカードにリセットをかけることができると
共にホストシステム装置の電源における消費電流を削減
することができるＰＣカードを得る。 【解決手段】 ホストシステム装置に接続して使用する
ＰＣカードであって、ＰＣカード側のコネクタには、ア
ース端子に接続される第１の端子及び第２の端子が設け
られ、ホストシステム装置側には、ホストシステム装置
のコネクタにおける、上記第１の端子及び第２の端子が
接続される各端子のそれぞれの電圧レベルから、ＰＣカ
ードの接続の有無を検出する接続検出手段が設けられて
なるＰＣカードにおいて、上記第１の端子及び第２の端
子におけるアース端子への接続を、外部からの操作によ
って制御するスイッチング手段を備える。
Description
【０００１】
【発明の属する技術分野】本発明は、ＰＣＭＣＩＡ／Ｊ
ＥＩＤＡ策定のＰＣカード・スタンダードに準拠すると
共に、パーソナルコンピュータ等の情報処理機器からな
るホストシステム装置に接続してなるＰＣカードに関す
るものである。
ＥＩＤＡ策定のＰＣカード・スタンダードに準拠すると
共に、パーソナルコンピュータ等の情報処理機器からな
るホストシステム装置に接続してなるＰＣカードに関す
るものである。
【０００２】
【従来の技術】図３は、従来のＰＣカードにおけるホス
トシステム装置との接続部を示した概略のブロック図で
ある。図３において、ＰＣＭＣＩＡ／ＪＥＩＤＡ策定の
ＰＣカード・スタンダードに準拠したＰＣカード５０に
おけるカード側コネクタ５１と、ホストシステム装置５
２におけるＰＣＭＣＩＡ／ＪＥＩＤＡ策定のＰＣカード
・スタンダードに準拠したシステム側コネクタ５３とが
接続されて、ＰＣカード５０がホストシステム装置５２
に接続される。
トシステム装置との接続部を示した概略のブロック図で
ある。図３において、ＰＣＭＣＩＡ／ＪＥＩＤＡ策定の
ＰＣカード・スタンダードに準拠したＰＣカード５０に
おけるカード側コネクタ５１と、ホストシステム装置５
２におけるＰＣＭＣＩＡ／ＪＥＩＤＡ策定のＰＣカード
・スタンダードに準拠したシステム側コネクタ５３とが
接続されて、ＰＣカード５０がホストシステム装置５２
に接続される。
【０００３】ここで、カード側コネクタ５１における、
ＣＤ１端子である３６番端子５４及びＣＤ２端子である
６７番端子５５は、ＰＣカード５０内でそれぞれアース
端子に接続されており、該アース端子はＰＣカード５０
がホストシステム装置５２に接続された際に、ホストシ
ステム装置５２のアースに接続される。また、システム
側コネクタ５３におけるＣＤ１端子である３６番ピン５
６は、プルアップ抵抗５７を介して直流電源Ｖccに接続
され、更にコンパレータ５８の入力端子に接続される。
同様に、システム側コネクタ５３におけるＣＤ２端子で
ある６７番ピン５９は、プルアップ抵抗６０を介して直
流電源Ｖccに接続され、更にコンパレータ６１の入力端
子に接続される。更に、上記コンパレータ５８及び６１
の出力端子は、システム側コネクタ５３から出力される
各信号の出力及び電源の供給を制御するインタフェース
制御部６２にそれぞれ接続される。
ＣＤ１端子である３６番端子５４及びＣＤ２端子である
６７番端子５５は、ＰＣカード５０内でそれぞれアース
端子に接続されており、該アース端子はＰＣカード５０
がホストシステム装置５２に接続された際に、ホストシ
ステム装置５２のアースに接続される。また、システム
側コネクタ５３におけるＣＤ１端子である３６番ピン５
６は、プルアップ抵抗５７を介して直流電源Ｖccに接続
され、更にコンパレータ５８の入力端子に接続される。
同様に、システム側コネクタ５３におけるＣＤ２端子で
ある６７番ピン５９は、プルアップ抵抗６０を介して直
流電源Ｖccに接続され、更にコンパレータ６１の入力端
子に接続される。更に、上記コンパレータ５８及び６１
の出力端子は、システム側コネクタ５３から出力される
各信号の出力及び電源の供給を制御するインタフェース
制御部６２にそれぞれ接続される。
【０００４】上記コンパレータ５８及び６１は、それぞ
れ内部に基準電圧源を有し、該基準電圧源による基準電
圧と、入力された信号の信号レベルとを比較し、該比較
した結果を上記インタフェース制御部６２に出力する。
インタフェース制御部６２は、コンパレータ５８及び６
１から入力された比較結果からＰＣカード５０が接続さ
れたか否かを判断する。すなわち、コンパレータ５８及
び６１の各入力端子が「Ｈ」レベルのとき、インタフェ
ース制御部６２は、コンパレータ５８及び６１から入力
された各信号レベルから、ＰＣカード５０が接続されて
いないことを検出し、コンパレータ５８及び６１の各入
力端子が「Ｌ」レベルのとき、インタフェース制御部６
２は、コンパレータ５８及び６１から入力された各信号
レベルから、ＰＣカード５０が接続されたことを検出す
る。なお、図３では、カード側コネクタ５１及びシステ
ム側コネクタ５３において、説明を分かりやすくするた
めに、上記以外の端子及びピンは省略している。
れ内部に基準電圧源を有し、該基準電圧源による基準電
圧と、入力された信号の信号レベルとを比較し、該比較
した結果を上記インタフェース制御部６２に出力する。
インタフェース制御部６２は、コンパレータ５８及び６
１から入力された比較結果からＰＣカード５０が接続さ
れたか否かを判断する。すなわち、コンパレータ５８及
び６１の各入力端子が「Ｈ」レベルのとき、インタフェ
ース制御部６２は、コンパレータ５８及び６１から入力
された各信号レベルから、ＰＣカード５０が接続されて
いないことを検出し、コンパレータ５８及び６１の各入
力端子が「Ｌ」レベルのとき、インタフェース制御部６
２は、コンパレータ５８及び６１から入力された各信号
レベルから、ＰＣカード５０が接続されたことを検出す
る。なお、図３では、カード側コネクタ５１及びシステ
ム側コネクタ５３において、説明を分かりやすくするた
めに、上記以外の端子及びピンは省略している。
【０００５】上記のような構成において、ＰＣカード５
０がホストシステム装置５２に接続されていないとき、
上記両コンパレータ５８及び６１の入力端子は「Ｈ」レ
ベルとなっており、上記インタフェース制御部６２は、
両コンパレータ５８及び６１の各出力端子より入力され
た各信号の信号レベルから、ＰＣカード５０が接続され
ていないことを検出し、システム側コネクタ５３からの
各信号の出力を停止すると共に、電源の供給を停止す
る。
０がホストシステム装置５２に接続されていないとき、
上記両コンパレータ５８及び６１の入力端子は「Ｈ」レ
ベルとなっており、上記インタフェース制御部６２は、
両コンパレータ５８及び６１の各出力端子より入力され
た各信号の信号レベルから、ＰＣカード５０が接続され
ていないことを検出し、システム側コネクタ５３からの
各信号の出力を停止すると共に、電源の供給を停止す
る。
【０００６】次にＰＣカード５０がホストシステム装置
５２に接続されると、システム側コネクタ５３の３６番
ピン５６はカード側コネクタ５１の３６番端子５４に、
システム側コネクタ５３の６７番ピン５９はカード側コ
ネクタ５１の６７番端子５５にそれぞれ接続されること
から、システム側コネクタ５３の３６番ピン５６及び６
７番ピン５９は共に接地される。このとき、上記インタ
フェース制御部６２は、上記両コンパレータ５８及び６
１の各出力端子から入力された各信号のレベルから、Ｐ
Ｃカード５０が接続されたと判断して、システム側コネ
クタ５３からの各信号の出力停止を解除すると共にＰＣ
カード５０への電源供給を行う。
５２に接続されると、システム側コネクタ５３の３６番
ピン５６はカード側コネクタ５１の３６番端子５４に、
システム側コネクタ５３の６７番ピン５９はカード側コ
ネクタ５１の６７番端子５５にそれぞれ接続されること
から、システム側コネクタ５３の３６番ピン５６及び６
７番ピン５９は共に接地される。このとき、上記インタ
フェース制御部６２は、上記両コンパレータ５８及び６
１の各出力端子から入力された各信号のレベルから、Ｐ
Ｃカード５０が接続されたと判断して、システム側コネ
クタ５３からの各信号の出力停止を解除すると共にＰＣ
カード５０への電源供給を行う。
【０００７】
【発明が解決しようとする課題】しかし、何らかの原因
で上記ＰＣカード５０の内部機能が暴走したり、ハング
アップを起こしてＰＣカード５０が使用できなくなった
場合、ＰＣカード５０をいったんホストシステム装置５
２から切り離し、再びＰＣカード５０をホストシステム
装置５２に接続することによってＰＣカード５０をリセ
ットさせるか、又は、専用のソフトウェアを使用してホ
ストシステム装置５２側から操作しなければ、ＰＣカー
ド５０への電源供給を切断してＰＣカード５０をリセッ
トさせることができなかった。
で上記ＰＣカード５０の内部機能が暴走したり、ハング
アップを起こしてＰＣカード５０が使用できなくなった
場合、ＰＣカード５０をいったんホストシステム装置５
２から切り離し、再びＰＣカード５０をホストシステム
装置５２に接続することによってＰＣカード５０をリセ
ットさせるか、又は、専用のソフトウェアを使用してホ
ストシステム装置５２側から操作しなければ、ＰＣカー
ド５０への電源供給を切断してＰＣカード５０をリセッ
トさせることができなかった。
【０００８】また、ＰＣカード５０をホストシステム装
置５２に接続した状態では、ＰＣカード５０を使用しな
くとも電源が消費されるため、ホストシステム装置５２
がバッテリで駆動されている場合、該バッテリの消耗を
早めるという問題があり、この場合、バッテリの消耗を
減少させるためには、ＰＣカード５０を使用しない場合
は、その都度ＰＣカード５０をホストシステム装置５２
から抜いて切り離す必要があった。
置５２に接続した状態では、ＰＣカード５０を使用しな
くとも電源が消費されるため、ホストシステム装置５２
がバッテリで駆動されている場合、該バッテリの消耗を
早めるという問題があり、この場合、バッテリの消耗を
減少させるためには、ＰＣカード５０を使用しない場合
は、その都度ＰＣカード５０をホストシステム装置５２
から抜いて切り離す必要があった。
【０００９】本発明は、上記のような問題を解決するた
めになされたものであり、ＰＣカードを抜き差しするこ
となく、ＰＣカードをホストシステム装置に接続した状
態で専用のソフトウェアを使用せずにリセットをかける
ことができると共に、バッテリで動作するホストシステ
ム装置において、ＰＣカードを接続した状態でのバッテ
リの消耗を減少させることができるＰＣカードを得るこ
とを目的とする。
めになされたものであり、ＰＣカードを抜き差しするこ
となく、ＰＣカードをホストシステム装置に接続した状
態で専用のソフトウェアを使用せずにリセットをかける
ことができると共に、バッテリで動作するホストシステ
ム装置において、ＰＣカードを接続した状態でのバッテ
リの消耗を減少させることができるＰＣカードを得るこ
とを目的とする。
【００１０】
【課題を解決するための手段】本発明は、情報処理機器
からなるホストシステム装置に接続して使用する、ＰＣ
ＭＣＩＡ／ＪＥＩＤＡ策定のＰＣカード・スタンダード
に準拠したＰＣカードであって、ＰＣカード側のコネク
タには、アース端子に接続される第１の端子及び第２の
端子が設けられ、ホストシステム装置側には、ホストシ
ステム装置のコネクタにおける、上記第１の端子及び第
２の端子が接続される各端子のそれぞれの電圧レベルか
ら、ＰＣカードの接続の有無を検出する接続検出手段が
設けられてなるＰＣカードにおいてなされたものであ
る。すなわち、本発明は、このようなＰＣカードにおい
て、上記第１の端子及び第２の端子におけるアース端子
への接続を、外部からの操作によって制御するスイッチ
ング手段を備えたことを特徴とするＰＣカードを提供す
るものである。
からなるホストシステム装置に接続して使用する、ＰＣ
ＭＣＩＡ／ＪＥＩＤＡ策定のＰＣカード・スタンダード
に準拠したＰＣカードであって、ＰＣカード側のコネク
タには、アース端子に接続される第１の端子及び第２の
端子が設けられ、ホストシステム装置側には、ホストシ
ステム装置のコネクタにおける、上記第１の端子及び第
２の端子が接続される各端子のそれぞれの電圧レベルか
ら、ＰＣカードの接続の有無を検出する接続検出手段が
設けられてなるＰＣカードにおいてなされたものであ
る。すなわち、本発明は、このようなＰＣカードにおい
て、上記第１の端子及び第２の端子におけるアース端子
への接続を、外部からの操作によって制御するスイッチ
ング手段を備えたことを特徴とするＰＣカードを提供す
るものである。
【００１１】具体的には、ＰＣカードをホストシステム
装置に接続するために使用されるＰＣカード側のコネク
タの、ＣＤ１端子である３６番端子及びＣＤ２端子であ
る６７番端子における、アース端子との接続に対するス
イッチングを共に行うスイッチング手段を備えたもので
あり、例えば、上記スイッチング手段は、接点を有し、
外部からの機械的な操作によってスイッチングを行うも
のであり、機械的な操作が行われるごとに、そのスイッ
チング状態を保持する。また、上記スイッチング手段
は、ホストシステム装置への接続面と相対する面に操作
部が設けられる。
装置に接続するために使用されるＰＣカード側のコネク
タの、ＣＤ１端子である３６番端子及びＣＤ２端子であ
る６７番端子における、アース端子との接続に対するス
イッチングを共に行うスイッチング手段を備えたもので
あり、例えば、上記スイッチング手段は、接点を有し、
外部からの機械的な操作によってスイッチングを行うも
のであり、機械的な操作が行われるごとに、そのスイッ
チング状態を保持する。また、上記スイッチング手段
は、ホストシステム装置への接続面と相対する面に操作
部が設けられる。
【００１２】
【発明の実施の形態】次に、図面に示す実施の形態に基
づいて、本発明を詳細に説明する。 実施の形態１．図１は、本発明の実施の形態１における
ＰＣカードのホストシステム装置との接続部を示した概
略ブロック図である。図１において、ＰＣＭＣＩＡ／Ｊ
ＥＩＤＡ策定のＰＣカード・スタンダードに準拠したＰ
Ｃカード１におけるカード側コネクタ２と、ホストシス
テム装置３におけるＰＣＭＣＩＡ／ＪＥＩＤＡ策定のＰ
Ｃカード・スタンダードに準拠したシステム側コネクタ
４とが接続されて、ＰＣカード１がホストシステム装置
３に接続される。上記カード側コネクタ２は３４端子×
２列で構成された６８端子のコネクタからなり、システ
ム側コネクタ４は、３４ピン×２列で構成された６８ピ
ンのコネクタからなる。
づいて、本発明を詳細に説明する。 実施の形態１．図１は、本発明の実施の形態１における
ＰＣカードのホストシステム装置との接続部を示した概
略ブロック図である。図１において、ＰＣＭＣＩＡ／Ｊ
ＥＩＤＡ策定のＰＣカード・スタンダードに準拠したＰ
Ｃカード１におけるカード側コネクタ２と、ホストシス
テム装置３におけるＰＣＭＣＩＡ／ＪＥＩＤＡ策定のＰ
Ｃカード・スタンダードに準拠したシステム側コネクタ
４とが接続されて、ＰＣカード１がホストシステム装置
３に接続される。上記カード側コネクタ２は３４端子×
２列で構成された６８端子のコネクタからなり、システ
ム側コネクタ４は、３４ピン×２列で構成された６８ピ
ンのコネクタからなる。
【００１３】ここで、カード側コネクタ２における、Ｃ
Ｄ１端子である３６番端子５及びＣＤ２端子である６７
番端子６は、ＰＣカード１内でそれぞれ、例えばスライ
ドスイッチのようなリセットスイッチ７を介してアース
端子に接続されており、該アース端子は、ＰＣカード１
がホストシステム装置３に接続された際に、ホストシス
テム装置３のアースに接続される。
Ｄ１端子である３６番端子５及びＣＤ２端子である６７
番端子６は、ＰＣカード１内でそれぞれ、例えばスライ
ドスイッチのようなリセットスイッチ７を介してアース
端子に接続されており、該アース端子は、ＰＣカード１
がホストシステム装置３に接続された際に、ホストシス
テム装置３のアースに接続される。
【００１４】上記リセットスイッチ７は、２回路のスイ
ッチであり、リセットスイッチ７における一方の回路の
スイッチ接点部を７ａとし、他方の回路のスイッチ接点
部を７ｂとすると、カード側コネクタ２の３６番端子５
はスイッチ接点部７ａを介してアース端子に接続され、
カード側コネクタ２の６７番端子６はスイッチ接点部７
ｂを介してアース端子に接続される。上記スイッチ接点
部７ａ及び７ｂは、同時にオン又は同時にオフするもの
であり、リセットスイッチ７をオンにするということ
は、スイッチ接点部７ａ及び７ｂが同時にオンすること
であり、リセットスイッチ７をオフにするということ
は、スイッチ接点部７ａ及び７ｂが同時にオフすること
である。
ッチであり、リセットスイッチ７における一方の回路の
スイッチ接点部を７ａとし、他方の回路のスイッチ接点
部を７ｂとすると、カード側コネクタ２の３６番端子５
はスイッチ接点部７ａを介してアース端子に接続され、
カード側コネクタ２の６７番端子６はスイッチ接点部７
ｂを介してアース端子に接続される。上記スイッチ接点
部７ａ及び７ｂは、同時にオン又は同時にオフするもの
であり、リセットスイッチ７をオンにするということ
は、スイッチ接点部７ａ及び７ｂが同時にオンすること
であり、リセットスイッチ７をオフにするということ
は、スイッチ接点部７ａ及び７ｂが同時にオフすること
である。
【００１５】また、システム側コネクタ４におけるＣＤ
１端子である３６番ピン８は、プルアップ抵抗９を介し
て直流電源Ｖccに接続され、更にコンパレータ１０の入
力端子に接続される。同様に、システム側コネクタ４に
おけるＣＤ２端子である６７番ピン１１は、プルアップ
抵抗１２を介して直流電源Ｖccに接続され、更にコンパ
レータ１３の入力端子に接続される。更に、上記コンパ
レータ１０及び１３の出力端子は、システム側コネクタ
４から出力される各信号の出力及び電源の供給を制御す
るインタフェース制御部１４にそれぞれ接続される。
１端子である３６番ピン８は、プルアップ抵抗９を介し
て直流電源Ｖccに接続され、更にコンパレータ１０の入
力端子に接続される。同様に、システム側コネクタ４に
おけるＣＤ２端子である６７番ピン１１は、プルアップ
抵抗１２を介して直流電源Ｖccに接続され、更にコンパ
レータ１３の入力端子に接続される。更に、上記コンパ
レータ１０及び１３の出力端子は、システム側コネクタ
４から出力される各信号の出力及び電源の供給を制御す
るインタフェース制御部１４にそれぞれ接続される。
【００１６】上記コンパレータ１０及び１３は、それぞ
れ内部に基準電圧源を有し、該基準電圧源による基準電
圧と、入力された信号の信号レベルとを比較し、該比較
した結果を上記インタフェース制御部１４に出力する。
インタフェース制御部１４は、コンパレータ１０及び１
３から入力された比較結果からＰＣカード１が接続され
たか否かを判断する。
れ内部に基準電圧源を有し、該基準電圧源による基準電
圧と、入力された信号の信号レベルとを比較し、該比較
した結果を上記インタフェース制御部１４に出力する。
インタフェース制御部１４は、コンパレータ１０及び１
３から入力された比較結果からＰＣカード１が接続され
たか否かを判断する。
【００１７】すなわち、コンパレータ１０及び１３の各
入力端子が「Ｈ」レベルのとき、インタフェース制御部
１４は、コンパレータ１０及び１３から入力された各信
号レベルから、ＰＣカード１が接続されていないことを
検出し、コンパレータ１０及び１３の各入力端子が
「Ｌ」レベルのとき、インタフェース制御部１４は、コ
ンパレータ１０及び１３から入力された各信号レベルか
ら、ＰＣカード１が接続されたことを検出する。なお、
図１では、カード側コネクタ２及びシステム側コネクタ
４において、説明を分かりやすくするために、上記以外
の端子及びピンは省略している。また、上記プルアップ
抵抗９，１２、コンパレータ１０，１３及びインタフェ
ース制御部１４は接続検出手段をなし、上記リセットス
イッチ７はスイッチング手段をなす。
入力端子が「Ｈ」レベルのとき、インタフェース制御部
１４は、コンパレータ１０及び１３から入力された各信
号レベルから、ＰＣカード１が接続されていないことを
検出し、コンパレータ１０及び１３の各入力端子が
「Ｌ」レベルのとき、インタフェース制御部１４は、コ
ンパレータ１０及び１３から入力された各信号レベルか
ら、ＰＣカード１が接続されたことを検出する。なお、
図１では、カード側コネクタ２及びシステム側コネクタ
４において、説明を分かりやすくするために、上記以外
の端子及びピンは省略している。また、上記プルアップ
抵抗９，１２、コンパレータ１０，１３及びインタフェ
ース制御部１４は接続検出手段をなし、上記リセットス
イッチ７はスイッチング手段をなす。
【００１８】上記のような構成において、ＰＣカード１
がホストシステム装置３に接続されていないとき、上記
両コンパレータ１０及び１３の入力端子は「Ｈ」レベル
となっており、上記インタフェース制御部１４は、両コ
ンパレータ１０及び１３のそれぞれの出力端子から入力
された各信号の信号レベルから、ＰＣカード１が接続さ
れていないことを検出し、システム側コネクタ４から
の、各信号の出力を停止すると共に電源の供給を停止す
る。
がホストシステム装置３に接続されていないとき、上記
両コンパレータ１０及び１３の入力端子は「Ｈ」レベル
となっており、上記インタフェース制御部１４は、両コ
ンパレータ１０及び１３のそれぞれの出力端子から入力
された各信号の信号レベルから、ＰＣカード１が接続さ
れていないことを検出し、システム側コネクタ４から
の、各信号の出力を停止すると共に電源の供給を停止す
る。
【００１９】次に、カード側コネクタ２の３６番端子５
及び６７番端子６が、リセットスイッチ７によって、共
にアース端子に接続されている場合、ＰＣカード１がホ
ストシステム装置３に接続されると、システム側コネク
タ４の３６番ピン８はカード側コネクタ２の３６番端子
５に、システム側コネクタ４の６７番ピン１１はカード
側コネクタ２の６７番端子６にそれぞれ接続されること
から、システム側コネクタ４の３６番ピン８及び６７番
ピン１１は共に接地される。このとき、上記インタフェ
ース制御部１４は、上記両コンパレータ１０及び１３の
各出力端子から入力された各信号のレベルから、ＰＣカ
ード１が接続されたと判断して、システム側コネクタ４
からの各信号の出力停止を解除すると共にＰＣカード１
への電源供給を行う。
及び６７番端子６が、リセットスイッチ７によって、共
にアース端子に接続されている場合、ＰＣカード１がホ
ストシステム装置３に接続されると、システム側コネク
タ４の３６番ピン８はカード側コネクタ２の３６番端子
５に、システム側コネクタ４の６７番ピン１１はカード
側コネクタ２の６７番端子６にそれぞれ接続されること
から、システム側コネクタ４の３６番ピン８及び６７番
ピン１１は共に接地される。このとき、上記インタフェ
ース制御部１４は、上記両コンパレータ１０及び１３の
各出力端子から入力された各信号のレベルから、ＰＣカ
ード１が接続されたと判断して、システム側コネクタ４
からの各信号の出力停止を解除すると共にＰＣカード１
への電源供給を行う。
【００２０】上記のようなＰＣカード１において、動作
中に何らかの原因で動作しなくなり、ホストシステム装
置３からアクセスができなくなった場合、ＰＣカード１
をホストシステム装置３に接続した状態で上記リセット
スイッチ７をオフにし、カード側コネクタ２の３６番端
子５及び６７番端子６をアース端子から切り離してオー
プン状態にする。すると、ホストシステム装置３では、
上記両コンパレータ１０及び１３の入力端子が共に
「Ｈ」レベルとなり、上記インタフェース制御部１４
は、両コンパレータ１０及び１３のそれぞれの出力端子
から入力された各信号の信号レベルから、ＰＣカード１
が抜かれて接続されていない状態にあると判断し、シス
テム側コネクタ４からの、各信号の出力を停止すると共
に電源の供給を停止する。
中に何らかの原因で動作しなくなり、ホストシステム装
置３からアクセスができなくなった場合、ＰＣカード１
をホストシステム装置３に接続した状態で上記リセット
スイッチ７をオフにし、カード側コネクタ２の３６番端
子５及び６７番端子６をアース端子から切り離してオー
プン状態にする。すると、ホストシステム装置３では、
上記両コンパレータ１０及び１３の入力端子が共に
「Ｈ」レベルとなり、上記インタフェース制御部１４
は、両コンパレータ１０及び１３のそれぞれの出力端子
から入力された各信号の信号レベルから、ＰＣカード１
が抜かれて接続されていない状態にあると判断し、シス
テム側コネクタ４からの、各信号の出力を停止すると共
に電源の供給を停止する。
【００２１】このことから、ＰＣカード１は、ホストシ
ステム装置３からの電源の供給が絶たれると共に各信号
の入力が停止して、ホストシステム装置３からＰＣカー
ド１を抜いた状態と同様の状態になる。
ステム装置３からの電源の供給が絶たれると共に各信号
の入力が停止して、ホストシステム装置３からＰＣカー
ド１を抜いた状態と同様の状態になる。
【００２２】次に、ＰＣカード１をホストシステム装置
３に接続した状態で上記リセットスイッチ７をオンにし
て、カード側コネクタ２の３６番端子５及び６７番端子
６をそれぞれアース端子に接続する。すると、ホストシ
ステム装置３では、上記両コンパレータ１０及び１３の
入力端子が共に「Ｌ」レベルとなり、上記インタフェー
ス制御部１４は、両コンパレータ１０及び１３のそれぞ
れの出力端子から入力された各信号の信号レベルから、
ＰＣカード１が接続されたと判断し、システム側コネク
タ４からの、各信号の出力の停止及び電源供給の停止を
それぞれ解除する。このことから、ＰＣカード１は、ホ
ストシステム装置３に接続した状態と同様の状態にな
る。
３に接続した状態で上記リセットスイッチ７をオンにし
て、カード側コネクタ２の３６番端子５及び６７番端子
６をそれぞれアース端子に接続する。すると、ホストシ
ステム装置３では、上記両コンパレータ１０及び１３の
入力端子が共に「Ｌ」レベルとなり、上記インタフェー
ス制御部１４は、両コンパレータ１０及び１３のそれぞ
れの出力端子から入力された各信号の信号レベルから、
ＰＣカード１が接続されたと判断し、システム側コネク
タ４からの、各信号の出力の停止及び電源供給の停止を
それぞれ解除する。このことから、ＰＣカード１は、ホ
ストシステム装置３に接続した状態と同様の状態にな
る。
【００２３】また、ＰＣカード１が正常に動作する状態
において、ＰＣカード１を使用しないときには、上記リ
セットスイッチ７をオフにすることによって、上記のよ
うに、ホストシステム装置３のインタフェース制御部１
４は、システム側コネクタ４からの各信号の出力を停止
すると共に電源供給を停止することから、ＰＣカード１
をホストシステム装置３に接続した状態でのＰＣカード
１による電源の消費をなくすことができる。図２は、図
１で示したＰＣカード１における上記リセットスイッチ
７の操作部の配置例を示した斜視図である。図２におい
て、リセットスイッチ７は、ＰＣカード１のカード側コ
ネクタ２と相対する面に操作部１５が設けられている。
において、ＰＣカード１を使用しないときには、上記リ
セットスイッチ７をオフにすることによって、上記のよ
うに、ホストシステム装置３のインタフェース制御部１
４は、システム側コネクタ４からの各信号の出力を停止
すると共に電源供給を停止することから、ＰＣカード１
をホストシステム装置３に接続した状態でのＰＣカード
１による電源の消費をなくすことができる。図２は、図
１で示したＰＣカード１における上記リセットスイッチ
７の操作部の配置例を示した斜視図である。図２におい
て、リセットスイッチ７は、ＰＣカード１のカード側コ
ネクタ２と相対する面に操作部１５が設けられている。
【００２４】このように、本実施の形態１におけるＰＣ
カード１は、上記リセットスイッチ７を設け、リセット
スイッチ７をオフにした後再びオンにするという一連の
操作を行うことによって、ＰＣカード１をホストシステ
ム装置３から抜き再度接続して行う、ＰＣカード１に対
する従来のリセット動作と同じリセット動作を、ホスト
システム装置３にＰＣカード１を接続した状態で行うこ
とができる。
カード１は、上記リセットスイッチ７を設け、リセット
スイッチ７をオフにした後再びオンにするという一連の
操作を行うことによって、ＰＣカード１をホストシステ
ム装置３から抜き再度接続して行う、ＰＣカード１に対
する従来のリセット動作と同じリセット動作を、ホスト
システム装置３にＰＣカード１を接続した状態で行うこ
とができる。
【００２５】また、上記ＰＣカード１を使用しない場
合、上記リセットスイッチ７をオフにしておくことによ
って、ＰＣカード１をホストシステム装置３に接続した
状態であっても、ＰＣカード１によるホストシステム装
置３の電源の消費を減少させることができ、バッテリで
動作するホストシステム装置にＰＣカードを使用する場
合、該バッテリの消耗を減少させ、例えばホストシステ
ム装置を持ち運ぶときなどのバッテリの消耗を減少させ
て、ホストシステム装置におけるバッテリでの動作時間
を長くすることができる。
合、上記リセットスイッチ７をオフにしておくことによ
って、ＰＣカード１をホストシステム装置３に接続した
状態であっても、ＰＣカード１によるホストシステム装
置３の電源の消費を減少させることができ、バッテリで
動作するホストシステム装置にＰＣカードを使用する場
合、該バッテリの消耗を減少させ、例えばホストシステ
ム装置を持ち運ぶときなどのバッテリの消耗を減少させ
て、ホストシステム装置におけるバッテリでの動作時間
を長くすることができる。
【００２６】更に、上記リセットスイッチ７の操作部１
５をカード側コネクタ２と相対する面に配置したことか
ら、ＰＣカード１をホストシステム装置３のカードスロ
ットに挿入してホストシステム装置３に接続した状態
で、上記リセットスイッチ７の操作を容易に行うことが
できる。
５をカード側コネクタ２と相対する面に配置したことか
ら、ＰＣカード１をホストシステム装置３のカードスロ
ットに挿入してホストシステム装置３に接続した状態
で、上記リセットスイッチ７の操作を容易に行うことが
できる。
【００２７】
【発明の効果】上記の説明から明らかなように、本発明
のＰＣカードによれば、ＰＣカード側におけるホストシ
ステム装置に接続するためのコネクタには、アース端子
に接続される第１の端子及び第２の端子を設け、ホスト
システム装置は、接続検出手段によって、ホストシステ
ム装置側のコネクタにおける、上記第１の端子及び第２
の端子が接続される各端子のそれぞれの電圧レベルか
ら、ＰＣカードの接続の有無を検出する構成において、
上記第１の端子及び第２の端子におけるアース端子への
接続を、外部からの操作によって制御するスイッチング
手段をＰＣカードに備えるものである。
のＰＣカードによれば、ＰＣカード側におけるホストシ
ステム装置に接続するためのコネクタには、アース端子
に接続される第１の端子及び第２の端子を設け、ホスト
システム装置は、接続検出手段によって、ホストシステ
ム装置側のコネクタにおける、上記第１の端子及び第２
の端子が接続される各端子のそれぞれの電圧レベルか
ら、ＰＣカードの接続の有無を検出する構成において、
上記第１の端子及び第２の端子におけるアース端子への
接続を、外部からの操作によって制御するスイッチング
手段をＰＣカードに備えるものである。
【００２８】すなわち、ＰＣカードをホストシステム装
置に接続するために使用されるＰＣカード側のコネクタ
における、ＣＤ１端子である３６番端子とアース端子、
及びＣＤ２端子である６７番端子とアース端子とのそれ
ぞれの接続に対するスイッチングを共に行うスイッチン
グ手段を、ＰＣカードに備えるものであり、該スイッチ
ング手段としては、例えば接点を有し外部からの機械的
な操作によってスイッチングを行うものである。これら
のことから、ＰＣカードをホストシステム装置から抜き
再度接続して行う、ＰＣカードに対する従来のリセット
動作と同じリセット動作を、ホストシステム装置にＰＣ
カードを接続した状態で行うことができ、使用性の向上
を図ることができる。
置に接続するために使用されるＰＣカード側のコネクタ
における、ＣＤ１端子である３６番端子とアース端子、
及びＣＤ２端子である６７番端子とアース端子とのそれ
ぞれの接続に対するスイッチングを共に行うスイッチン
グ手段を、ＰＣカードに備えるものであり、該スイッチ
ング手段としては、例えば接点を有し外部からの機械的
な操作によってスイッチングを行うものである。これら
のことから、ＰＣカードをホストシステム装置から抜き
再度接続して行う、ＰＣカードに対する従来のリセット
動作と同じリセット動作を、ホストシステム装置にＰＣ
カードを接続した状態で行うことができ、使用性の向上
を図ることができる。
【００２９】また、上記スイッチング手段として、機械
的な操作が行われるごとに、そのスイッチング状態を保
持するものを使用する。このことにより、上記のよう
な、ＰＣカードに対する従来のリセット動作と同じリセ
ット動作を、ホストシステム装置にＰＣカードを接続し
た状態で行うことができ、使用性の向上を図ることがで
きると共に、ＰＣカードを使用しない場合、スイッチン
グ手段を操作して、カード側コネクタの３６番端子及び
６７番端子と、アース端子とのそれぞれの接続を断ち開
放することによって、ＰＣカードをホストシステム装置
に接続した状態であっても、ＰＣカードによるホストシ
ステム装置の電源の消費を減少させることができるた
め、バッテリで動作するホストシステム装置にＰＣカー
ドを使用する場合、該バッテリの消耗を減少させること
ができ、ホストシステム装置におけるバッテリでの動作
時間を長くすることができる。
的な操作が行われるごとに、そのスイッチング状態を保
持するものを使用する。このことにより、上記のよう
な、ＰＣカードに対する従来のリセット動作と同じリセ
ット動作を、ホストシステム装置にＰＣカードを接続し
た状態で行うことができ、使用性の向上を図ることがで
きると共に、ＰＣカードを使用しない場合、スイッチン
グ手段を操作して、カード側コネクタの３６番端子及び
６７番端子と、アース端子とのそれぞれの接続を断ち開
放することによって、ＰＣカードをホストシステム装置
に接続した状態であっても、ＰＣカードによるホストシ
ステム装置の電源の消費を減少させることができるた
め、バッテリで動作するホストシステム装置にＰＣカー
ドを使用する場合、該バッテリの消耗を減少させること
ができ、ホストシステム装置におけるバッテリでの動作
時間を長くすることができる。
【００３０】更に、上記スイッチング手段の操作部を、
ＰＣカードにおけるホストシステム装置への接続面と相
対する面に設けたことから、ＰＣカードをホストシステ
ム装置のカードスロットに挿入してホストシステム装置
に接続した状態で、上記スイッチング手段の操作を容易
に行うことができ、使用性の向上を図ることができる。
ＰＣカードにおけるホストシステム装置への接続面と相
対する面に設けたことから、ＰＣカードをホストシステ
ム装置のカードスロットに挿入してホストシステム装置
に接続した状態で、上記スイッチング手段の操作を容易
に行うことができ、使用性の向上を図ることができる。
【図１】 本発明の実施の形態１におけるＰＣカードの
ホストシステム装置との接続部を示した概略ブロック図
である。
ホストシステム装置との接続部を示した概略ブロック図
である。
【図２】 図１で示したＰＣカード１におけるリセット
スイッチ５の操作部の配置例を示した斜視図である。
スイッチ５の操作部の配置例を示した斜視図である。
【図３】 従来のＰＣカードにおけるホストシステム装
置との接続部を示した概略ブロック図である。
置との接続部を示した概略ブロック図である。
１ ＰＣカード、 ２ カード側コネクタ、 ３ ホス
トシステム装置、 ４システム側コネクタ、 ５ カー
ド側コネクタのＣＤ１端子、 ６ カード側コネクタの
ＣＤ２端子、 ７ リセットスイッチ、 ８ システム
側コネクタのＣＤ１端子、 ９，１２ プルアップ抵
抗、 １０，１３ コンパレータ、 １１ システム側
コネクタのＣＤ２端子、 １４ インタフェース制御
部、 １５リセットスイッチの操作部
トシステム装置、 ４システム側コネクタ、 ５ カー
ド側コネクタのＣＤ１端子、 ６ カード側コネクタの
ＣＤ２端子、 ７ リセットスイッチ、 ８ システム
側コネクタのＣＤ１端子、 ９，１２ プルアップ抵
抗、 １０，１３ コンパレータ、 １１ システム側
コネクタのＣＤ２端子、 １４ インタフェース制御
部、 １５リセットスイッチの操作部
Claims (5)
- 【請求項１】 情報処理機器からなるホストシステム装
置に接続して使用する、ＰＣＭＣＩＡ／ＪＥＩＤＡ策定
のＰＣカード・スタンダードに準拠したＰＣカードであ
って、ＰＣカード側のコネクタには、アース端子に接続
される第１の端子及び第２の端子が設けられ、ホストシ
ステム装置側には、ホストシステム装置のコネクタにお
ける、上記第１の端子及び第２の端子が接続される各端
子のそれぞれの電圧レベルから、ＰＣカードの接続の有
無を検出する接続検出手段が設けられてなるＰＣカード
において、 上記第１の端子及び第２の端子におけるアース端子への
接続を、外部からの操作によって制御するスイッチング
手段を備えたことを特徴とするＰＣカード。 - 【請求項２】 請求項１に記載のＰＣカードにして、上
記スイッチング手段は、ＰＣカードをホストシステム装
置に接続するために使用されるＰＣカード側のコネクタ
の、ＣＤ１端子である３６番端子及びＣＤ２端子である
６７番端子における、アース端子との接続に対するスイ
ッチングを共に行うことを特徴とするＰＣカード。 - 【請求項３】 請求項１又は請求項２のいずれかに記載
のＰＣカードにして、上記スイッチング手段は、接点を
有し、外部からの機械的な操作によってスイッチングを
行うことを特徴とするＰＣカード。 - 【請求項４】 請求項３に記載のＰＣカードにして、上
記スイッチング手段は、機械的な操作が行われるごと
に、そのスイッチング状態を保持することを特徴とする
ＰＣカード。 - 【請求項５】 請求項３又は請求項４のいずれかに記載
のＰＣカードにして、上記スイッチング手段は、ホスト
システム装置への接続面と相対する面に操作部が設けら
れたことを特徴とするＰＣカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8209698A JPH1049269A (ja) | 1996-08-08 | 1996-08-08 | Ｐｃカード |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8209698A JPH1049269A (ja) | 1996-08-08 | 1996-08-08 | Ｐｃカード |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1049269A true JPH1049269A (ja) | 1998-02-20 |
Family
ID=16577159
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8209698A Pending JPH1049269A (ja) | 1996-08-08 | 1996-08-08 | Ｐｃカード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1049269A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015103256A (ja) * | 2013-11-21 | 2015-06-04 | 創惟科技股▲ふん▼有限公司 | ユニバーサルシリアルバス装置の検知システム及び検知方法 |
-
1996
- 1996-08-08 JP JP8209698A patent/JPH1049269A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015103256A (ja) * | 2013-11-21 | 2015-06-04 | 創惟科技股▲ふん▼有限公司 | ユニバーサルシリアルバス装置の検知システム及び検知方法 |
| US10042801B2 (en) | 2013-11-21 | 2018-08-07 | Genesys Logic, Inc. | System for detecting universal serial bus (USB) device and method thereof |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050304 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20070419 |
|
| A761 | Written withdrawal of application |
Free format text: JAPANESE INTERMEDIATE CODE: A761 Effective date: 20070423 |
|
| A131 | Notification of reasons for refusal |
Effective date: 20070424 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
|
| AA92 | Notification of invalidation |
Free format text: JAPANESE INTERMEDIATE CODE: A971092 Effective date: 20070515 |