JPH10133637A - ビデオ用印刷配線基板構造 - Google Patents
ビデオ用印刷配線基板構造Info
- Publication number
- JPH10133637A JPH10133637A JP8305590A JP30559096A JPH10133637A JP H10133637 A JPH10133637 A JP H10133637A JP 8305590 A JP8305590 A JP 8305590A JP 30559096 A JP30559096 A JP 30559096A JP H10133637 A JPH10133637 A JP H10133637A
- Authority
- JP
- Japan
- Prior art keywords
- video
- substrate
- chip
- accelerator
- printed wiring
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】
【課題】 ビデオデコーダチップのノイズの影響の低
減。 【解決手段】 この基板構造は、ビデオデコーダチップ
を搭載した基板をビデオアクセラレータチップを搭載し
た基板から切り離し、両ボードを信号線あるいはコネク
タを介して接続するようにしたものである。
減。 【解決手段】 この基板構造は、ビデオデコーダチップ
を搭載した基板をビデオアクセラレータチップを搭載し
た基板から切り離し、両ボードを信号線あるいはコネク
タを介して接続するようにしたものである。
Description
【０００１】
【発明の属する技術分野】本発明は、ビデオ用配線基板
構造に関し、特に、ビデオアクセラレータのディジタイ
ザー入力部に直接ビデオデコーダを接続するビデオ用印
刷配線基板構造に関する。
構造に関し、特に、ビデオアクセラレータのディジタイ
ザー入力部に直接ビデオデコーダを接続するビデオ用印
刷配線基板構造に関する。
【０００２】
【従来の技術】従来のビデオアクセラレータのディジタ
イザー入力部に直接ビデオコーダを接続するビデオ用印
刷配線基板構造においては、図３に示されるように、ビ
デオアクセラレータを搭載したチップ１１とアナログの
ビデオ入力が供給されてディジタルビデオ信号に変換す
るビデオデコーダを搭載したチップ１２を同一の基板１
３上に配置していた。この場合、基板１３は、パソコン
のマザーボードであり、チップ１１とチップ１２との間
は、Ｙｕｖ信号線１５、データ信号線１６等の印刷配線
により接続されている。
イザー入力部に直接ビデオコーダを接続するビデオ用印
刷配線基板構造においては、図３に示されるように、ビ
デオアクセラレータを搭載したチップ１１とアナログの
ビデオ入力が供給されてディジタルビデオ信号に変換す
るビデオデコーダを搭載したチップ１２を同一の基板１
３上に配置していた。この場合、基板１３は、パソコン
のマザーボードであり、チップ１１とチップ１２との間
は、Ｙｕｖ信号線１５、データ信号線１６等の印刷配線
により接続されている。
【０００３】
【発明が解決しようとする課題】このため、基板１３上
では、パソコンが種々のディジタル処理動作を行うため
の多数のクロック信号が混在して使用されており、この
ため、ビデオデコーダチップ１２のアナログビデオ信号
とこれらの信号が相互に干渉しあってノイズを発生させ
る。この問題を解決するためには、基板１３上の部品及
び配線のレイアウトを調整することが一般的に行われて
いるが、マザーボードである基板１３上の配線密度も高
いため、配線パターンレイアウトが困難であるという問
題を含んでいた。
では、パソコンが種々のディジタル処理動作を行うため
の多数のクロック信号が混在して使用されており、この
ため、ビデオデコーダチップ１２のアナログビデオ信号
とこれらの信号が相互に干渉しあってノイズを発生させ
る。この問題を解決するためには、基板１３上の部品及
び配線のレイアウトを調整することが一般的に行われて
いるが、マザーボードである基板１３上の配線密度も高
いため、配線パターンレイアウトが困難であるという問
題を含んでいた。
【０００４】
【課題を解決するための手段】このような問題を解決す
るために、本発明ではビデオデコーダを搭載した基板を
ビデオアクセラレータを搭載した基板から切り離し、両
ボードを配線ケーブルあるいはコネクタを介して接続す
るようにしたこを特徴とするビデオ用印刷配線基板構造
が提供される。
るために、本発明ではビデオデコーダを搭載した基板を
ビデオアクセラレータを搭載した基板から切り離し、両
ボードを配線ケーブルあるいはコネクタを介して接続す
るようにしたこを特徴とするビデオ用印刷配線基板構造
が提供される。
【０００５】このように構成すれば、アナログ信号を扱
うビデオデコーダチップをディジタル信号を処理するア
クセラレータチップを搭載した基板１３から切り離すこ
とができ、ノイズの発生を抑えることができ、配線パタ
ーンレイアウトの調整も従来より容易となる。
うビデオデコーダチップをディジタル信号を処理するア
クセラレータチップを搭載した基板１３から切り離すこ
とができ、ノイズの発生を抑えることができ、配線パタ
ーンレイアウトの調整も従来より容易となる。
【０００６】
【発明の実施の形態】図１は、本発明によるビデオ用印
刷配線基板構造の基本構成を示しており、同図におい
て、ビデオデコーダチップ１２はビデオデコーダ基板２
１に搭載され、ビデオアクセラレータチップ１１は従来
と同様にパソコンのマザーボードのような基板１３に搭
載されている。そして、基板２１と基板１３は、それぞ
れに設けられた端子２１ａ，１３ａを介して信号線２２
により接続されている。この場合、両基板２１と１３の
接続はコネクタによって行うようにしてもよい。
刷配線基板構造の基本構成を示しており、同図におい
て、ビデオデコーダチップ１２はビデオデコーダ基板２
１に搭載され、ビデオアクセラレータチップ１１は従来
と同様にパソコンのマザーボードのような基板１３に搭
載されている。そして、基板２１と基板１３は、それぞ
れに設けられた端子２１ａ，１３ａを介して信号線２２
により接続されている。この場合、両基板２１と１３の
接続はコネクタによって行うようにしてもよい。
【０００７】このように構成すれば、アナログ信号を扱
うビデオデコーダチップ１２をディジタル信号を処理す
るアクセラレータチップ１１を搭載した基板１３から切
り離すことができ、ノイズの発生を抑えることができ、
配線パターンレイアウトの調整も従来より容易となる。
うビデオデコーダチップ１２をディジタル信号を処理す
るアクセラレータチップ１１を搭載した基板１３から切
り離すことができ、ノイズの発生を抑えることができ、
配線パターンレイアウトの調整も従来より容易となる。
【０００８】図２（ａ），（ｂ）は、実際のビデオデコ
ーダチップ１２の入出力ポートとビデオアクセラレータ
チップ１１のディジタイザー入力ポートの関係を示して
いる。ビデオデコーダチップ１２を搭載した基板２１の
端子２１ａには、Ｙｕｖデータ出力、ＨーＳＹＮＣ出
力、ＶーＳＹＮＣ出力、ＳＤＡおよびＳＣＬのクロック
信号、＋５Ｖ，ＧＮＤの電源信号およびオーディオ信号
等の信号が供給されている。
ーダチップ１２の入出力ポートとビデオアクセラレータ
チップ１１のディジタイザー入力ポートの関係を示して
いる。ビデオデコーダチップ１２を搭載した基板２１の
端子２１ａには、Ｙｕｖデータ出力、ＨーＳＹＮＣ出
力、ＶーＳＹＮＣ出力、ＳＤＡおよびＳＣＬのクロック
信号、＋５Ｖ，ＧＮＤの電源信号およびオーディオ信号
等の信号が供給されている。
【０００９】
【発明の効果】以上述べたように、本発明によるビデオ
用印刷配線基板構造を用いれば、アナログ信号を扱うビ
デオデコーダ１１をディジタル信号を処理するアクセラ
レータ１２を搭載した基板１３から切り離すことがで
き、ノイズの発生を抑えることができ、配線パターンレ
イアウトの調整も従来より容易となる。また、ビデオデ
コーダを独立の基板に搭載するようにしたため、このビ
デオデコーダの搭載あるいは非搭載の仕様変更を容易に
行うことができる。
用印刷配線基板構造を用いれば、アナログ信号を扱うビ
デオデコーダ１１をディジタル信号を処理するアクセラ
レータ１２を搭載した基板１３から切り離すことがで
き、ノイズの発生を抑えることができ、配線パターンレ
イアウトの調整も従来より容易となる。また、ビデオデ
コーダを独立の基板に搭載するようにしたため、このビ
デオデコーダの搭載あるいは非搭載の仕様変更を容易に
行うことができる。
【図１】本発明によるビデオ用印刷配線基板構造の基本
構成を示す図である。
構成を示す図である。
【図２】（ａ），（ｂ）は、実際のビデオデコーダの入
出力ポートとビデオアクセラレータのディジタイザー入
力ポートの関係を示す図である。
出力ポートとビデオアクセラレータのディジタイザー入
力ポートの関係を示す図である。
【図３】従来のビデオ用印刷配線基板構造の基本構成を
示す図である。
示す図である。
１１・・・ビデオアクセラレータチップ １２・・・ビデオレコーダチップ １３・・・マザーボードのような基板 １５，１６，２２・・・信号線 ２１・・・ビデオデコーダ基板 １３ａ，２１ａ・・・端子
Claims (1)
- 【請求項１】 グラフイックアクセラレータのディジタ
イザー入力部に直接ビデオデコーダを接続するビデオ用
印刷配線基板構造において、ビデオデコーダを搭載した
基板をグラフイックアクセラレータを搭載した基板から
切り離し、両ボードを配線ケーブルあるいはコネクタを
介して接続するようにしたことを特徴とするビデオ用印
刷配線基板構造。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8305590A JPH10133637A (ja) | 1996-10-31 | 1996-10-31 | ビデオ用印刷配線基板構造 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8305590A JPH10133637A (ja) | 1996-10-31 | 1996-10-31 | ビデオ用印刷配線基板構造 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10133637A true JPH10133637A (ja) | 1998-05-22 |
Family
ID=17946979
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8305590A Pending JPH10133637A (ja) | 1996-10-31 | 1996-10-31 | ビデオ用印刷配線基板構造 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10133637A (ja) |
-
1996
- 1996-10-31 JP JP8305590A patent/JPH10133637A/ja active Pending
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