JPH09251334A - 消費電力制御方式 - Google Patents
消費電力制御方式Info
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- JPH09251334A JPH09251334A JP8060579A JP6057996A JPH09251334A JP H09251334 A JPH09251334 A JP H09251334A JP 8060579 A JP8060579 A JP 8060579A JP 6057996 A JP6057996 A JP 6057996A JP H09251334 A JPH09251334 A JP H09251334A
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- JP
- Japan
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- power consumption
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- control circuit
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Abstract
(57)【要約】
【課題】パソコンが大量に導入された場合、オフィスの
規定値以上の電力を使用することができない。各機器の
最大電力の合計がオフィスの最大電力を越える場合、ブ
レーカー断の危険性がある。 【解決手段】消費電力の最大値を設定する手段と、各デ
バイスの消費電力を検知する手段と、検知した消費電力
の合計を算出する手段と、該算出データと前出の消費電
力の最大値を比較する手段と、該比較結果によって各デ
バイスの動作を制御する手段を備え、消費電力を一定に
保つ機能をもつ事を特徴とする消費電力制御方式。
規定値以上の電力を使用することができない。各機器の
最大電力の合計がオフィスの最大電力を越える場合、ブ
レーカー断の危険性がある。 【解決手段】消費電力の最大値を設定する手段と、各デ
バイスの消費電力を検知する手段と、検知した消費電力
の合計を算出する手段と、該算出データと前出の消費電
力の最大値を比較する手段と、該比較結果によって各デ
バイスの動作を制御する手段を備え、消費電力を一定に
保つ機能をもつ事を特徴とする消費電力制御方式。
Description
【０００１】
【発明の属する技術分野】本発明は、コンピュータ等の
情報処理装置の電力制御に関する。
情報処理装置の電力制御に関する。
【０００２】
【従来の技術】近年、パーソナルコンピュータ（以下パ
ソコンと略す）の性能向上が著しい。これは中央処理装
置（以下ＣＰＵと略す）の高速化と表示コントローラの
高速化、また、補助記憶装置の大容量化が進んだことに
よるところが大きい。
ソコンと略す）の性能向上が著しい。これは中央処理装
置（以下ＣＰＵと略す）の高速化と表示コントローラの
高速化、また、補助記憶装置の大容量化が進んだことに
よるところが大きい。
【０００３】これらにより性能は大幅に向上したが、そ
の反面消費電力が増大する傾向にある。現在、環境保護
の面からエネルギー消費を抑えることは重要なファクタ
ーとなってきている。現在では消費電力を抑えるため、
様々な方法が取られている。例えば、以下のような方法
が一般的である。
の反面消費電力が増大する傾向にある。現在、環境保護
の面からエネルギー消費を抑えることは重要なファクタ
ーとなってきている。現在では消費電力を抑えるため、
様々な方法が取られている。例えば、以下のような方法
が一般的である。
【０００４】１．一定の期間ＨＤＤ（補助記憶装置の一
種）をアクセスしなかった場合、ＨＤＤのモーターを停
止させる。
種）をアクセスしなかった場合、ＨＤＤのモーターを停
止させる。
【０００５】２．一定の期間入力がなかった場合、表示
装置を停止させる。
装置を停止させる。
【０００６】３．一定の期間入力がなかった場合、ＣＰ
Ｕのクロック周波数を低下させる。
Ｕのクロック周波数を低下させる。
【０００７】４．一定の期間入力がなかった場合、ＣＰ
Ｕのクロックを停止させる。
Ｕのクロックを停止させる。
【０００８】
【発明が解決しようとする課題】上記のような手段は個
々の装置の消費電力を抑えるのに有効な方法である。し
かし、近年のオフィスの様にパソコンが大量に導入され
た場合、オフィスの最大電力が決まっているため、その
規定値以上の電力を使用することができないのが現状で
ある。各機器の最大電力を足しあわせた結果をオフィス
の最大電力以下にしておけば問題ないが、常に最大電力
を使用しているわけではないので非効率的である。従来
の手段ではこの部分の制御を人間が行う必要があったた
め手間がかかり、また偶然に全パソコンが最大電力を使
用してしまった場合は最悪の場合ブレーカーが落ち、デ
ータを消失する事となる。
々の装置の消費電力を抑えるのに有効な方法である。し
かし、近年のオフィスの様にパソコンが大量に導入され
た場合、オフィスの最大電力が決まっているため、その
規定値以上の電力を使用することができないのが現状で
ある。各機器の最大電力を足しあわせた結果をオフィス
の最大電力以下にしておけば問題ないが、常に最大電力
を使用しているわけではないので非効率的である。従来
の手段ではこの部分の制御を人間が行う必要があったた
め手間がかかり、また偶然に全パソコンが最大電力を使
用してしまった場合は最悪の場合ブレーカーが落ち、デ
ータを消失する事となる。
【０００９】
【課題を解決するための手段】上記問題点を解決するた
めに本発明は、消費電力の最大値を設定する手段と、各
デバイスの消費電力を検知する手段と、検知した消費電
力の合計を算出する手段と、該算出データと前出の消費
電力の最大値を比較する手段と、該比較結果によって各
デバイスの動作を制御する手段を備え、消費電力を一定
に保つ機能をもつ事を特徴とする消費電力制御方式を提
供する。
めに本発明は、消費電力の最大値を設定する手段と、各
デバイスの消費電力を検知する手段と、検知した消費電
力の合計を算出する手段と、該算出データと前出の消費
電力の最大値を比較する手段と、該比較結果によって各
デバイスの動作を制御する手段を備え、消費電力を一定
に保つ機能をもつ事を特徴とする消費電力制御方式を提
供する。
【００１０】
【発明の実施の形態】図１から図３を用いて本発明の実
施例を説明する。まず図１を用いて本発明による電力制
御部の動作を説明する。図１は本発明による電力制御回
路の一実施例である。１０は本発明による電力制御部、
２１は装置の目標消費電力を設定する装置消費電力レジ
スタ、２２はＣＰＵの消費電力を検知するＣＰＵ消費電
力レジスタ、２３はＨＤＤの消費電力を検知するＨＤＤ
消費電力レジスタ、２４はＣＲＴの消費電力を検知する
ＣＲＴ消費電力レジスタ、２５はその他のデバイスの消
費電力を検知するその他消費電力レジスタ、２６はＣＰ
Ｕ消費電力レジスタ２２とＨＤＤ消費電力レジスタ２３
と、ＣＲＴ消費電力レジスタ２４と、その他消費電力レ
ジスタ２５の電力の合計を算出する加算回路、２７は装
置消費電力レジスタ２１と加算回路２６の算出結果を比
較する比較回路、２８は比較回路２７の結果を元にして
各デバイスへフィードバックをかける全体制御回路、２
９は全体制御回路２８の命令に従いＣＰＵの消費電力を
制御するＣＰＵ制御回路、３０は全体制御回路２８の命
令に従いＨＤＤの消費電力を制御するＨＤＤ制御回路、
３１は全体制御回路２８の命令に従いＣＲＴの消費電力
を制御するＣＲＴ制御回路、３２は全体制御回路２８の
命令に従いその他のデバイスの消費電力を制御するその
他制御回路である。以下本実施例の動作を説明する。ま
ず初期設定として、装置消費電力レジスタ２１にその装
置が目標とする最大消費電力を設定する。その後、ＣＰ
Ｕ消費電力レジスタ２２からその他消費電力レジスタ２
５までの４レジスタの値を元に加算回路２６が現在の消
費電力を計算する。その計算結果と目標である装置消費
電力レジスタ２１に設定している値を比較回路２７が比
較する。その結果は全体制御回路２８へ引き渡される。
全体制御回路２８は装置消費電力レジスタ２１の値が加
算回路２６の値より大きくかつある値以内の差である場
合は特に制御動作を行わない。しかし、ある値以上の差
が生じている場合はＣＰＵ制御回路２９からその他制御
回路３２までの４制御回路のいずれかに対して消費電力
抑制を緩めるように命令する。しかし、その逆の場合は
ＣＰＵ制御回路２９からその他制御回路３２までの４制
御回路のいずれかに対して消費電力を抑制するよう命令
する。このように消費電力のフィードバック制御を行う
ことで、設定した消費電力の範囲内で最大のパフォーマ
ンスを実現することが可能となる。
施例を説明する。まず図１を用いて本発明による電力制
御部の動作を説明する。図１は本発明による電力制御回
路の一実施例である。１０は本発明による電力制御部、
２１は装置の目標消費電力を設定する装置消費電力レジ
スタ、２２はＣＰＵの消費電力を検知するＣＰＵ消費電
力レジスタ、２３はＨＤＤの消費電力を検知するＨＤＤ
消費電力レジスタ、２４はＣＲＴの消費電力を検知する
ＣＲＴ消費電力レジスタ、２５はその他のデバイスの消
費電力を検知するその他消費電力レジスタ、２６はＣＰ
Ｕ消費電力レジスタ２２とＨＤＤ消費電力レジスタ２３
と、ＣＲＴ消費電力レジスタ２４と、その他消費電力レ
ジスタ２５の電力の合計を算出する加算回路、２７は装
置消費電力レジスタ２１と加算回路２６の算出結果を比
較する比較回路、２８は比較回路２７の結果を元にして
各デバイスへフィードバックをかける全体制御回路、２
９は全体制御回路２８の命令に従いＣＰＵの消費電力を
制御するＣＰＵ制御回路、３０は全体制御回路２８の命
令に従いＨＤＤの消費電力を制御するＨＤＤ制御回路、
３１は全体制御回路２８の命令に従いＣＲＴの消費電力
を制御するＣＲＴ制御回路、３２は全体制御回路２８の
命令に従いその他のデバイスの消費電力を制御するその
他制御回路である。以下本実施例の動作を説明する。ま
ず初期設定として、装置消費電力レジスタ２１にその装
置が目標とする最大消費電力を設定する。その後、ＣＰ
Ｕ消費電力レジスタ２２からその他消費電力レジスタ２
５までの４レジスタの値を元に加算回路２６が現在の消
費電力を計算する。その計算結果と目標である装置消費
電力レジスタ２１に設定している値を比較回路２７が比
較する。その結果は全体制御回路２８へ引き渡される。
全体制御回路２８は装置消費電力レジスタ２１の値が加
算回路２６の値より大きくかつある値以内の差である場
合は特に制御動作を行わない。しかし、ある値以上の差
が生じている場合はＣＰＵ制御回路２９からその他制御
回路３２までの４制御回路のいずれかに対して消費電力
抑制を緩めるように命令する。しかし、その逆の場合は
ＣＰＵ制御回路２９からその他制御回路３２までの４制
御回路のいずれかに対して消費電力を抑制するよう命令
する。このように消費電力のフィードバック制御を行う
ことで、設定した消費電力の範囲内で最大のパフォーマ
ンスを実現することが可能となる。
【００１１】本実施例では消費電力レジスタ（２２から
２５）を４個としているがこれはそれ以上でもそれ以下
でもかまわない。また、消費電力制御回路（２９から３
２）を４個としているがそれ以上でもそれ以下でもかま
わない。
２５）を４個としているがこれはそれ以上でもそれ以下
でもかまわない。また、消費電力制御回路（２９から３
２）を４個としているがそれ以上でもそれ以下でもかま
わない。
【００１２】次に図２を用いて本発明による電力制御装
置の構成を説明する。図２は本発明による消費電力制御
装置のブロック図である。１０は本発明による電力制御
部、４０は代表的な補助記憶装置であるＨＤＤ、５０は
ＣＰＵ、６０はその他のデバイス類（例えばＦＤＤ、メ
モリ等々）、７０はＣＲＴ（表示装置）である。以下、
本装置の動作の概略を説明する。電力制御部１０はＨＤ
Ｄ４０，ＣＰＵ５０、その他６０，ＣＲＴ７０の消費電
力を検知し、電力制御部１０の中に設定してある目標電
力と比較し、消費電力が目標電力を上回るようならばＨ
ＤＤ４０，ＣＰＵ５０、その他６０にフィードバックを
かけ、消費電力を目標電力以下に抑える。
置の構成を説明する。図２は本発明による消費電力制御
装置のブロック図である。１０は本発明による電力制御
部、４０は代表的な補助記憶装置であるＨＤＤ、５０は
ＣＰＵ、６０はその他のデバイス類（例えばＦＤＤ、メ
モリ等々）、７０はＣＲＴ（表示装置）である。以下、
本装置の動作の概略を説明する。電力制御部１０はＨＤ
Ｄ４０，ＣＰＵ５０、その他６０，ＣＲＴ７０の消費電
力を検知し、電力制御部１０の中に設定してある目標電
力と比較し、消費電力が目標電力を上回るようならばＨ
ＤＤ４０，ＣＰＵ５０、その他６０にフィードバックを
かけ、消費電力を目標電力以下に抑える。
【００１３】なお、ここでデバイスとして４例を挙げて
いるがそれ以外のデバイスであってもかまわない。ま
た、各デバイスは消費電力を通知する手段を持っていて
も持っていなくてもかまわない（但しその場合は電力制
御部が全ての消費電力を把握している必要がある）。
いるがそれ以外のデバイスであってもかまわない。ま
た、各デバイスは消費電力を通知する手段を持っていて
も持っていなくてもかまわない（但しその場合は電力制
御部が全ての消費電力を把握している必要がある）。
【００１４】次に図３に消費電力の動作の一例を示す。
最大消費電力時にＣＰＵが３０Ｗ、ＨＤＤが３０Ｗ、Ｃ
ＲＴが７０Ｗ、その他のデバイスが３０Ｗを消費する装
置を考える。本装置は最大動作時には１６０Ｗを消費す
る。装置の目標最大電力を１３０Ｗとすると例１ではＨ
ＤＤが２０Ｗ、その他のデバイスが１０Ｗ消費電力を抑
えている。本状態はＨＤＤアクセスがなく、また他のデ
バイスへのアクセスもない、ＣＰＵがメインで動作して
いる場合と考えることができる。この状態からＨＤＤの
アクセスが始まった場合を考える。ＨＤＤの消費電力は
３０Ｗへと２０Ｗ増加する。そうすると本発明による電
力制御装置は、ＣＰＵの動作クロックを低下させ、１０
Ｗへ抑える。一般的にＨＤＤアクセス中はＣＰＵはそれ
ほど高速な動作を要求されないため別段不都合は生じな
い。このように他のデバイスへの消費電力が増加した場
合も、その他のデバイスへの消費電力抑制の命令を発す
ることで消費電力を一定に保つことができる。また、参
考として例３にスタンバイモードに入った場合の状態を
記述する。この場合、ＣＰＵ，ＨＤＤ，ＣＲＴ、その他
のデバイスともに消費電力を抑えるため装置の消費電力
は５０Ｗへと低下する。この場合は従来の電力制御機構
が動作するため本発明の消費電力制御は動作しない。
最大消費電力時にＣＰＵが３０Ｗ、ＨＤＤが３０Ｗ、Ｃ
ＲＴが７０Ｗ、その他のデバイスが３０Ｗを消費する装
置を考える。本装置は最大動作時には１６０Ｗを消費す
る。装置の目標最大電力を１３０Ｗとすると例１ではＨ
ＤＤが２０Ｗ、その他のデバイスが１０Ｗ消費電力を抑
えている。本状態はＨＤＤアクセスがなく、また他のデ
バイスへのアクセスもない、ＣＰＵがメインで動作して
いる場合と考えることができる。この状態からＨＤＤの
アクセスが始まった場合を考える。ＨＤＤの消費電力は
３０Ｗへと２０Ｗ増加する。そうすると本発明による電
力制御装置は、ＣＰＵの動作クロックを低下させ、１０
Ｗへ抑える。一般的にＨＤＤアクセス中はＣＰＵはそれ
ほど高速な動作を要求されないため別段不都合は生じな
い。このように他のデバイスへの消費電力が増加した場
合も、その他のデバイスへの消費電力抑制の命令を発す
ることで消費電力を一定に保つことができる。また、参
考として例３にスタンバイモードに入った場合の状態を
記述する。この場合、ＣＰＵ，ＨＤＤ，ＣＲＴ、その他
のデバイスともに消費電力を抑えるため装置の消費電力
は５０Ｗへと低下する。この場合は従来の電力制御機構
が動作するため本発明の消費電力制御は動作しない。
【００１５】
【発明の効果】パソコンの最大消費電力を設定しておけ
ば、自動的にその範囲内の消費電力で動作をおこなうこ
とができる。それによって電力の消費量を抑えることが
出来、電力の過大消費によって生じるブレーカー断によ
るデータの消失を予防することが出来る。
ば、自動的にその範囲内の消費電力で動作をおこなうこ
とができる。それによって電力の消費量を抑えることが
出来、電力の過大消費によって生じるブレーカー断によ
るデータの消失を予防することが出来る。
【図１】本発明による電力制御部の一実施例のブロック
図である。
図である。
【図２】本発明による電力制御装置の実施例のブロック
図である。
図である。
【図３】本発明による電力制御の動作例を示す図であ
る。
る。
１０…本発明による電力制御部、２１…装置の目標消費
電力を設定する装置消費電力レジスタ、２２…ＣＰＵの
消費電力を検知するＣＰＵ消費電力レジスタ、２３…Ｈ
ＤＤの消費電力を検知するＨＤＤ消費電力レジスタ、２
４…ＣＲＴの消費電力を検知するＣＲＴ消費電力レジス
タ、２５…その他のデバイスの消費電力を検知するその
他消費電力レジスタ、２６…ＣＰＵ消費電力レジスタ２
２とＨＤＤ消費電力レジスタ２３と、ＣＲＴ消費電力レ
ジスタ２４と、その他消費電力レジスタ２５の電力の合
計を算出する加算回路、２７…装置消費電力レジスタ２
１と加算回路２６の算出結果を比較する比較回路、２８
…比較回路２７の結果を元にして各デバイスへフィード
バックをかける全体制御回路、２９…全体制御回路２８
の命令に従いＣＰＵの消費電力を制御するＣＰＵ制御回
路、３０…全体制御回路２８の命令に従いＨＤＤの消費
電力を制御するＨＤＤ制御回路、３１…全体制御回路２
８の命令に従いＣＲＴの消費電力を制御するＣＲＴ制御
回路、３２…全体制御回路２８の命令に従いその他のデ
バイスの消費電力を制御するその他制御回路、４０…代
表的な補助記憶装置であるＨＤＤ、５０…ＣＰＵ、６０
…その他のデバイス類（例えばＦＤＤ、メモリ等々）、
７０…ＣＲＴ（表示装置）。
電力を設定する装置消費電力レジスタ、２２…ＣＰＵの
消費電力を検知するＣＰＵ消費電力レジスタ、２３…Ｈ
ＤＤの消費電力を検知するＨＤＤ消費電力レジスタ、２
４…ＣＲＴの消費電力を検知するＣＲＴ消費電力レジス
タ、２５…その他のデバイスの消費電力を検知するその
他消費電力レジスタ、２６…ＣＰＵ消費電力レジスタ２
２とＨＤＤ消費電力レジスタ２３と、ＣＲＴ消費電力レ
ジスタ２４と、その他消費電力レジスタ２５の電力の合
計を算出する加算回路、２７…装置消費電力レジスタ２
１と加算回路２６の算出結果を比較する比較回路、２８
…比較回路２７の結果を元にして各デバイスへフィード
バックをかける全体制御回路、２９…全体制御回路２８
の命令に従いＣＰＵの消費電力を制御するＣＰＵ制御回
路、３０…全体制御回路２８の命令に従いＨＤＤの消費
電力を制御するＨＤＤ制御回路、３１…全体制御回路２
８の命令に従いＣＲＴの消費電力を制御するＣＲＴ制御
回路、３２…全体制御回路２８の命令に従いその他のデ
バイスの消費電力を制御するその他制御回路、４０…代
表的な補助記憶装置であるＨＤＤ、５０…ＣＰＵ、６０
…その他のデバイス類（例えばＦＤＤ、メモリ等々）、
７０…ＣＲＴ（表示装置）。
Claims (1)
- 【請求項１】消費電力の最大値を設定する手段と、 各デバイスの消費電力を検知する手段と、 検知した消費電力の合計を算出する手段と、 該算出データと前出の消費電力の最大値を比較する手段
と、 該比較結果によって各デバイスの動作を制御する手段を
備え、消費電力を一定に保つ機能をもつ事を特徴とする
消費電力制御方式
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8060579A JPH09251334A (ja) | 1996-03-18 | 1996-03-18 | 消費電力制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8060579A JPH09251334A (ja) | 1996-03-18 | 1996-03-18 | 消費電力制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09251334A true JPH09251334A (ja) | 1997-09-22 |
Family
ID=13146308
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8060579A Pending JPH09251334A (ja) | 1996-03-18 | 1996-03-18 | 消費電力制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09251334A (ja) |
Cited By (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20020008110A (ko) * | 1998-12-23 | 2002-01-29 | 피터 엔. 데트킨 | 컴퓨터 시스템에서의 전력 소비 관리 방법 및 장치 |
| US6789207B1 (en) | 1998-07-02 | 2004-09-07 | Renesas Technology Corp. | Microprocessor |
| US7178043B2 (en) | 2002-04-02 | 2007-02-13 | Kabushiki Kaisha Toshiba | Power consumption control method and information processing device |
| US7212954B2 (en) | 2005-01-28 | 2007-05-01 | Fujitsu Limited | Information processing apparatus, failure monitoring method and failure monitoring computer program |
| JP2007287150A (ja) * | 2006-04-15 | 2007-11-01 | Hewlett-Packard Development Co Lp | 電力管理システム及び方法 |
| JP2008160971A (ja) * | 2006-12-25 | 2008-07-10 | Fujitsu Ltd | 消費電力調整プログラム，装置，および処理方法 |
| JP2008197871A (ja) * | 2007-02-13 | 2008-08-28 | Fuji Xerox Co Ltd | 給電システム、端末装置およびプログラム |
| JP2009159712A (ja) * | 2007-12-26 | 2009-07-16 | Fujitsu Ltd | 消費電力監視プログラム、消費電力監視装置、および消費電力監視方法 |
| CN104798005A (zh) * | 2012-12-28 | 2015-07-22 | 英特尔公司 | 总平台功率控制 |
| US9542104B2 (en) | 2013-08-05 | 2017-01-10 | Western Digital Technologies, Inc. | System and method for controlling a storage device |
| JP2019101870A (ja) * | 2017-12-05 | 2019-06-24 | 富士通株式会社 | 電力制御システム及び電力制御プログラム |
-
1996
- 1996-03-18 JP JP8060579A patent/JPH09251334A/ja active Pending
Cited By (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6789207B1 (en) | 1998-07-02 | 2004-09-07 | Renesas Technology Corp. | Microprocessor |
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