JPH09251053A - Semiconductor testing device - Google Patents

Semiconductor testing device

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Publication number
JPH09251053A
JPH09251053A JP8084734A JP8473496A JPH09251053A JP H09251053 A JPH09251053 A JP H09251053A JP 8084734 A JP8084734 A JP 8084734A JP 8473496 A JP8473496 A JP 8473496A JP H09251053 A JPH09251053 A JP H09251053A
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JP
Japan
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board
socket
resistor
test
coaxial cable
Prior art date
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JP8084734A
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Japanese (ja)
Inventor
Masashi Kaneko
昌史 金子
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Ando Electric Co Ltd
Original Assignee
Ando Electric Co Ltd
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Publication date
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Abstract

PROBLEM TO BE SOLVED: To provide the semiconductor testing device, which can terminate a high-speed, small-amplitude interface IC with resistors in two directions of the input/output and can measure the IC, by securing a region, wherein a plurality of coaxial cables and resistors are mounted, without deteriorating electric characteristics and without enlarging the outer shape of a socket board. SOLUTION: This semiconductor testing device has a socket board 3,a printed board 6, a resistor 7 and coaxial cables 4. On the socket board 3, an IC socket 2 for mounting a device to be measured l is mounted. Furthermore, the printed board 6 is fixed to the socket board 3 by a conductive fixing pin 8, which is connected to the device to be measured l through the IC socket 2. Furthermore, on the printed board 6, the resistor 7 and a plurality of the coaxial cables 4 are mounted. The resistor 7 is connected to the conductive fixing pin 8. A plurality of the coaxial cables 4 are connected to the resistor 7 and a terminating circuit T contained in a test head 5.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】この発明は半導体試験装置、
特に高速小振幅インターフェースバスICの良否を測定
する半導体試験装置に関する。
The present invention relates to a semiconductor test apparatus,
In particular, the present invention relates to a semiconductor test device for measuring the quality of a high speed small amplitude interface bus IC.

【0002】[0002]

【従来の技術】一般に、半導体試験装置は、図4に示す
構成を備えている。図4において、参照符号1は被測定
デバイス、2はICソケット、3はソケットボード、4
は同軸ケーブル、5はテストヘッド、53はテストボー
ドである。
2. Description of the Related Art Generally, a semiconductor test apparatus has a structure shown in FIG. In FIG. 4, reference numeral 1 is a device under test, 2 is an IC socket, 3 is a socket board, 4
Is a coaxial cable, 5 is a test head, and 53 is a test board.

【0003】前記テストヘッド5上には、ソケットボー
ド3を含むテストボード53が設けられ、このテストボ
ード53には、ICソケット2を介して被測定デバイス
1が装着されていると共に、テストボード53内には、
図示するように、同軸ケーブル4が延びている。
A test board 53 including a socket board 3 is provided on the test head 5, and the device under test 1 is mounted on the test board 53 via the IC socket 2 and the test board 53. Within
As shown, the coaxial cable 4 extends.

【0004】この構成により、前記同軸ケーブル4を介
して信号が授受され、終端回路Tを構成するピンエレク
トロニクスカード等の測定回路により、被測定デバイス
1が測定される。
With this configuration, signals are transmitted and received through the coaxial cable 4, and the device under test 1 is measured by the measurement circuit such as the pin electronics card that constitutes the termination circuit T.

【0005】この場合、前記テストボード53の従来技
術の一例は、図5(A)に示す構成を備えている。
In this case, an example of the prior art of the test board 53 has the structure shown in FIG.

【0006】図5(A)において、同軸ケーブル4の一
端部4Aは、ソケットボード3に実装されたICソケッ
ト2に接続し、同軸ケーブル4の他端部4Bは、テスト
ヘッド5に接続している。
In FIG. 5A, one end 4A of the coaxial cable 4 is connected to the IC socket 2 mounted on the socket board 3, and the other end 4B of the coaxial cable 4 is connected to the test head 5. There is.

【0007】即ち、同軸ケーブル4の一端部4Aから
は、図示するように、芯線4Cとシールド線4Dが延び
ている。
That is, as shown in the figure, a core wire 4C and a shield wire 4D extend from one end 4A of the coaxial cable 4.

【0008】前記芯線4Cは、スルーホール3cに、前
記シールド線4Dは、スルーホール3aに、それぞれ接
続されている。
The core wire 4C is connected to the through hole 3c, and the shield wire 4D is connected to the through hole 3a.

【0009】また、同軸ケーブル4の芯線4Cは、導電
パターン9を介して、スルーホール3bにはんだ付けさ
れたICソケット2のピン2Aに、接続されている。
The core wire 4C of the coaxial cable 4 is connected to the pin 2A of the IC socket 2 soldered to the through hole 3b via the conductive pattern 9.

【0010】一方、同軸ケーブル4の他端部4Bは、テ
ストヘッド5、より詳しくは、他端部4Bから延びる芯
線(図示省略)が、テストヘッド5に内蔵された終端回
路T(図4)に、コネクタ(図示省略)を介して又は直
接に接続されている。
On the other hand, the other end 4B of the coaxial cable 4 has a test head 5, more specifically, a terminating circuit T (FIG. 4) in which a core wire (not shown) extending from the other end 4B is built in the test head 5. Via a connector (not shown) or directly.

【0011】[0011]

【発明が解決しようとする課題】しかし、上述した図5
(A)に示す半導体試験装置は、次のような課題があ
る。
However, FIG. 5 described above is used.
The semiconductor test apparatus shown in (A) has the following problems.

【0012】例えば、SSTL(Stub Series Terminate
d Logic)やGTL(Gunning Transceiver Logic)のよう
な高速小振幅インターフェースICを、入出力の双方向
で抵抗終端することにより測定する場合である。
For example, SSTL (Stub Series Terminate)
This is a case where a high-speed small-amplitude interface IC such as d Logic) or GTL (Gunning Transceiver Logic) is measured by resistance termination in both input and output directions.

【0013】即ち、前記高速小振幅インターフェースI
Cを測定する場合には、図5(B)に示すように、被測
定デバイス1をテストヘッド5内の終端回路Tにつなげ
るために、被測定デバイス1の各ピンに対して、同軸ケ
ーブル4を複数本、例えば2本、接続させる必要があ
る。
That is, the high-speed small-amplitude interface I
When measuring C, as shown in FIG. 5B, in order to connect the device under test 1 to the termination circuit T in the test head 5, the coaxial cable 4 is connected to each pin of the device under test 1 in order to connect the device under test 1. It is necessary to connect a plurality of, for example, two.

【0014】更に、図5(B)に示すように、2本の同
軸ケーブル4と、被測定デバイス1との間に、抵抗RI
(例えば、50Ω)を持つ抵抗器7を被測定デバイス1
の近くに直列に接続する必要がある。
Further, as shown in FIG. 5B, a resistor RI is provided between the two coaxial cables 4 and the device under test 1.
The resistor 7 having (for example, 50Ω)
Need to be connected in series near.

【0015】このために、従来は、テストボード53の
ような広さが決まっている領域内に、2本の同軸ケーブ
ル4と一個の抵抗器7を実装する方法として、次の2つ
の方法が提案された。
For this reason, conventionally, the following two methods have been used to mount the two coaxial cables 4 and the single resistor 7 in an area having a fixed size such as the test board 53. was suggested.

【0016】第一の方法は、同軸ケーブル4の外径を小
さくする方法であり、これにより、図5(B)に示す回
路を実現しようとするものである。
The first method is to reduce the outer diameter of the coaxial cable 4, thereby realizing the circuit shown in FIG. 5 (B).

【0017】しかし、この方法は、同軸ケーブル4の減
衰量が大きくなり、そのために、電気的特性が劣化する
という課題がある。
However, this method has a problem in that the amount of attenuation of the coaxial cable 4 becomes large, which causes the electrical characteristics to deteriorate.

【0018】第二の方法は、ICソケット2を実装する
ソケットボード3の外形を大きくする方法であり、これ
により、複数本の同軸ケーブル4と抵抗器7とから成る
回路(図5(B))を実現しようとするものである。
The second method is to enlarge the outer shape of the socket board 3 on which the IC socket 2 is mounted, whereby a circuit composed of a plurality of coaxial cables 4 and resistors 7 (FIG. 5B). ) Is intended to be realized.

【0019】しかし、この方法は、ソケットボード3を
大きくすることから、寸法が決まっている既存の外部機
器(例えば、被測定デバイスの供給装置であるハンド
ラ)に、半導体試験装置(図5)を適用して接続させる
ことが困難である。
However, in this method, since the socket board 3 is made large, the semiconductor test apparatus (FIG. 5) is attached to the existing external equipment (for example, the handler which is the supply apparatus of the device under test) whose dimensions are fixed. It is difficult to apply and connect.

【0020】この発明の目的は、電気的特性を劣化させ
ることなく、またソケットボードの外形を大きくするこ
となく、複数本の同軸ケーブルと抵抗器を実装する領域
を確保することにより、高速小振幅インターフェースI
Cを入出力の双方向で抵抗終端して測定できる半導体試
験装置を提供することにある。
An object of the present invention is to secure a region for mounting a plurality of coaxial cables and resistors without deteriorating the electrical characteristics and without enlarging the outer shape of the socket board, thereby achieving a high speed and small amplitude. Interface I
It is an object of the present invention to provide a semiconductor test device capable of measuring C by resistance termination in both input and output directions.

【0021】[0021]

【課題を解決するための手段】前記課題を解決するため
に、この発明は、図1、図2、図3に示すように、ソケ
ットボード3の下面31に、導電性固定ピン8により、
プリント基板6を固定し、このプリント基板6上に、抵
抗器7と同軸ケーブル4を実装した。
In order to solve the above-mentioned problems, according to the present invention, as shown in FIGS. 1, 2 and 3, a lower surface 31 of a socket board 3 is provided with a conductive fixing pin 8.
The printed circuit board 6 was fixed, and the resistor 7 and the coaxial cable 4 were mounted on the printed circuit board 6.

【0022】この構成によれば、狭いテストボード53
内に、プリント基板6を利用することにより、複数本の
同軸ケーブルと抵抗器を実装する領域を確保できたの
で、電気的特性を劣化させることなく、またソケットボ
ードの外形を大きくすることなく、高速小振幅インター
フェースICを入出力の双方向で抵抗終端して測定でき
るようになった。
According to this configuration, the narrow test board 53
By using the printed circuit board 6 inside, a region for mounting a plurality of coaxial cables and resistors can be secured, so that the electrical characteristics are not deteriorated and the outer shape of the socket board is not increased. A high-speed small-amplitude interface IC can now be measured by resistance termination in both input and output directions.

【0023】[0023]

【発明の実施の形態】以下、この発明を実施の形態によ
り添付図面を参照して説明する。図1は、この発明の実
施形態を示す図、図2は、この発明の実施形態を示す詳
細図、図3は、図1の矢印IIIから見た図である。図
示する半導体試験装置は、ソケットボード3と、プリン
ト基板6と、抵抗器7と、同軸ケーブル4を備えてい
る。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS The present invention will be described below with reference to the accompanying drawings according to embodiments. 1 is a view showing an embodiment of the present invention, FIG. 2 is a detailed view showing an embodiment of the present invention, and FIG. 3 is a view seen from an arrow III in FIG. The illustrated semiconductor testing device includes a socket board 3, a printed circuit board 6, a resistor 7, and a coaxial cable 4.

【0024】前記ソケットボード3は、テストボード5
3を構成し、スルーホール3A、3Bがそれそれ形成さ
れている。
The socket board 3 is a test board 5
3 and through holes 3A and 3B are formed respectively.

【0025】このソケットボード3上には、図示するよ
うに、ICソケット2が、そのピン2Aをスルーホール
3Aに挿入されはんだ付けすることにより、固定され、
ICソケット2には、被測定デバイス1が装着されてい
る。
As shown in the figure, the IC socket 2 is fixed on the socket board 3 by inserting its pins 2A into the through holes 3A and soldering them.
The device under test 1 is attached to the IC socket 2.

【0026】プリント基板6は、前記ソケットボード3
の下面31に対して、ほぼ直角に配置され(図1、図
2、図3)、プリント基板6には、上部にスルーホール
6Aが、下部にスルーホール6B、6Cがそれぞれ形成
されている。
The printed board 6 is the socket board 3
The printed circuit board 6 is arranged substantially at right angles to the lower surface 31 (FIG. 1, FIG. 2, FIG. 3), and the printed circuit board 6 has through holes 6A formed in the upper part and through holes 6B, 6C formed in the lower part.

【0027】前記プリント基板6のスルーホール6A
は、プリント基板6の長手方向に(図3)複数個形成さ
れ、各スルーホール6Aには、導電性固定ピン8の他端
部8Bが挿入され、導電性固定ピン8の一端部8Aは、
前記ソケットボード3のスルーホール3Aに挿入されは
んだ付けされている。
Through hole 6A of the printed circuit board 6
Are formed in the longitudinal direction of the printed circuit board 6 (FIG. 3), the other end 8B of the conductive fixing pin 8 is inserted into each through hole 6A, and one end 8A of the conductive fixing pin 8 is
It is inserted into the through hole 3A of the socket board 3 and soldered.

【0028】前記導電性固定ピン8は、図1、図2に示
すように、例えばL字型に形成され、その一端部8A
は、導電パターン9を介して、ICソケット2のピン2
Aに接続され、他端部8Bは、導電パターン9を介し
て、後述する抵抗器7に接続されている。
As shown in FIGS. 1 and 2, the conductive fixing pin 8 is formed in an L shape, for example, and has one end 8A.
Is the pin 2 of the IC socket 2 via the conductive pattern 9.
The other end portion 8B is connected to A, and the other end portion 8B is connected to a resistor 7 described later via the conductive pattern 9.

【0029】即ち、前記導電性固定ピン8は、ソケット
ボード3に対して、プリント基板6を機械的に固定する
と共に、電気的に接続する機能を備えている。
That is, the conductive fixing pin 8 has a function of mechanically fixing the printed board 6 to the socket board 3 and electrically connecting the same.

【0030】プリント基板6上には、抵抗器7が実装さ
れ、この抵抗器7は、導電パターン9を介して、同軸ケ
ーブル4の一端部4Aに接続されている(図1、図
2)。
A resistor 7 is mounted on the printed circuit board 6, and the resistor 7 is connected to one end 4A of the coaxial cable 4 via a conductive pattern 9 (FIGS. 1 and 2).

【0031】即ち、同軸ケーブル4の一端部4Aから
は、芯線4Cが延びており、芯線4Cは、スルーホール
6Bに挿入されはんだ付けされていると共に、図2に示
すように、導電パターン9に接続されている。
That is, the core wire 4C extends from the one end 4A of the coaxial cable 4, and the core wire 4C is inserted into the through hole 6B and soldered, and as shown in FIG. It is connected.

【0032】また、同軸ケーブル4の一端部4Aから
は、絶縁用のシールド線4Dが延び、シールド線4D
は、スルーホール6Cに挿入され、プリント基板6に接
続されている。
A shielded wire 4D for insulation extends from one end 4A of the coaxial cable 4, and the shielded wire 4D
Are inserted into the through holes 6C and connected to the printed circuit board 6.

【0033】一方、同軸ケーブル4の他端部4Bは、テ
ストヘッド5に、より詳しくは、同軸ケーブル4の他端
部4Bから延びる芯線(図示省略)が、テストヘッド5
に内蔵された終端回路Tに、コネクタ(図示省略)を介
して又は直接に接続されている(図3、図4、図5
(B))。
On the other hand, the other end 4B of the coaxial cable 4 is connected to the test head 5, more specifically, a core wire (not shown) extending from the other end 4B of the coaxial cable 4 is connected to the test head 5.
Is connected to a terminal circuit T built in the device via a connector (not shown) or directly (FIGS. 3, 4, and 5).
(B)).

【0034】更に、プリント基板6の反対側にも、同軸
ケーブル4が、前記と同様の構成により実装され(図
1、図2)、図5(B)に示す回路が実現されている。
Further, the coaxial cable 4 is mounted on the opposite side of the printed circuit board 6 in the same configuration as described above (FIGS. 1 and 2), and the circuit shown in FIG. 5B is realized.

【0035】従来技術では、同軸ケーブル4は、被測定
デバイス1の各ピン1A当り複数本であるが、この実施
の形態では、2本である(図1、図2、図5(B))。
In the prior art, there are a plurality of coaxial cables 4 for each pin 1A of the device under test 1, but in this embodiment, there are two (4) (FIG. 1, FIG. 2, FIG. 5B). .

【0036】また、この発明では、同軸ケーブル4の外
径を小さくせず、かつソケットボード3の外形を大きく
しないことを前提にしているので、図3に示すように、
抵抗器7に対するプリント基板6上の実装領域にも余裕
がない場合がある。
Further, in the present invention, it is premised that the outer diameter of the coaxial cable 4 is not made small and the outer shape of the socket board 3 is not made large. Therefore, as shown in FIG.
There may be no room in the mounting area on the printed circuit board 6 for the resistor 7.

【0037】この場合には、図示するように、抵抗器7
が、上下方向に蛇行して配置され(矢印A)、いわば千
鳥配置に実装されている。
In this case, as shown in FIG.
However, they are arranged so as to meander in the vertical direction (arrow A), and are mounted in a zigzag arrangement, so to speak.

【0038】しかし、プリント基板6上の実装領域に余
裕があれば、前記抵抗器7を蛇行させることなく横一列
に、同じ高さ位置に配置することもできる。
However, if the mounting area on the printed circuit board 6 has a margin, the resistors 7 can be arranged in a horizontal row at the same height position without meandering.

【0039】このようにして、同軸ケーブル4と抵抗器
7の実装領域を確保したプリント基板6は、図1に示す
ように、一つの被測定デバイス1に対して複数枚設けら
れ、被測定デバイス1の各ピン1Aは、図5(B)に示
す回路に従って、テストヘッド5に内蔵された終端回路
Tに接続され、高速小振幅インターフェースICの測定
が可能である。
As shown in FIG. 1, a plurality of printed circuit boards 6 in which the mounting areas of the coaxial cable 4 and the resistor 7 are secured are provided for one device under test 1 as shown in FIG. Each pin 1A of No. 1 is connected to the termination circuit T built in the test head 5 according to the circuit shown in FIG. 5B, and the high speed small amplitude interface IC can be measured.

【0040】以下、前記構成を備えた半導体試験装置の
作用を説明する。
The operation of the semiconductor test apparatus having the above structure will be described below.

【0041】上述したように、ソケットボード3の下面
31には、導電性固定ピン8により、1つの被測定デバ
イス1に対して、例えば2枚のプリント基板6が設けら
れている。
As described above, on the lower surface 31 of the socket board 3, for example, two printed circuit boards 6 are provided for one device under test 1 by the conductive fixing pins 8.

【0042】また、各プリント基板6の両側には、被測
定デバイス1の各ピン1Aに対して、例えば、2本の同
軸ケーブル4が実装されていると共に、2本の同軸ケー
ブル4に対して一個の抵抗器7が実装されている。
Further, for example, two coaxial cables 4 are mounted on each side of each printed circuit board 6 for each pin 1A of the device under test 1 and for each coaxial cable 4. One resistor 7 is mounted.

【0043】そして、このように、プリント基板6に実
装された抵抗器7と、ソケットボード3上にICソケッ
ト2を介して装着されている被測定デバイス1とは、導
電パターン9と導電性固定ピン8により接続され(図
1)、また、プリント基板6上に実装された抵抗器7と
同軸ケーブル4どうしは、導電パターン9により接続さ
れ、更に、同軸ケーブル4は、プリント基板6の下方の
テストヘッド5に内蔵した終端回路Tに接続されてい
る。
In this way, the resistor 7 mounted on the printed board 6 and the device under test 1 mounted on the socket board 3 via the IC socket 2 are electrically conductive pattern 9 and conductively fixed. The resistors 7 mounted on the printed circuit board 6 and the coaxial cables 4 are connected by the pins 8 (FIG. 1), and the coaxial cable 4 is connected to the lower part of the printed circuit board 6 by the conductive pattern 9. It is connected to a termination circuit T built in the test head 5.

【0044】このようにして、ソケットボード3とテス
トヘッド5間に介在するテストボード53内に、プリン
ト基板6を設け、同軸ケーブル4と抵抗器7を実装する
領域を確保することにより、高速小振幅インターフェー
スICを入出力の双方向で抵抗終端して測定できる回路
(図5(B))を実現した。
In this way, the printed board 6 is provided in the test board 53 interposed between the socket board 3 and the test head 5, and the area for mounting the coaxial cable 4 and the resistor 7 is secured, so that the high speed small size can be achieved. A circuit (Fig. 5 (B)) that can measure the amplitude interface IC by resistance termination in both input and output directions has been realized.

【0045】[0045]

【発明の効果】この発明によれば、ソケットボードの下
面にプリント基板を設け、プリント基板上に被測定デバ
イスの各ピン当り複数本の同軸ケーブル及び抵抗器を実
装する領域を確保できたので、電気的特性を劣化させる
ことなく、またソケットボードの外形を大きくすること
なく、高速小振幅インターフェースICを入出力の双方
向で抵抗終端して測定できるという効果がある。
According to the present invention, the printed board is provided on the lower surface of the socket board, and the area for mounting a plurality of coaxial cables and resistors for each pin of the device under test can be secured on the printed board. There is an effect that the high-speed small-amplitude interface IC can be resistance-terminated in both input and output directions and measured without deteriorating the electrical characteristics and without enlarging the outer shape of the socket board.

【0046】[0046]

【図面の簡単な説明】[Brief description of drawings]

【図1】この発明の実施形態を示す図である。FIG. 1 is a diagram showing an embodiment of the present invention.

【図2】この発明の実施形態を示す詳細図である。FIG. 2 is a detailed diagram showing an embodiment of the present invention.

【図3】図1の矢印IIIから見た図である。FIG. 3 is a view seen from an arrow III in FIG.

【図4】半導体試験装置の一般的説明図である。FIG. 4 is a general explanatory view of a semiconductor test device.

【図5】従来技術の説明図である。FIG. 5 is an explanatory diagram of a conventional technique.

【符号の説明】[Explanation of symbols]

1 被測定デバイス 2 ICソケット 3 ソケットボード 4 同軸ケーブル 5 テストヘッド 6 プリント基板 7 抵抗器 8 導電性固定ピン 9 導電パターン T 終端回路 1 Device under Test 2 IC Socket 3 Socket Board 4 Coaxial Cable 5 Test Head 6 Printed Circuit Board 7 Resistor 8 Conductive Fixing Pin 9 Conductive Pattern T Termination Circuit

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】 被測定デバイス(1)を装着するICソ
ケット(2)が実装されたソケットボード(3)と、終
端回路(T)が内蔵されたテストヘッド(5)を備えた
半導体試験装置において、 前記ICソケット(2)に接続されている導電性固定ピ
ン(8)により、ソケットボード(3)に固定されてい
るプリント基板(6)と、 プリント基板(6)上に実装されていると共に、前記導
電性固定ピン(8)に接続されている抵抗器(7)と、 プリント基板(6)上に実装されていると共に、前記抵
抗器(7)とテストヘッド(5)に接続されている複数
本の同軸ケーブル(4)により構成されていることを特
徴とする半導体試験装置。
1. A semiconductor test apparatus comprising a socket board (3) on which an IC socket (2) for mounting a device under test (1) is mounted, and a test head (5) containing a termination circuit (T). In the printed board (6) fixed to the socket board (3) by the conductive fixing pin (8) connected to the IC socket (2), and mounted on the printed board (6). A resistor (7) connected to the conductive fixing pin (8) and a resistor (7) mounted on the printed circuit board (6) and connected to the resistor (7) and the test head (5). A semiconductor test apparatus comprising a plurality of coaxial cables (4).
【請求項2】 前記導電性固定ピン(8)の一端部(8
A)が、導電パターン(9)により、ICソケット
(2)のピン(2A)に接続され、他端部(8B)が、
導電パターン(9)により、抵抗器(7)に接続されて
いる請求項1記載の半導体試験装置。
2. One end (8) of the conductive fixing pin (8)
A) is connected to the pin (2A) of the IC socket (2) by the conductive pattern (9), and the other end (8B) is
The semiconductor test device according to claim 1, wherein the semiconductor test device is connected to the resistor (7) by a conductive pattern (9).
【請求項3】 被測定デバイス(1)の各ピン(1A)
に対して、2本の同軸ケーブル(4)がプリント基板
(6)の両面に実装され、各同軸ケーブル(4)の一端
部(4A)が、導電パターン(9)により、抵抗器
(7)に接続されている請求項1記載の半導体試験装
置。
3. Each pin (1A) of the device under test (1)
On the other hand, two coaxial cables (4) are mounted on both surfaces of the printed circuit board (6), and one end portion (4A) of each coaxial cable (4) is connected to the resistor (7) by the conductive pattern (9). The semiconductor test apparatus according to claim 1, which is connected to the.
JP8084734A 1996-03-13 1996-03-13 Semiconductor testing device Pending JPH09251053A (en)

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JP8084734A JPH09251053A (en) 1996-03-13 1996-03-13 Semiconductor testing device

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JP8084734A Pending JPH09251053A (en) 1996-03-13 1996-03-13 Semiconductor testing device

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003503712A (en) * 1999-06-28 2003-01-28 テラダイン・インコーポレーテッド Semiconductor parallel tester

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JP2003503712A (en) * 1999-06-28 2003-01-28 テラダイン・インコーポレーテッド Semiconductor parallel tester

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