JPH088671B2 - Liquid crystal drive - Google Patents

Liquid crystal drive

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JPH088671B2
JPH088671B2 JP63306947A JP30694788A JPH088671B2 JP H088671 B2 JPH088671 B2 JP H088671B2 JP 63306947 A JP63306947 A JP 63306947A JP 30694788 A JP30694788 A JP 30694788A JP H088671 B2 JPH088671 B2 JP H088671B2
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liquid crystal
signal
frame
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昌男 川村
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Casio Computer Co Ltd
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Description

【発明の詳細な説明】 [産業上の利用分野] この発明は、ドットマトリクスの液晶表示パネルを駆
動する液晶駆動装置に関する。
The present invention relates to a liquid crystal drive device for driving a dot matrix liquid crystal display panel.

[従来の技術] 従来、携帯用の小型テレビジョン受像機、小型電子式
計算機等の表示部には、一般にドットマトリクスの液晶
表示パネルが使用されている。第5図はその駆動回路の
構成を示すもので、11がN×Mドットのドットマトリク
スの液晶表示パネル(LCD)、12は液晶表示パネル11の
セグメント電極を駆動するセグメントドライバ、13は同
じく液晶表示パネル11のコモン電極を駆動するコモンド
ライバ、14はアナログの映像入力信号をN×Mの画素単
位に量子化するA/D変換器、15は上記セグメントドライ
バ12、コモンドライバ13、A/D変換器14にそれぞれタイ
ミング信号を送出するタイミング信号発生回路である。
[Prior Art] Conventionally, a dot-matrix liquid crystal display panel is generally used for a display unit of a portable small television receiver, a small electronic calculator, or the like. FIG. 5 shows the structure of the drive circuit. 11 is a liquid crystal display panel (LCD) of a dot matrix of N × M dots, 12 is a segment driver for driving the segment electrodes of the liquid crystal display panel 11, and 13 is also a liquid crystal. A common driver that drives the common electrode of the display panel 11, 14 is an A / D converter that quantizes an analog video input signal in N × M pixel units, and 15 is the segment driver 12, common driver 13, A / D A timing signal generation circuit for sending a timing signal to each converter 14.

アナログの映像入力信号はA/D変換器14でタイミング
信号発生回路15からのタイミング信号によりN×Mドッ
トの画素単位に量子化され、セグメントドライバ12に送
出される。このセグメントドライバ12は上記A/D変換器1
4、コモンドライバ13と共にタイミング信号発生回路15
からのタイミング信号に同期して動作するもので、A/D
変換器14からのデジタルデータに対応した階調波形をコ
モンドライバ13で選択された走査線に表示させる。
The analog video input signal is quantized by the A / D converter 14 by the timing signal from the timing signal generation circuit 15 in pixel units of N × M dots and sent to the segment driver 12. This segment driver 12 is the above A / D converter 1
4, timing signal generator 15 with common driver 13
It operates in synchronization with the timing signal from
The gradation waveform corresponding to the digital data from the converter 14 is displayed on the scanning line selected by the common driver 13.

上記のような構成の液晶駆動装置にあって、テレビ画
像は17[mS](=1/60[s])毎に表示しなければなら
ないため、液晶表示パネルの応答速度も必然的に17[m
S]より充分速いことが望まれる。しかしながら、現状
における液晶表示パネルの応答速度は50[mS]〜100[m
S]程度であり、動画表示の際に残像が見えてしまうと
いう欠点があった。
In the liquid crystal driving device having the above structure, the television image must be displayed every 17 [mS] (= 1/60 [s]), so the response speed of the liquid crystal display panel is necessarily 17 [mS]. m
S] is expected to be sufficiently faster. However, the current response speed of liquid crystal display panels is 50 [mS] to 100 [m
However, the afterimage is visible when displaying a moving image.

そこで、応答速度を向上させ、残像が出なくなる液晶
駆動装置として次のような方法が考えられた。すなわ
ち、液晶表示パネル中の一画素に着目すると、1F(フレ
ーム:本願明細書中に言う「フレーム」とは、1画面を
構成する絵素全てが1通り走査される期間を示し、例え
ばTV信号の1フィールド毎に1画面を構成する絵素全て
を1通り走査して表示を行なう場合、TV信号の1フィー
ルドと本願中に言う1フレームは等しいとみなし、TV信
号の1フレームとは必ずしも一致しない。)に1回選択
状態となり、画像データがリフレッシュされる。液晶表
示パネルが累積応答性を有することは周知であるが、こ
の累積応答性を数式のモデルとして表わすと yn=(1−K)xn+Kyn-1 …(1) (ただし、K:定数 xn:入力画像データ yn:出力画像データ (表示されるデータ)) となる。この(1)式をZ変換すると、 Y(z)=(1−K)X(z)+KZ-1Y(z) Y(z)=(1−K)X(z)/(1−KZ-1) …(2) (ただし、Z-1:1フレーム分の遅延演算子)となる。
したがって、液晶表示パネルの伝達関数H(z)は H(z)=(1−K)/(1−KZ-1) …(3) と考えることができる。ここで、液晶表示パネルの伝達
関数とは逆の伝達関数で信号の前処理を行なえば、表示
の応答速度を改善することができる。すなわち、 X(z)=(1−KZ-1)W(z)/(1−K) …(4) この(4)式をZ逆変換すると、 xn=(wn−Kwn-1)/(1−K) …(5) なる式を得るものである。なお、こうして得られた信号
xnはその振幅が大きくなってしまい、そのまま液晶表示
パネルで表示させることは不可能であるので、リミッタ
によってxnとwnの振幅を等しくする必要がある。
Therefore, the following method has been conceived as a liquid crystal driving device that improves the response speed and eliminates the afterimage. That is, focusing on one pixel in the liquid crystal display panel, 1F (frame: “frame” in the specification of the present application indicates a period in which all the picture elements forming one screen are scanned in one way, for example, a TV signal). When all the picture elements that compose one screen for one field are scanned and displayed, one field of the TV signal and one frame in the present application are considered to be equal, and one frame of the TV signal does not necessarily match. No)), the image data is refreshed. It is well known that a liquid crystal display panel has a cumulative response, but when this cumulative response is expressed as a mathematical model, y n = (1-K) x n + Ky n-1 (1) (where K: Constant x n : Input image data y n : Output image data (displayed data)). When Z-transforming this equation (1), Y (z) = (1-K) X (z) + KZ- 1 Y (z) Y (z) = (1-K) X (z) / (1-KZ -1 ) (2) (However, Z -1 : delay operator for one frame).
Therefore, the transfer function H (z) of the liquid crystal display panel can be considered as H (z) = (1−K) / (1−KZ −1 ) (3). Here, if the signal is preprocessed with a transfer function opposite to the transfer function of the liquid crystal display panel, the display response speed can be improved. That is, X (z) = (1−KZ −1 ) W (z) / (1−K) (4) When this formula (4) is inversely Z-transformed, x n = (w n −Kw n−1) ) / (1-K) (5) The signal obtained in this way
Since the amplitude of x n becomes large and it is impossible to display it on the liquid crystal display panel as it is, it is necessary to make the amplitudes of x n and w n equal by a limiter.

第6図は上記(5)式を実現するための回路構成を示
すもので、アナログの映像入力信号はA/D変換器21で画
素単位に量子化され、デジタル信号wnとして1フレーム
遅延回路22と減算器23の+入力側に送出される。1フレ
ーム遅延回路22は入力された信号wnを1フレーム、17
[mS]だけ遅延させ、信号wn-1として乗算器24に出力す
る。乗算器24は信号wn-1をK倍してKwn-1とし、上記減
算器23の−入力側に送出する。減算器23ではA/D変換器2
1からの信号wnと減算器23からの信号Kwn-1とにより、減
算 wn−Kwn-1 を行ない、その差を乗算器25に出力する。乗算器25は入
力された信号を1/(1−K)倍し、リミッタ26に送出す
る。リミッタ26は、送られてきた信号が上記A/D変換器2
1の出力信号wnの振幅を越えていた場合にこれを演算に
よって制限するもので、その出力が信号xnとしてセグメ
ントドライバ27に送られる。セグメントドライバ27は信
号xnに従って液晶表示パネル28のセグメント電極を駆動
する。この液晶表示パネル28のコモン電極はコモンドラ
イバ29によって駆動されるもので、これら液晶表示パネ
ル28、コモンドライバ29及び上記A/D変換器21は共にタ
イミング信号発生回路30から送られてくるタイミング信
号に同期して動作する。
FIG. 6 shows a circuit configuration for realizing the above formula (5). An analog video input signal is quantized by the A / D converter 21 pixel by pixel, and a 1-frame delay circuit is provided as a digital signal w n. It is sent to the + input side of the subtractor 23 and the subtractor 23. The 1-frame delay circuit 22 receives the input signal w n for 1 frame,
The signal is delayed by [mS] and output as a signal w n-1 to the multiplier 24. The multiplier 24 multiplies the signal w n-1 by K to obtain Kw n-1, and sends it to the minus input side of the subtractor 23. A / D converter 2 in subtractor 23
Subtraction w n −Kw n−1 is performed by the signal w n from 1 and the signal Kw n−1 from the subtractor 23, and the difference is output to the multiplier 25. The multiplier 25 multiplies the input signal by 1 / (1-K) and sends it to the limiter 26. The limiter 26 sends the received signal to the A / D converter 2 described above.
When the amplitude of the output signal w n of 1 is exceeded, this is limited by calculation, and its output is sent to the segment driver 27 as the signal x n . The segment driver 27 drives the segment electrodes of the liquid crystal display panel 28 according to the signal x n . The common electrode of the liquid crystal display panel 28 is driven by a common driver 29. The liquid crystal display panel 28, the common driver 29 and the A / D converter 21 are all timing signals sent from the timing signal generating circuit 30. It operates in synchronization with.

上記のような構成にあって、液晶表示パネル28の1画
素における応答速度が例えば50[mS](≒3フレーム)
であるとする。この場合、上記(5)式の定数K=1/2
となる。したがって、乗算器24では1フレーム遅延回路
22で遅延された信号wn-1をwn-1/2とし、減算器23では減
算 wn−wn-1/2 が行なわれる。乗算器25は入力された信号を2倍し、リ
ミッタ26に「2wn−wn-1」なる信号を送出する。リミッ
タ26では、送られてきた信号に対して、例えば xn=(2wn−wn-1)/3+1/3 なる演算を施し、得られた信号xnをセグメントドライバ
27に出力して液晶表示パネル28で表示させる。
In the above structure, the response speed in one pixel of the liquid crystal display panel 28 is, for example, 50 [mS] (≈3 frames).
Suppose In this case, the constant K in equation (5) K = 1/2
Becomes Therefore, in the multiplier 24, the 1-frame delay circuit
The signal w n-1 delayed by 22 is set to w n-1 / 2, and the subtractor 23 performs subtraction w n −w n-1 / 2. The multiplier 25 doubles the input signal and sends a signal "2w n -w n-1 " to the limiter 26. In the limiter 26, against sent signal, for example, x n = (2w n -w n -1) / 3 + 1/3 becomes operational alms, resulting signal x n segment driver
Output to 27 and display on liquid crystal display panel 28.

このような回路構成とすれば、予め時間方向の画像変
化を強調する信号処理を施したデータを用いて液晶表示
パネルを駆動するようにしたので、残像となる影響成分
を除去することが可能となり、液晶表示パネルの低い応
答速度を補償することができる。
With such a circuit configuration, since the liquid crystal display panel is driven by using the data that has been subjected to the signal processing that emphasizes the image change in the time direction in advance, it is possible to remove the influence component that causes the afterimage. The low response speed of the liquid crystal display panel can be compensated.

[発明が解決しようとする課題] しかしながら、上記のような構成の液晶駆動装置は応
答速度の改善効果は大きいが、その反面、静止画に近い
動きの少ない画像領域では過度に変化を強調してしま
う。
[Problems to be Solved by the Invention] However, although the liquid crystal drive device having the above-described configuration has a great effect of improving the response speed, on the other hand, the change is emphasized excessively in an image region having a small amount of motion close to a still image. I will end up.

この発明は上記のような実情に鑑みてなされたもの
で、残像とノイズを大幅に減らした画像表示を行なうこ
とが可能な液晶駆動装置を提供することを目的とする。
The present invention has been made in view of the above circumstances, and an object of the present invention is to provide a liquid crystal drive device capable of displaying an image with significantly reduced afterimage and noise.

[課題を解決するための手段及び作用] この発明は、動きの少ない静止画領域と動きの多い動
画領域とを判別し、動画領域にのみ、時間方向の画像変
化を強調する信号処理を施すようにしたもので、必要な
画像領域のみ応答速度を向上させるため、残像及びノイ
ズを大幅に減少することができる。
[Means and Actions for Solving the Problem] The present invention discriminates between a still image region with little motion and a moving image region with many motions, and performs signal processing for emphasizing image changes in the time direction only in the moving image region. Since the response speed is improved only in the necessary image area, afterimage and noise can be significantly reduced.

[実施例] 以下図面を参照してこの発明の実施例を説明する。Embodiments Embodiments of the present invention will be described below with reference to the drawings.

第1図は一実施例の回路構成を示すもので、第6図の
ものと基本的な構成は同一であるので、同一部分には同
一符号を付してその説明は省略する。
FIG. 1 shows a circuit structure of one embodiment, and since the basic structure is the same as that of FIG. 6, the same portions are denoted by the same reference numerals and the description thereof will be omitted.

しかして、A/D変換器21の出力するデジタル信号wn
1フレーム遅延回路22の出力する信号wn-1は動き検出回
路31にも送出される。この動き検出回路31は、1フレー
ム分の時差を有する2つの信号wn,wn-1の差からその画
素が動画領域にあるか、静止画領域にあるかを判断し、
その判断結果に応じて上記乗算器24及び乗算器25に定数
Kを出力する。
The digital signal w n output from the A / D converter 21 and the signal w n-1 output from the 1-frame delay circuit 22 are also sent to the motion detection circuit 31. The motion detection circuit 31 determines whether the pixel is in the moving image area or the still image area based on the difference between the two signals w n and w n−1 having a time difference of one frame.
The constant K is output to the multiplier 24 and the multiplier 25 according to the result of the determination.

例えば、A/D変換器21の出力するデジタル信号wn及び
これを1フレーム遅延回路22で1フレーム分遅延させた
信号wn-1は、映像信号の輝度成分をmビットの重みを持
ったデータで表わしたものであるので、これらの差分が
ある所定ビット以上あるか否かで動画領域であるか、静
止画領域であるかを判断する。この判断結果によって動
き検出回路31から出力される定数Kのとりうる範囲は
「0≦K<1」である。静止画領域であると判断された
場合は定数Kの値は「0」となり、その結果、乗算器24
の出力は「0」、乗算器25はスルーパスとなって、上記
第7図に示した回路と機能的に同一の、画像変化を強調
する信号処理を行なわない回路となる。また、動画領域
であると判断された場合は、定数Kは「0<K<1」の
範囲内で予め設定された値、例えば「1/2」とされるも
ので、上記第6図に示した如く画像変化を強調する信号
処理が施され、応答速度の改善がなされる。この場合、
定数Kの値が「1」に近付く程、強調の度合いが大きく
なる。
For example, a digital signal w n output from the A / D converter 21 and a signal w n-1 obtained by delaying the digital signal w n by one frame by the one-frame delay circuit 22 have a luminance component of a video signal with a weight of m bits. Since it is represented by data, it is determined whether it is a moving image area or a still image area depending on whether these differences are equal to or more than a predetermined bit. The range of the constant K output from the motion detection circuit 31 based on the result of this determination is “0 ≦ K <1”. If it is determined to be the still image area, the value of the constant K becomes "0", and as a result, the multiplier 24
Is "0", and the multiplier 25 is a through-pass, so that it becomes a circuit which is functionally identical to the circuit shown in FIG. 7 and which does not perform signal processing for emphasizing image change. If it is determined that the area is a moving image area, the constant K is set to a preset value within the range of “0 <K <1”, for example, “1/2”. As shown, signal processing that emphasizes image changes is performed to improve the response speed. in this case,
The closer the value of the constant K is to “1”, the greater the degree of emphasis.

上記第1図では信号wnと1フレーム分遅延された信号
wn-1とにより動きがあるか否かを検出するようにした
が、これに代わって信号wnとリミッタ26の出力である信
号xnとにより同じように動きの検出を行なうことも考え
られる。
In FIG. 1 above, the signal w n is delayed by one frame.
Although w n-1 is used to detect whether or not there is motion, instead of this, it is also possible to detect motion in the same way using the signal w n and the signal x n output from the limiter 26. To be

第2図はこれを実現し他の構成例を示すもので、上記
第1図と同じく基本的な構成は第6図に示したものと同
様であるので、同一部分には同一符号を付してその説明
は省略する。
FIG. 2 shows another configuration example in which this is realized. Since the basic configuration is the same as that shown in FIG. 6 as in FIG. 1, the same parts are designated by the same reference numerals. The description will be omitted.

しかして、A/D変換器21の出力するデジタル信号wn
動き検出回路32に出力される。この動き検出回路32には
また、リミッタ26の出力である信号xnが1フレーム遅延
回路33を介して1フレーム分遅延され、信号xn-1となっ
て入力される。この動き検出回路32は、1フレーム分の
時差を有する2つの信号wn,xn-1の差からその画素が動
画領域にあるか、静止画領域にあるかを判断し、その判
断結果に応じて上記乗算器24及び乗算器25に定数Kを出
力する。
Then, the digital signal w n output from the A / D converter 21 is output to the motion detection circuit 32. The signal x n, which is the output of the limiter 26, is delayed by one frame via the one-frame delay circuit 33 and is input to the motion detection circuit 32 as a signal x n-1 . The motion detection circuit 32 determines whether the pixel is in the moving image area or the still image area from the difference between the two signals w n and x n−1 having the time difference of one frame, and the result of the determination is In response, the constant K is output to the multiplier 24 and the multiplier 25.

動き検出回路32の動作自体は上記第1図の動き検出回
路31と同様であるが、動き検出回路31の周波数特性がフ
ラットであり、周波数に関係なく画像変化を強調するの
に対し、動き検出回路32はハイパスフィルタ的な周波数
特性を有し、周波数が高くなるにつれて強調の度合いも
大きくなる。これは、液晶表示パネルの伝達関数H
(z)が上記(3)式に示した通りである。この(3)
式の式中に Z-1=e-jwT …(6) を代入して周波数特性をみると、 なる式が得られるものである。第3図は第1図の動き検
出回路31による動き検出の周波数特性Iと第2図の動き
検出回路32による動き検出の周波数特性IIを示すもので
あり、動き検出回路32が動き検出回路31に比して、より
顕著に動き(すなわち画像の変化)を検出することがで
きることを表わしている。
The operation itself of the motion detection circuit 32 is similar to that of the motion detection circuit 31 of FIG. 1, but the frequency characteristic of the motion detection circuit 31 is flat, and the image change is emphasized regardless of the frequency. The circuit 32 has a high-pass filter-like frequency characteristic, and the degree of emphasis increases as the frequency increases. This is the transfer function H of the liquid crystal display panel.
(Z) is as shown in the above formula (3). This (3)
Substituting Z −1 = e -jwT (6) into the equation, and looking at the frequency characteristics, Is obtained. FIG. 3 shows a frequency characteristic I for motion detection by the motion detection circuit 31 in FIG. 1 and a frequency characteristic II for motion detection by the motion detection circuit 32 in FIG. This means that it is possible to detect the motion (that is, the change in the image) more significantly than the above.

また、上記第2図に示した構成はさらに第4図のよう
にすることも考えられる。これは、上記(1)式の逆関
数を求めると xn=(yn−Kyn-1)/(1−K) …(8) なる式が得られる。、この(8)式の画像入力データyn
をwnで置換えると xn=(wn−Kyn-1)/(1−K) …(9) なる式が得られ、これを実現する回路をA/D変換器21と
セグメントドライバ27の間に配設すれば、上記第1図と
同様の効果が得られるものである。以下、第4図につい
て述べる。
Further, the configuration shown in FIG. 2 may be further modified as shown in FIG. This is the (1) is the inverse function seek when x n = (y n -Ky n -1) / (1-K) ... (8) becomes equation of Formula obtained. , Image input data y n of this equation (8)
When the replaced by w n x n = (w n -Ky n-1) / (1-K) ... (9) becomes equation is obtained, a circuit for realizing this A / D converter 21 and the segment driver If it is arranged between the two 27, the same effect as that of FIG. 1 can be obtained. Hereinafter, FIG. 4 will be described.

図中、A/D変換器21(図示せず)から送られてきたデ
ジタル信号wnは動き検出回路34及び減算器35に送出され
る。減算着35の減算結果は乗算器36に送られるもので、
乗算器36では送られてきた信号を1/(1−K)倍してリ
ミッタ37に出力する。リミッタ37は送られてきた信号が
上記A/D変換器21の出力信号wnの振幅を越えていた場合
にこれを演算によって制限するもので、その出力は信号
xnとしてセグメントドライバ27(図示せず)に送られる
と共に、1フレーム遅延回路38、乗算器39にも送られ
る。乗算器39は入力された信号xnを(1−K)倍し、そ
の乗算結果を加算器40に出力する。加算器40は後述する
乗算器42からの信号と乗算器39からの信号とを加算し、
その加算結果である信号ynを1フレーム遅延回路41に送
出する。1フレーム遅延回路41で1フレーム分遅延され
てyn-1となった信号は乗算器42でK倍された後、上記加
算器40及び減算器35の−入力側に出力される。上記1フ
レーム遅延回路38は、信号xnを1フレーム分遅延させ、
信号xn-1として動き検出回路34に出力する。動き検出回
路34は、1フレーム分の時差を有する2つの信号wn,x
n-1の差からその画素が動画領域にあるか、静止画領域
にあるかを判断し、その判断結果に応じて上記乗算器3
6、乗算器39及び乗算器42に定数Kを出力する。
In the figure, the digital signal w n sent from the A / D converter 21 (not shown) is sent to the motion detection circuit 34 and the subtractor 35. The subtraction result of the subtraction destination 35 is sent to the multiplier 36,
The multiplier 36 multiplies the received signal by 1 / (1-K) and outputs it to the limiter 37. The limiter 37 limits the calculated signal when the sent signal exceeds the amplitude of the output signal w n of the A / D converter 21, and its output is the signal.
It is sent to the segment driver 27 (not shown) as x n , and is also sent to the 1-frame delay circuit 38 and the multiplier 39. The multiplier 39 multiplies the input signal x n by (1−K) and outputs the multiplication result to the adder 40. The adder 40 adds the signal from the multiplier 42 described later and the signal from the multiplier 39,
The signal y n which is the addition result is sent to the 1-frame delay circuit 41. The signal delayed by one frame in the one-frame delay circuit 41 to become y n-1 is multiplied by K in the multiplier 42, and then output to the-input side of the adder 40 and the subtractor 35. The 1-frame delay circuit 38 delays the signal x n by 1 frame,
It is output to the motion detection circuit 34 as a signal x n-1 . The motion detection circuit 34 uses two signals w n and x having a time difference of 1 frame.
It is determined from the difference of n-1 whether the pixel is in the moving image area or the still image area, and the multiplier 3 is used according to the determination result.
6. The constant K is output to the multiplier 39 and the multiplier 42.

この回路の動作も上記第2図に示したものと同様であ
り、動き検出回路32はハイパスフィルタ的な周波数特性
を有し、周波数が高くなるにつれて強調の度合いも大き
くなる。したがって、第1図の動き検出回路31に比し
て、より顕著に動き(すなわち画像の変化)を検出する
ことができる [発明の効果] 以上詳記した如くこの発明によれば、動きの少ない静
止画領域と動きの多い動画領域とを判別し、動画領域に
のみ、時間方向の画像変化を強調する信号処理を施すよ
うにしたので、必要な画像領域のみ応答速度を向上さ
せ、残像及びノイズの発生が少ない液晶駆動装置を提供
することができる。
The operation of this circuit is similar to that shown in FIG. 2, and the motion detection circuit 32 has a high-pass filter-like frequency characteristic, and the degree of emphasis increases as the frequency increases. Therefore, it is possible to detect the motion (that is, the change in the image) more remarkably than the motion detection circuit 31 of FIG. 1 [Effect of the invention] As described above in detail, according to the present invention, the motion is small. The still image area and the moving image area with a lot of movement are discriminated, and the signal processing that emphasizes the image change in the time direction is applied only to the moving image area. It is possible to provide a liquid crystal driving device in which the occurrence of

【図面の簡単な説明】[Brief description of drawings]

第1図乃至第4図はこの発明の実施例を示すもので、第
1図は一実施例の回路構成を示すブロック図、第2図は
他の構成例を示すブロック図、第3図は第2図の周波数
特性を示す図、第4図は他の構成例を示すブロック図、
第5図及び第6図は従来の液晶駆動装置の回路構成を示
すブロック図である。 11,28……液晶表示パネル、12,27……セグメントドライ
バ、13,29……コモンドライバ、14,21……A/D変換器、1
5,30……タイミング信号発生回路、22,33,38,41……1
フレーム遅延回路、23,35……減算器、24,25,36,39,42
……乗算器、26,37……リミッタ、31,32,34……動き検
出回路、40……加算器。
1 to 4 show an embodiment of the present invention. FIG. 1 is a block diagram showing a circuit configuration of one embodiment, FIG. 2 is a block diagram showing another configuration example, and FIG. The figure which shows the frequency characteristic of FIG. 2, FIG. 4 is the block diagram which shows another structural example,
5 and 6 are block diagrams showing a circuit configuration of a conventional liquid crystal driving device. 11,28 …… Liquid crystal display panel, 12,27 …… Segment driver, 13,29 …… Common driver, 14,21 …… A / D converter, 1
5,30 …… Timing signal generator, 22,33,38,41 …… 1
Frame delay circuit, 23,35 ... Subtractor, 24,25,36,39,42
…… Multiplier, 26,37 …… Limiter, 31,32,34 …… Motion detection circuit, 40 …… Adder.

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】累積応答性を有する液晶表示パネルに映像
信号を表示するための液晶駆動装置において、 映像信号Wn(nはフレーム)を出力する映像信号出力手
段と、 液晶表示パネルの伝達関数 H(z)=(1−K)/(1−KZ-1) (Kは定数) とは逆特性の伝達関数 X(z)=(1−KZ-1)W(z)/(1−K) で上記映像信号Wnを演算処理する演算手段と、 映像信号WnとWn-1とを比較し、その差の大きさに応じて
上記定数Kを設定する設定手段と、 上記演算処理された映像信号Xnに基づいて液晶表示パネ
ルに表示を行なう駆動手段と を具備したことを特徴とする液晶駆動装置。
1. A liquid crystal driving device for displaying a video signal on a liquid crystal display panel having a cumulative response, a video signal output means for outputting a video signal W n (n is a frame), and a transfer function of the liquid crystal display panel. H (z) = (1−K) / (1−KZ −1 ) (K is a constant) and a transfer function having an inverse characteristic X (z) = (1−KZ −1 ) W (z) / (1− calculating means for processing the video signal W n in K), compared with the video signal W n and W n-1, and setting means for setting the constant K in accordance with the magnitude of the difference, the operation A liquid crystal drive device comprising: a drive unit that displays on a liquid crystal display panel based on the processed video signal X n .
【請求項2】映像信号Wn(nはフレーム)を1フレーム
分遅延して出力する第1の遅延手段と、 この遅延手段より出力される映像信号Wn-1に対して定数
Kを乗ずる第1の乗算手段と、 上記映像信号Wnから上記第1の乗算手段の出力する映像
信号KWn-1を減ずる減算手段と、 この減算手段の出力する映像信号「Wn−KWn-1」に対し
て定数Kを用いた乗数「1/(1−K)」を乗ずる第2の
乗算手段と、 この第2の乗算手段の出力する映像信号「(Wn−K
Wn-1)/(1−K)」の振幅制限を行なう制限手段と、 この制限手段より出力される映像信号xnを1フレーム分
遅延して出力する第2の遅延手段と、 この第2の遅延手段より出力される映像信号xn-1と上記
映像信号Wnとを比較し、その差の大きさに応じて上記定
数Kを設定する動き検出手段と、 上記制限手段より出力される映像信号xnに基づいて液晶
表示パネルに表示を行なう駆動手段と を具備したことを特徴とする液晶駆動装置。
2. A first delay means for delaying and outputting a video signal W n (n is a frame) by one frame, and a video signal W n-1 output from this delay means is multiplied by a constant K. A first multiplication means, a subtraction means for subtracting the video signal KW n-1 output from the first multiplication means from the video signal W n, and a video signal “W n −KW n-1 ” output from the subtraction means. Is multiplied by a multiplier "1 / (1-K)" using a constant K, and a video signal "(W n -K
W n-1 ) / (1-K) ”amplitude limiting means, second delay means for delaying the video signal x n output from this limiting means by one frame, and outputting the delayed signal. The video signal x n-1 output from the second delay means is compared with the video signal W n, and the motion detection means sets the constant K in accordance with the magnitude of the difference, and the output from the limiting means. And a drive means for displaying on the liquid crystal display panel based on the video signal x n .
【請求項3】映像信号Wn(nはフレーム)から、映像信
号Kyn-1を減ずる第1の減算手段と、 この第1の減算手段の出力する映像信号「Wn−Kyn-1
に対して定数Kを用いた乗算「1/(1−K)」を乗ずる
第1の乗算手段と、 この第1の乗算手段の出力する映像信号「Wn−Kyn-1
/(1−K)」の振幅制限を行なう制限手段と、 この制限手段より出力される映像信号xnに対して定数K
を用いた乗数「1−K」を乗ずる第2の乗算手段と、 この第2の乗算手段の出力する映像信号「(1−K)
xn」と映像信号Kyn-1とを加算する加算手段と、 この加算手段より出力される映像信号ynを1フレーム分
遅延して出力する第1の遅延手段と、 この第1の遅延手段より出力される映像信号yn-1に対し
て定数Kを乗じ、その積出力である映像信号Kyn-1を上
記第1の加算手段及び加算出力に出力する上記第2の乗
算手段と、 上記制限手段より出力される映像信号xnを1フレーム分
遅延して出力する第2の遅延手段と、 この第2の遅延手段より出力される映像信号xn-1と上記
映像信号Wnとを比較し、その差の大きさに応じて上記定
数Kを設定する動き検出手段と、 上記制限手段より出力される映像信号xnに基づいて液晶
表示パネルに表示を行なう駆動手段と を具備したことを特徴とする液晶駆動装置。
3. A first subtracting means for subtracting the video signal Ky n-1 from the video signal W n (n is a frame), and a video signal "W n -Ky n-1 " output by the first subtracting means. "
Multiplication with the constant K with respect to "1 / (1-K)" and the first multiplying means for multiplying the video signal "W n -Ky n-1 output from the first multiplying means)
/ (1-K) "limiting means for limiting the amplitude and a constant K for the video signal x n output from the limiting means.
And a video signal "(1-K)" output from the second multiplication means.
adding means for adding the video signal Ky n-1 and x n ", a first delay means for outputting a video signal y n to be outputted from the adding means with a delay of one frame, the first delay A second multiplication means for multiplying the video signal y n-1 output from the means by a constant K, and outputting a video signal Ky n-1 which is the product output to the first addition means and the addition output. Second delay means for delaying and outputting the video signal x n output from the limiting means by one frame, and the video signal x n-1 output from the second delay means and the video signal W n And a driving means for displaying on the liquid crystal display panel based on the video signal x n output from the limiting means. A liquid crystal drive device characterized by the above.
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JPS63184486A (en) * 1987-01-26 1988-07-29 Nec Home Electronics Ltd Cyclic type noise reducing device

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