JPH088653B2 - Digital image processor - Google Patents
Digital image processorInfo
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- JPH088653B2 JPH088653B2 JP61129624A JP12962486A JPH088653B2 JP H088653 B2 JPH088653 B2 JP H088653B2 JP 61129624 A JP61129624 A JP 61129624A JP 12962486 A JP12962486 A JP 12962486A JP H088653 B2 JPH088653 B2 JP H088653B2
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Landscapes
- Picture Signal Circuits (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は非常に暗い被写体を高感度撮像管を使用した
カメラで撮ったテレビ信号をデジタル画像処理をして画
質を改善するデジタル画像処理装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Industrial application] The present invention relates to a digital image processing apparatus for improving the image quality by digitally image-processing a television signal taken by a camera using a high-sensitivity image pickup tube for a very dark subject. Regarding
非常に暗い被写体を撮るために、撮像部として高感度
撮像管であるSIT（Siricon Intensifier Target）管を
使用したカメラや、あるいはCCDカメラにII（Image Int
ensifier）を付加して使用していた。To capture a very dark subject, a camera using a SIT (Siricon Intensifier Target) tube, which is a high-sensitivity image pickup tube, or a CCD camera II (Image Int.
ensifier) was used.
IIやSITを使用して高感度化したカメラは、SITやIIが
発生する余計なノイズが加わり画面がざらついてしま
う、また例えば夜空を撮影した場合、一様に暗いはずの
夜空の部分がSITやIIが発生する暗電流などの余分な信
号によって、一様にならなくなってしまう。A camera with high sensitivity using II or SIT will add extra noise generated by SIT or II, and the screen will be rough. The extra signals such as the dark current generated by I and II will not be uniform.
本発明は、テレビカメラからの映像信号をデジタル信
号に変換するA/D変換回路と、A/D変換されたデータを１
−Ｋ倍する（１−Ｋ）倍回路と、２つの入力信号を加算
する加算回路と、加算回路出力を１フレームディレイす
る１フレームディレイ回路と、前記加算回路出力を受け
る１フレームメモリまたはディレイする１フレームメモ
リと、前記１フレームディレイと１フレームメモリのデ
ータを引算する引算回路と、前記引算回路出力をD/A変
換するD/A変換回路を有し、一方前記１フレームディレ
イ回路出力をＫ倍するＫ倍回路を有し、前記加算回路の
２つの入力信号として前記（１−Ｋ）倍回路の出力と前
記Ｋ倍回路の出力が入力されるように構成され前記１フ
レームメモリ回路に、前記テレビカメラのアイリスを閉
め固定パターンノイズのみを入力し、ランダムノイズを
取り除いた信号を記憶し、前記テレビカメラのアイリス
を開き映像信号を入力することにより、映像信号のラン
ダムノイズと固定パターンノイズを取り除き画質を改善
する。The present invention relates to an A / D conversion circuit that converts a video signal from a television camera into a digital signal, and A / D converted data
A (1-K) multiplication circuit that multiplies by -K, an addition circuit that adds two input signals, a one-frame delay circuit that delays the output of the addition circuit by one frame, and a one-frame memory that receives the output of the addition circuit or delays the same. A 1-frame memory, a subtraction circuit for subtracting the 1-frame delay and the data of the 1-frame memory, and a D / A conversion circuit for D / A converting the output of the subtraction circuit, while the 1-frame delay circuit The one-frame memory having a K-fold circuit for multiplying the output by K, and configured to receive the output of the (1-K) -fold circuit and the output of the K-fold circuit as two input signals of the adder circuit. In the circuit, close the iris of the TV camera, input only fixed pattern noise, memorize the signal with random noise removed, open the iris of the TV camera and input the video signal By Rukoto, improving image quality by removing random noise and fixed pattern noise of the image signal.
次に、本発明について図面を参照して説明する。第１
図は本発明の一実施例の系統図である。テレビカメラの
アイリスを閉め光入射をカットし固定パターンのみを出
力し、入力信号端子１に入力し、A/D変換回路２でデジ
タル信号に変換され（１−Ｋ）倍回路３で、１−Ｋ倍
（Ｋ＜１）される、加算回路４では、１フレームディレ
イ回路５の出力をＫ倍回路７でＫ倍した信号と（１−
Ｋ）倍回路出力を加算し、１フレームディレイ回路５に
入力することにより、ランダムノイズを取り除き、ラン
ダムノイズを取り除かれた固定パターンを加算回路４の
出力より１フレームメモリ６に記憶する。その後にテレ
ビカメラのアイリスを開き、テレビカメラからの映像信
号を、入力信号端子１に入力し、A/D変換回路２でデジ
タル信号に変換され（１−Ｋ）倍回路で、１−Ｋ倍（Ｋ
＜１）される。加算回路４では、１フレームディレイ回
路５の出力をＫ倍回路７でＫ倍した信号と（１−Ｋ）倍
回路出力を加算し１フレームディレイ回路に入力するこ
とにより、映像信号のランダムノイズを取り除き、ラン
ダムノイズが取り除かれた１フレームディレイ回路の出
力から１フレームメモリ６に記憶されている固定パター
ンを引算回路８で引算して、D/A変換回路６でD/A変換さ
れ出力端子７に出力する。Next, the present invention will be described with reference to the drawings. First
FIG. 1 is a system diagram of an embodiment of the present invention. Close the iris of the TV camera to cut off the light incident and output only the fixed pattern, input it to the input signal terminal 1, converted into a digital signal by the A / D conversion circuit 2, and (1-K) multiplication circuit 3 In the adding circuit 4, which is multiplied by K (K <1), the output of the one-frame delay circuit 5 is multiplied by K in the K multiplying circuit 7 and (1-
K) Random noise is removed by adding the output of the multiplying circuit and inputting it to the 1-frame delay circuit 5, and the fixed pattern from which the random noise is removed is stored in the 1-frame memory 6 from the output of the adding circuit 4. After that, open the iris of the TV camera, input the video signal from the TV camera to the input signal terminal 1 and convert it into a digital signal by the A / D conversion circuit 2 (1-K times) circuit, 1-K times (K
<1) is done. In the adder circuit 4, a signal obtained by multiplying the output of the 1-frame delay circuit 5 by K by the K-multiplier circuit 7 and the output of the (1-K) -multiplier circuit are added and input to the 1-frame delay circuit, whereby random noise of the video signal is eliminated. The subtraction circuit 8 subtracts the fixed pattern stored in the 1-frame memory 6 from the output of the 1-frame delay circuit from which the random noise has been removed, and the D / A conversion circuit 6 outputs the fixed pattern. Output to terminal 7.
この時の、ランダムノイズのS/N改善度は 10LOG（（１＋Ｋ）／（１−Ｋ））〔dB〕 となる。 At this time, the S / N improvement degree of random noise is 10LOG ((1 + K) / (1-K)) [dB].
以上は固定パターンの取込みにあたってノイズリジュ
ーサと呼ばれる方法によって行っているが、さらにS/N
改善をして取り込みために１−Ｋ倍回路の１−Ｋを小さ
くし、Ｋ倍回路のＫを１とし、積分することによりS/N
改善比を大きくして取り込む方法でも実現できる。The above is performed by a method called a noise reducer when capturing a fixed pattern.
In order to improve and capture, 1-K of 1-K times circuit is made small, K of K times circuit is set to 1, and S / N is obtained by integrating.
It can also be realized by increasing the improvement ratio and importing.
以上説明したように本発明は、テレビカメラのアイリ
スを閉め固定パターンのみを出力し、ランダムノイズを
取り除き１フレームメモリに記憶し、その後にテレビカ
メラのアイリスを開き、テレビカメラの映像信号を入力
し映像信号のランダムノイズを取り除き、フレームメモ
リに記憶されている固定パターンを引算することによ
り、ランダムノイズと固定パターンノイズが取り除か
れ、画質改善された動画の映像信号を得ることが出来
る。又、これでは、動きの速い映像信号では残像が生じ
るが、動き検知回路をもうけて、Ｋをコントロールする
ことにより改善することもできる。As described above, according to the present invention, the iris of the TV camera is closed and only the fixed pattern is output, random noise is removed and stored in one frame memory, after which the iris of the TV camera is opened and the video signal of the TV camera is input. By removing the random noise of the video signal and subtracting the fixed pattern stored in the frame memory, the random noise and the fixed pattern noise are removed, and a video signal of a moving image with improved image quality can be obtained. Further, in this case, afterimages occur in a fast-moving video signal, but this can be improved by providing a motion detection circuit and controlling K.
第１図は、本発明の一実施例である。 １……信号入力端子、２……A/D変換回路、３……（１
−Ｋ）倍回路、４……加算回路、５……１フレームディ
レイ回路、６……１フレームメモリ回路、７……Ｋ倍回
路、８……引算回路、９……D/A変換回路、10……出力
信号端子。FIG. 1 shows an embodiment of the present invention. 1 ... Signal input terminal, 2 ... A / D conversion circuit, 3 ... (1
-K) multiplication circuit, 4 ... addition circuit, 5 ... 1 frame delay circuit, 6 ... 1 frame memory circuit, 7 ... K multiplication circuit, 8 ... subtraction circuit, 9 ... D / A conversion circuit , 10 …… Output signal terminal.
フロントページの続き (56)参考文献 特開 昭62−245877（ＪＰ，Ａ) 特開 昭62−95074（ＪＰ，Ａ) 特開 昭61−101179（ＪＰ，Ａ) 特開 昭57−212876（ＪＰ，Ａ)Continuation of the front page (56) Reference JP 62-245877 (JP, A) JP 62-95074 (JP, A) JP 61-101179 (JP, A) JP 57-212876 (JP , A)
Claims (1)
像信号の画質を改善する装置において、テレビカメラか
らの映像信号をデジタル信号に変換するA/D変換回路
と、A/D変換されたデータを１−Ｋ倍する（１−Ｋ）倍
回路と、２つの入力信号を加算する加算回路と、加算回
路出力を１フレームディレイする１フレームディレイ回
路と、前記加算回路出力を受ける１フレームメモリと、
前記１フレームディレイ回路と１フレームメモリのデー
タを引算する引算回路と、前記引算回路出力をD/A変換
するD/A変換回路と、前記１フレームディレイ回路出力
をＫ倍するＫ倍回路とを有し、前記加算回路の２つの入
力信号として前記（１−Ｋ）倍回路の出力と前記Ｋ倍回
路の出力が入力されるように構成され、前記テレビカメ
ラのアイリスを閉め、ランダムノイズを取り除いた固定
パターンノイズのみを前記１フレームメモリに入力して
記憶し、前記テレビカメラのアイリスを開き、ランダム
ノイズを取り除いた映像信号を１フレームディレイ回路
の出力に得、１フレームディレイ回路出力の映像信号と
前記１フレームメモリに記憶したデータとを引算回路で
引算することにより、映像信号のランダムノイズと固定
パターンノイズを取り除き画質を改善することを特徴と
するデジタル画像処理装置。1. An apparatus for improving the image quality of a video signal from a TV camera for photographing a dark place, an A / D conversion circuit for converting a video signal from the TV camera into a digital signal, and A / D converted data. A 1-K multiple circuit, an adder circuit that adds two input signals, a one-frame delay circuit that delays the output of the adder circuit by one frame, and a one-frame memory that receives the output of the adder circuit. ,
A subtraction circuit for subtracting the data of the 1-frame delay circuit and the 1-frame memory, a D / A conversion circuit for D / A converting the subtraction circuit output, and a K-fold for multiplying the 1-frame delay circuit output by K. A circuit configured to receive the output of the (1-K) times circuit and the output of the K times circuit as two input signals of the adder circuit, close the iris of the television camera, and randomly Only fixed pattern noise from which noise has been removed is input and stored in the 1-frame memory, the iris of the TV camera is opened, and the video signal from which random noise has been removed is obtained at the output of the 1-frame delay circuit. 1-frame delay circuit output Random noise and fixed pattern noise of the video signal are removed by subtracting the video signal of Digital image processing apparatus characterized by improving can quality.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61129624A JPH088653B2 (en) | 1986-06-03 | 1986-06-03 | Digital image processor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61129624A JPH088653B2 (en) | 1986-06-03 | 1986-06-03 | Digital image processor |
Publications (2)
| Publication Number | Publication Date |
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| JPS62285584A JPS62285584A (en) | 1987-12-11 |
| JPH088653B2 true JPH088653B2 (en) | 1996-01-29 |
Family
ID=15014082
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
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| JP61129624A Expired - Lifetime JPH088653B2 (en) | 1986-06-03 | 1986-06-03 | Digital image processor |
Country Status (1)
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| JP (1) | JPH088653B2 (en) |
Families Citing this family (4)
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|---|---|---|---|---|
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| DE3914575A1 (en) * | 1989-05-03 | 1990-11-08 | Bosch Gmbh Robert | IMAGE RECORDING DEVICE |
| JPH05103266A (en) * | 1991-10-04 | 1993-04-23 | Nec Corp | Tv camera device |
| JP3610115B2 (en) * | 1994-05-20 | 2005-01-12 | キヤノン株式会社 | Imaging device |
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1986
- 1986-06-03 JP JP61129624A patent/JPH088653B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
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| JPS62285584A (en) | 1987-12-11 |
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