JPH0854943A - Stabilized power supply circuit - Google Patents

Stabilized power supply circuit

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JPH0854943A
JPH0854943A JP19033694A JP19033694A JPH0854943A JP H0854943 A JPH0854943 A JP H0854943A JP 19033694 A JP19033694 A JP 19033694A JP 19033694 A JP19033694 A JP 19033694A JP H0854943 A JPH0854943 A JP H0854943A
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Abstract

PURPOSE:To compose the low-pass filter for phase compensation of a feedback loop for current limiting without an exterior capacitor. CONSTITUTION:An FETQ 8 is provided between the collector of a transistor Q4 for excess current detection and a resistance R3 for current voltage conversion. Between the resistance R3 and the base of the differential FET Q5 of an error amplifier for excess current time, an FET Q9 composing the FET Q8 and a current mirror circuit is provided. Because the on-resistance of the FET Q9 is incommensurably larger than the resistance R3, the cut-off frequency of a low-pass filter for phase compensation becomes the product of the on- resistance of the FET Q9 and the capacitance of a capacitor C. As compared with a case where the cut-off frequency is determined by the resistance R3 and the capacitor C, the capacitor C becomes smaller and it becomes possible to be incoporated in a regulated power supply circuit IC. Because the FET Q8 and Q9 compose the current mirror circuit, the dispersion of the threshold voltage of the FET Q9 can be absorbed.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、電流制限機能を有する
安定化電源回路に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a stabilized power supply circuit having a current limiting function.

【0002】[0002]

【従来の技術】図3には、第1従来例に係る安定化電源
回路の構成が示されている。この従来例は、トランジス
タQ1 及びQ2 並びに定電流源1〜3から構成される第
1のエラーアンプを備えている。トランジスタQ3 のコ
レクタから出力される出力電圧Vo は、抵抗R1 及びR
2 から構成されるブリーダにより分圧され第1のエラー
アンプのトランジスタQ2 のベースに帰還される。トラ
ンジスタQ2 と差動関係にあるトランジスタQ1 のベー
スにはリファレンス電圧Vref が印加されているため、
トランジスタQ2 のコレクタにはVref に対するVo ・
R2 /(R1 +R2 )の誤差に相当する電圧が現れる。
この従来例では、この電圧をトランジスタQ3 のベース
に印加して、安定化した出力電圧Vo を得ている。
2. Description of the Related Art FIG. 3 shows the configuration of a stabilized power supply circuit according to a first conventional example. This conventional example includes a first error amplifier including transistors Q1 and Q2 and constant current sources 1 to 3. The output voltage Vo output from the collector of the transistor Q3 is the resistance R1 and R
It is divided by a bleeder composed of 2 and fed back to the base of the transistor Q2 of the first error amplifier. Since the reference voltage Vref is applied to the base of the transistor Q1 which has a differential relationship with the transistor Q2,
The collector of the transistor Q2 has Vo for Vref
A voltage corresponding to the error of R2 / (R1 + R2) appears.
In this conventional example, this voltage is applied to the base of the transistor Q3 to obtain a stabilized output voltage Vo.

【0003】この従来例は、トランジスタQ3 のコレク
タ電流(出力電流)Io が過電流となった場合に図4に
示されるような垂下特性にて電流制限を施す機能を有し
ている。出力電流Io の過電流状態は、安定化出力電圧
Vo により駆動される回路の側で地絡事故が発生した場
合に生じる。例えば、あるICを安定化電源回路にて駆
動する場合に、このICが搭載されているプリント基板
上の電源配線にグラウンドとの短絡箇所があると、出力
電圧Vo が低下し出力電流Io が増大する。このような
状態が発生すると顕著な場合トランジスタQ3 が破壊す
る。図3に設けられている回路のうち、トランジスタQ
4 、抵抗R3 、コンデンサC及びトランジスタQ5 から
構成されるループは、このような事態から安定化電源回
路、特に出力トランジスタQ3 を保護するための回路で
ある。
This conventional example has a function of limiting the current with a drooping characteristic as shown in FIG. 4 when the collector current (output current) Io of the transistor Q3 becomes an overcurrent. The overcurrent state of the output current Io occurs when a ground fault occurs on the side of the circuit driven by the stabilized output voltage Vo. For example, when a certain IC is driven by a stabilized power supply circuit, if there is a short-circuit point with the ground in the power supply wiring on the printed circuit board on which this IC is mounted, the output voltage Vo decreases and the output current Io increases. To do. When such a situation occurs, the transistor Q3 will be destroyed if it is noticeable. Of the circuits provided in FIG. 3, the transistor Q
The loop composed of 4, the resistor R3, the capacitor C and the transistor Q5 is a circuit for protecting the stabilized power supply circuit, particularly the output transistor Q3, from such a situation.

【0004】まず、トランジスタQ3 及びQ4 は電流ミ
ラー回路を構成しており、トランジスタQ4 のコレクタ
には出力電流Io ×ミラー比Xの電流が流れる。抵抗R
3 はトランジスタQ4 のコレクタ電流を電圧に変換す
る。抵抗R3 による電圧降下分はトランジスタQ5 のベ
ースに印加される。トランジスタQ5 は、トランジスタ
Q1 及び定電流源1〜3と共に、第2のエラーアンプを
構成している。トランジスタQ5 のコレクタにはVref
に対するIo ・X・R3 の誤差に相当する電圧が現れ
る。この電圧はトランジスタQ3 のベースに印加され
る。
First, the transistors Q3 and Q4 form a current mirror circuit, and a current of output current Io × mirror ratio X flows through the collector of the transistor Q4. Resistance R
3 converts the collector current of the transistor Q4 into a voltage. The voltage drop due to the resistor R3 is applied to the base of the transistor Q5. The transistor Q5 constitutes a second error amplifier together with the transistor Q1 and the constant current sources 1 to 3. Vref is applied to the collector of the transistor Q5.
A voltage corresponding to the error of Io.X.R3 with respect to appears. This voltage is applied to the base of transistor Q3.

【0005】第2のエラーアンプが動作するのは、出力
電流Io が過電流となったときである。すなわち、出力
電流Io が制限値より小さい間(正常である間)はトラ
ンジスタQ5 のベース電圧はトランジスタQ2 のベース
電圧より低いから、トランジスタQ2 がオン、トランジ
スタQ5 がオフ状態であり、第1のエラーアンプが動作
する。出力電流Io が増大していき制限値に至ると、ト
ランジスタQ5 のベース電圧がトランジスタQ2 のベー
ス電圧より高くなり、トランジスタQ2 がオフ、トラン
ジスタQ5 がオンする。これにより第2のエラーアンプ
が動作する。第2のエラーアンプが動作している状態で
は、出力電圧Vo にかかわらず出力電流Io が一定値に
維持されるようトランジスタQ3 が駆動されるから、図
4に示されるような垂下特性による電流制限が実現され
る。
The second error amplifier operates when the output current Io becomes an overcurrent. That is, while the output current Io is smaller than the limit value (while normal), the base voltage of the transistor Q5 is lower than the base voltage of the transistor Q2, so that the transistor Q2 is on and the transistor Q5 is off. The amplifier works. When the output current Io increases and reaches the limit value, the base voltage of the transistor Q5 becomes higher than that of the transistor Q2, the transistor Q2 is turned off and the transistor Q5 is turned on. As a result, the second error amplifier operates. In the state where the second error amplifier is operating, the transistor Q3 is driven so that the output current Io is maintained at a constant value regardless of the output voltage Vo. Therefore, the current limit due to the drooping characteristic shown in FIG. Is realized.

【0006】図5には、第2従来例に係る安定化電源回
路の構成が示されている。この従来例は、第1従来例の
回路に、トランジスタQ6 及びQ7 から構成される電流
ミラー回路並びに抵抗R4 を付加した構成である。出力
電流Io が制限値より小さな間は第1従来例と同様の第
1のエラーアンプが動作する。出力電流Io が増大して
いき制限値に至ると、第1従来例と同様、トランジスタ
Q4 のコレクタ電流が抵抗R3 により電圧に変換され、
抵抗R3 による電圧降下分がトランジスタQ5のベース
に印加される。従って、第1従来例と同様、第2のエラ
ーアンプが動作する。
FIG. 5 shows the configuration of a stabilized power supply circuit according to the second conventional example. This conventional example has a configuration in which a current mirror circuit composed of transistors Q6 and Q7 and a resistor R4 are added to the circuit of the first conventional example. While the output current Io is smaller than the limit value, the first error amplifier similar to the first conventional example operates. When the output current Io increases and reaches the limit value, the collector current of the transistor Q4 is converted into a voltage by the resistor R3, as in the first conventional example.
The voltage drop due to the resistor R3 is applied to the base of the transistor Q5. Therefore, as in the first conventional example, the second error amplifier operates.

【0007】但し、この従来例では、トランジスタQ4
のコレクタ電流は、出力電流Io やトランジスタQ3 及
びQ4 から構成される電流ミラー回路のミラー比Xのみ
では決まらない。すなわち、抵抗R4 に流れる電流(出
力電圧Vo に対応する)によっても制限を受ける。従っ
て、この従来例における制限値Ilimit は次の値とな
る。この式の右辺第1項は、トランジスタQ3 及びQ4
から構成される電流ミラー回路に関連する項であり、出
力電圧Vo が0となる時点の出力電流Io 、すなわちシ
ョート時電流Ishort を表している。第2項は、トラン
ジスタQ6 及びQ7 から構成される電流ミラー回路に関
連する項である。従って、電流制限特性は図6に示され
るような「フ」の字特性となる。但し、VBEはトランジ
スタQ6 のベースエミッタ間電圧である。
However, in this conventional example, the transistor Q4
The collector current of is not determined only by the output current Io and the mirror ratio X of the current mirror circuit composed of the transistors Q3 and Q4. That is, it is also limited by the current flowing through the resistor R4 (corresponding to the output voltage Vo). Therefore, the limit value Ilimit in this conventional example is as follows. The first term on the right side of this equation is the transistors Q3 and Q4.
Is a term related to the current mirror circuit composed of, and represents the output current Io at the time when the output voltage Vo becomes 0, that is, the short-time current Ishort. The second term is related to the current mirror circuit composed of the transistors Q6 and Q7. Therefore, the current limiting characteristic is a "F" -shaped characteristic as shown in FIG. However, VBE is the base-emitter voltage of the transistor Q6.

【0008】[0008]

【数1】Ilimit =Vref /R3 ・X+(Vo −VBE)
/R4 ・X
## EQU1 ## Ilimit = Vref / R3.X + (Vo-VBE)
/ R4 ・ X

【0009】[0009]

【発明が解決しようとする課題】これらの従来例には、
いずれも、コンデンサCが大容量であり、IC化した場
合にこれを外付けせざるを得ず部品点数が多くなる、と
いう問題がある。
These conventional examples include the following:
In both cases, the capacitor C has a large capacity, and when it is made into an IC, it has to be externally attached, and the number of parts increases, which is a problem.

【0010】まず、第1従来例において、数MHzまで
延びているゲイン周波数特性を数十〜数百Hzまで落と
し安定化電源回路の出力から高周波成分を除去するため
には、トランジスタQ3 のコレクタとグラウンドの間に
数十μFのコンデンサを設けると共に、出力トランジス
タQ4 から抵抗R3 を経てトランジスタQ5 に至る帰還
ループに位相補償用のローパスフィルタを設けなければ
ならない。トランジスタQ3 とトランジスタQ4 から構
成される電流ミラー回路のミラー比Xを1000とした
場合、抵抗R3 と共にローパスフィルタを構成するコン
デンサCは数万pF程度の大きな静電容量となるから、
IC内で構成するのは困難である。
First, in the first conventional example, in order to remove the high frequency component from the output of the stabilized power supply circuit by reducing the gain frequency characteristic extending up to several MHz to several tens to several hundreds Hz, the collector of the transistor Q3 is used. It is necessary to provide a capacitor of several tens of μF between the ground and a low-pass filter for phase compensation in the feedback loop from the output transistor Q4 through the resistor R3 to the transistor Q5. When the mirror ratio X of the current mirror circuit composed of the transistor Q3 and the transistor Q4 is 1000, the capacitor C that constitutes the low-pass filter together with the resistor R3 has a large electrostatic capacity of about tens of thousands of pF.
It is difficult to configure in the IC.

【0011】特に、第2従来例においては、トランジス
タQ5 がオフしている時点でもトランジスタQ3 からト
ランジスタQ6 、Q7 、抵抗R3 を経てトランジスタQ
5 に至る経路で正帰還が加わっているから、この意味で
も位相補償は必須である。抵抗R3 に流れる電流がμA
オーダーであるとすると抵抗R3 の値はkΩオーダーと
なり、コンデンサCはやはり数万pF程度の大きな静電
容量となるから、IC内で構成するのは困難である。
In particular, in the second conventional example, even when the transistor Q5 is off, the transistor Q3 passes through the transistors Q6, Q7 and the resistor R3, and then the transistor Q3.
Since positive feedback is added to the path up to 5, phase compensation is essential in this sense as well. The current flowing through the resistor R3 is μA
If it is on the order, the value of the resistor R3 is on the order of kΩ, and the capacitor C also has a large electrostatic capacity of about tens of thousands of pF, so that it is difficult to configure it in the IC.

【0012】本発明は、このような問題点を解決するこ
とを課題としてなされたものであり、電流制限用の帰還
ループに位相補償用のローパスフィルタを設ける際、こ
のローパスフィルタを能動素子を用いて構成することに
より、大きな静電容量を有する位相補償用コンデンサを
使用する必要をなくし、小形化、IC化に適した安定化
電源回路を実現することを目的とする。
The present invention has been made to solve the above problems, and when a low-pass filter for phase compensation is provided in a feedback loop for current limitation, an active element is used for this low-pass filter. This configuration eliminates the need to use a phase compensation capacitor having a large electrostatic capacity and realizes a stabilized power supply circuit suitable for downsizing and IC implementation.

【0013】[0013]

【課題を解決するための手段】このような目的を達成す
るために、本発明は、電流制限用の帰還ループが、検出
した出力電流を電圧に変換するための抵抗と出力電流の
高周波成分を除去するコンデンサの間に、少なくとも出
力トランジスタの出力電流が過剰となった場合にオンし
オン抵抗を挿入する能動素子を備えることを特徴とす
る。
In order to achieve such an object, the present invention provides a resistor for converting a detected output current into a voltage by a current limiting feedback loop and a high frequency component of the output current. An active element that turns on and inserts an on-resistance at least when the output current of the output transistor becomes excessive is provided between the capacitors to be removed.

【0014】本発明は、さらに、上記能動素子がFET
であることを特徴とする。本発明は、上記能動素子と共
に電流ミラー回路を構成し検出した出力電流に応じた値
の電流を上記能動素子に供給するFETを備えることを
特徴とする。本発明は、上記抵抗に流れる電流を出力電
圧に応じて制限する手段を備えることを特徴とする。
The present invention further provides that the active element is a FET.
Is characterized in that. The present invention is characterized by comprising a current mirror circuit together with the active element, and comprising an FET for supplying a current having a value corresponding to the detected output current to the active element. The present invention is characterized by including means for limiting the current flowing through the resistor according to the output voltage.

【0015】[0015]

【作用】本発明においては、検出した出力電流を電圧に
変換するための抵抗と出力電流の高周波成分を除去する
コンデンサの間に、オン抵抗を有する能動素子が挿入さ
れる。これにより、抵抗、コンデンサ及び能動素子から
構成されるローパスフィルタが、電流制限用の帰還ルー
プに挿入される。このローパスフィルタのカットオフ周
波数は、抵抗、コンデンサ及び能動素子のオン抵抗の値
により決定される。従って、抵抗及びコンデンサのみに
よってカットオフ周波数を決めていた構成に比べ、能動
素子のオン抵抗相当分、コンデンサの静電容量を小さく
できるため、少なくとも従来と同程度の電流制限性能及
び周波数特性を維持しながら、小形化、IC化に適した
安定化電源回路を実現することが可能になる。
In the present invention, the active element having the ON resistance is inserted between the resistor for converting the detected output current into the voltage and the capacitor for removing the high frequency component of the output current. As a result, the low-pass filter composed of the resistor, the capacitor and the active element is inserted in the feedback loop for current limitation. The cutoff frequency of this low-pass filter is determined by the values of the on resistances of the resistors, capacitors and active elements. Therefore, compared to the configuration in which the cutoff frequency is determined only by the resistance and the capacitor, the capacitance of the capacitor can be reduced by the ON resistance of the active element, so that at least the same current limiting performance and frequency characteristics as before can be maintained. However, it becomes possible to realize a stabilized power supply circuit suitable for miniaturization and IC implementation.

【0016】特に、上記能動素子としてFETを使用し
た場合、そのオン抵抗は非常に大きくなるため、コンデ
ンサの静電容量を非常に小さくでき、またカットオフ周
波数を設計するに当たって電流電圧変換用の抵抗の値を
無視できる。さらに、このFETに対し検出した出力電
流に応じた値の電流を供給するFETを、電流ミラー回
路を構成するよう設けることにより、ローパスフィルタ
を構成するFETのスレッショルド電圧のばらつきを吸
収できる。
In particular, when an FET is used as the active element, its on-resistance becomes very large, so that the electrostatic capacitance of the capacitor can be made very small, and the resistance for current-voltage conversion in designing the cutoff frequency. You can ignore the value of. Further, by providing an FET that supplies a current having a value corresponding to the detected output current to the FET so as to configure the current mirror circuit, it is possible to absorb variations in the threshold voltage of the FET that configures the low-pass filter.

【0017】そして、本発明の電流制限特性は、垂下特
性にも「フ」の字特性にもすることができる。「フ」の
字特性にする場合、電流電圧変換用の抵抗に流れる電流
を出力電圧に応じて制限するようにすればよい。
The current limiting characteristic of the present invention can be a drooping characteristic or a fold-back characteristic. In the case of the "F" -shaped characteristic, the current flowing through the resistance for current-voltage conversion may be limited according to the output voltage.

【0018】[0018]

【実施例】以下、本発明の好適な実施例について図面に
基づき説明する。なお、図3〜図6に示される従来例と
同様の構成には同一の符号を付し、説明を省略する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENT A preferred embodiment of the present invention will be described below with reference to the drawings. The same components as those of the conventional example shown in FIGS. 3 to 6 are designated by the same reference numerals and the description thereof will be omitted.

【0019】図1には本発明の第1実施例に係る安定化
電源回路の構成が、図2には第2実施例に係る安定化電
源回路の構成が、それぞれ示されている。第1実施例の
電流制限特性は垂下特性であり、第2実施例の電流制限
特性は「フ」の字特性である。これらの実施例は、第1
又は第2従来例にトランジスタQ8 及びQ9 を付加した
構成である。トランジスタQ8 及びQ9 は電流ミラー回
路を構成している。トランジスタQ5 としては、新たに
付加したトランジスタQ8 及びQ9 と同様、FETが用
いられている。
FIG. 1 shows the configuration of a stabilized power supply circuit according to the first embodiment of the present invention, and FIG. 2 shows the configuration of a stabilized power supply circuit according to the second embodiment. The current limiting characteristic of the first embodiment is a drooping characteristic, and the current limiting characteristic of the second embodiment is a fold-back characteristic. These examples are
Alternatively, it is a configuration in which transistors Q8 and Q9 are added to the second conventional example. The transistors Q8 and Q9 form a current mirror circuit. An FET is used as the transistor Q5, like the newly added transistors Q8 and Q9.

【0020】この実施例におけるトランジスタQ9 は抵
抗として使用されている。すなわち、トラジスタQ8 に
大きなドレイン電流が流れるとトランジスタQ9 にはミ
ラー比倍のドレイン電流が流れる。この状態、すなわち
トランジスタQ9 がオンしている状態では、トランジス
タQ9 のオン抵抗が、電流制限用の帰還ループ上の位相
補償用ローパスフィルタに挿入されることになる。ここ
に、トランジスタQ9としてFETを用いているため、
そのオン抵抗を数十MΩオーダーとすることができる。
この抵抗値は電流電圧変換用の抵抗R3 の値(数kΩオ
ーダー)に比べ十分大きいから、本実施例における位相
補償用ローパスフィルタのカットオフ周波数は、専ら、
トランジスタQ9 のオン抵抗とコンデンサCの静電容量
にて決定される。抵抗R3 に比べトランジスタQ9 のオ
ン抵抗は10000倍程度大きいから、抵抗R3 を単に
大きくした場合のようにトランジスタQ5 のベース電圧
の変化を招くことなく、コンデンサCの静電容量を従来
例の1/10000程度、すなわち数pF〜数十pFま
で小さくすることができる。この結果、コンデンサCを
安定化電源回路IC内に構成でき、外付け部品の点数が
減ってコストダウンを実現できる。
Transistor Q9 in this embodiment is used as a resistor. That is, when a large drain current flows through the transistor Q8, a drain current of the mirror ratio times the transistor Q9 flows. In this state, that is, when the transistor Q9 is on, the on-resistance of the transistor Q9 is inserted into the low-pass filter for phase compensation on the feedback loop for current limitation. Here, since FET is used as the transistor Q9,
The on-resistance can be on the order of tens of MΩ.
Since this resistance value is sufficiently larger than the value of the resistor R3 for current / voltage conversion (on the order of several kΩ), the cut-off frequency of the low-pass filter for phase compensation in this embodiment is exclusively
It is determined by the on-resistance of the transistor Q9 and the capacitance of the capacitor C. Since the on-resistance of the transistor Q9 is about 10,000 times larger than that of the resistor R3, the capacitance of the capacitor C can be reduced to 1 / th of that of the conventional example without causing a change in the base voltage of the transistor Q5 as in the case where the resistor R3 is simply increased. It can be reduced to about 10,000, that is, several pF to several tens of pF. As a result, the capacitor C can be configured in the stabilized power supply circuit IC, the number of external parts can be reduced, and the cost can be reduced.

【0021】さらに、トランジスタQ8 及びQ9 により
電流ミラー回路を構成しているため、次の式が成り立
ち、トランジスタQ9 のスレシュホールド電圧のばらつ
きによるオン抵抗のばらつきを吸収できる。
Further, since the current mirror circuit is constituted by the transistors Q8 and Q9, the following formula is established, and the variation of the ON resistance due to the variation of the threshold voltage of the transistor Q9 can be absorbed.

【0022】[0022]

【数2】L9 /W9 =Ron/{(2・L8 /W8 )・K
P ・ID }1/2 但し、L9 ,W9 :トランジスタQ9 の実効ゲート長及
び幅 L8 ,W8 :トランジスタQ8 の実効ゲート長及び幅 Ron:トランジスタQ9 のオン抵抗 KP :トランジスタQ8 及びQ9 のトランスコンダクタ
ンス ID :トランジスタQ8 のドレイン電流 なお、トランジスタQ5 をFETとしているのは、バイ
ポーラとするとオフセットが著しくなるためである。ま
た、各バイポーラトランジスタの極性は、設計的にPN
P又はNPNとすることができ、各バイポーラトランジ
スタをFETに置き換えることもできる。
[Equation 2] L9 / W9 = Ron / {(2.L8 / W8) .K
P · ID} 1/2 where L9, W9: effective gate length and width of transistor Q9 L8, W8: effective gate length and width of transistor Q8 Ron: on-resistance of transistor Q9 KP: transconductance of transistors Q8 and Q9 : The drain current of the transistor Q8 The reason why the transistor Q5 is an FET is that the offset becomes significant when it is a bipolar transistor. In addition, the polarity of each bipolar transistor is PN by design.
It can be P or NPN and each bipolar transistor can be replaced by a FET.

【0023】[0023]

【発明の効果】以上説明したように、本発明によれば、
検出した出力電流を電圧に変換するための抵抗と出力電
流の高周波成分を除去するコンデンサの間に、オン抵抗
を有する能動素子を挿入し、抵抗、コンデンサ及び能動
素子から構成されるローパスフィルタを電流制限用の帰
還ループに挿入するようにしたため、従来と同様の電流
制限特性及び周波数特性を少なくとも維持しながらコン
デンサの静電容量を小さくでき、小形化、IC化に適し
た安定化電源回路を実現できる。
As described above, according to the present invention,
An active element having an on-resistance is inserted between the resistor for converting the detected output current to a voltage and the capacitor for removing the high frequency component of the output current, and the low-pass filter composed of the resistor, the capacitor and the active element is used as the current. Since it is inserted into the feedback loop for limiting, the capacitance of the capacitor can be reduced while maintaining at least the current limiting characteristics and frequency characteristics similar to the conventional one, realizing a stabilized power supply circuit suitable for miniaturization and IC integration. it can.

【0024】特に、上記能動素子としてFETを使用し
た場合、そのオン抵抗は非常に大きくなるため、コンデ
ンサの静電容量を非常に小さくでき、またカットオフ周
波数を設計するに当たって電流電圧変換用の抵抗の値を
無視できる。さらに、このFETに対し検出した出力電
流に応じた値の電流を供給するFETを、電流ミラー回
路を構成するよう設けることにより、ローパスフィルタ
を構成するFETのスレショルド電圧のばらつきを吸収
できる。そして、本発明の電流制限特性は、垂下特性に
も「フ」の字特性にもすることができる。
In particular, when an FET is used as the active element, its on-resistance becomes very large, so that the electrostatic capacitance of the capacitor can be made extremely small, and the resistance for current-voltage conversion in designing the cutoff frequency. You can ignore the value of. Further, by providing an FET that supplies a current having a value corresponding to the detected output current to the FET so as to configure the current mirror circuit, it is possible to absorb variations in the threshold voltage of the FET that configures the low-pass filter. Further, the current limiting characteristic of the present invention can be a drooping characteristic or a fold-back characteristic.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の第1実施例に係る安定化電源回路の構
成を示す回路図である。
FIG. 1 is a circuit diagram showing a configuration of a stabilized power supply circuit according to a first embodiment of the present invention.

【図2】本発明の第2実施例に係る安定化電源回路の構
成を示す回路図である。
FIG. 2 is a circuit diagram showing a configuration of a stabilized power supply circuit according to a second embodiment of the present invention.

【図3】第1従来例に係る安定化電源回路の構成を示す
回路図である。
FIG. 3 is a circuit diagram showing a configuration of a stabilized power supply circuit according to a first conventional example.

【図4】第1従来例の電流制限特性を示す図である。FIG. 4 is a diagram showing a current limiting characteristic of a first conventional example.

【図5】第2従来例に係る安定化電源回路の構成を示す
回路図である。
FIG. 5 is a circuit diagram showing a configuration of a stabilized power supply circuit according to a second conventional example.

【図6】第1従来例の電流制限特性を示す図である。FIG. 6 is a diagram showing a current limiting characteristic of a first conventional example.

【符号の説明】[Explanation of symbols]

Vcc 電源電圧 Vref リファレンス電圧 Vo 出力電圧 Io 出力電流 1〜3 定電流源 Q1 〜Q9 トランジスタ R1 〜R4 抵抗 C コンデンサ Vcc Power supply voltage Vref Reference voltage Vo Output voltage Io Output current 1-3 Constant current source Q1-Q9 Transistor R1-R4 Resistor C Capacitor

Claims (5)

【特許請求の範囲】[Claims] 【請求項1】 安定化された出力電圧を外部に出力する
ための出力トランジスタと、出力トランジスタの出力電
圧を検出し、所定のリファレンス電圧を基準として出力
電圧の誤差を検出し、検出した誤差が抑制されるよう出
力トランジスタを駆動する電圧安定化手段と、上記出力
電流を検出し、上記リファレンス電圧を基準として出力
電流の過剰分を検出し、少なくとも検出した過剰分が打
ち消されるよう出力トランジスタを駆動する電流制限手
段と、を備え、 電流制限手段が、 検出した出力電流を電圧に変換する抵抗と、 抵抗に並列接続され出力電流の高周波成分を除去するコ
ンデンサと、 少なくとも出力トランジスタの出力電流が過剰となった
場合にオンし抵抗とコンデンサの間にそのオン抵抗を挿
入する能動素子と、 を備えることを特徴とする安定化電源回路。
1. An output transistor for outputting a stabilized output voltage to the outside, an output voltage of the output transistor is detected, an error of the output voltage is detected with reference to a predetermined reference voltage, and the detected error is Voltage stabilizing means for driving the output transistor to be suppressed, and detecting the output current, detecting an excess of the output current with reference to the reference voltage, and driving the output transistor so that at least the detected excess is canceled. The current limiting means includes a resistor for converting the detected output current into a voltage, a capacitor connected in parallel with the resistor for removing high frequency components of the output current, and at least an output current of the output transistor being excessive. And an active element that inserts the on-resistance between the resistor and the capacitor when Stabilized power supply circuit for the butterflies.
【請求項2】 安定化電源回路の出力電流を検出し、所
定のリファレンス電圧を基準として出力電流の過剰分を
検出し、少なくとも検出した過剰分が打ち消されるよう
出力電流を制御する電流制限回路において、 検出した出力電流を電圧に変換する抵抗と、 抵抗に並列接続され出力電流の高周波成分を除去するコ
ンデンサと、 少なくとも出力電流が過剰となった場合にオンし抵抗と
コンデンサの間にそのオン抵抗を挿入する能動素子と、 を備えることを特徴とする電流制限回路。
2. A current limiting circuit for detecting an output current of a stabilized power supply circuit, detecting an excess of the output current with reference to a predetermined reference voltage, and controlling the output current so as to cancel at least the detected excess. , A resistor that converts the detected output current into a voltage, a capacitor that is connected in parallel with the resistor to remove high frequency components of the output current, and that turns on when at least the output current becomes excessive. A current limiting circuit, comprising:
【請求項3】 請求項1又は2記載の回路において、 上記能動素子がFETであることを特徴とする回路。3. The circuit according to claim 1, wherein the active element is a FET. 【請求項4】 請求項3記載の回路において、 上記能動素子と共に電流ミラー回路を構成し検出した出
力電流に応じた値の電流を上記能動素子に供給するFE
Tを備えることを特徴とする回路。
4. The FE according to claim 3, wherein a current mirror circuit is formed with the active element to supply a current having a value corresponding to the detected output current to the active element.
A circuit comprising T.
【請求項5】 請求項1又は2記載の回路において、 上記抵抗に流れる電流を出力電圧に応じて制限する手段
を備えることを特徴とする回路。
5. The circuit according to claim 1, further comprising means for limiting a current flowing through the resistor according to an output voltage.
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* Cited by examiner, † Cited by third party
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JP2006301787A (en) * 2005-04-18 2006-11-02 Ricoh Co Ltd Constant-voltage power supply circuit
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JP2008059541A (en) * 2006-08-30 2008-03-13 Seiko Npc Corp Constant voltage circuit
DE102006043614A1 (en) * 2006-09-16 2008-03-27 Conti Temic Microelectronic Gmbh Linear voltage regulator for battery and line-powered devices, has voltage actuating element, which is arranged between input and output for voltage regulation and current measuring device, which is coupled with regulating module
JP2012083850A (en) * 2010-10-07 2012-04-26 On Semiconductor Trading Ltd Constant voltage power supply circuit

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