JPH0837514A - 複数階梯型デマンドアサイン多重化装置 - Google Patents
複数階梯型デマンドアサイン多重化装置Info
- Publication number
- JPH0837514A JPH0837514A JP17279794A JP17279794A JPH0837514A JP H0837514 A JPH0837514 A JP H0837514A JP 17279794 A JP17279794 A JP 17279794A JP 17279794 A JP17279794 A JP 17279794A JP H0837514 A JPH0837514 A JP H0837514A
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Abstract
(57)【要約】
【目的】複数のメディアを収容して多重伝送を行うマル
チメディア時分割多重化装置において、サブレートクラ
スから高速レートクラスまでの速度が大きく異なるメデ
ィアに対してもデマンドアサインを効率よく実行させる
ことを目的とする。 【構成】サブレート処理部（１０３）と高速レート処理
部（１０４）の複数階梯で構成し、その間は複数のサブ
レート多重化信号（１０９）とデマンドアサイン信号
（１１０）とにより接続する。メディアからのデマンド
要求の増減に応じて、このサブレート多重化信号の使用
本数の増減を行う。サブレート処理部は、収容するメデ
ィアに最も適合した多重化形式毎に複数種類を接続され
る。
チメディア時分割多重化装置において、サブレートクラ
スから高速レートクラスまでの速度が大きく異なるメデ
ィアに対してもデマンドアサインを効率よく実行させる
ことを目的とする。 【構成】サブレート処理部（１０３）と高速レート処理
部（１０４）の複数階梯で構成し、その間は複数のサブ
レート多重化信号（１０９）とデマンドアサイン信号
（１１０）とにより接続する。メディアからのデマンド
要求の増減に応じて、このサブレート多重化信号の使用
本数の増減を行う。サブレート処理部は、収容するメデ
ィアに最も適合した多重化形式毎に複数種類を接続され
る。
Description
【０００１】
【産業上の利用分野】本発明は、複数のメディアを収容
した高速ディジタル専用線での多重伝送用のマルチメデ
ィア時分割多重化装置において、メディアからのチャネ
ル割当要求に応じて伝送路上にチャネルの割当を行いパ
スを接続する複数階梯型デマンドアサイン多重化装置に
関する。
した高速ディジタル専用線での多重伝送用のマルチメデ
ィア時分割多重化装置において、メディアからのチャネ
ル割当要求に応じて伝送路上にチャネルの割当を行いパ
スを接続する複数階梯型デマンドアサイン多重化装置に
関する。
【０００２】
【従来の技術】第一種通信事業者（以下キャリアと呼
ぶ）が提供する高速ディジタル専用線サービスでは、 ・国際電気通信連合（ＩＴＵ）勧告 Ｇ７０３ ・電信電話技術委員会（ＴＴＣ）標準 ＪＴ−Ｉ４３
０、Ｉ４３１、Ｇ７０３の国際・国内標準に準拠して、
最低転送速度レートを８ｋｂｐｓ単位に設定しディジタ
ル伝送している。
ぶ）が提供する高速ディジタル専用線サービスでは、 ・国際電気通信連合（ＩＴＵ）勧告 Ｇ７０３ ・電信電話技術委員会（ＴＴＣ）標準 ＪＴ−Ｉ４３
０、Ｉ４３１、Ｇ７０３の国際・国内標準に準拠して、
最低転送速度レートを８ｋｂｐｓ単位に設定しディジタ
ル伝送している。
【０００３】一方、この種のサービスに使用されるマル
チメディア多重化装置が収容するメディアの速度レート
は、伝送速度が数ｋｂｐｓのサブレートクラスから、数
１０ｋ〜数Ｍｂｐｓの高速レートクラスまで広範囲にわ
たっている。一般的に、高速レートクラスとは８Ｋｂｐ
ｓ××ｉ、６４ｋｂｐｓ×ｉ（ｉは整数）単位の信号速
度系列をさし、サブレートクラスとは高速レートの速度
に満たない０．４ｋｂｐｓ×ｉ、０．８ｋｂｐｓ×ｉ、
３２ｋｂｐｓ×ｉ（ｉは整数）単位の信号速度系列を意
味する。なお８ｋｂｐｓ×ｉの信号速度系列について
は、サブレートクラスとして定義することもある。
チメディア多重化装置が収容するメディアの速度レート
は、伝送速度が数ｋｂｐｓのサブレートクラスから、数
１０ｋ〜数Ｍｂｐｓの高速レートクラスまで広範囲にわ
たっている。一般的に、高速レートクラスとは８Ｋｂｐ
ｓ××ｉ、６４ｋｂｐｓ×ｉ（ｉは整数）単位の信号速
度系列をさし、サブレートクラスとは高速レートの速度
に満たない０．４ｋｂｐｓ×ｉ、０．８ｋｂｐｓ×ｉ、
３２ｋｂｐｓ×ｉ（ｉは整数）単位の信号速度系列を意
味する。なお８ｋｂｐｓ×ｉの信号速度系列について
は、サブレートクラスとして定義することもある。
【０００４】従来のこの種のマルチメディア多重化装置
は、サブレートクラスの伝送を、キャリアが提供する８
ｋｂｐｓ単位の伝送と整合をとりつつ効率的に行うため
に、 ・電信電話技術審議会（ＴＴＣ）標準 ＪＪ−２０．３
１、３２ ・メーカ独自の多重化形式 の規定により、マルチフレーム同期用フレームビットを
付加して一旦８ｋｂｐｓ×ｉ（ｉは整数）の多重化を行
い、次いで他の高速レートクラスの信号と多重化して伝
送している。
は、サブレートクラスの伝送を、キャリアが提供する８
ｋｂｐｓ単位の伝送と整合をとりつつ効率的に行うため
に、 ・電信電話技術審議会（ＴＴＣ）標準 ＪＪ−２０．３
１、３２ ・メーカ独自の多重化形式 の規定により、マルチフレーム同期用フレームビットを
付加して一旦８ｋｂｐｓ×ｉ（ｉは整数）の多重化を行
い、次いで他の高速レートクラスの信号と多重化して伝
送している。
【０００５】従来のマルチメディア多重化用のデマンド
アサイン多重化装置では、上述したような複数の信号速
度系列に対応するために、下記のいずれかの方式を採用
している。
アサイン多重化装置では、上述したような複数の信号速
度系列に対応するために、下記のいずれかの方式を採用
している。
【０００６】（１）伝送路上の領域を、あらかじめ高速
レート領域とサブレート領域に分割して、個々の領域で
デマンドアサイン処理及び多重化を行う。
レート領域とサブレート領域に分割して、個々の領域で
デマンドアサイン処理及び多重化を行う。
【０００７】（２）サブレートクラスの信号をダミービ
ットの付加により高速レートクラスの信号にオーバース
ピード化を行い、すべての信号を高速レートクラスとし
て取り扱いデマンドアサイン処理及び高速レートでの多
重化を行う。
ットの付加により高速レートクラスの信号にオーバース
ピード化を行い、すべての信号を高速レートクラスとし
て取り扱いデマンドアサイン処理及び高速レートでの多
重化を行う。
【０００８】（３）高速レートクラスの信号をサブレー
トクラスの信号として取り扱いデマンドアサイン処理及
びサブレートの多重化を行う。
トクラスの信号として取り扱いデマンドアサイン処理及
びサブレートの多重化を行う。
【０００９】
【発明が解決しようとする課題】上述した従来の方式で
は、 （１）においては、分割損が発生し多重化効率が悪くな
る。 （２）においては、サブレートクラスの信号のオーバー
スピード化により多重化効率が悪くなる。 （３）においては、高速レートクラスの信号がサブレー
トでの同期を取られることにより伝送遅延が大きくな
る。という問題点がある。
は、 （１）においては、分割損が発生し多重化効率が悪くな
る。 （２）においては、サブレートクラスの信号のオーバー
スピード化により多重化効率が悪くなる。 （３）においては、高速レートクラスの信号がサブレー
トでの同期を取られることにより伝送遅延が大きくな
る。という問題点がある。
【００１０】
【課題を解決するための手段】本発明の装置は、それぞ
れメディアの信号形式と多重化用の信号形式との相互変
換を行なうとともに前記メディアからのチャネル割当要
求信号を抽出するチャネルインタフェース部群と、サブ
レートのチャネルからの前記チャネル割当要求信号を検
出しそれに応じてチャネル割当制御を行ないサブレート
のチャネル群を上位階梯にサブレート多重化するととも
に上位階梯に対してチャネル割当要求するサブレート処
理部群と、高速レートのチャネル及び下位階梯からの前
記チャネル割当要求信号を検出しそれに応じてチャネル
割当制御を行ない高速レート多重化する高速レート処理
部と、前記高速レート多重化した信号と伝送路信号との
信号形式の相互変換を行なう伝送路インタフェース群と
を備えている。
れメディアの信号形式と多重化用の信号形式との相互変
換を行なうとともに前記メディアからのチャネル割当要
求信号を抽出するチャネルインタフェース部群と、サブ
レートのチャネルからの前記チャネル割当要求信号を検
出しそれに応じてチャネル割当制御を行ないサブレート
のチャネル群を上位階梯にサブレート多重化するととも
に上位階梯に対してチャネル割当要求するサブレート処
理部群と、高速レートのチャネル及び下位階梯からの前
記チャネル割当要求信号を検出しそれに応じてチャネル
割当制御を行ない高速レート多重化する高速レート処理
部と、前記高速レート多重化した信号と伝送路信号との
信号形式の相互変換を行なう伝送路インタフェース群と
を備えている。
【００１１】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【００１２】図１ないし図３は、本発明の一実施例のブ
ロック図である。説明を簡略化するため、１種類の信号
速度系列のサブレートクラスのメディアを収容する装置
を表しているが、収容種類の数の制約は無い。
ロック図である。説明を簡略化するため、１種類の信号
速度系列のサブレートクラスのメディアを収容する装置
を表しているが、収容種類の数の制約は無い。
【００１３】図１は本実施例の主要部全体の構成例を示
し、サブレート処理部１０３と高速レート処理部１０４
との２階梯で構成されている。サブレート処理部１０３
と高速レート処理部１０４との接続は、複数組のサブレ
ート多重化出力１０９と、これに対応したチャネル割当
要求信号１１０とで行う。サブレート多重化出力１０９
は、高速レートクラスの信号速度系列までサブレートの
信号を多重した出力信号である。
し、サブレート処理部１０３と高速レート処理部１０４
との２階梯で構成されている。サブレート処理部１０３
と高速レート処理部１０４との接続は、複数組のサブレ
ート多重化出力１０９と、これに対応したチャネル割当
要求信号１１０とで行う。サブレート多重化出力１０９
は、高速レートクラスの信号速度系列までサブレートの
信号を多重した出力信号である。
【００１４】サブレート処理部１０３は、サブレート多
重化出力１０９の利用本数が常に最小限となるように多
重化制御を行い、利用するサブレート多重化出力１０９
の分だけ高速レート処理部１０４に対してチャネル割当
／開放要求を行う。高速レート処理部１０４は、高速レ
ートクラスのメディアからの信号とサブレート処理部１
０３のサブレート多重化出力１０９の信号とのチャネル
割当処理を行う。
重化出力１０９の利用本数が常に最小限となるように多
重化制御を行い、利用するサブレート多重化出力１０９
の分だけ高速レート処理部１０４に対してチャネル割当
／開放要求を行う。高速レート処理部１０４は、高速レ
ートクラスのメディアからの信号とサブレート処理部１
０３のサブレート多重化出力１０９の信号とのチャネル
割当処理を行う。
【００１５】チャネルインタフェース部１０１〜１０２
は、メディアの信号形式と装置内での信号形式１０７と
の相互変換を行うインタフェース回路と、メディアから
のチャネル割当要求信号１０８を抽出する機能とを有し
ている。尚、チャネル割当要求信号としては、例えばＣ
ＣＩＴＴ Ｖ．２５ｂｉｓ勧告の接続要求信号情報、Ｃ
ＣＩＴＴ Ｖ．２４勧告のＥＲ信号ＯＮ状態になった情
報、構内交換機（ＰＢＸ）からのＳＳ／ＳＲ信号情報な
ど各種の要求信号形式がメディア毎に存在する。通常、
マルチメディア多重化装置は、複数のメディアに対応す
るために、複数種類のチャネルインタフェース部を具備
している。
は、メディアの信号形式と装置内での信号形式１０７と
の相互変換を行うインタフェース回路と、メディアから
のチャネル割当要求信号１０８を抽出する機能とを有し
ている。尚、チャネル割当要求信号としては、例えばＣ
ＣＩＴＴ Ｖ．２５ｂｉｓ勧告の接続要求信号情報、Ｃ
ＣＩＴＴ Ｖ．２４勧告のＥＲ信号ＯＮ状態になった情
報、構内交換機（ＰＢＸ）からのＳＳ／ＳＲ信号情報な
ど各種の要求信号形式がメディア毎に存在する。通常、
マルチメディア多重化装置は、複数のメディアに対応す
るために、複数種類のチャネルインタフェース部を具備
している。
【００１６】図２は本実施例のサブレート処理部１０３
の構成例を示すブロック図である。チャネル割当要求検
出部２０１は、チャネルインタフェース部１０１からの
チャネル割当要求信号１０８を解読してチャネル割当制
御部２０２に通知する。その通知を受け取ったチャネル
割当制御部２０２は、チャネル割当の場合、現在利用し
ているサブレート多重化出力（例えば１０９）に対し空
き帯域の検索をして優先的にチャネル割当を行い、サブ
レート多重化部２０４に割当情報を書き込む。割当でき
ない場合には、ほかのサブレート多重化出力（例えば１
１１）の利用要求をチャネル割当要求部２０３からチャ
ネル割当要求信号１１２を通して高速レート処理部１０
４に要求する。高速レート処理部１０４の帯域割当処理
が終了し、次の多重化出力ポートに割当が可能となった
時点で、サブレート多重化部１０４に割当情報を書き込
む。
の構成例を示すブロック図である。チャネル割当要求検
出部２０１は、チャネルインタフェース部１０１からの
チャネル割当要求信号１０８を解読してチャネル割当制
御部２０２に通知する。その通知を受け取ったチャネル
割当制御部２０２は、チャネル割当の場合、現在利用し
ているサブレート多重化出力（例えば１０９）に対し空
き帯域の検索をして優先的にチャネル割当を行い、サブ
レート多重化部２０４に割当情報を書き込む。割当でき
ない場合には、ほかのサブレート多重化出力（例えば１
１１）の利用要求をチャネル割当要求部２０３からチャ
ネル割当要求信号１１２を通して高速レート処理部１０
４に要求する。高速レート処理部１０４の帯域割当処理
が終了し、次の多重化出力ポートに割当が可能となった
時点で、サブレート多重化部１０４に割当情報を書き込
む。
【００１７】メディアからのチャネル割当要求信号１０
８がチャネル開放の場合には、サブレート多重化部２０
４に既に書き込まれてる割当情報を削除し、さらに、１
つの多重化出力ポートの利用終了通知をチャネル割当要
求部２０３からチャネル割当要求信号１１２を通して高
速レート処理部１０４に通知する。
８がチャネル開放の場合には、サブレート多重化部２０
４に既に書き込まれてる割当情報を削除し、さらに、１
つの多重化出力ポートの利用終了通知をチャネル割当要
求部２０３からチャネル割当要求信号１１２を通して高
速レート処理部１０４に通知する。
【００１８】図３は本実施例の高速レート処理部１０４
の構成例を示すブロック図である。チャネル割当検出部
２０１は、チャネルインタフェース部１０２からのチャ
ネル割当要求信号（例えば１１４）及びサブレート処理
部１０３からのチャネル割当要求信号（例えば１１２）
を解読し、チャネル割当制御部２０５に通知する。その
通知を受け取ったチャネル割当制御部２０５は、割当の
場合には伝送路１０６上の空き帯域を検索し、高速レー
ト多重化部２０６に割当情報を書き込み、開放の場合に
は高速レート多重化部２０６に既に書き込まれてる割当
情報を削除する。
の構成例を示すブロック図である。チャネル割当検出部
２０１は、チャネルインタフェース部１０２からのチャ
ネル割当要求信号（例えば１１４）及びサブレート処理
部１０３からのチャネル割当要求信号（例えば１１２）
を解読し、チャネル割当制御部２０５に通知する。その
通知を受け取ったチャネル割当制御部２０５は、割当の
場合には伝送路１０６上の空き帯域を検索し、高速レー
ト多重化部２０６に割当情報を書き込み、開放の場合に
は高速レート多重化部２０６に既に書き込まれてる割当
情報を削除する。
【００１９】図１において、伝送路インタフェース部１
０５は従来の時分割多重化装置に使用されているものと
同じで、高速レート処理部１０４からの多重化信号を伝
送路１０６の信号形式に変換するインタフェース回路を
有している。
０５は従来の時分割多重化装置に使用されているものと
同じで、高速レート処理部１０４からの多重化信号を伝
送路１０６の信号形式に変換するインタフェース回路を
有している。
【００２０】以上に説明したごとく本実施例では、必要
に応じてサブレートおよび高速レートの複数階梯でチャ
ネルのデマンドアサインを行うので、分割損を少なくし
多重化効率を向上できるとともに、高速レート信号の伝
送遅延を増大させずに済む。
に応じてサブレートおよび高速レートの複数階梯でチャ
ネルのデマンドアサインを行うので、分割損を少なくし
多重化効率を向上できるとともに、高速レート信号の伝
送遅延を増大させずに済む。
【００２１】更に図４、図５に例示するように、異なる
サブレートクラスのサブレート処理部１０３−１〜１０
３−３と高速レート処理部１０４との組み合わせ構成に
より、収容するメディアの信号速度系列に応じた最適の
組み合わせを取ることができる。すなわち、図４では異
るサブレート処理部１０３−１および１０３−２を並設
してあり、また図５では図４のサブレート処理部１０３
−１の前段にサブレート処理部１０３−３を前置して３
階梯型の処理を行わせる構成を例示してある。
サブレートクラスのサブレート処理部１０３−１〜１０
３−３と高速レート処理部１０４との組み合わせ構成に
より、収容するメディアの信号速度系列に応じた最適の
組み合わせを取ることができる。すなわち、図４では異
るサブレート処理部１０３−１および１０３−２を並設
してあり、また図５では図４のサブレート処理部１０３
−１の前段にサブレート処理部１０３−３を前置して３
階梯型の処理を行わせる構成を例示してある。
【００２２】
【発明の効果】以上説明したように本発明によれば、
（１）伝送路上の高速レート領域とサブレート領域と
を、それぞれのメディアからのチャネル割当要求に応じ
て自動的に分割使用することができるので、分割損が少
なくなり多重化効率が良くなるとともに、（２）各メデ
ィアの信号速度系列に最も適した多重化形式をとること
ができるので、多重化効率が良くなり伝送遅延を最小に
抑えることができる。という効果が得られる。
（１）伝送路上の高速レート領域とサブレート領域と
を、それぞれのメディアからのチャネル割当要求に応じ
て自動的に分割使用することができるので、分割損が少
なくなり多重化効率が良くなるとともに、（２）各メデ
ィアの信号速度系列に最も適した多重化形式をとること
ができるので、多重化効率が良くなり伝送遅延を最小に
抑えることができる。という効果が得られる。
【図１】本発明の一実施例のブロック図。
【図２】図１中のサブレート処理部の構成を例示するブ
ロック図。
ロック図。
【図３】図１中の高速レート処理部の構成を例示するブ
ロック図。
ロック図。
【図４】図１の実施例にサブレート処理部を付加した構
成例を示すブロック図。
成例を示すブロック図。
【図５】図１の実施例にサブレート処理の階梯を付加し
た構成例を示すブロック図。
た構成例を示すブロック図。
１０１，１０２ チャネルインタフェース部 １０３，１０３−１ないし１０３−３ サブレート処
理部 １０４ 高速レート処理部 １０５ 伝送路インタフェース １０６ 伝送路 ２０１ チャネル割当要求検出部 ２０２，２０５ サブレート処理部のチャネル割当制
御部 ２０３ チャネル割当要求部 ２０４ サブレート多重化部 ２０６ 高速レート多重化部
理部 １０４ 高速レート処理部 １０５ 伝送路インタフェース １０６ 伝送路 ２０１ チャネル割当要求検出部 ２０２，２０５ サブレート処理部のチャネル割当制
御部 ２０３ チャネル割当要求部 ２０４ サブレート多重化部 ２０６ 高速レート多重化部
Claims (3)
- 【請求項１】 それぞれメディアの信号形式と多重化用
の信号形式との相互変換を行なうとともに前記メディア
からのチャネル割当要求信号を抽出するチャネルインタ
フェース部群と、サブレートのチャネルからの前記チャ
ネル割当要求信号を検出しそれに応じてチャネル割当制
御を行ないサブレートのチャネル群を上位階梯にサブレ
ート多重化するとともに上位階梯に対してチャネル割当
要求するサブレート処理部群と、高速レートのチャネル
及び下位階梯からの前記チャネル割当要求信号を検出し
それに応じてチャネル割当制御を行ない高速レート多重
化する高速レート処理部と、前記高速レート多重化した
信号と伝送路信号との信号形式の相互変換を行なう伝送
路インタフェース群とを備えていることを特徴とする複
数階梯型デマンドアサイン多重化装置。 - 【請求項２】 前記サブレート処理部群は、複数種類の
サブレート処理部を並設した構成を含む請求項１記載の
複数階梯型デマンドアサイン多重化装置。 - 【請求項３】 前記サブレート処理部群は、複数種類の
サブレート処理部を、縦続接続した構成を含む請求項１
記載と複数階梯型デマンドアサイン多重化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17279794A JPH0837514A (ja) | 1994-07-25 | 1994-07-25 | 複数階梯型デマンドアサイン多重化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17279794A JPH0837514A (ja) | 1994-07-25 | 1994-07-25 | 複数階梯型デマンドアサイン多重化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0837514A true JPH0837514A (ja) | 1996-02-06 |
Family
ID=15948547
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17279794A Pending JPH0837514A (ja) | 1994-07-25 | 1994-07-25 | 複数階梯型デマンドアサイン多重化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0837514A (ja) |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5833334A (ja) * | 1981-08-21 | 1983-02-26 | Hitachi Ltd | 時分割多重化装置 |
| JPS63128829A (ja) * | 1986-11-18 | 1988-06-01 | Nec Corp | タイムスロツト割当方式 |
| JPS6457844A (en) * | 1987-08-28 | 1989-03-06 | Hitachi Ltd | Digital signal multiplexer |
| JPH0199357A (ja) * | 1987-10-12 | 1989-04-18 | Tokyo Electric Power Co Inc:The | ディジタル中継線のチャネル割当方式 |
| JPH01188043A (ja) * | 1988-01-21 | 1989-07-27 | Canon Inc | 多重変換装置 |
-
1994
- 1994-07-25 JP JP17279794A patent/JPH0837514A/ja active Pending
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5833334A (ja) * | 1981-08-21 | 1983-02-26 | Hitachi Ltd | 時分割多重化装置 |
| JPS63128829A (ja) * | 1986-11-18 | 1988-06-01 | Nec Corp | タイムスロツト割当方式 |
| JPS6457844A (en) * | 1987-08-28 | 1989-03-06 | Hitachi Ltd | Digital signal multiplexer |
| JPH0199357A (ja) * | 1987-10-12 | 1989-04-18 | Tokyo Electric Power Co Inc:The | ディジタル中継線のチャネル割当方式 |
| JPH01188043A (ja) * | 1988-01-21 | 1989-07-27 | Canon Inc | 多重変換装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19981124 |