JPH0730356A - Noise filter - Google Patents

Noise filter

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JPH0730356A
JPH0730356A JP19381793A JP19381793A JPH0730356A JP H0730356 A JPH0730356 A JP H0730356A JP 19381793 A JP19381793 A JP 19381793A JP 19381793 A JP19381793 A JP 19381793A JP H0730356 A JPH0730356 A JP H0730356A
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Japan
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coil
half turn
noise filter
lower half
metal
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JP19381793A
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Takeshi Ikeda
毅 池田
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Abstract

PURPOSE:To provide an extremely compact noise filter with an excellent noise blocking characteristic suitable to mass production. CONSTITUTION:A lower half turn 32 of an outside coil 3 is formed on the surface of an insulating substrate 1, and a lower half turn 42 of an inside coil 4 is formed through a dielectric layer 22 on the lower half turn 32 of the outside coil 3. An upper half turn 44 of the inside coil 4 is formed through a dielectric layer 23 on the lower turn 42 of the inside coil 4, and an upper half turn 34 of the outside coil 3 is formed through a dielectric layer 24 on the upper half turn 44 of the inside coil 4.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】この発明は、電子機器における信
号通過回路または電源回路などに使用してノイズの伝搬
を阻止する小型のノイズ・フィルタに関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a small noise filter which is used in a signal passage circuit or a power supply circuit in electronic equipment to prevent the propagation of noise.

【0002】[0002]

【従来の技術】コンピュータなどのディジタル信号を扱
う電子機器においては、信号通過回路または電源回路な
どにノイズ・フィルタが使用されている。
2. Description of the Related Art A noise filter is used in a signal passing circuit or a power supply circuit in electronic equipment such as a computer which handles digital signals.

【0003】従来のノイズ・フィルタの一例として、図
7に示すように、誘電体90を介して1対のスパイラル電
極91、92を対向配置し、一方のスパイラル電極91の両端
子93、94を伝送信号通過回路に直列に挿入し、他方のス
パイラル電極92の任意の一端95を接地する。そして、図
8の等価回路に示すように、1対のスパイラル電極91、
92の間に分布容量を形成させるとともに、信号通過回路
となるスパイラル電極91が有するインダクタンスにより
シャープ・カットオフのローパス・フィルタを得てい
る。
As an example of a conventional noise filter, as shown in FIG. 7, a pair of spiral electrodes 91 and 92 are arranged to face each other with a dielectric 90 interposed therebetween, and both terminals 93 and 94 of one spiral electrode 91 are connected. It is inserted in series in the transmission signal passing circuit, and one end 95 of the other spiral electrode 92 is grounded. Then, as shown in the equivalent circuit of FIG. 8, a pair of spiral electrodes 91,
A distributed capacitor is formed between 92, and a low pass filter with a sharp cutoff is obtained by the inductance of the spiral electrode 91 that serves as a signal passing circuit.

【0004】このような従来のフィルタにおいては、誘
電体90としてセラミック、プラスチック、ガラス、マイ
カなどの材料を使用し、印刷工程により誘電体20の両面
に対向配置したスパイラル電極91、92を形成している。
In such a conventional filter, a material such as ceramic, plastic, glass, or mica is used as the dielectric 90, and the spiral electrodes 91 and 92 arranged facing each other on both sides of the dielectric 20 are formed by a printing process. ing.

【0005】[0005]

【発明が解決しようとする課題】近年、携帯電話、携帯
用パソコンなどのディジタル信号を扱う携帯用の電子機
器が普及するにつれて、ノイズ・フィルタも小型化が要
求されている。しかし、このような従来のフィルタにお
いては、誘電体を薄くして分布容量を増すこと、印刷工
程により長いスパイラル電極を形成することには限度が
あり、著しい小型化は困難であった。
In recent years, with the spread of portable electronic devices such as portable telephones and portable personal computers that handle digital signals, there is a demand for miniaturization of noise filters. However, in such a conventional filter, it is difficult to make the dielectric thin to increase the distributed capacitance and to form a long spiral electrode in the printing process, and it is difficult to make the size extremely small.

【0006】そこで、この発明は、大量生産に適し、極
めて小型で、優れたノイズ阻止特性を有するノイズ・フ
ィルタを得るために考えられたものである。
Therefore, the present invention was conceived in order to obtain a noise filter which is suitable for mass production, is extremely small, and has excellent noise blocking characteristics.

【0007】[0007]

【課題を解決するための手段】この発明のノイズ・フィ
ルタは、絶縁基板の表面に、外側コイルの下半ターンを
形成し、この外側コイルの下半ターンの上に誘電体層を
介して内側コイルの下半ターンを形成し、この内側コイ
ルの下半ターンの上に誘電体層を介して内側コイルの上
半ターンを形成し、内側コイルの上半ターンの上に誘電
体層を介して外側コイルの上半ターンを形成したもので
ある。
According to the noise filter of the present invention, the lower half turn of the outer coil is formed on the surface of the insulating substrate, and the inner half is formed on the lower half turn of the outer coil through the dielectric layer. The lower half turn of the coil is formed, the upper half turn of the inner coil is formed on the lower half turn of the inner coil, and the upper half turn of the inner coil is formed on the upper half turn of the inner coil. The upper half turn of the outer coil is formed.

【0008】また、絶縁基板の表面に、第1コイルの下
半ターンと第2コイルの下半ターンとを交互に形成し、
これら第1および第2コイルの下半ターンの上に誘電体
層を介して、第1コイルの上半ターンと第2コイルの上
半ターンとを交互にを形成し、第1コイルおよび第2コ
イルをバイファイラ巻に構成してもよいのである。
Further, lower half turns of the first coil and lower half turns of the second coil are alternately formed on the surface of the insulating substrate,
An upper half turn of the first coil and an upper half turn of the second coil are alternately formed on the lower half turns of the first and second coils through a dielectric layer, and the first coil and the second coil are formed. The coil may be bifilar wound.

【0009】[0009]

【作用】2つのコイルが有するインダクタンスおよび両
コイル間に存在する静電容量とよりなる疑似的な分布定
数回路を形成して、広い周波数帯域にわたるノイズを抑
制することができる。
It is possible to suppress noise over a wide frequency band by forming a pseudo distributed constant circuit consisting of the inductance of the two coils and the electrostatic capacitance existing between the two coils.

【0010】[0010]

【実施例】(第1実施例)図3の等価回路に示すノイズ
・フィルタの第1実施例を製造工程順に説明すると、図
1の断面図に示すように、(1) まず、ガラス、合成樹
脂、セラミック、高純度のシリコン・ウエハなどの絶縁
基板を用意する。特に、絶縁基板には、バルク抵抗が大
きい高純度のシリコン・ウエハ1が適している。
EXAMPLE (First Example) The first example of the noise filter shown in the equivalent circuit of FIG. 3 will be described in the order of manufacturing steps. As shown in the sectional view of FIG. Prepare insulating substrates such as resin, ceramics, and high-purity silicon wafers. In particular, a high-purity silicon wafer 1 having a large bulk resistance is suitable for the insulating substrate.

【0011】(2) このシリコン・ウエハ1の上に、化学
気相法(CVD)、または、酸化雰囲気中においてシリコ
ン・ウエハ1を酸化させることにより第1のシリコン酸
化膜21を形成したのち、(3) このシリコン酸化膜21の上
に、スパッタリングや蒸着によって、次の化学気相法の
工程に耐え得る金属、例えば、アルミニウム、金、タン
グステン、モリブデン、タンタル、ニオブなどの金属膜
3aを形成し、(4) 金属膜3a上に、両端部が右下がりに半
ピッチずれた平行な複数条のフォトレジスト51のパター
ンを形成し、(5) このフォトレジスト51をマスクにし
て、図2の(1)に示す複数条の平行な第1の金属電極32
を形成したのち、フォトレジスト51を除去する。この第
1の金属電極32は、外側コイルの下半ターン分を形成す
る。
(2) After forming the first silicon oxide film 21 on the silicon wafer 1 by chemical vapor deposition (CVD) or by oxidizing the silicon wafer 1 in an oxidizing atmosphere, (3) On this silicon oxide film 21, a metal capable of withstanding the next chemical vapor deposition process by sputtering or vapor deposition, for example, a metal film of aluminum, gold, tungsten, molybdenum, tantalum, niobium, or the like.
3a is formed, (4) on the metal film 3a, a pattern of a plurality of parallel photoresists 51 whose both ends are shifted downward by a half pitch is formed, (5) using this photoresist 51 as a mask, A plurality of parallel first metal electrodes 32 shown in (1) of FIG.
After forming, the photoresist 51 is removed. This first metal electrode 32 forms the lower half turn of the outer coil.

【0012】(6) 図2の(2)に示すように、複数条の平
行な第1の各金属電極32の両端部31、33を除く全面に対
して、化学気相法により第2のシリコン酸化膜22を形成
したのち、(7) この第2のシリコン酸化膜22上に第2の
金属膜4aを形成し、(8) この第2の金属膜4a上におい
て、第1の平行な金属電極32の上に、第1の平行な金属
電極32よりも短くて、両端部が右下がりに半ピッチずれ
た平行な複数条のフォトレジスト52のパターンと、第1
の各金属電極32の両端部31、33を露出させるフォトレジ
スト52のパターンとを形成し、(9) このフォトレジスト
のパターン52をマスクにして、図2の(3)に示すよう
に、複数条の平行な第2の金属電極42と、第1の各金属
電極32の両端部31、33を形成したのち、フォトレジスト
52を除去する。この第2の金属電極42は、内側コイルの
下半ターン分を形成する。
(6) As shown in (2) of FIG. 2, the entire surface of each of the plurality of parallel first metal electrodes 32 excluding both end portions 31, 33 is subjected to a second chemical vapor deposition method to form a second metal electrode. After forming the silicon oxide film 22, (7) a second metal film 4a is formed on the second silicon oxide film 22, and (8) a first parallel film is formed on the second metal film 4a. A pattern of a plurality of parallel photoresists 52, which are shorter than the first parallel metal electrode 32 and whose both ends are shifted downward by a half pitch, on the metal electrode 32;
And a pattern of a photoresist 52 exposing both end portions 31 and 33 of each metal electrode 32 is formed, and (9) using the photoresist pattern 52 as a mask, as shown in (3) of FIG. After forming the parallel second metal electrodes 42 and the both ends 31, 33 of each first metal electrode 32, a photoresist is formed.
Remove 52. This second metal electrode 42 forms the lower half turn of the inner coil.

【0013】(10) 図2の(4)に示すように、複数条の
平行な第1および第2の各金属電極32、42の両端部31、
33、および、41、43を除く全面に、化学気相法により第
3のシリコン酸化膜23を形成したのち、(11) この第3
のシリコン酸化膜23上、および、露出している金属電極
32、42の両端部31、33、および、41、43の上に第3の金
属膜4bを形成し、(12) 平行な第2の金属電極42の各端
部41、43を接続する左下がりに半ピッチずれた平行な複
数条のフォトレジスト53のパターンと、第1の各金属電
極32の両端部31、33を露出させるフォトレジスト53のパ
ターンとを形成し、(13) このフォトレジスト53のパタ
ーンをマスクにして、図2の(5)に示すように、複数条
の平行な第3の金属電極44と、第1の各金属電極32の両
端部31、33を形成したのち、フォトレジスト53を除去す
る。このとき、第2の金属電極42の下半ターン分と第3
の金属電極44の上半ターン分とにより偏平な内側コイル
4が形成される。
(10) As shown in (4) of FIG. 2, both ends 31 of the plurality of parallel first and second metal electrodes 32, 42,
A third silicon oxide film 23 is formed on the entire surface except 33 and 41 and 43 by a chemical vapor deposition method, and then (11) the third silicon oxide film 23 is formed.
On the silicon oxide film 23 and exposed metal electrode
A third metal film 4b is formed on both ends 31, 33 and 41, 43 of 32, 42, and (12) the left ends connecting the ends 41, 43 of the parallel second metal electrode 42. A pattern of a plurality of parallel photoresists 53 shifted downward by a half pitch and a pattern of the photoresist 53 exposing both end portions 31, 33 of each first metal electrode 32 are formed. (13) This photoresist Using the pattern of 53 as a mask, as shown in FIG. 2 (5), after forming a plurality of parallel third metal electrodes 44 and both ends 31, 33 of the first metal electrodes 32, The photoresist 53 is removed. At this time, the lower half turn of the second metal electrode 42 and the third turn
The flat inner coil 4 is formed by the upper half turn of the metal electrode 44.

【0014】(14) 図2の(6)に示すように、複数条の
平行な第1の各金属電極32の両端部31、33、および、偏
平な内側コイルの両端子部40、45を除く全面に化学気相
法により第4のシリコン酸化膜24を形成したのち、(15)
この第4のシリコン酸化膜24上、および、露出してい
る金属電極32の両端部31、33の上にに第4の金属膜3bを
形成し、(16) 平行な第1の金属電極32の各端部31、33
を接続する左下がりに半ピッチずれた平行な複数条のフ
ォトレジスト54のパターンと、第1および第2の各金属
電極の両端子部30、35、40、45を露出させるためのフォ
トレジスト54のパターンとを形成し、(17) 図2の(7)
に示すように、このフォトレジスト54のパターンをマス
クにして、複数条の平行な第4の金属電極34と、内側の
コイル4の両端子部40、45と、外側のコイル3の両端子
部30、35を形成したのち、フォトレジスト54を除去す
る。このとき、第1の金属電極32の下半ターン分と第4
の金属電極34の上半ターン分とにより偏平な外側コイル
3が形成される。
(14) As shown in (6) of FIG. 2, both end portions 31, 33 of the plurality of parallel first metal electrodes 32 and both terminal portions 40, 45 of the flat inner coil are arranged. After forming a fourth silicon oxide film 24 on the entire surface except for the chemical vapor deposition method, (15)
A fourth metal film 3b is formed on the fourth silicon oxide film 24 and on both ends 31, 33 of the exposed metal electrode 32, and (16) the parallel first metal electrodes 32 are formed. Each end of 31, 33
And a pattern of a plurality of parallel photoresists 54 shifted by a half pitch to the lower left and connecting the two, and a photoresist 54 for exposing both terminal portions 30, 35, 40, 45 of the first and second metal electrodes. And (17) in FIG. 2 (7)
As shown in FIG. 3, the pattern of the photoresist 54 is used as a mask to form a plurality of parallel fourth metal electrodes 34, both terminal portions 40 and 45 of the inner coil 4, and both terminal portions of the outer coil 3. After forming 30, 35, the photoresist 54 is removed. At this time, the lower half turn of the first metal electrode 32 and the fourth turn
The flat outer coil 3 is formed by the upper half turn of the metal electrode 34.

【0015】このような1連の工程を経て、シリコン・
ウエハ1上に、コイルのピッチが重なり合った第3のシ
リコン酸化膜23を巻芯とする偏平な内側コイル4および
外側コイル3を形成することができる。そして、露出し
た各コイルの両端部30、35、および、40、45をそれぞれ
端子電極とする。
Through such a series of steps, silicon
On the wafer 1, it is possible to form the flat inner coil 4 and the outer coil 3 having the third silicon oxide film 23 having the coil pitches overlapped as the winding core. Then, the exposed ends 30, 35 and 40, 45 of each coil are used as terminal electrodes.

【0016】最後に、シリコン・ウエハ1を素子単位に
分割して、2つの偏平なコイル3と4の端子電極30、3
5、および、40、45にそれぞれボンディングしてコーテ
ィングするか、または、パッケージに収める。
Finally, the silicon wafer 1 is divided into elements, and the terminal electrodes 30 and 3 of the two flat coils 3 and 4 are divided.
Bond and coat 5, or 40, 45 respectively, or package.

【0017】偏平な第1のコイル3が有するインダクタ
ンスと、偏平な第2のコイル4との間に形成される静電
容量とを所望の値に設定して、図3の等価回路に示すよ
うに、疑似的な分布定数回路を形成する。
The inductance of the flat first coil 3 and the electrostatic capacitance formed between the flat second coil 4 are set to desired values, and as shown in the equivalent circuit of FIG. Then, a pseudo distributed constant circuit is formed.

【0018】(第2実施例)内側のコイル4および外側
のコイル3の幅を部分的に広げて対向させ、いずれか一
方のコイル短くし、他方のコイルを細長く形成して、幅
を広げた部分で形成される静電容量の大きい疑似的な分
布定数回路と、細長いコイルのインダクタンスの集中定
数回路との直列回路よりなるハイブリッド回路を形成す
る。
(Second Embodiment) The inner coil 4 and the outer coil 3 are partially widened to face each other, one of the coils is shortened, and the other coil is formed elongated to widen the width. A hybrid circuit is formed by a series circuit of a pseudo distributed constant circuit having a large electrostatic capacitance formed in a portion and a lumped constant circuit of the inductance of the elongated coil.

【0019】(第3実施例)図4の平面図に示すよう
に、内側のコイル4と外側のコイル3との重なり状態を
ずらせて、内側のコイル4の隣接する電極を跨がるよう
に外側のコイル3の両側部を重ね合わせ、端子電極30、
35、40を形成する。
(Third Embodiment) As shown in the plan view of FIG. 4, the inner coil 4 and the outer coil 3 are offset from each other so as to straddle adjacent electrodes of the inner coil 4. Both sides of the outer coil 3 are overlapped, and the terminal electrode 30,
Form 35 and 40.

【0020】(第4実施例)以上で説明した第3実施例
においては、内側のコイル4の隣接する両電極上に跨が
って外側のコイル3の両側部が重なるように形成してい
るが、外側のコイル3の電極の片側部だけ、すなわち、
少なくとも一部分が重なるように形成して、2つのコイ
ル3、4の電極間の結合状態を変えてもよいのである。
(Fourth Embodiment) In the third embodiment described above, both side portions of the outer coil 3 are formed so as to straddle over both adjacent electrodes of the inner coil 4. However, only one side of the electrode of the outer coil 3, that is,
It may be formed so that at least a part thereof overlaps, and the coupling state between the electrodes of the two coils 3 and 4 may be changed.

【0021】(第5実施例)第3実施例においては、内
側のコイル4の隣接する両電極上に跨がって外側のコイ
ル3の両側部が重なるように形成しているが、図5の平
面図に示すように、第1のコイル3の隣接する電極の間
に第2のコイル4を形成して、2つのコイル3、4をバ
イファイラ巻に構成してもよいのである。この場合、2
つのコイル間の静電容量を小さくすることができる。
(Fifth Embodiment) In the third embodiment, both side portions of the outer coil 3 are formed so as to overlap the adjacent electrodes of the inner coil 4 and overlap each other. The second coil 4 may be formed between the adjacent electrodes of the first coil 3 to form the two coils 3 and 4 in a bifilar winding, as shown in the plan view of FIG. In this case, 2
The capacitance between the two coils can be reduced.

【0022】(第6実施例)既に集積回路を形成したシ
リコン・ウエハの表面上に、ノイズ・フィルタを立体的
に形成する際には、既に集積回路を形成したシリコン・
ウエハの上に、化学気相法によりシリコン酸化膜を形成
し、このシリコン酸化膜の上に、第1〜第5実施例で説
明した工程を経て、ノイズ・フィルタを形成する。
(Sixth Embodiment) When a noise filter is three-dimensionally formed on the surface of a silicon wafer on which an integrated circuit is already formed, the silicon on which the integrated circuit is already formed is formed.
A silicon oxide film is formed on the wafer by a chemical vapor deposition method, and a noise filter is formed on the silicon oxide film through the steps described in the first to fifth embodiments.

【0023】このように、ノイズ・フィルタを立体的に
形成すると、シリコン・ウエハの面積を有効利用するこ
とができる。
By thus forming the noise filter three-dimensionally, the area of the silicon wafer can be effectively used.

【0024】(その他の実施例)第1〜第5実施例の工
程によって製造したノイズ・フィルタのパッケージング
の方法として、図6に示すように、分割されたシリコン
・ウエハのチップAの全表面に、化学液相法によりシリ
コン酸化膜Bを形成し、エッチングによって端子電極上
のシリコン酸化膜Bを除去して孔をあけ、その孔をハン
ダCで表面に盛り上がる程度に封じると、突出したハン
ダCを印刷配線基板のランドと直接接触させることがで
きるので、表面実装に際して好都合である。なお、チッ
プB表面の保護膜に、合成樹脂などの他の絶縁材料を使
用してもよく、保護膜の穿孔に、レーザー光線を利用し
てもよいのである。
(Other Embodiments) As a method of packaging the noise filter manufactured by the steps of the first to fifth embodiments, as shown in FIG. 6, the whole surface of the chip A of the divided silicon wafer is shown. Then, a silicon oxide film B is formed by a chemical liquid phase method, the silicon oxide film B on the terminal electrode is removed by etching to form a hole, and the hole is sealed with solder C to the extent that it rises on the surface. Since C can be brought into direct contact with the land of the printed wiring board, it is convenient for surface mounting. It should be noted that another insulating material such as synthetic resin may be used for the protective film on the surface of the chip B, and a laser beam may be used for perforating the protective film.

【0025】内側コイルおよび外側コイルの各金属電極
32、34、42、44は、膜厚および幅に応じた抵抗を有して
おり、その厚みおよび/または幅を変えて抵抗を調整す
ることにより、疑似的な分布定数回路のQを調整するこ
とができる。
Each metal electrode of the inner coil and the outer coil
32, 34, 42, and 44 have resistances according to film thickness and width, and the resistance of the pseudo distributed constant circuit is adjusted by changing the thickness and / or width to adjust the resistance. be able to.

【0026】Qが高い場合には、減衰特性において、特
定の周波数で急峻な減衰または共振点をもつが、Qが低
い場合には、広い周波数帯域にわたって一様な減衰特性
を得ることができるので、絶縁基板となるシリコン・ウ
エハのバルク抵抗、コイルを形成する金属電極の長さ、
厚み、幅および絶縁性酸化皮膜となるシリコン酸化膜の
厚みなどを選択することにより、所望の減衰特性のノイ
ズ・フィルタを得ることができる。
When Q is high, the attenuation characteristic has a sharp attenuation or resonance point at a specific frequency, but when Q is low, uniform attenuation characteristics can be obtained over a wide frequency band. , The bulk resistance of the silicon wafer that becomes the insulating substrate, the length of the metal electrode that forms the coil,
By selecting the thickness, width, and thickness of the silicon oxide film to be the insulating oxide film, it is possible to obtain a noise filter having a desired attenuation characteristic.

【0027】以上で説明した各実施例においては、2つ
のコイルを形成する金属電極32、34または42、44は、そ
れぞれ1層づつ形成されているが、シリコン酸化膜を介
在させ、その層間で接続して複数層形成することによ
り、インダクタンスおよび/または静電容量を増加する
ことができる。
In each of the embodiments described above, each of the metal electrodes 32, 34 or 42, 44 forming the two coils is formed by one layer, but a silicon oxide film is interposed between the metal electrodes 32, 34 or 42, 44. By connecting and forming a plurality of layers, the inductance and / or the capacitance can be increased.

【0028】コイルのインダクタンスを増加させたい場
合には、絶縁基板としてフェライトのような磁性絶縁体
を使用すればよいのである。
When it is desired to increase the inductance of the coil, a magnetic insulator such as ferrite may be used as the insulating substrate.

【0029】この発明のノイズ・フィルタは、単一の素
子をケースに収めて1つの部品として使用することもで
きるが、印刷配線基板やICカードなどの絶縁基板上に
形成される他の回路の一部としてノイズ・フィルタを形
成し、電源回路や伝送信号通過回路に接続して使用する
ことができる。
Although the noise filter of the present invention can be used as a single component by housing a single element in a case, it can be used for other circuits formed on an insulating substrate such as a printed wiring board or an IC card. A noise filter can be formed as a part and can be used by connecting to a power supply circuit or a transmission signal passing circuit.

【0030】また、絶縁基板に複数個のノイズ・フィル
タを形成して、一体化することにより、単一部品とし
て、複数ビットの伝送信号より発生するノイズの伝搬を
阻止することができる。
Further, by forming and integrating a plurality of noise filters on the insulating substrate, it is possible to prevent the propagation of noise generated by a transmission signal of a plurality of bits as a single component.

【0031】2つのコイルの間に介在する誘電体層の静
電気による破壊を防止するためには、金属電極間に放電
ギャップを設けたり、複数の直列接続されたダイオード
を接続してその順方向の閾値電圧以下で動作させたり、
ツェナー・ダイオードを接続すればよいのである。
In order to prevent the dielectric layer interposed between the two coils from being destroyed by static electricity, a discharge gap is provided between the metal electrodes, or a plurality of diodes connected in series are connected to form a forward gap. Operating below the threshold voltage,
Just connect a Zener diode.

【0032】2つのコイルの間に存在する誘電体層とし
て、シリコン酸化膜に代えて誘電率が比較的大きいシリ
コン窒化膜(Si34膜)を使用してもよいのである。
As the dielectric layer existing between the two coils, a silicon nitride film (Si 3 N 4 film) having a relatively large dielectric constant may be used instead of the silicon oxide film.

【0033】高純度の半導体基板、例えば、高純度のシ
リコン・ウエハは、そのバルク抵抗が、コイルを形成す
る金属電極32、34、42、44などの金属導電体に比して極
めて高く、絶縁基板として充分使用することができる。
A high-purity semiconductor substrate, for example, a high-purity silicon wafer, has a bulk resistance extremely higher than that of metal conductors such as metal electrodes 32, 34, 42, and 44 forming a coil, and is highly insulating. It can be sufficiently used as a substrate.

【0034】この発明のノイズ・フィルタは、シリコン
・ウエハを絶縁基板として構成すると、従来から使用さ
れている集積回路の製造装置によって製造し、検査し、
パッケージングすることが可能になり、新たな設備を設
ける必要はないのである。
The noise filter of the present invention, when a silicon wafer is used as an insulating substrate, is manufactured and inspected by a conventionally used integrated circuit manufacturing apparatus.
It becomes possible to package it, and there is no need to install new equipment.

【0035】[0035]

【発明の効果】以上の実施例に基づく説明から明らかな
ように、この発明のノイズ・フィルタによると、集積回
路の製造技術と類似な技術によって製造することができ
るので、小型化が容易であり、新たな設備投資を要する
ことなく、大量生産に適し、廉価に製造することが可能
であり、また、種々の減衰特性を有する素子を得ること
が容易である。
As is apparent from the description based on the above embodiments, the noise filter of the present invention can be manufactured by a technique similar to the manufacturing technique of an integrated circuit, and therefore can be easily miniaturized. Further, it is suitable for mass production without requiring new facility investment, can be manufactured at low cost, and it is easy to obtain elements having various attenuation characteristics.

【図面の簡単な説明】[Brief description of drawings]

【図1】この発明のノイズ・フィルタの第1実施例を製
造工程順に示した断面図、
FIG. 1 is a sectional view showing a first embodiment of a noise filter according to the present invention in the order of manufacturing steps;

【図2】この発明のノイズ・フィルタの第1実施例の製
造工程の途中における状態を示す平面図、
FIG. 2 is a plan view showing the state of the noise filter according to the first embodiment of the present invention during the manufacturing process,

【図3】この発明のノイズ・フィルタの等価回路図、FIG. 3 is an equivalent circuit diagram of the noise filter of the present invention,

【図4】この発明のノイズ・フィルタの他の実施例を示
す平面図、
FIG. 4 is a plan view showing another embodiment of the noise filter according to the present invention,

【図5】この発明のノイズ・フィルタのさらに他の実施
例を示す平面図、
FIG. 5 is a plan view showing still another embodiment of the noise filter according to the present invention,

【図6】各実施例で製造したこの発明のノイズ・フィル
タのパッケージングの一例を示す断面図、
FIG. 6 is a sectional view showing an example of packaging of the noise filter of the present invention manufactured in each of the embodiments,

【図7】従来のノイズ・フィルタの一例を示す表面図
(a)、側面図(b)、裏面図(c)、
FIG. 7 is a surface view showing an example of a conventional noise filter.
(a), side view (b), back view (c),

【図8】従来のノイズ・フィルタの等価回路図である。FIG. 8 is an equivalent circuit diagram of a conventional noise filter.

【符号の説明】[Explanation of symbols]

1 シリコン・ウエハ(絶縁基板) 3 外側のコイル 4 内側のコイル 21、22、23、24 誘電体層(シリコン酸化膜) 32、34 外側のコイルを形成する金属電極 42、44 内側のコイルを形成する金属電極 1 silicon wafer (insulating substrate) 3 outer coil 4 inner coil 21, 22, 23, 24 dielectric layer (silicon oxide film) 32, 34 metal electrode forming outer coil 42, 44 inner coil formed Metal electrode

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 絶縁基板の表面に、外側コイルの下半タ
ーンを形成し、 上記外側コイルの下半ターンの上に誘電体層を介して内
側コイルの下半ターンを形成し、 上記内側コイルの下半ターンの上に誘電体層を介して内
側コイルの上半ターンを形成し、 内側コイルの上半ターンの上に誘電体層を介して外側コ
イルの上半ターンを形成したことを特徴とするノイズ・
フィルタ。
1. A lower half turn of the outer coil is formed on a surface of an insulating substrate, and a lower half turn of the inner coil is formed on the lower half turn of the outer coil through a dielectric layer. The upper half turn of the inner coil is formed on the lower half turn of the inner coil via the dielectric layer, and the upper half turn of the outer coil is formed on the upper half turn of the inner coil via the dielectric layer. Noise
filter.
【請求項2】 絶縁基板の表面に、第1コイルの下半タ
ーンと第2コイルの下半ターンとを交互に形成し、 上記第1および第2コイルの下半ターンの上に誘電体層
を介して、第1コイルの上半ターンと第2コイルの上半
ターンとを交互にを形成し、 上記第1コイルおよび第2コイルをバイファイラ巻に形
成したことを特徴とするノイズ・フィルタ。
2. A lower half turn of the first coil and a lower half turn of the second coil are alternately formed on the surface of the insulating substrate, and a dielectric layer is formed on the lower half turns of the first and second coils. A noise filter, characterized in that the upper half-turns of the first coil and the upper half-turns of the second coil are alternately formed, and the first coil and the second coil are formed in a bifilar winding.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2012124561A1 (en) * 2011-03-16 2012-09-20 株式会社 村田製作所 Electronic part

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