JPH0666102B2 - Disk device - Google Patents

Disk device

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JPH0666102B2
JPH0666102B2 JP59040129A JP4012984A JPH0666102B2 JP H0666102 B2 JPH0666102 B2 JP H0666102B2 JP 59040129 A JP59040129 A JP 59040129A JP 4012984 A JP4012984 A JP 4012984A JP H0666102 B2 JPH0666102 B2 JP H0666102B2
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JP
Japan
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disk
light
write
output
gate
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JP59040129A
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誠 正路
裕司 露口
省三 当麻
和裕 平木
努 森田
Original Assignee
ティアツク株式会社
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Publication date
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B5/00Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
    • G11B5/48Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed
    • G11B5/54Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head into or out of its operative position or across tracks
    • G11B5/55Track change, selection or acquisition by displacement of the head
    • G11B5/5521Track change, selection or acquisition by displacement of the head across disk tracks
    • G11B5/5526Control therefor; circuits, track configurations or relative disposition of servo-information transducers and servo-information tracks for control thereof
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    • G11B19/00Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
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    • G11B19/02Control of operating function, e.g. switching from recording to reproducing
    • G11B19/04Arrangements for preventing, inhibiting, or warning against double recording on the same blank or against other recording or reproducing malfunctions

Description

【発明の詳細な説明】 技術分野 本発明は、フロツピーデイスク(フレキシブル磁気デイ
スク)又はこれに類似したデイスクを使用して情報の記
録又は再生を行うためのデイスク装置に関するものであ
る。
TECHNICAL FIELD The present invention relates to a disk device for recording or reproducing information using a floppy disk (flexible magnetic disk) or a disk similar thereto.

従来技術 磁気デイスク装置は、デイスク回転機構と、磁気ヘツド
(変換器)と、ヘツド移動機構とを有する。ヘツド移動
機構は、一般にステツプ信号に応答するステツピングモ
ータと、このモータの回転運動に対応した直線運動を得
るための回転−直線変換機構とから成り、ヘツドをデイ
スクの半径方向(トラツク交差方向)に移動させるよう
に構成されている。
2. Description of the Related Art A magnetic disk device has a disk rotating mechanism, a magnetic head (transducer), and a head moving mechanism. The head moving mechanism is generally composed of a stepping motor which responds to a step signal and a rotation-linear conversion mechanism for obtaining a linear motion corresponding to the rotational motion of the motor. The head is moved in the radial direction of the disk (track crossing direction). Is configured to move.

この種の磁気デイスク装置で情報(データ)をデイスク
に記録する際に、デイスクに消去してはならないデータ
が書き込まれているか否かを検出しなければなやない。
従つて、一般的デイスクカートリツジには、書き込み禁
止被検出部又はフアイルプロテクト被検出部と呼ぶこと
が出来る光学的被検出部が設けられている。ところで、
従来装置では、光学的検出のための発光素子をデイスク
装置の使用期間の全部にわたつて発光させていたため、
必然的に電力消費量が大になつた。
When recording information (data) on a disk with this type of magnetic disk device, it is necessary to detect whether or not data that should not be erased is written on the disk.
Therefore, the general disk cartridge is provided with an optical detected portion which can be called a write-inhibited detected portion or a file-protected detected portion. by the way,
In the conventional device, the light emitting element for optical detection was made to emit light over the entire period of use of the disk device,
Inevitably, the amount of power consumption has increased.

発明の目的 そこで、本発明の目的は、節電が可能なデイスク装置を
提供することにある。
Therefore, an object of the present invention is to provide a disk device capable of saving power.

発明の構成 上記目的を達成するための本発明は、ケースに記録媒体
デイスクが収容され且つ前記ケースに前記デイスクに対
する情報の書き込みを禁止するか否かを光学的に判別す
るための書き込み禁止被検出部が設けられているデイス
クカートリツジを使用して情報の変換を行う装置であ
り、前記デイスクを回転するためのデイスク回転機構
と、前記デイスクの回転中に前記デイスクとの間で情報
の変換を行うための変換器と、前記変換器を前記デイス
クのトラツク交差方向に移動させるための変換器移動機
構と、前記書き込み禁止被検出部を光学的に検出するた
めに、前記回転機構に対する前記カートリツジの正常装
填状態において前記書き込み禁止被検出部に対応するよ
うに配置された書き込み禁止検出用発光素子と、前記書
き込み禁止被検出部を検出するために前記発光素子に対
応配置された受光素子と、前記発光素子を選択的に発光
させるために前記発光素子の電源ラインに接続されたス
イツチと、前記デイスクの回転駆動開始時点から前記デ
イスクがほぼ正常な回転状態になるレデイ時点までの期
間内に設定された所定期間に前記発光素子を発光させる
ように前記スイツチを制御するスイツチ制御回路とを具
備しているデイスク装置に係わるものである。
According to the present invention to achieve the above object, a write-prohibited detected object for optically determining whether a recording medium disk is housed in a case and information writing to the disk is prohibited in the case. Is a device for converting information using a disk cartridge provided with a unit, and for converting information between a disk rotating mechanism for rotating the disk and the disk during rotation of the disk. A converter for carrying out the operation, a converter moving mechanism for moving the converter in the track crossing direction of the disk, and a cartridge moving mechanism for the rotation mechanism in order to optically detect the write protected part. A write-prohibition detecting light-emitting element arranged so as to correspond to the write-prohibition detected portion in a normal loading state, and the write-prohibition A light receiving element arranged corresponding to the light emitting element for detecting a detected portion, a switch connected to a power supply line of the light emitting element for selectively causing the light emitting element to emit light, and a rotational driving start of the disk A switch device including a switch control circuit for controlling the switch so that the light emitting element emits light for a predetermined period set within a period from a time point to a ready time point when the disk is in a substantially normal rotation state. It is related.

発明の作用効果 上記発明は次の作用効果を有する。Effects of the Invention The above invention has the following effects.

(イ) 書き込み禁止検出用発光素子をデイスクの回転
駆動開始時点からレデイ時点までの期間内に設定された
所定期間に発光させるので、大幅な節電が達成される。
(A) Since the write-inhibition detecting light-emitting element is caused to emit light for a predetermined period set within the period from the start of the rotational drive of the disk to the ready, the significant power saving is achieved.

(ロ) デイスクの回転駆動開始時点からレデイ時点ま
での期間内に設定された所定期間に書き込み禁止(ライ
トプロテクト又はフアイルプロテクト)の検出を実行す
るので、記録再生の開始直前に書き込み禁止情報を得る
ことができる。従つて、短い検出期間であるにも拘わら
ず、必要な書き込み禁止情報を確実に得ることができ
る。
(B) Since write-protection (write protect or file protect) is detected during a predetermined period set within the period from the start of the disk rotation drive to the ready, the write-protection information is obtained immediately before the start of recording / reproduction. be able to. Therefore, it is possible to surely obtain the necessary write-prohibition information despite the short detection period.

実施例 次に、第1図〜第7図を参照して本発明の実施例に係わ
る磁気デイスク装置について述べる。
Embodiment Next, a magnetic disk device according to an embodiment of the present invention will be described with reference to FIGS.

第1図及び第2図はこの磁気デイスク装置で使用する磁
気デイスクカートリツジ(1)を示す。このカートリツ
ジ(1)は、一般にマイクロフロツピーデイスクと呼ば
れているものであり、直径86mmの記録媒体デイスク
(2)を剛性を有する合成樹脂ケース(3)に収容する
ことにより構成されている。ケース(3)の表面(4)
と裏面(5)との両方にヘツド挿入用開口(6)(7)
が設けられ、非使用時にはこの開口(6)(7)はスラ
イド式のシヤツタ(8)によつて閉じられている。シヤ
ツタ(8)は第1図で右方向にバネ(図示せず)によつ
て偏倚されており、使用時にはこの偏倚力に抗して左に
移動される。なお、シヤツタ(8)の開放はこの側面を
押圧することによつてなす。この実施例のデイスクカー
トリツジ(1)のデイスク(2)は磁気シート(2a)と
この中央に装着された磁性体金属円板から成るハブ(2
b)とから成る。デイスク(2)はクランパで押圧して
回転させるものではないので、ケース(3)の裏面
(5)にのみ回転駆動用の開口(10)が設けられ、ここ
からハブ(2b)が露出されている。このハブ(2b)には
スピンドル挿入用穴(2c)と駆動ピン挿入用穴(2d)と
が設けられている。(9)は書き込み禁止非検出部であ
り、書き込み禁止時に光透過状態とされる窓(9a)と、
書き込みが禁止されていない時(記録可能時)に窓(9
a)を閉めるための蓋(9b)とから成る。なお、蓋(9
b)は開閉自在にスライド式に形成されている。
1 and 2 show a magnetic disk cartridge (1) used in this magnetic disk device. This cartridge (1) is generally called a micro floppy disc and is constituted by accommodating a recording medium disc (2) having a diameter of 86 mm in a synthetic resin case (3) having rigidity. Surface (4) of case (3)
Head insertion openings (6) (7) on both the back and back (5)
Is provided, and the openings (6) and (7) are closed by a sliding shutter (8) when not in use. The shutter (8) is biased to the right in FIG. 1 by a spring (not shown), and is moved to the left against this biasing force during use. The shutter (8) is opened by pressing this side surface. The disk (2) of the disk cartridge (1) of this embodiment has a hub (2) composed of a magnetic sheet (2a) and a magnetic metal disk mounted in the center thereof.
b) consists of Since the disk (2) is not rotated by pressing with the clamper, the opening (10) for rotational drive is provided only on the back surface (5) of the case (3), and the hub (2b) is exposed from here. There is. The hub (2b) is provided with a spindle insertion hole (2c) and a drive pin insertion hole (2d). (9) is a write-prohibition non-detection part, and a window (9a) that is in a light transmission state when write-protection is
When writing is not prohibited (recordable), the window (9
It consists of a lid (9b) for closing a). The lid (9
b) is a slide type that can be opened and closed.

第1図及び第2図に示すカートリツジ(1)を使用して
データの記録再生を行う磁気デイスク装置の主要部は第
3図に示す如く構成されている。この第3図において、
回転台(11)は、所定位置に装填されたカートリツジ
(1)のケース(3)内のデイスク(2)を回転するた
めのものであり、ハブ(2b)を吸着する磁石(図示せ
ず)、穴(2c)に挿入されるスピンドル(図示せず)、
穴(2d)に挿入する駆動ピン(図示せず)等を備えてい
る。(12)は回転台(11)に直結されたアウターロータ
型モータである。(13)(14)は変換器としての記録再
生兼用磁気ヘツドであり、キヤリツジ(15)に取付けら
れ、デイスク(2)の半径方向に移動自在に案内されて
いる。(16)はヘツド移動機構を構成するステツピング
モータであり、α巻きスチールベルト、又はピニオンと
ラツク、又はリードスクリユー等から成る公知の回転一
直線変換機構(17)を介してキヤリツジ(15)を駆動す
るものである。(18)はヘツド(13)(14)のトラツク
零位置を検出するための遮光板であり、キヤリツジ(1
5)に一体化されている。(19)はヘツド(13)(14)
のトラツク零位置を検出するための発光ダイオード、
(20)はホトトランジスタである。ホトトランジスタ
(20)の光入力は、ヘツド(13)(14)のトラツク零位
置に対応して遮断される。
The main part of the magnetic disk device for recording / reproducing data using the cartridge (1) shown in FIGS. 1 and 2 is constructed as shown in FIG. In this FIG.
The turntable (11) is for rotating the disk (2) in the case (3) of the cartridge (1) loaded at a predetermined position, and a magnet (not shown) that attracts the hub (2b). , A spindle (not shown) inserted into the hole (2c),
It has a drive pin (not shown) and the like to be inserted into the hole (2d). (12) is an outer rotor type motor directly connected to the rotary base (11). (13) and (14) are recording / reproducing magnetic heads as converters, which are attached to the carriage (15) and are movably guided in the radial direction of the disk (2). (16) is a stepping motor which constitutes a head moving mechanism. The carriage (15) is connected via a known straight-line conversion mechanism (17) consisting of an α-wound steel belt, a pinion and a rack, or a lead screw. It is driven. Reference numeral (18) is a light shielding plate for detecting the track zero position of the heads (13) and (14).
It is integrated in 5). (19) is head (13) (14)
A light emitting diode for detecting the track zero position of
(20) is a phototransistor. The light input of the phototransistor (20) is blocked corresponding to the track zero position of the heads (13) (14).

(21)は書き込み禁止(フアイルプロテクト)検出用発
光ダイオードであり、カートリツジ(1)の正常装填位
置における窓(9a)に対応して配置されている。(22)
は書き込み禁止検出用ホトトランジスタであり、窓(9
a)に対応配置され、窓(9a)が開放されている時に発
光ダイオード(21)の光を受け入れる。
Reference numeral (21) is a write protect (light protect) detecting light emitting diode, which is arranged corresponding to the window (9a) at the normal loading position of the cartridge (1). (twenty two)
Is a phototransistor for detecting write protection, and
It is arranged corresponding to a) and receives the light of the light emitting diode (21) when the window (9a) is opened.

(23)はデイスク装填検出用発光ダイオードであり、カ
ートリツジ(1)の正常装填位置においてその一方の側
となるように配置されている。(24)はデイスク装填検
出用ホトトランジスタであり、カートリツジ(1)が装
填された時に発光ダイオード(23)からの入射光が遮断
されるようにカートリツジ(1)の他方の側に配置され
ている。
Reference numeral (23) denotes a disk loading detection light emitting diode, which is arranged so as to be on one side of the normal loading position of the cartridge (1). Reference numeral (24) is a disk-loading detection phototransistor, which is arranged on the other side of the cartridge (1) so that the incident light from the light emitting diode (23) is blocked when the cartridge (1) is loaded. .

(25)はデイスク(2)の回転検出器であり、デイスク
(2)及び回転台(11)と共に回転するアウターロータ
型モータ(12)のロータ(26)の表面に貼り付けられた
光反射インデツクス即ち指標(27)を検出するための発
光ダイオード(28)とホトトランジスタ(29)とを具備
し、デイスク(2)の回転角度位置及び回転速度を検出
する。(30)はレデイ検出回路であり、回転検出器(2
5)の出力に基づいて、デイスク(2)が正常速度の90
%以上になつたこと、及び回転開始時点から一定時間
(例えば420ms)が経過したことに基づいてレデイ状態
(記録再生準備完了状態)になつたことを示す信号を出
力するものである。
Reference numeral (25) is a rotation detector of the disk (2), which is a light reflection index attached to the surface of the rotor (26) of the outer rotor type motor (12) which rotates together with the disk (2) and the turntable (11). That is, a light emitting diode (28) for detecting the index (27) and a phototransistor (29) are provided, and the rotational angular position and rotational speed of the disk (2) are detected. (30) is a ready detection circuit, which is a rotation detector (2
Based on the output of 5), the disk (2) has a normal speed of 90.
A signal indicating that the ready state (recording / playback preparation complete state) has been reached is output based on the fact that the rotation speed has reached a percentage or more and that a fixed time (for example, 420 ms) has elapsed since the start of rotation.

第4図は第3図のステツピングモータ(16)及びその駆
動回路を示す。ステツピングモータ(16)は、第1相巻
線(31)、第2相巻線(32)、第3相巻線(33)、及び
第4相巻線(34)を有する4相構成のステツピングモー
タであり、正常ステツプ駆動時には、トランジスタ(3
5)(36)(37)(38)を1相励磁方式で順次にオンオ
フ制御することによつてロータ(図示せず)を所定角度
だけ回すものである。
FIG. 4 shows the stepping motor (16) of FIG. 3 and its drive circuit. The stepping motor (16) has a four-phase configuration including a first phase winding (31), a second phase winding (32), a third phase winding (33), and a fourth phase winding (34). This is a stepping motor, and the transistor (3
5) The rotor (not shown) is rotated by a predetermined angle by sequentially controlling ON / OFF of (36), (37) and (38) by a one-phase excitation method.

第5図は第3図の磁気デイスク装置の電気回路部分を示
す。この第5図から明らかな如く、トラツク零検出用発
光ダイオード(19)及び書き込み禁止検出用発光ダイオ
ード(21)は、電源に単に接続されておらず、本発明に
従うスイツチとしてのトランジスタ(39)を介して電源
回路に接続されている。即ち、2つの発光ダイオード
(19)(21)が互いに直列に接続され、アノードが+5V
の電源ライン(40)に接続され、カソードとグランドと
の間にトランジスタ(39)が接続されている。従つて、
トランジスタ(39)がオンの期間にのみ発光ダイオード
(19)(21)に電流が流れる。
FIG. 5 shows an electric circuit portion of the magnetic disk device shown in FIG. As is clear from FIG. 5, the light emitting diode (19) for detecting the track zero and the light emitting diode (21) for detecting the write inhibition are not simply connected to the power source, and the transistor (39) as the switch according to the present invention is used. It is connected to the power supply circuit via. That is, two light emitting diodes (19) and (21) are connected in series with each other, and the anode is + 5V.
And a transistor (39) connected between the cathode and ground. Therefore,
A current flows through the light emitting diodes (19) (21) only while the transistor (39) is on.

次に、第5図におけるトランジスタ(39)の制御回路
を、第6図及び第7図を参照して説明する。このデイス
ク装置全体の+12Vの電源端子(41)と+5Vの電源端子
(42)とに接続された電源オン検出回路(43)は、電源
端子(41)に電力が供給され、電源電圧が一定値(例え
ば正常電圧の70〜80%)になつたことを電圧コンパレー
タによつて検出し、且つ+5Vの電源端子(42)の電圧が
一定値(正常電圧の70〜80%)になつたことを検出し、
+12Vと+5Vとのいずれもが検出されたときに第6図
(A)のt1時点に示す如く高レベルの電源オン信号を送
出するものである。
Next, the control circuit of the transistor (39) in FIG. 5 will be described with reference to FIGS. 6 and 7. The power-on detection circuit (43) connected to the + 12V power supply terminal (41) and the + 5V power supply terminal (42) of the entire disk device is supplied with power to the power supply terminal (41) and has a constant power supply voltage. (Eg, 70-80% of normal voltage) is detected by the voltage comparator, and the + 5V power supply terminal (42) voltage has reached a constant value (70-80% of normal voltage). Detect and
When both + 12V and + 5V are detected, a high-level power-on signal is transmitted as shown at time t 1 in FIG. 6 (A).

この電源オン検出回路(43)の出力に接続された第1の
タイマ(44)は、t1時点で電源オン検出信号が高レベル
に転換することに対応してT1=12msの高レベルパルスを
第6図(B)に示す如く送出するものである。このタイ
マ(44)の出力はステツピングモータ制御駆動回路(4
5)に供給され、電源オン開始時のみステツピングモー
タ(16)を多相励磁するために使用される。タイマ(4
4)の出力は第1のORゲート(46)の第1の入力端子に
接続されている。この第1のORゲート(46)の出力は、
第2のORゲート(47)の一方の入力端子に接続されてい
ると共に100μsの遅延回路(48)を介して第2のORゲ
ート(47)の他方の入力端子に接続されている。第2の
ORゲート(47)の出力は増幅器(49)を介してトランジ
スタ(39)のベースに接続されている。従つて、タイマ
(44)の出力が第6図(B)に示す如く、t1〜t2期間で
高レベルになると、第1のORゲート(46)の出力も第6
図(L)に示す如く高レベルになり、結局、トランジス
タ(39)がオンになる。
The first timer (44) connected to the output of the power-on detection circuit (43) has a high-level pulse of T 1 = 12 ms in response to the power-on detection signal changing to a high level at time t 1. Is transmitted as shown in FIG. 6 (B). The output of this timer (44) is the stepping motor control drive circuit (4
5) and is used for multi-phase excitation of the stepping motor (16) only when the power is turned on. Timer (4
The output of 4) is connected to the first input terminal of the first OR gate (46). The output of this first OR gate (46) is
It is connected to one input terminal of the second OR gate (47) and also connected to the other input terminal of the second OR gate (47) via a delay circuit (48) of 100 μs. Second
The output of the OR gate (47) is connected to the base of the transistor (39) via the amplifier (49). Therefore, when the output of the timer (44) becomes high level during the period of t 1 to t 2 as shown in FIG. 6 (B), the output of the first OR gate (46) also becomes the sixth.
As shown in the figure (L), the level becomes high, and eventually the transistor (39) is turned on.

ステツピングモータ制御駆動回路(45)は、ライン(5
0)からステツプ信号の供給を受け、且つライン(51)
からステツプ方向信号の供給を受けてステツピングモー
タ(16)を駆動するものであり、第4図に示すトランジ
スタ(35)〜(38)を1相励磁方式で駆動するようにス
テツプパルスを分配する公知の回路を含む。また、この
制御駆動回路(45)は、電源オン検出回路(43)から得
られる高レベルの電源オン検出信号に応答して第4図に
示す第1相トランジスタ(35)をオン駆動する信号を発
生する。この装置は、ヘツド(13)(14)のトラツク零
位置が第1相巻線(31)に対応するように構成されてい
るので、電源投入時に第1相巻線(31)に励磁電流を供
給することにより、ヘツド(13)(14)をトラツク零位
置に保持することが可能になる。なお、発光ダイオード
(19)とホトトランジスタ(20)とでトラツク零が検出
されていない場合には、ヘツドをトラツク零に戻すため
のステツプパルスが発生する。
The stepping motor control drive circuit (45) is connected to the line (5
The step signal is supplied from (0) and the line (51)
The stepping motor (16) is driven by the supply of the step direction signal from the device, and the step pulse is distributed so as to drive the transistors (35) to (38) shown in FIG. 4 by the one-phase excitation method. It includes a known circuit. In addition, the control drive circuit (45) outputs a signal for turning on the first-phase transistor (35) shown in FIG. 4 in response to a high level power-on detection signal obtained from the power-on detection circuit (43). Occur. Since this device is configured so that the track zero position of the heads (13) and (14) corresponds to the first phase winding (31), an exciting current is applied to the first phase winding (31) when the power is turned on. By supplying it, the heads (13) and (14) can be held at the track zero position. When the track zero is not detected by the light emitting diode (19) and the phototransistor (20), a step pulse for returning the head to the track zero is generated.

ところで、発光ダイオード(19)とホトトランジスタ
(20)とによる検出誤差が2トラツクピツチ程度あるの
で、ヘツド(13)(14)がトラツク零以外のトラツク1
又は2であつてもトラツク零検出信号が発生することが
ある。もし、ヘツド(13)(14)がトラツク1にある場
合に対応してステツピングモータ(16)のロータが第2
相巻線(32)にあれば、電源投入時に第1相巻線(31)
の励磁電流を流すことにより、ロータを第1相巻線(3
1)に移動し、ヘツド(13)(14)をトラツク零に移動
することが出来る。しかし、ロータが第3相巻線(33)
にある時には、第1相巻線(31)に励磁電流を流して
も、ロータを動かすことが出来ない。そこで、この実施
例では、タイマ(44)の出力パルスに応答して制御駆動
回路(45)がステツピングモータ(16)の第2相巻線
(32)に電流を流すように構成されている。これによ
り、ロータが例え第3相巻線(33)にあつても、ここか
ら脱出させることが出来る。なお、第1相を励磁すると
共に、第3相巻線(33)又は第4相巻線(34)にt1〜t2
で電流を流してロータを第3相から脱出させてもよい。
また、第1相巻線(31)にt2から電流を流してもよい。
By the way, since the detection error due to the light emitting diode (19) and the phototransistor (20) is about two track pitches, the heads (13) and (14) are track 1 other than track zero.
Or even in the case of 2, the track zero detection signal may be generated. If the heads (13) and (14) are on the track 1, the rotor of the stepping motor (16) is the second rotor.
If it is in the phase winding (32), it is the first phase winding (31) when the power is turned on.
By passing the excitation current of
You can move to 1) and move heads (13) and (14) to track zero. However, the rotor is the third phase winding (33)
In the case of, the rotor cannot be moved even if an exciting current is passed through the first phase winding (31). Therefore, in this embodiment, the control drive circuit (45) is configured to flow a current through the second phase winding (32) of the stepping motor (16) in response to the output pulse of the timer (44). . This allows the rotor to escape from the third phase winding (33), for example. It should be noted that while exciting the first phase, t 1 -t 2 is applied to the third phase winding (33) or the fourth phase winding (34).
You may make a rotor escape from a 3rd phase by sending an electric current in.
Further, a current may flow from t 2 to the first phase winding (31).

ステツピングモータ制御駆動回路(45)から導出されて
いるライン(52)は、第4図の第1相トランジスタ(3
5)をオン制御すると同様な第1相励磁信号をANDゲート
(53)の第1の入力端子に供給するものである。ANDゲ
ート(53)の第2の入力端子にステツプ方向信号ライン
(51)が接続され、第3の入力端子にはリトリガ単安定
マルチバイブレータ(54)の出力端子が接続されてい
る。
The line (52) derived from the stepping motor control drive circuit (45) is connected to the first phase transistor (3) of FIG.
When 5) is turned on, the same first phase excitation signal is supplied to the first input terminal of the AND gate (53). The step direction signal line (51) is connected to the second input terminal of the AND gate (53), and the output terminal of the retrigger monostable multivibrator (54) is connected to the third input terminal.

リトリガ単安定マルチバイブレータ(54)の入力端子に
は第1タイマ(44)とステツプ信号ライン(50)とが接
続されている。従つて、このリトリガ単安定マルチバイ
ブレータ(54)は、第6図(B)のタイマ出力パルスの
後縁即ち高レベルから低レベルへの転換に対応してトリ
ガされ、第6図(E)に示す如く、t2〜t3期間(T2=50
ms)で高レベルの出力パルスを発生し、また、第6図
(D)に示すt13〜t14の各ステツプパルスの後縁に応答
してt13〜t15の期間で高レベル出力を発生する。なお、
ステツプパルスは50msよりも十分に短いので、50ms以内
で再トリガされ、最後のステツプパルスの後縁時点t14
からT8=50ms後のt15まで高レベル出力となる。
A first timer (44) and a step signal line (50) are connected to an input terminal of the retrigger monostable multivibrator (54). Therefore, the retriggered monostable multivibrator (54) is triggered in response to the trailing edge of the timer output pulse of FIG. 6 (B), that is, the conversion from high level to low level, and is shown in FIG. 6 (E). As shown, t 2 to t 3 period (T 2 = 50
generates an output pulse of high level ms), also a high level output during the period of t 13 ~t 15 in response to the trailing edge of each step pulse t 13 ~t 14 shown in FIG. 6 (D) Occur. In addition,
The step pulse is much shorter than 50ms, so it is retriggered within 50ms and trailing edge time t 14 of the last step pulse.
To high level output from t 8 to t 15 after 50 ms.

このデイスク装置では、電源投入に同期して第1相巻線
励磁信号がライン(52)に得られ、且つライン(51)に
第6図(C)に示すステツプアウトを示す信号即ちヘツ
ド(13)(14)をトラツク零に向けて駆動するための高
レベル信号が得られる。なお、電源投入時のステツプア
ウト信号は図示されていないコントローラから供給され
る。一方、リトリガ単安定マルチバイブレータ(54)
は、タイマ(44)の出力に応答してt2〜t3期間(T2=m
s)で高レベルパルスを発生する。従つて、t2〜t3期間
には、ANDゲート(53)の全部の入力が高レベルとな
り、その出力も高レベルとなる。この結果、第1のORゲ
ート(46)の出力が第6図(L)に示す如くt2〜t3で高
レベルとなり、結局、トランジスタ(39)がオンにな
る。この結果、電源投入に同期してt1〜t3(T3=T1+T2
=62ms)だけ2つの発光ダイオード(19)(20)が発光
し、トラツク零検出が可能になる。
In this disk device, the first-phase winding excitation signal is obtained on the line (52) in synchronization with the power-on, and the line (51) shows the step-out signal shown in FIG. 6C, that is, the head (13). ) (14) provides a high level signal to drive toward track zero. The step-out signal when the power is turned on is supplied from a controller (not shown). Meanwhile, retrigger monostable multivibrator (54)
Responds to the output of the timer (44) for the t 2 to t 3 period (T 2 = m
s) generates a high level pulse. Therefore, during the period of t 2 to t 3 , all the inputs of the AND gate (53) become high level, and the output thereof also becomes high level. As a result, the output of the first OR gate (46) becomes high level from t 2 to t 3 as shown in FIG. 6 (L), and eventually the transistor (39) is turned on. As a result, t 1 to t 3 (T 3 = T 1 + T 2
= 62 ms), the two light emitting diodes (19) (20) emit light, and the track zero detection becomes possible.

ホトトランジスタ(20)(22)はいずれもエミツタがグ
ランドに接続され、コレクタに+Vのバイアス電源が抵
抗(55)(56)を介して接続されている。従つて、ホト
トランジスタ(20)(22)に光入力が有る時のみ、それ
ぞれのコレクタライン(57)(58)が低レベルになる。
もし、ヘツド(13)(14)のトラツク零位置に対応して
遮光板(18)が発光ダイオード(19)とホトトランジス
タ(20)との間に位置すれば、発光ダイオード(19)が
発光中であつても、ホトトランジスタ(20)の光入力が
ないため、そのコレクタライン(57)が高レベルにな
る。従つて、発光ダイオード(19)が発光しているのに
も拘らず、ホトトランジスタ(20)のコレクタライン
(57)が高レベルであることに基づいてヘツド(13)
(14)がトラツク零にあることを検出できる。
In each of the phototransistors (20) and (22), the emitter is connected to the ground, and the + V bias power source is connected to the collector through the resistors (55) and (56). Therefore, the collector lines (57) (58) of the respective phototransistors (20) (22) are at a low level only when there is an optical input.
If the shading plate (18) is located between the light emitting diode (19) and the phototransistor (20) corresponding to the track zero position of the head (13) (14), the light emitting diode (19) is emitting light. However, since there is no light input to the phototransistor (20), its collector line (57) becomes high level. Therefore, the head line (13) is based on the high level of the collector line (57) of the phototransistor (20) even though the light emitting diode (19) is emitting light.
It can be detected that (14) is at track zero.

一方、カートリツジ(1)が装填された状態において、
発光ダイオード(21)の発光期間中にホトダイオード
(22)に光入力があれば、そのコレクタライン(58)が
低レベルとなり、書き込み禁止のカートリツジであるこ
とが分る。即ち、書き込み禁止のために、窓(9a)が蓋
(9b)で閉じられていないことが分る。
On the other hand, in the state where the cartridge (1) is loaded,
If light is input to the photodiode (22) during the light emitting period of the light emitting diode (21), the collector line (58) of the light emitting diode (22) becomes low level, which indicates that it is a write-protected cartridge. That is, it can be seen that the window (9a) is not closed by the lid (9b) due to write protection.

発光ダイオード(19)(21)の発光期間中でのみトラツ
ク零検出及び書き込み禁止検出を行うために、5つのAN
Dゲート(59)(60)(61)(62)(63)と、2つのNOT
回路(64)(65)と、2つのRSフリツプフロツプ(66)
(67)が設けられている。
In order to detect the track zero and the write inhibit only during the light emitting period of the light emitting diodes (19) (21), five ANs are used.
D gate (59) (60) (61) (62) (63) and two NOT
Circuits (64) (65) and two RS flip flops (66)
(67) is provided.

ANDゲート(59)の一方の入力端子はコレクタライン(5
7)に接続され、他方の入力端子はANDゲータ(63)の出
力端子に接続されている。ところで、ANDゲート(63)
の一方の入力端子は遅延回路(48)の出力端子に接続さ
れ、他方の入力端子はORゲート(46)の出力端子に接続
されている。このため、第7図に示す如く、ORゲート
(46)から(M)に示す如く、t1〜t3の期間に高レベル
出力が得られ、遅延回路(48)から(N)に示す如くt1
d〜t3dの期間に高レベル出力が得られた時にはANDゲー
ト(63)から第7図(P)に示すt1d〜t3の期間に高レ
ベル出力が得られる。一方、ORゲート(47)からは、第
7図(O)に示す如くt1〜t3dの期間で高レベル出力が
得られる。この結果、発光ダイオード(19)(21)が発
光駆動される期間t1〜t3dよりもANDゲート(63)の高レ
ベル期間が短かくなる。このように設定すれば、発光ダ
イオード(19)(21)の発光の立上りに遅れが生じて
も、完全な発光期間となるt1d〜t3において、トラツク
零検出及び書き込み禁止検出を行うことが出来る。
One input terminal of the AND gate (59) is connected to the collector line (5
7) and the other input terminal is connected to the output terminal of the AND gate (63). By the way, AND gate (63)
One input terminal is connected to the output terminal of the delay circuit (48), and the other input terminal is connected to the output terminal of the OR gate (46). Therefore, as shown in FIG. 7, a high level output is obtained from the OR gate (46) to the period t 1 to t 3 as shown in (M), and as shown in the delay circuit (48) to (N). t 1
When a high level output is obtained in the period of d to t 3 d, a high level output is obtained from the AND gate (63) in the period of t 1 d to t 3 shown in FIG. 7 (P). On the other hand, a high level output is obtained from the OR gate (47) in the period of t 1 to t 3 d as shown in FIG. 7 (O). As a result, the high-level period of the light-emitting diode (19) (21) is driven to emit light by a period t 1 ~t 3 d AND gates than (63) becomes shorter. With this setting, even if there is a delay in the rise of the light emission of the light emitting diodes (19) and (21), the track zero detection and the write protection detection are performed during the complete light emission period t 1 d to t 3 . Can be done.

今、第6図のt1〜t3期間においてトラツク零検出用ホト
トランジスタ(20)の出力ライン(57)が高レベルにな
り、ヘツドのトラツク零が検出されたとすれば、ANDゲ
ート(59)は第7図に示したt1d〜t3期間内においてト
ラツク零検出を示す高レベル出力を発生し、これが第1
のフリツプフロツプ(66)のセツト端子に入力し、ラツ
チされる。この結果、トラツク零検出を示す信号がフリ
ツプフロツプ(66)のQ出力端子から送出される。な
お、高レベルのQ出力はそのまま伝送されず、NANDゲー
ト(68)を介して低レベル形式で送り出される。即ち、
このNANDゲート(68)及び第2のフリツプフロツプ(6
7)の出力ラインのNANDゲート(69)は、ドライブセレ
クト信号を入力としているので、高レベルのドライブセ
レクト信号が発生している場合のみ、トラツク零を示す
低レベルの出力がNANDゲート(68)から得られ、これが
ホスト側装置に送られる。また、発光ダイオード(19)
が発光していない期間には、ANDゲート(63)の出力が
低レベルであるので、例えライン(57)が高レベルにな
つても、ANDゲート(59)の出力は低レベルに保たれ
る。
Now, assuming that the output line (57) of the phototransistor (20) for detecting the track zero becomes high level during the period of t 1 to t 3 in FIG. 6 and the track zero of the head is detected, the AND gate (59). Generates a high level output indicating track zero detection within the period t 1 d to t 3 shown in FIG.
It is input to the set terminal of the flip-flop (66) and latched. As a result, a signal indicating the detection of track zero is sent from the Q output terminal of the flip-flop (66). The high-level Q output is not transmitted as it is, but is sent out in a low-level format via the NAND gate (68). That is,
This NAND gate (68) and the second flip-flop (6
Since the NAND gate (69) of the output line of 7) receives the drive select signal as an input, the low level output indicating the track zero is output only when the high level drive select signal is generated. , Which is sent to the host-side device. Also, light-emitting diodes (19)
Since the output of the AND gate (63) is at a low level during the period when is not emitting light, the output of the AND gate (59) is kept at a low level even if the line (57) is at a high level. .

フリツプフロツプ(66)のリセツト端子にはANDゲート
(60)の出力端が接続され、ANDゲート(60)の一方の
入力端子はNOT回路(64)を介してコレクタライン(5
7)に接続され、他方の入力端子はANDゲート(63)の出
力端子に接続されているために、ANDゲート(63)の出
力が高レベルであり、且つライン(57)が低レベルの時
に、ANDゲート(60)の出力が高レベルとなり、フリツ
プフロツプ(66)がリセツトされる。従つて、発光ダイ
オード(19)の発光期間にトラツク零が検出されない場
合は、フリツプフロツプ(66)が必ずリセツトされる。
The output terminal of the AND gate (60) is connected to the reset terminal of the flip-flop (66), and one input terminal of the AND gate (60) is connected to the collector line (5) via the NOT circuit (64).
7) and the other input terminal is connected to the output terminal of the AND gate (63), the output of the AND gate (63) is high level and the line (57) is low level. , The output of the AND gate (60) becomes high level, and the flip-flop (66) is reset. Therefore, when the track zero is not detected during the light emitting period of the light emitting diode (19), the flip-flop (66) is always reset.

書き込み禁止検出回路におけるANDゲート(61)の一方
の入力端子はNOT回路(65)を介してホトトランジスタ
(22)のコレクタライン(58)に接続され、他方の入力
端子はANDゲート(63)の出力端子に接続されている。
従つて、発光ダイオード(21)が発光している期間にコ
レクタライン(58)が低レベルになると、ANDゲート(6
1)から高レベルの書き込み禁止を示す信号が得られ、
これがフリツプフロツプ(67)のリセツト端子に供給さ
れ、保持される。なお、発光ダイオード(21)が発光し
ていない期間にはANDゲート(63)の出力が低レベルで
あるので、例えライン(58)が低レベルになつても、AN
Dゲート(61)の出力は低レベルに保たれる。フリツプ
フロツプ(67)がセツトされると、Q出力端子から高レ
ベル出力が得られ、NANDゲート(69)を介してホスト側
装置に低レベル形式で書き込み禁止信号を送る。フリツ
プフロツプ(67)のリセツト端子にはANDゲート(62)
の出力端子が接続され、このANDゲート(62)の一方の
入力端子はライン(58)に、他方の入力端子はANDゲー
ト(63)の出力端子に接続されているので、ANDゲート
(63)の出力が高レベルの期間にライン(58)が高レベ
ルになつた時に、フリツプフロツプ(67)にリセツト信
号が供給される。
One input terminal of the AND gate (61) in the write protection detection circuit is connected to the collector line (58) of the phototransistor (22) via the NOT circuit (65), and the other input terminal of the AND gate (63) is connected. It is connected to the output terminal.
Therefore, if the collector line (58) becomes low level while the light emitting diode (21) is emitting light, the AND gate (6
1) gives a high level write inhibit signal,
This is supplied to and held by the reset terminal of the flip-flop (67). Note that the output of the AND gate (63) is at a low level while the light emitting diode (21) is not emitting light, so even if the line (58) goes low,
The output of the D gate (61) is kept low. When the flip-flop (67) is set, a high level output is obtained from the Q output terminal, and a write inhibit signal is sent in a low level format to the host side device via the NAND gate (69). AND gate (62) on reset terminal of flip-flop (67)
Of the AND gate (62) is connected to the line (58) and the other input terminal is connected to the output terminal of the AND gate (63). The reset signal is supplied to the flip-flop (67) when the line (58) becomes high level during the period when the output of is high level.

書き込み禁止(フアイルプロテクト)のカートリツジで
あるか、否かの検出は、少なくともデイスク装置からレ
デイ信号発生までの間に行う必要がある。第5図におい
て、(70)はデイスク装填検出回路であり、第3図に示
した発光ダイオード(23)とホトトランジスタ(24)と
を含み、デイスク(2)を含むカートリツジ(1)が装
填された時に第6図(F)に示す如く高レベルの出力を
発生するように形成されている。このデイスク装填検出
回路(70)の出力ラインに接続されたT6=80msの遅延回
路(71)は、カートリツジ(1)の完全な挿入状態が得
られる時点t5を求めるためのものであり、第6図(F)
の信号をT6=80msだけ遅延した信号を出力する。第2の
タイマ(72)は遅延回路(71)の出力が低レベルから高
レベルに立上る時点でトリガされ、T7=40msの高レベル
パルスを第6図(J)に示す如く出力し、これをORゲー
ト(46)に供給するものである。従つて、このt5〜t6
間においても、発光ダイオード(19)(21)が点灯し、
書き込み禁止の検出及びトラツク零の検出が行われる。
It is necessary to detect whether the cartridge is a write-protected (fail protect) cartridge or not at least between the disk device and the ready signal generation. In FIG. 5, reference numeral (70) denotes a disk loading detection circuit, which includes the light emitting diode (23) and the phototransistor (24) shown in FIG. 3, and is loaded with the cartridge (1) including the disk (2). It is formed so as to generate a high level output as shown in FIG. 6 (F). The delay circuit (71) of T 6 = 80 ms connected to the output line of the disk loading detection circuit (70) is for determining the time point t 5 at which the complete insertion state of the cartridge (1) is obtained, Fig. 6 (F)
The signal of is delayed by T 6 = 80 ms and is output. The second timer (72) is triggered when the output of the delay circuit (71) rises from a low level to a high level, and outputs a high level pulse of T 7 = 40 ms as shown in FIG. 6 (J). This is supplied to the OR gate (46). Therefore, even in this t 5 to t 6 period, the light emitting diodes (19) (21) are lit,
The write protection and the track zero are detected.

(73)はRSフリツプフロツプであり、デイスク装填検出
回路(70)の出力でセツトされ、第3図に示したレデイ
検出回路(30)から得られる第6図(I)の高レベルの
レデイ検出信号でリセツトされる。この結果、フリツプ
フロツプ(73)のQ出力は、第6図のt4〜t9期間で高レ
ベルとなり、これがORゲート(74)の入力となる。ORゲ
ート(74)のもう一方の入力はモータオン信号ライン
(75)に接続されている。この結果、ライン(75)から
供給される第6図(G)に示すt10以後の高レベルのモ
ータオン信号とt4〜t9期間のフリツプフロツプ(73)の
高レベル出力との和の信号がORゲート(74)の出力段に
第6図(H)に示す如く得られる。ORゲート(74)の出
力はモータ駆動回路(76)を介してデイスク回転用モー
タ(12)の回転駆動に利用されるので、モータ(12)
は、t4〜t9期間、及びt10以後で回転する。デイスク装
填と同時にデイスク(2)を回転する理由は、デイスク
(2)の確実な装着状態を早めに得るためである。な
お、カートリツジ(1)が挿入されている状態で電源オ
ン検出信号が得られた時にも、電源オン検出に同期して
t4〜t9期間と同様にデイスク(2)を回転するように構
成されている。
(73) is an RS flip-flop, which is set by the output of the disk loading detection circuit (70) and is obtained from the ready detection circuit (30) shown in FIG. Is reset. As a result, Q output of the flip-flop (73), at t 4 ~t 9 period of Figure 6 goes high, which is the input of the OR gate (74). The other input of the OR gate (74) is connected to the motor on signal line (75). As a result, the sum signal of the high level output of the line a of FIG. 6 (G) to indicate t 10 after a high level of motor on signal and t supplied from (75) 4 ~t 9 period of flip-flops (73) It is obtained at the output stage of the OR gate (74) as shown in FIG. 6 (H). The output of the OR gate (74) is used to drive the rotation of the disk rotation motor (12) via the motor drive circuit (76).
Rotates at t 4 ~t 9 period, and t 10 after. The reason for rotating the disk (2) at the same time as loading the disk is to obtain a reliable mounted state of the disk (2) early. Even when the power-on detection signal is obtained while the cartridge (1) is inserted, it is synchronized with the power-on detection.
It is configured to rotate the disk (2) as with t 4 ~t 9 periods.

ANDゲート(77)の一方の入力端子はデイスク装填検出
回路(70)の出力に接続され、他方の入力端子はORゲー
ト(74)の出力端子に接続されている。従つて、第6図
(F)に示す高レベルのデイスク装填検出信号が発生し
且つ第6図(H)に示すORゲート(74)の出力が高レベ
ルになる期間のみANDゲート(77)の出力は高レベルと
なる。なお、第6図のタイミングチャートの場合には、
ANDゲート(77)の出力状態は、第6図(H)のORゲー
ト(74)の出力状態と一致する。遅延回路(78)は、AN
Dゲート(77)の出力をT4=320msだけ遅延する回路であ
る。即ち、t4時点から320ms後のt7時点、及びt10時点か
ら320ms後のt11時点を決めるものである。遅延回路(7
8)の出力に接続された第3のタイマ(79)は、遅延回
路(78)の出力が低レベルから高レベルに立上る時点t7
及びt11でトリガされてT5=100msのパルスを第6図
(K)で示す如く発生し、これをORゲート(46)に供給
するものである。従つて、発光ダイオード(19)(21)
は、t7〜t8期間、及びt11〜t12期間でも点灯する。この
ように、デイスク(2)の回転開始から320ms後に、約1
00msだけ発光ダイオード(19)(21)を発光させる理由
は、デイスク(2)の回転が開始し、カートリツジ
(1)が安定した状態で、書き込み禁止状態を検出する
必要があるためである。
One input terminal of the AND gate (77) is connected to the output of the disk loading detection circuit (70), and the other input terminal is connected to the output terminal of the OR gate (74). Accordingly, the AND gate (77) of the AND gate (77) is operated only while the high level disk loading detection signal shown in FIG. 6 (F) is generated and the output of the OR gate (74) shown in FIG. 6 (H) is at the high level. The output goes high. In the case of the timing chart of FIG. 6,
The output state of the AND gate (77) matches the output state of the OR gate (74) in FIG. 6 (H). Delay circuit (78) is AN
This circuit delays the output of the D gate (77) by T 4 = 320ms. That is, it determines the time point t 7 320 ms after the time point t 4 and the time point t 11 320 ms after the time point t 10 . Delay circuit (7
The third timer (79) connected to the output of 8) is at time t 7 when the output of the delay circuit (78) rises from the low level to the high level.
And t 11 to generate a pulse of T 5 = 100 ms as shown in FIG. 6 (K), which is supplied to the OR gate (46). Therefore, light emitting diodes (19) (21)
Also turned on at the t 7 ~t 8 period, and t 11 ~t 12 period. Thus, about 320 ms after the start of rotation of the disk (2), about 1
The reason why the light emitting diodes (19) and (21) are made to emit light for 00 ms is that it is necessary to detect the write-inhibited state when the rotation of the disk (2) is started and the cartridge (1) is stable.

上述から明らかな如く本実施例によつて次の作用効果が
得られる。
As is apparent from the above, according to this embodiment, the following operational effects can be obtained.

(A) 第6図のt1〜t3、t5〜t6、t7〜t8、t11〜t12
t14〜t15期間で発光ダイオード(19)(21)が発光する
のみであるから、発光ダイオード(19)(21)及びホト
トランジスタ(20)(22)の回路における大幅な節電が
達成される。
(A) t 1 to t 3 , t 5 to t 6 , t 7 to t 8 , t 11 to t 12 , in FIG.
Since the light emitting diodes (19) (21) only emit light in the period of t 14 to t 15 , a significant power saving in the circuits of the light emitting diodes (19) (21) and the phototransistors (20) (22) is achieved. .

(B) t1〜t3期間で発光ダイオード(19)(21)を発
光するので、電源投入時のトラツク零検出、及びデイス
ク装填中の場合には書き込み禁止の検出を確実に行うこ
とが出来る。
(B) Since the light emitting diodes (19) and (21) emit light in the period of t 1 to t 3 , it is possible to surely detect the track zero when the power is turned on and the write inhibition when the disk is loaded. .

(C) デイスク装填後のt5〜t6期間のみでなく、t7
t8、t11〜t12期間でも発光ダイオード(19)(21)を発
光させるので、書き込み禁止状態を確実に検出すること
が出来る。
(C) Not only the period from t 5 to t 6 after loading the disk, but from t 7 to
Since t 8, t 11 ~t emitting diode (19) in 12 periods (21) to emit light, it is possible to reliably detect a write-protected state.

(D) t13〜t14期間に示す如く、第6図(C)に示す
ステツプ方向信号をステツプアウトを示す高レベル状態
とし、第6図(D)に示す如く、第4相φ、第3相φ
、第2相φ、第1相φの順で励磁し、ヘツド(1
3)(14)をトラツク零位置に移動した場合において
も、t14〜t15に示す期間で発光ダイオード(19)(21)
が発光するので、トラツク零を検出し、これをフリツプ
フロツプ(16)でラツチすることが出来る。
(D) as shown in t 13 ~t 14 period, a step direction signal shown in FIG. 6 (C) to a high level state indicating step-out, as shown in FIG. 6 (D), the fourth phase phi 4, Third phase φ
3 , the second phase φ 2 and the first phase φ 1 are excited in this order, and the head (1
3) Even when the (14) is moved to the track zero position, the light emitting diode (19) (21) remains in the period shown from t 14 to t 15.
Emits light, so it is possible to detect the track zero and latch it with the flip-flop (16).

(E) 発光ダイオード(19)(21)の発光時間と、AN
Dゲート(59)〜(62)からセツト又はリセツト信号を
得る時間との関係を第7図のように設定したので、発光
ダイオード(19)(21)の発光開始及び終了時の不安定
期間を除いて、トラツク例検出及び書き込み禁止検出を
行うことが出来る。
(E) Light emitting time of the light emitting diodes (19) and (21) and AN
Since the relationship with the time to obtain the set or reset signal from the D gates (59) to (62) is set as shown in FIG. 7, the unstable period at the start and end of light emission of the light emitting diodes (19) (21) is Except for this, it is possible to detect a track example and a write protection.

(F) トラツク零検出のための発光ダイオード(19)
の発光時間の設定を特別な回路で行わずに、トラツク零
検出に必要な、第1相励磁信号とステツプアウト方向信
号とが入力するANDゲート(53)に基づいて行つている
ので、回路構成が簡単になつている。
(F) Light emitting diode for detecting zero track (19)
Since the light emission time of is not set by a special circuit, it is performed based on the AND gate (53) to which the first phase excitation signal and the step-out direction signal necessary for the track zero detection are input. Is getting easier.

(G) 発光ダイオード(19)と(21)とを直列に接続
したので、駆動回路が簡略化されている。
(G) Since the light emitting diodes (19) and (21) are connected in series, the drive circuit is simplified.

変形例 本発明は上述の実施例に限定されるものではなく、例え
ば次の変形例が可能なものである。
Modifications The present invention is not limited to the above-described embodiments, and the following modifications are possible, for example.

(a) 発光ダイオード(19)と(21)との駆動回路を
独立に設け、発光ダイオード(19)の駆動回路には、タ
イマ(44)及びANDゲート(53)の出力を供給し、発光
ダイオード(21)の駆動回路にはタイマ(72)(79)の
出力を供給するようにしてもよい。
(A) A driving circuit for the light emitting diodes (19) and (21) is provided independently, and the driving circuit for the light emitting diode (19) is supplied with the outputs of the timer (44) and the AND gate (53). The output of the timers (72) and (79) may be supplied to the drive circuit of (21).

(b) トラツク零の時にホトトランジスタ(20)に光
入力が与えられるようになし、また書き込み禁止の時に
ホトトランジスタ(22)の光入力を遮断するように構成
してもよい。
(B) An optical input may be applied to the phototransistor (20) when the track is zero, and an optical input to the phototransistor (22) may be blocked when the write is prohibited.

(c) タイマ(72)と(79)とのいずれか一方のみの
出力をORゲート(46)に送るように構成してもよい。
(C) The output of only one of the timers (72) and (79) may be sent to the OR gate (46).

(d) デイスク装填に応答してt4〜t9期間でデイスク
(2)を回転させない形式の装置にも勿論適用可能であ
る。
(D) Of course, it can be applied to an apparatus of the type in which the disk (2) is not rotated in the period of t 4 to t 9 in response to the disk loading.

(e) 可撓性磁気デイスク装置に限らず、固定磁気デ
イスク装置、及びその他の種々のデイスク装置に適用可
能である。また、可撓性ケースに磁気デイスクを挿入し
た一般にミニフロツピーデイスクと呼ばれているカート
リツジを使用する装置にも適用可能である。
(E) The present invention can be applied not only to the flexible magnetic disk device but also to a fixed magnetic disk device and various other disk devices. Further, it is also applicable to an apparatus using a cartridge which is generally called a mini floppy disk in which a magnetic disk is inserted in a flexible case.

【図面の簡単な説明】[Brief description of drawings]

第1図〜第7図は本発明の実施例に係わる磁気デイスク
装置を説明するためのものであり、第1図は磁気デイス
クカートリツジの平面図、第2図は第1図のカートリツ
ジの底面図、第3図は磁気デイスク装置の主要部を原理
的に示す正面図、第4図はステツピングモータ及びその
駆動回路を示す回路図、第5図は磁気デイスク装置の電
気回路部分を示すブロツク図、第6図及び第7図は第5
図のA〜P点の状態を示す波形図である。 (1)……カートリツジ、(2)……磁気デイスク、
(3)……ケース、(9)……書き込み禁止被検出部、
(9a)……窓、(9b)……蓋、(12)……デイスク回転
用モータ、(13)(14)……磁気ヘツド、(16)……ス
テツピングモータ、(19)……トラツク零検出用発光ダ
イオード、(20)……トラツク零検出用ホトトランジス
タ、(21)……書き込み禁止検出用発光ダイオード、
(22)……書き込み禁止検出用ホトトランジスタ、(3
9)……スイツチングトランジスタ、(44)……第1の
タイマ、(72)……第2のタイマ。
1 to 7 are for explaining a magnetic disk device according to an embodiment of the present invention. FIG. 1 is a plan view of a magnetic disk cartridge, and FIG. 2 is a bottom surface of the cartridge of FIG. 3 and 4 are front views showing principal parts of the magnetic disk device in principle, FIG. 4 is a circuit diagram showing a stepping motor and its drive circuit, and FIG. 5 is a block diagram showing an electric circuit part of the magnetic disk device. Figures 5, 6 and 7 are the fifth
It is a wave form diagram which shows the state of A-P point of a figure. (1) …… Cartridge, (2) …… Magnetic disk,
(3) …… Case, (9) …… Write-protected detected part,
(9a) …… Window, (9b) …… Lid, (12) …… Disk rotation motor, (13) (14) …… Magnetic head, (16) …… Stepping motor, (19) …… Track Zero-detecting light-emitting diode, (20) …… Track zero-detecting phototransistor, (21) …… Write-protection detecting light-emitting diode,
(22) …… Phototransistor for detecting write protection, (3
9) ... Switching transistor, (44) ... first timer, (72) ... second timer.

フロントページの続き (72)発明者 当麻 省三 東京都武蔵野市中町3丁目7番3号 テイ アツク株式会社内 (72)発明者 平木 和裕 東京都武蔵野市中町3丁目7番3号 テイ アツク株式会社内 (72)発明者 森田 努 東京都武蔵野市中町3丁目7番3号 テイ アツク株式会社内 (56)参考文献 特開 昭59−139174(JP,A)Front Page Continuation (72) Inventor Shozo Toma 3-7-3 Nakamachi, Musashino-shi, Tokyo Within TAITSUKU Co., Ltd. (72) Inventor Kazuhiro Hiraki 3-7-3 Nakamachi, Musashino-shi, Tokyo TAI ATSK Co., Ltd. In (72) Inventor Tsutomu Morita 3-7-3 Nakamachi, Musashino-shi, Tokyo Inside Tetsuku Co., Ltd. (56) Reference JP-A-59-139174 (JP, A)

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】ケースに記録媒体ディスクが収容され且つ
前記ケースに前記ディスクに対する情報の書き込みを禁
止するか否かを光学的に判別するための書き込み禁止被
検出部が設けられているディスクカートリッジを使用し
て情報の変換を行う装置であり、 前記ディスクを回転するためのディスク回転機構と、 前記ディスクの回転中に前記ディスクとの間で情報の変
換を行うための変換器と、 前記変換器を前記ディスクのトラック交差方向に移動さ
せるための変換器移動機構と、 前記書き込み禁止被検出部を光学的に検出するために、
前記回転機構に対する前記カードリッジの正常装填状態
において前記書き込み禁止被検出部に対応するように配
置された書き込み禁止検出用発光素子と、 前記書き込み禁止被検出部を検出するために前記発光素
子に対応配置された受光素子と、 前記発光素子を選択的に発光させるために前記発光素子
の電源ラインに接続されたスイッチと、 前記ディスクの回転駆動開始時点から前記ディスクがほ
ぼ正常な回転状態になるレデイ時点までの期間内に設定
された所定期間に前記発光素子を発光させ、前記所定期
間の終了時点で前記発光素子の発光を停止させるように
前記スイッチを制御するスイッチ制御回路と を具備しているディスク装置。
1. A disc cartridge in which a recording medium disc is housed in a case, and a write-inhibited detection portion is provided in the case for optically determining whether or not writing of information to the disc is prohibited. A device for converting information by using the disk rotating mechanism for rotating the disk, a converter for converting information between the disk while the disk is rotating, and the converter. A converter moving mechanism for moving the disk in the track crossing direction of the disk, and for optically detecting the write-inhibited detected portion,
A write-protection detecting light-emitting element arranged so as to correspond to the write-inhibition detected portion in a state where the cartridge is normally loaded in the rotation mechanism, and corresponds to the light-emitting element for detecting the write-inhibition detected portion. A light-receiving element arranged, a switch connected to a power line of the light-emitting element to selectively cause the light-emitting element to emit light, and a ready-to-use disk that is in a substantially normal rotation state from the start of rotational driving of the disk. A switch control circuit for controlling the switch so that the light emitting element is caused to emit light for a predetermined period set within a period until the time point and the light emission of the light emitting element is stopped at the end point of the predetermined period. Disk device.
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