JPH06303552A - 多重化・分離制御回路 - Google Patents
多重化・分離制御回路Info
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- JPH06303552A JPH06303552A JP5085948A JP8594893A JPH06303552A JP H06303552 A JPH06303552 A JP H06303552A JP 5085948 A JP5085948 A JP 5085948A JP 8594893 A JP8594893 A JP 8594893A JP H06303552 A JPH06303552 A JP H06303552A
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Abstract
(57)【要約】
【目的】 映像信号に対する音声信号の遅延を０に保つ
多重化・分離回路を実現する。 【構成】 映像信号の特定のラインにおいて、映像信号
ａと音声信号ｂの遅延が規定値になるように映像遅延器
１０１、音声遅延器１０３にて調整した上で音声信号デ
ータを映像信号に多重化回路１０２にて多重化し、ま
た、分離制御装置においては前記特定ラインにおける映
像信号と音声信号の遅延量を基準にして映像信号と音声
信号の遅延量を映像遅延器１０８、音声遅延器１０９に
て調整し、両者の同時性を回復する。あらかじめこの特
定のラインもしくは遅延量を固定することが困難な場合
には、前記特定映像ラインと規定遅延量の少なくとも一
方を音声データとは別に映像信号に多重化して伝送し、
これらを用いて、映像信号と音声信号との遅延量を調整
し、両者の同時性を回復する。
多重化・分離回路を実現する。 【構成】 映像信号の特定のラインにおいて、映像信号
ａと音声信号ｂの遅延が規定値になるように映像遅延器
１０１、音声遅延器１０３にて調整した上で音声信号デ
ータを映像信号に多重化回路１０２にて多重化し、ま
た、分離制御装置においては前記特定ラインにおける映
像信号と音声信号の遅延量を基準にして映像信号と音声
信号の遅延量を映像遅延器１０８、音声遅延器１０９に
て調整し、両者の同時性を回復する。あらかじめこの特
定のラインもしくは遅延量を固定することが困難な場合
には、前記特定映像ラインと規定遅延量の少なくとも一
方を音声データとは別に映像信号に多重化して伝送し、
これらを用いて、映像信号と音声信号との遅延量を調整
し、両者の同時性を回復する。
Description
【０００１】
【産業上の利用分野】本発明は、デジタル映像信号の同
期期間にデジタル音声信号を多重化して伝送する伝送方
式に於ける多重化及び分離回路に関するものである。
期期間にデジタル音声信号を多重化して伝送する伝送方
式に於ける多重化及び分離回路に関するものである。
【０００２】
【従来の技術】デジタル映像信号にデジタル音声信号を
多重化して伝送する伝送方式として、デジタル映像信号
の水平及び垂直同期期間にデジタル音声信号を時間軸多
重して伝送する方法があり、デジタル映像機器間のイン
タフェースとして規格化作業が進んでいる（ＳＭＰＴＥ
２５９Ｍ）。
多重化して伝送する伝送方式として、デジタル映像信号
の水平及び垂直同期期間にデジタル音声信号を時間軸多
重して伝送する方法があり、デジタル映像機器間のイン
タフェースとして規格化作業が進んでいる（ＳＭＰＴＥ
２５９Ｍ）。
【０００３】このような伝送方式においては、映像信号
１ライン間に入力した音声信号を次あるいはそれ以降の
水平同期期間に多重化して伝送するため、音声信号のバ
ッファＲＡＭが必要になる。コンポジット映像信号に於
いては、同期信号期間のシンクチップレベル部分に音声
信号データの多重化を行うが、シンクチップレベル部分
が狭い等価パルス期間が存在し、この期間では一般的に
音声信号データの多重化を行わず、この期間に伝される
べき音声信号データを垂直同期期間にまとめて伝送する
為、図３に示すようにバッファＲＡＭ内の音声信号デー
タ量が大きく変動する。さらに、２４ビットの音声を伝
送する場合には、各水平同期期間には音声１チャンネル
につき３サンプルの音声データしか伝送するスペースが
なく、１水平ラインでの平均入力音声データ量が約３．
０５サンプルである事から、２０ラインに１サンプル分
の音声データがバッファＲＡＭに蓄えられ、これが垂直
同期期間にまとめて送られ、バッファＲＡＭのデータ量
変動はさらに大きくなる。また、コンポーネント映像信
号に於いても、映像信号のスイッチングを行うライン付
近では音声信号の多重化を行わないのが一般的であり、
やはりバッファＲＡＭ内の音声信号データ量に変動が生
じる。
１ライン間に入力した音声信号を次あるいはそれ以降の
水平同期期間に多重化して伝送するため、音声信号のバ
ッファＲＡＭが必要になる。コンポジット映像信号に於
いては、同期信号期間のシンクチップレベル部分に音声
信号データの多重化を行うが、シンクチップレベル部分
が狭い等価パルス期間が存在し、この期間では一般的に
音声信号データの多重化を行わず、この期間に伝される
べき音声信号データを垂直同期期間にまとめて伝送する
為、図３に示すようにバッファＲＡＭ内の音声信号デー
タ量が大きく変動する。さらに、２４ビットの音声を伝
送する場合には、各水平同期期間には音声１チャンネル
につき３サンプルの音声データしか伝送するスペースが
なく、１水平ラインでの平均入力音声データ量が約３．
０５サンプルである事から、２０ラインに１サンプル分
の音声データがバッファＲＡＭに蓄えられ、これが垂直
同期期間にまとめて送られ、バッファＲＡＭのデータ量
変動はさらに大きくなる。また、コンポーネント映像信
号に於いても、映像信号のスイッチングを行うライン付
近では音声信号の多重化を行わないのが一般的であり、
やはりバッファＲＡＭ内の音声信号データ量に変動が生
じる。
【０００４】従来、このバッファＲＡＭ内の音声データ
量の変動に対して、受信側では大きめのバッファＲＡＭ
を用意して図２に示す様な制御回路を用いていた。音声
の多重化されたデジタル映像信号Ａは、音声データ分離
回路１及び同期信号分離回路２に入力され、音声データ
分離回路１では音声データＢが、同期信号分離回路２で
は同期信号Ｃがそれぞれ検出分離される。音声データＢ
は音声データデフォーマッタ３で通常のパラレルデータ
Ｄにデフォーマットされ、書き込みクロックＥと共にバ
ッファＲＡＭ４に入力される。バッファＲＡＭ４はライ
トアドレスカウンタ４ａ、リードアドレスカウンタ４
ｂ、及びリード用とライト用の２つのポートを持つＲＡ
Ｍ４ｃとから構成され、書き込みクロックＥによってラ
イトアドレスカウンタ４ａが、また、読み出しクロック
Ｆによってリードアドレスカウンタ４ｂがそれぞれイン
クリメントされる。音声出力回路５は音声クロックＩに
同期してバッファＲＡＭ４からパラレル音声データＧを
読み出しクロックＦによって読み出し、ＡＥＳ／ＥＢＵ
等のフォーマットに変換してシリアルデジタル音声信号
Ｈとして出力する。
量の変動に対して、受信側では大きめのバッファＲＡＭ
を用意して図２に示す様な制御回路を用いていた。音声
の多重化されたデジタル映像信号Ａは、音声データ分離
回路１及び同期信号分離回路２に入力され、音声データ
分離回路１では音声データＢが、同期信号分離回路２で
は同期信号Ｃがそれぞれ検出分離される。音声データＢ
は音声データデフォーマッタ３で通常のパラレルデータ
Ｄにデフォーマットされ、書き込みクロックＥと共にバ
ッファＲＡＭ４に入力される。バッファＲＡＭ４はライ
トアドレスカウンタ４ａ、リードアドレスカウンタ４
ｂ、及びリード用とライト用の２つのポートを持つＲＡ
Ｍ４ｃとから構成され、書き込みクロックＥによってラ
イトアドレスカウンタ４ａが、また、読み出しクロック
Ｆによってリードアドレスカウンタ４ｂがそれぞれイン
クリメントされる。音声出力回路５は音声クロックＩに
同期してバッファＲＡＭ４からパラレル音声データＧを
読み出しクロックＦによって読み出し、ＡＥＳ／ＥＢＵ
等のフォーマットに変換してシリアルデジタル音声信号
Ｈとして出力する。
【０００５】一方同期信号Ｃは、フィールドタイミング
検出生回路６に入力され、映像信号のライン、フィール
ド、フレーム等が検出され、例えば音声フレーム周期
毎、即ち音声サンプリング数が正に整数となる映像フィ
ールド周期毎に１つのパルスがフィールドタイミング信
号Ｊとして出力される。アドレス差計算回路７では、リ
ードアドレスカウンタ４ａからのリードアドレスＫとラ
イトアドレスカウンタ４ｂからのライトアドレスＬのア
ドレス差（Ｌ−Ｋ）を計算し、バッファＲＡＭデータ量
検査回路８では、フィールドタイミングＪのタイミング
でアドレス差（Ｌ−Ｋ）が外部より設定された規定値Ｐ
と異なる場合には、リードアドレスカウンタ４ｂにプリ
セットパルスＭを出力する。これにより、リードアドレ
ス設定回路９にて計算されたライトアドレスＬから規定
値Ｐを引いたリードアドレスプリセット値Ｎが、リード
アドレスカウンタ４ｂにプリセットされる。これによっ
て、バッファＲＡＭ４内の有効音声信号データ量は規定
値に等しくなる。音声信号が映像信号に同期している限
り、以降の検査タイミングにおける音声信号データ量は
規定値に等しくなる。また、映像信号もしくは音声信号
のスイッチングが発生した場合には、スイッチング直後
の検査タイミングにてリードアドレスへのプリセットが
発生し、やはり以降の検査タイミングでは、バッファＲ
ＡＭ内の音声信号データ量は規定値に等しくなる。
検出生回路６に入力され、映像信号のライン、フィール
ド、フレーム等が検出され、例えば音声フレーム周期
毎、即ち音声サンプリング数が正に整数となる映像フィ
ールド周期毎に１つのパルスがフィールドタイミング信
号Ｊとして出力される。アドレス差計算回路７では、リ
ードアドレスカウンタ４ａからのリードアドレスＫとラ
イトアドレスカウンタ４ｂからのライトアドレスＬのア
ドレス差（Ｌ−Ｋ）を計算し、バッファＲＡＭデータ量
検査回路８では、フィールドタイミングＪのタイミング
でアドレス差（Ｌ−Ｋ）が外部より設定された規定値Ｐ
と異なる場合には、リードアドレスカウンタ４ｂにプリ
セットパルスＭを出力する。これにより、リードアドレ
ス設定回路９にて計算されたライトアドレスＬから規定
値Ｐを引いたリードアドレスプリセット値Ｎが、リード
アドレスカウンタ４ｂにプリセットされる。これによっ
て、バッファＲＡＭ４内の有効音声信号データ量は規定
値に等しくなる。音声信号が映像信号に同期している限
り、以降の検査タイミングにおける音声信号データ量は
規定値に等しくなる。また、映像信号もしくは音声信号
のスイッチングが発生した場合には、スイッチング直後
の検査タイミングにてリードアドレスへのプリセットが
発生し、やはり以降の検査タイミングでは、バッファＲ
ＡＭ内の音声信号データ量は規定値に等しくなる。
【０００６】
【発明が解決しようとする課題】このような構成の多重
化分離制御回路では、どの映像ラインにどれだけのサン
プル数の音声データが多重化されているかという音声デ
ータの多重化のマッピングによって、送信側と受信側を
合わせたトータルでの遅延時間に変動が生じてしまう。
化分離制御回路では、どの映像ラインにどれだけのサン
プル数の音声データが多重化されているかという音声デ
ータの多重化のマッピングによって、送信側と受信側を
合わせたトータルでの遅延時間に変動が生じてしまう。
【０００７】例えば、ある映像ラインの先頭にてバッフ
ァＲＡＭ容量検査を行った場合を考える。図４に、垂直
同期期間以外の各映像ラインに各々３サンプルずつの音
声データを多重化したマッピングにてデータが送られて
きたときのバッファＲＡＭ容量の変化の様子をＡ、同じ
く垂直同期期間以外の各映像ラインに各々３サンプルま
たは４サンプルずつの音声データを多重化したマッピン
グにてデータが送られてきたときのバッファＲＡＭ容量
の変化の様子をＢで示した。
ァＲＡＭ容量検査を行った場合を考える。図４に、垂直
同期期間以外の各映像ラインに各々３サンプルずつの音
声データを多重化したマッピングにてデータが送られて
きたときのバッファＲＡＭ容量の変化の様子をＡ、同じ
く垂直同期期間以外の各映像ラインに各々３サンプルま
たは４サンプルずつの音声データを多重化したマッピン
グにてデータが送られてきたときのバッファＲＡＭ容量
の変化の様子をＢで示した。
【０００８】このようにマッピングによって、バッファ
ＲＡＭ容量の変化の山と谷の高低や位置がかわってしま
うため、受信側の分離装置にてある映像ラインにおける
遅延時間を一定にしたとしても送受信トータルでの遅延
時間は未知数のままである。
ＲＡＭ容量の変化の山と谷の高低や位置がかわってしま
うため、受信側の分離装置にてある映像ラインにおける
遅延時間を一定にしたとしても送受信トータルでの遅延
時間は未知数のままである。
【０００９】また、ライトアドレスとリードアドレスと
の衝突のみを検出し、衝突時にリードアドレスをライト
アドレスより遅らせる通常のバッファＲＡＭ制御では、
バッファＲＡＭを有効に使用することができるが、バッ
ファＲＡＭ内の音声データ量は不定となってしまい、従
って、映像信号と音声信号の遅延時間は接続の度毎に変
化してしまう。
の衝突のみを検出し、衝突時にリードアドレスをライト
アドレスより遅らせる通常のバッファＲＡＭ制御では、
バッファＲＡＭを有効に使用することができるが、バッ
ファＲＡＭ内の音声データ量は不定となってしまい、従
って、映像信号と音声信号の遅延時間は接続の度毎に変
化してしまう。
【００１０】本発明は上記の問題を鑑みてなされたもの
で、映像信号と音声信号の同時性の回復を容易にするこ
とを目的とする。
で、映像信号と音声信号の同時性の回復を容易にするこ
とを目的とする。
【００１１】
【課題を解決するための手段】この目的を達成するため
に本発明では、デジタル映像信号の同期信号期間に映像
信号に同期したデジタル音声信号を多重化して伝送する
伝送装置に於いて、映像信号の特定のラインにおいて、
映像信号と音声信号の遅延が規定値になるように音声信
号データを多重化し、また、分離制御装置においては前
記特定ラインにおける映像信号と音声信号の遅延量を基
準にして映像信号と音声信号の遅延量を調整し、両者の
同時性を回復する。
に本発明では、デジタル映像信号の同期信号期間に映像
信号に同期したデジタル音声信号を多重化して伝送する
伝送装置に於いて、映像信号の特定のラインにおいて、
映像信号と音声信号の遅延が規定値になるように音声信
号データを多重化し、また、分離制御装置においては前
記特定ラインにおける映像信号と音声信号の遅延量を基
準にして映像信号と音声信号の遅延量を調整し、両者の
同時性を回復する。
【００１２】あらかじめこの特定のラインもしくは遅延
量を固定する事が困難な場合には、前記特定映像ライン
と規定遅延量の少なくとも一方を音声データとは別に映
像信号に多重化して伝送し、これらを用いて、映像信号
と音声信号との遅延量を調整し、両者の同時性を回復す
る。
量を固定する事が困難な場合には、前記特定映像ライン
と規定遅延量の少なくとも一方を音声データとは別に映
像信号に多重化して伝送し、これらを用いて、映像信号
と音声信号との遅延量を調整し、両者の同時性を回復す
る。
【００１３】
【作用】上記の手段により、本発明によれば、音声デー
タのマッピングに関わらず映像信号に対する音声信号の
遅れを一定に保つことができ、映像信号と音声信号の同
時性の回復を容易にすることができる。
タのマッピングに関わらず映像信号に対する音声信号の
遅れを一定に保つことができ、映像信号と音声信号の同
時性の回復を容易にすることができる。
【００１４】
【実施例】以下、本発明の実施例を説明する。
【００１５】図１は本発明の一実施例に係る多重化・分
離制御回路のブロック図である。送信側に於いては、映
像信号ａは一定の遅延量を持つ映像遅延器１０１を通っ
て、映像音声多重化回路１０２に入力される。一方、音
声信号ｂは遅延量を可変出来る音声遅延器１０３を通っ
て、映像音声多重化回路１０２に入力され、映像信号に
多重化される。また、遅延量を規定すべき映像ライン位
置データｃは、映像音声多重化回路１０２に入力され
る。さらに、規定遅延量ｄは音声遅延器１０３及び映像
音声多重化回路１０２に入力される。
離制御回路のブロック図である。送信側に於いては、映
像信号ａは一定の遅延量を持つ映像遅延器１０１を通っ
て、映像音声多重化回路１０２に入力される。一方、音
声信号ｂは遅延量を可変出来る音声遅延器１０３を通っ
て、映像音声多重化回路１０２に入力され、映像信号に
多重化される。また、遅延量を規定すべき映像ライン位
置データｃは、映像音声多重化回路１０２に入力され
る。さらに、規定遅延量ｄは音声遅延器１０３及び映像
音声多重化回路１０２に入力される。
【００１６】映像音声多重化回路１０２では、例えば図
２に示した従来例と同様の方法によって、即ち、映像ラ
イン位置データｃによって規定された映像ラインにおけ
るバッファＲＡＭ内の音声データ量を一定に保つという
方法によって、このラインにおける音声遅延時間をある
一定値に保ちながら、音声信号ｂ’を映像信号ａ’に多
重化する。音声遅延器１０３では、多重化後の伝送デー
タｇの映像ライン位置データｃによって規定された映像
ラインにおける音声信号の映像信号に対する遅延時間が
規定遅延量ｄになるように音声遅延量を可変する。つま
り、映像遅延器１０１による遅延量と規定遅延量ｄとの
和が、音声遅延器１０３による遅延と映像音声多重化回
路１０２による特定ラインでの遅延との和に等しくなる
ように音声遅延器１０３の遅延量を設定するわけであ
る。
２に示した従来例と同様の方法によって、即ち、映像ラ
イン位置データｃによって規定された映像ラインにおけ
るバッファＲＡＭ内の音声データ量を一定に保つという
方法によって、このラインにおける音声遅延時間をある
一定値に保ちながら、音声信号ｂ’を映像信号ａ’に多
重化する。音声遅延器１０３では、多重化後の伝送デー
タｇの映像ライン位置データｃによって規定された映像
ラインにおける音声信号の映像信号に対する遅延時間が
規定遅延量ｄになるように音声遅延量を可変する。つま
り、映像遅延器１０１による遅延量と規定遅延量ｄとの
和が、音声遅延器１０３による遅延と映像音声多重化回
路１０２による特定ラインでの遅延との和に等しくなる
ように音声遅延器１０３の遅延量を設定するわけであ
る。
【００１７】遅延データフォーマッタ１０４では、映像
ライン位置データｃ及び規定遅延量ｄを映像信号に多重
化できるようなフォーマットに変換し、遅延データ多重
化回路１０５によってこの遅延データｆが音声信号の多
重化された映像信号ｅに多重化され、伝送データｇとな
る。
ライン位置データｃ及び規定遅延量ｄを映像信号に多重
化できるようなフォーマットに変換し、遅延データ多重
化回路１０５によってこの遅延データｆが音声信号の多
重化された映像信号ｅに多重化され、伝送データｇとな
る。
【００１８】受信側では、伝送データｇは映像音声分離
回路１０６に入力され、映像信号ｈと音声信号ｉに分離
される。映像信号ｈは一定の遅延量をもつ映像遅延器１
０８にて一定時間の遅延を受けた後映像信号ｈ’として
出力される。また、伝送データｇから遅延データ分離回
路１０７において、映像ライン位置データｃ’と規定遅
延量ｄ’を分離する。映像ライン位置データｃ’は映像
音声分離回路１０６に入力され、例えば、この映像ライ
ン位置データｃ’にて規定されたライン位置におけるバ
ッファＲＡＭ内の音声データ量を一定とする、従来例に
て説明した方法等によって、このライン位置における映
像信号に対する音声遅延量を一定に保つ。
回路１０６に入力され、映像信号ｈと音声信号ｉに分離
される。映像信号ｈは一定の遅延量をもつ映像遅延器１
０８にて一定時間の遅延を受けた後映像信号ｈ’として
出力される。また、伝送データｇから遅延データ分離回
路１０７において、映像ライン位置データｃ’と規定遅
延量ｄ’を分離する。映像ライン位置データｃ’は映像
音声分離回路１０６に入力され、例えば、この映像ライ
ン位置データｃ’にて規定されたライン位置におけるバ
ッファＲＡＭ内の音声データ量を一定とする、従来例に
て説明した方法等によって、このライン位置における映
像信号に対する音声遅延量を一定に保つ。
【００１９】規定遅延量ｄ’は遅延量の可変可能な音声
遅延器１０９に入力され、この規定遅延量ｄ’をもとに
映像信号ｈ’と音声信号ｉ’との同時性が回復できるよ
うに遅延量が設定される。つまり、規定遅延量ｄ’に映
像音声分離回路１０６における映像ライン位置データ
ｃ’で規定された映像ラインでの遅延量と音声遅延器１
０９での遅延量を加えたものが、映像遅延器１０８にお
ける遅延量と等しくなる様に音声遅延器１０９の遅延量
が設定される。
遅延器１０９に入力され、この規定遅延量ｄ’をもとに
映像信号ｈ’と音声信号ｉ’との同時性が回復できるよ
うに遅延量が設定される。つまり、規定遅延量ｄ’に映
像音声分離回路１０６における映像ライン位置データ
ｃ’で規定された映像ラインでの遅延量と音声遅延器１
０９での遅延量を加えたものが、映像遅延器１０８にお
ける遅延量と等しくなる様に音声遅延器１０９の遅延量
が設定される。
【００２０】以上の構成によって、映像信号ｈ’と音声
信号ｉ’との同時性が、送信側の音声信号の多重化の仕
方によらずに確実に回復できる。
信号ｉ’との同時性が、送信側の音声信号の多重化の仕
方によらずに確実に回復できる。
【００２１】上記の説明では、送信側・受信側双方に映
像信号の遅延器を設けたが、映像信号の遅延器はどちら
か一方でもよく、音声信号の先読み等を行った場合な
ど、映像信号が音声信号より遅れるので有れば、必ずし
も遅延器は必要でない。また、音声遅延器１０２は必ず
しも必要ではなく、もちろん固定の遅延量でも良い。こ
れの場合には、伝送する規定遅延量ｆをそれに合わせて
変更すれば良い。
像信号の遅延器を設けたが、映像信号の遅延器はどちら
か一方でもよく、音声信号の先読み等を行った場合な
ど、映像信号が音声信号より遅れるので有れば、必ずし
も遅延器は必要でない。また、音声遅延器１０２は必ず
しも必要ではなく、もちろん固定の遅延量でも良い。こ
れの場合には、伝送する規定遅延量ｆをそれに合わせて
変更すれば良い。
【００２２】また、映像音声多重化回路・映像音声分離
回路の構成を、従来例と同様の方法によるものと説明し
たが、特定ラインにおける遅延量が一定となればこれに
限るものではない。さらに、特定ラインにおける遅延量
が一定にならない場合にも、特定ラインでの遅延量、即
ち、バッファＲＡＭ内の音声データ量が検出可能であれ
ば、この遅延量によっても音声遅延器１０９の遅延量を
可変させれば、即ち、映像音声分離回路にて検出された
遅延量と伝送された規定遅延量と音声遅延器による遅延
が映像遅延器による遅延と等しくなるように音声遅延器
による遅延を設定すれば、本発明は実現可能である。
回路の構成を、従来例と同様の方法によるものと説明し
たが、特定ラインにおける遅延量が一定となればこれに
限るものではない。さらに、特定ラインにおける遅延量
が一定にならない場合にも、特定ラインでの遅延量、即
ち、バッファＲＡＭ内の音声データ量が検出可能であれ
ば、この遅延量によっても音声遅延器１０９の遅延量を
可変させれば、即ち、映像音声分離回路にて検出された
遅延量と伝送された規定遅延量と音声遅延器による遅延
が映像遅延器による遅延と等しくなるように音声遅延器
による遅延を設定すれば、本発明は実現可能である。
【００２３】さらに、送信側、受信側であらかじめ特定
映像ライン位置、規定遅延量について規定しておけば、
映像ライン位置データｃ及び規定遅延量ｄの伝送は不要
であり、音声遅延器の可変も必要でなくなる。
映像ライン位置、規定遅延量について規定しておけば、
映像ライン位置データｃ及び規定遅延量ｄの伝送は不要
であり、音声遅延器の可変も必要でなくなる。
【００２４】
【発明の効果】以上のように、本発明では、映像信号の
特定のラインにおいて、映像信号と音声信号の遅延が規
定値になるように音声信号データを多重化し、また、分
離制御装置においては前記特定ラインにおける映像信号
と音声信号の遅延量を基準にして映像信号と音声信号の
遅延量を調整することにより、映像信号と音声信号との
同時性を回復することができる。
特定のラインにおいて、映像信号と音声信号の遅延が規
定値になるように音声信号データを多重化し、また、分
離制御装置においては前記特定ラインにおける映像信号
と音声信号の遅延量を基準にして映像信号と音声信号の
遅延量を調整することにより、映像信号と音声信号との
同時性を回復することができる。
【００２５】あらかじめこの特定のラインもしくは遅延
量を固定することが困難な場合には、前記特定映像ライ
ン、または、規定遅延量、或いはこの両方を音声データ
とは別に映像信号に多重化して伝送し、映像信号と音声
信号との遅延量を調整することにより、両者の同時性を
回復することができる。
量を固定することが困難な場合には、前記特定映像ライ
ン、または、規定遅延量、或いはこの両方を音声データ
とは別に映像信号に多重化して伝送し、映像信号と音声
信号との遅延量を調整することにより、両者の同時性を
回復することができる。
【００２６】これにより、音声信号の映像信号への多重
化のマッピングが異なったとしても、映像信号と音声信
号との同時性の回復が容易となる。
化のマッピングが異なったとしても、映像信号と音声信
号との同時性の回復が容易となる。
【図１】本発明の一実施例における多重化・分離制御回
路のブロック図
路のブロック図
【図２】従来の多重化・分離制御回路のブロック図
【図３】多重化分離制御回路のバッファＲＡＭ内音声信
号データ量の変動を示す図
号データ量の変動を示す図
【図４】従来の多重化分離制御回路におけるバッファＲ
ＡＭ内音声信号データ量の変動を示す図
ＡＭ内音声信号データ量の変動を示す図
１ 音声データ分離回路 ２ 同期信号分離回路 ３ 音声データデフォーマッタ ４ バッファＲＡＭ ５ 音声出力回路 ６ フィールドタイミング検出回路 ７ アドレス差計算回路 ８ バッファＲＡＭデータ量検査回路 ９ リードアドレス設定回路 １０１ 映像遅延器 １０２ 映像音声多重化回路 １０３ 音声遅延器 １０４ 遅延データフォーマッタ １０５ 多重化回路 １０６ 音声映像分離回路 １０７ 遅延データ分離回路 １０８ 映像遅延器 １０９ 音声遅延器
Claims (7)
- 【請求項１】デジタル映像信号の同期信号期間に映像信
号に同期したデジタル音声信号を多重化して伝送する伝
送装置に用いられる多重化制御回路であって、映像信号
の特定のラインにおいて、映像信号と音声信号の遅延が
規定値になるように音声信号データを多重化したことを
特徴とする多重化制御回路。 - 【請求項２】デジタル映像信号の同期信号期間に映像信
号に同期したデジタル音声信号が多重化された信号を受
信する受信装置に用いられる分離制御回路であって、映
像信号の特定ラインにおける映像信号と音声信号の遅延
量を基準にして、映像信号と音声信号との遅延量を調整
することを特徴とする分離制御回路。 - 【請求項３】遅延の規定値を０とすることを特徴とする
請求項１記載の多重化制御回路。 - 【請求項４】遅延の規定値を０とすることを特徴とする
請求項２記載の分離制御回路。 - 【請求項５】特定映像ラインと規定遅延量の少なくとも
一方を音声データとは別に映像信号に多重化して伝送す
ることを特徴とする請求項１または請求項３記載の多重
化制御回路。 - 【請求項６】特定映像ラインと規定遅延量の少なくとも
一方を音声データとは別に映像信号に多重化して伝送す
ることを特徴とする請求項２または請求項４記載の分離
制御回路。 - 【請求項７】映像信号とは別に伝送された前記特定映像
ライン位置と規定遅延量の少なくとも一方を用いて、映
像信号と音声信号との遅延量を調整することを特徴とす
る請求項２または請求項４記載の分離制御回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5085948A JPH06303552A (ja) | 1993-04-13 | 1993-04-13 | 多重化・分離制御回路 |
| DE69321558T DE69321558T2 (de) | 1992-11-17 | 1993-11-08 | Video- und Audiosignalmultiplex- und -trennvorrichtungen |
| EP93118046A EP0598295B1 (en) | 1992-11-17 | 1993-11-08 | Video and audio signal multiplexing apparatus and separating apparatus |
| US08/149,944 US5351090A (en) | 1992-11-17 | 1993-11-10 | Video and audio signal multiplexing apparatus and separating apparatus |
| CA002102928A CA2102928C (en) | 1992-11-17 | 1993-11-12 | Video and audio signal multiplexing apparatus and separating apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5085948A JPH06303552A (ja) | 1993-04-13 | 1993-04-13 | 多重化・分離制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06303552A true JPH06303552A (ja) | 1994-10-28 |
Family
ID=13872991
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5085948A Pending JPH06303552A (ja) | 1992-11-17 | 1993-04-13 | 多重化・分離制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06303552A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2002009443A1 (fr) * | 2000-07-21 | 2002-01-31 | Matsushita Electric Industrial Co., Ltd. | Dispositif emetteur de signaux, et dispositif recepteur de signaux |
| JP2002125207A (ja) * | 2000-07-21 | 2002-04-26 | Matsushita Electric Ind Co Ltd | 信号送信装置及び信号受信装置 |
-
1993
- 1993-04-13 JP JP5085948A patent/JPH06303552A/ja active Pending
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2002009443A1 (fr) * | 2000-07-21 | 2002-01-31 | Matsushita Electric Industrial Co., Ltd. | Dispositif emetteur de signaux, et dispositif recepteur de signaux |
| JP2002125207A (ja) * | 2000-07-21 | 2002-04-26 | Matsushita Electric Ind Co Ltd | 信号送信装置及び信号受信装置 |
| US7379121B2 (en) | 2000-07-21 | 2008-05-27 | Matsushita Electric Industrial Co., Ltd. | Signal transmitting device and signal receiving device |
| US7843514B2 (en) | 2000-07-21 | 2010-11-30 | Panasonic Corporation | Signal transmitter and signal receiver |
| US8345169B2 (en) | 2000-07-21 | 2013-01-01 | Panasonic Corporation | Signal transmitter and signal receiver |
| US8451385B2 (en) | 2000-07-21 | 2013-05-28 | Panasonic Corporation | Signal transmitter and signal receiver |
| US8681276B2 (en) | 2000-07-21 | 2014-03-25 | Panasonic Corporation | Signal transmitter and signal receiver |
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