JPH0628317A - Comuputer - Google Patents
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- JPH0628317A JPH0628317A JP18218092A JP18218092A JPH0628317A JP H0628317 A JPH0628317 A JP H0628317A JP 18218092 A JP18218092 A JP 18218092A JP 18218092 A JP18218092 A JP 18218092A JP H0628317 A JPH0628317 A JP H0628317A
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- numerical value
- register
- key
- input
- numerical
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Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明は、逐次計算を行う計算機
に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a computer for performing sequential calculation.
【0002】[0002]
【従来の技術】今日、日常使用されている電卓などと称
される普及型の小形計算機は、演算の種類においても、
小形化の面においても充分な機能を備えるに至ってい
る。計算機は、数値入力の後に演算キーを押すと、キー
によって指定された演算を行い、演算結果を表示する。2. Description of the Related Art Today's popular small-sized calculators called calculators, etc.
In terms of downsizing, it has a sufficient function. When the calculation key is pressed after inputting a numerical value, the computer performs the calculation designated by the key and displays the calculation result.
【0003】[0003]
【発明が解決しようとする課題】従来の小形計算機にお
いては、連続した加算、たとえば累計計算などを行う場
合にも、置数の都度、加算キーを入力しなければならな
いので、加算キーの入力忘れが起こることがあり、操作
が繁雑で面倒である。In the conventional small-sized computer, the addition key must be input every time the number is entered even when performing continuous addition, for example, cumulative calculation, so forgetting to enter the addition key. May occur, and the operation is complicated and troublesome.
【0004】本発明の目的は、同じ桁数の連続演算実行
時に、置数の都度、演算キーを入力する手間の省ける使
い勝手のよい計算機を提供することである。An object of the present invention is to provide a user-friendly computer which saves the trouble of inputting a calculation key each time a numeral is entered when executing continuous calculations with the same number of digits.
【0005】[0005]
【課題を解決するための手段】本発明は、数値を入力す
る数値キーと、入力された数値を記憶する数値メモリ
と、演算結果を記憶する演算結果メモリと、予め定める
桁数の数値が入力されたとき、前記数値メモリの数値と
前記演算結果メモリの数値との間で予め定める2変数演
算を実行し、演算結果を前記演算結果メモリに記憶する
演算手段とを含むことを特徴とする計算機である。According to the present invention, a numerical key for inputting a numerical value, a numerical value memory for storing the input numerical value, an operation result memory for storing an operation result, and a numerical value having a predetermined number of digits are input. And a calculation means for executing a predetermined two-variable calculation between the numerical value of the numerical value memory and the numerical value of the calculation result memory, and storing the calculation result in the calculation result memory. Is.
【0006】[0006]
【作用】本発明に従えば、計算機は、数値キーによって
入力された数値を数値メモリに記憶し、予め定める桁数
の数値が入力されたとき、演算結果を記憶する演算結果
メモリの数値と、数値メモリの数値との間で、予め定め
る2変数演算を実行し、その結果を演算結果メモリに記
憶する。したがって、予め定める桁数の数値の予め定め
る2変数演算については、数値を数値キーを用いて入力
するだけで実行することができる。According to the present invention, the computer stores the numerical value inputted by the numerical keys in the numerical value memory, and when the numerical value of the predetermined number of digits is inputted, the numerical value of the operation result memory for storing the operation result, A predetermined two-variable operation is executed with the numerical value in the numerical value memory, and the result is stored in the operation result memory. Therefore, the predetermined two-variable calculation of the numerical value of the predetermined number of digits can be executed only by inputting the numerical value using the numerical keys.
【0007】[0007]
【実施例】図1は、本発明の一実施例の全体の構成を示
すブロック図である。計算機1は、計算機1全体を制御
する動作プログラムを記憶し、入力数値、演算結果、入
力数値の桁数および後述する単純加算モードのときの設
定桁数を一時保持する各レジスタ、すなわち、Xレジス
タ8、Yレジスタ9、Zレジスタ10、Nレジスタ11
を含む記憶部2と、前記プログラムに基づき、指定され
た処理動作を実行する演算部3と、ユーザが数値を入力
したり、処理動作を選択するキー入力部4と、演算結
果、入力数値、モード名などを表示する表示部5と、置
数の後、入力値の確認を促す確認音を発するブザー回路
6と、演算部3に電源を供給する電池7とを含んで構成
される。1 is a block diagram showing the overall construction of an embodiment of the present invention. The computer 1 stores an operation program for controlling the entire computer 1 and temporarily stores the input numerical value, the operation result, the number of digits of the input numerical value, and the number of digits set in the simple addition mode described later, that is, an X register. 8, Y register 9, Z register 10, N register 11
A storage unit 2 including a calculation unit 3 for executing a specified processing operation based on the program, a key input unit 4 for a user to input a numerical value or select a processing operation, a calculation result, an input numerical value, It is configured to include a display unit 5 that displays a mode name, a buzzer circuit 6 that emits a confirmation sound that prompts confirmation of an input value after a numerical value, and a battery 7 that supplies power to the calculation unit 3.
【0008】図2は、計算機1の平面図である。計算機
1は、本体上部位置に太陽電池などの電池7および表示
部5を備える。その下部には、キー入力部4が設けられ
る。図に示す単純加算キー12は、通常計算モードから
単純加算モードへの切換えを指示するキーである。置数
キー13は、0〜9までの数値を入力するためのキーで
あり、「00」キーは、置数の末尾に「00」を付する
キーである。演算キー14a〜14dは、加減乗除算を
それぞれ指示するキーであり、パーセントキー14e
は、百分率計算を指示するキーである。FIG. 2 is a plan view of the computer 1. The computer 1 includes a battery 7 such as a solar cell and a display unit 5 at the upper position of the main body. A key input unit 4 is provided below the key input unit 4. The simple addition key 12 shown in the figure is a key for instructing switching from the normal calculation mode to the simple addition mode. The numerical key 13 is a key for inputting a numerical value from 0 to 9, and the "00" key is a key for adding "00" to the end of the numerical value. The calculation keys 14a to 14d are keys for instructing addition, subtraction, multiplication and division, respectively, and the percent key 14e.
Is a key for instructing percentage calculation.
【0009】イコールキー15は、単純加算モードから
通常計算モードへの切換えを指示し、Yレジスタ9を表
示後、全レジスタをクリアするキーであり、通常計算モ
ードにおいては、計算結果の表示を指示し、数値を一時
記憶している全レジスタをクリアするキーである。オー
ルクリアキー16aは、全レジスタをクリアするキー
で、クリアキー16bは、Xレジスタ8のみをクリアす
るキーである。The equal key 15 is a key for instructing switching from the simple addition mode to the normal calculation mode, and for clearing all the registers after displaying the Y register 9. In the normal calculation mode, the display of the calculation result is instructed. The key to clear all registers that temporarily store numerical values. The all clear key 16a is a key for clearing all registers, and the clear key 16b is a key for clearing only the X register 8.
【0010】メモリ演算キー17は、メモリ内に、表示
部5に表示されている数値を加算、あるいは減算で蓄積
していくキーで、メモリ内容を表示させ、メモリ内容を
クリアするキーを含む。小数点キー18は、このキーが
押下された時点で、入力数値の末尾に小数点を付与する
キーである。The memory operation key 17 is a key for accumulating numerical values displayed on the display unit 5 by addition or subtraction in the memory, and includes a key for displaying the memory contents and clearing the memory contents. The decimal point key 18 is a key that gives a decimal point to the end of the input numerical value when this key is pressed.
【0011】図3は、本実施例の計算機1全体の動作を
示すフローチャートである。計算機1は、電源投入によ
って動作を開始する。ステップm1で計算機1は、Xレ
ジスタ8、Yレジスタ9、Zレジスタ10、Nレジスタ
11などのレジスタに初期値「0」を与え、表示画面を
クリアし、Xレジスタ8を表示する。ステップm2にお
いて、キー入力部4からのキー入力があったかどうかを
判断し、なければステップm2に戻り、キー入力待機状
態とする。キー入力があったことを判断すると、次のス
テップm3に移る。FIG. 3 is a flowchart showing the operation of the entire computer 1 of this embodiment. The computer 1 starts its operation when the power is turned on. In step m1, the computer 1 gives an initial value “0” to registers such as the X register 8, the Y register 9, the Z register 10, and the N register 11, clears the display screen, and displays the X register 8. In step m2, it is determined whether or not there is a key input from the key input unit 4, and if there is no key input, the process returns to step m2 to enter the key input standby state. If it is determined that there is a key input, the process proceeds to the next step m3.
【0012】ステップm3では、単純加算キー12が押
下されたかどうかを判断し、押下されていればステップ
m8に移る。ステップm8では、Xレジスタ8の1(最
下位)の桁の置数を単純加算モードの設定桁数としてN
レジスタ11に書込む。次のステップm9でXレジスタ
8に0を与え、Nレジスタ11の値を表示し、ステップ
m2に戻って、次のキー入力を待つ。ステップm3で、
単純加算キー12が押下されていないときには、次のス
テップm4に移る。At step m3, it is judged whether or not the simple addition key 12 is pressed, and if so, the process proceeds to step m8. At step m8, the register number of 1 (the least significant) digit of the X register 8 is set as N in the simple addition mode.
Write to register 11. In the next step m9, 0 is given to the X register 8 to display the value of the N register 11, and the process returns to step m2 to wait for the next key input. In step m3,
When the simple addition key 12 is not pressed, the process proceeds to the next step m4.
【0013】ステップm4では、置数キー13が押下さ
れたかどうか判断し、置数キー13でない場合、ステッ
プm14に移る。置数キー13が押下されていれば、次
のm5に移る。At step m4, it is judged whether or not the numeral key 13 has been pressed. If not, the routine proceeds to step m14. If the numeral key 13 is pressed, the process moves to the next m5.
【0014】ステップm5において、単純加算モードか
どうかを判断し、単純加算モードであれば次のステップ
m6へ移り、単純加算モードでなければ、数値入力が行
われたとしてステップm12に入る。ステップm12で
は、Xレジスタ8の内容である数値を10倍して、入力
された数値を加え、再びXレジスタ8に書込む。次のス
テップm13において、Xレジスタ8の値を表示部5に
表示し、ステップm2に戻る。At step m5, it is judged whether or not the mode is the simple addition mode. If the mode is the simple addition mode, the process proceeds to the next step m6. If the mode is not the simple addition mode, it is considered that a numerical value has been input and the process goes to step m12. In step m12, the numerical value which is the contents of the X register 8 is multiplied by 10, the input numerical value is added, and the value is written in the X register 8 again. At the next step m13, the value of the X register 8 is displayed on the display unit 5, and the process returns to step m2.
【0015】ステップm5において、単純加算モードで
あれば、次のステップm6に移る。ステップm6におい
て、単純加算の桁数が設定されているかどうかを判断
し、設定されていれば、ステップm7に移る。ステップ
m7では、単純加算処理を行い、ステップm2に戻る。If it is the simple addition mode in step m5, the process proceeds to the next step m6. In step m6, it is determined whether or not the number of digits for simple addition is set, and if it is set, the process proceeds to step m7. In step m7, simple addition processing is performed, and the process returns to step m2.
【0016】ステップm6で、単純加算の桁数が設定さ
れていなければ、ステップm10に移る。ステップm1
0で、Xレジスタ8に数値が入力されているかどうかを
判断し、Xレジスタ8に数値が入力されていれば、次の
ステップm11でXレジスタ8の1の桁の値を単純加算
の設定桁数としてNレジスタ11に書込み、Xレジスタ
8に0を与え、Nレジスタ11の値を表示部5に表示す
る。次に、ステップm2に戻る。If the number of digits for simple addition is not set in step m6, the process proceeds to step m10. Step m1
At 0, it is determined whether or not a numerical value is input to the X register 8, and if the numerical value is input to the X register 8, the value of the digit of 1 of the X register 8 is set to the digit of the simple addition in the next step m11. The number is written to the N register 11, 0 is given to the X register 8, and the value of the N register 11 is displayed on the display unit 5. Then, the process returns to step m2.
【0017】ステップm10で、Xレジスタ8に数値が
入力されていなければ、ステップm2に戻る。この次の
キー入力で、置数キー13が押下されれば、ステップm
6,m10を経てステップm11で、その置数が単純加
算設定桁数としてNレジスタ11に書込まれる。At step m10, if no numerical value is input to the X register 8, the process returns to step m2. If the numeral key 13 is pressed by the next key input, step m
After 6 and m10, in step m11, the registered number is written in the N register 11 as the number of digits for simple addition.
【0018】ステップm4で、置数キー13が押下され
ていなければ、ステップm14に移る。ステップm14
では、イコールキー15が押下されたかどうかを判断
し、イコールキー15が押下されていれば、ステップm
15に移り、単純加算モードを終了する。ステップm1
6で、演算結果であるYレジスタ9の値を表示部5に表
示し、全レジスタに0を与え、ステップm2に戻る。ス
テップm14で、イコールキー15が押下されていない
場合には、次のステップm17に移り、各入力キーに対
応した演算を行い、ステップm2に戻る。If it is determined in step m4 that the numeral key 13 has not been pressed, the process proceeds to step m14. Step m14
Then, it is determined whether or not the equal key 15 is pressed, and if the equal key 15 is pressed, step m
Moving to 15, the simple addition mode is ended. Step m1
At 6, the value of the Y register 9 as the calculation result is displayed on the display unit 5, 0 is given to all the registers, and the process returns to step m2. In step m14, if the equal key 15 is not pressed, the process proceeds to the next step m17, the calculation corresponding to each input key is performed, and the process returns to step m2.
【0019】図4は、図3のステップm7における単純
加算処理の動作を示すフローチャートである。ステップ
n1では、Xレジスタ8の内容を10倍し、入力された
置数を加え、Xレジスタ8に書込む。次のステップn2
において、Xレジスタ8の内容を表示部5に表示し、次
のステップn3に移る。FIG. 4 is a flow chart showing the operation of the simple addition process in step m7 of FIG. In step n1, the contents of the X register 8 are multiplied by 10, the input numerical value is added, and the result is written into the X register 8. Next step n2
At, the contents of the X register 8 are displayed on the display unit 5, and the process proceeds to the next step n3.
【0020】ステップn3において、Xレジスタ8の内
容である数値の桁数であるZレジスタ10の数値が、N
レジスタ11に保持されている単純加算の設定桁数以上
になったかどうか、すなわち、入力された数値の桁数
が、単純加算の設定桁数に達したかどうかを判断する。
入力数値の桁数が設定桁数に達すると、ステップn4に
移り、ブザー回路6を駆動して確認音を発生し、置数が
設定桁数に達したことを知らせる。次に、ステップn5
において、Xレジスタ8の内容をYレジスタ9の内容に
加算し、Yレジスタ9に書込む。ステップn6では、X
レジスタ8に0を与える。ステップn7において、Yレ
ジスタ9を表示し、処理を終了する。At step n3, the numerical value of the Z register 10 which is the number of digits of the numerical value which is the contents of the X register 8 is N
It is determined whether or not the number of digits of the simple addition held in the register 11 is equal to or more than that, that is, whether the number of digits of the input numerical value has reached the number of digits of the simple addition.
When the number of digits of the input numerical value reaches the set number of digits, the process proceeds to step n4, the buzzer circuit 6 is driven and a confirmation sound is generated to notify that the number of digits has reached the set number of digits. Next, step n5
In, the contents of the X register 8 are added to the contents of the Y register 9, and the contents are written into the Y register 9. At step n6, X
0 is given to the register 8. In step n7, the Y register 9 is displayed, and the process ends.
【0021】ステップn3において、Zレジスタ10の
値が、Nレジスタ11の設定桁数の値に達しない間はス
テップn4〜n7の処理は行わず、処理を終了する。In step n3, while the value of the Z register 10 does not reach the value of the number of digits set in the N register 11, the processes of steps n4 to n7 are not performed and the process ends.
【0022】図5は、単純加算を行う際の表示部5にお
ける表示部画面の1例を示す図である。図5(1)〜
(4),(15),(16)は、図3のフローチャート
の、図5(5)〜(14)は、図4のフローチャートの
各ステップをそれぞれ参照して説明する。FIG. 5 is a view showing an example of the display screen of the display 5 when performing simple addition. 5 (1)-
(4), (15), and (16) will be described with reference to the steps of the flowchart of FIG. 3, and FIGS. 5 (5) to (14) will be described with reference to the respective steps of the flowchart of FIG.
【0023】図5(1)は、ステップm1で表示される
初期画面である。図5(2)は、ユーザが「5」の置数
キー13を押下したとき、ステップm13で表示される
表示画面である。このとき、計算機1は、ステップm1
2でXレジスタ8に、「5」を記憶させている。図5
(3)は、ユーザが「5」の置数キー13に続けて
「3」の置数キー13を入力した場合に、ステップm1
3で表示される表示画面である。計算機1は、ステップ
m12で、置数+10・X、すなわち、「3」+10×
「5」=53の演算を行い、Xレジスタ8の内容を「5
3」に書換え、ステップm13でこのXレジスタ8の内
容「53」を表示部5に表示する。FIG. 5A is an initial screen displayed in step m1. FIG. 5B is a display screen displayed in step m13 when the user presses the numeral key 13 of "5". At this time, the computer 1 uses the step m1.
In step 2, “5” is stored in the X register 8. Figure 5
Step (3) is a step m1 when the user inputs the numeral key 13 of "5" followed by the numeral key 13 of "3".
3 is a display screen displayed in 3. Calculator 1 at step m12 is a numeric value + 10 · X, that is, “3” + 10 ×
"5" = 53 is calculated and the contents of the X register 8 is changed to "5".
3 "and the content" 53 "of the X register 8 is displayed on the display unit 5 in step m13.
【0024】図5の(4)は、図5(3)が表示されて
いる間に、ユーザが単純加算キー12を押下した場合の
表示画面である。計算機1は、ステップm8で単純加算
モードを設定し、単純加算の設定桁数として、Xレジス
タ8に書込まれている「53」の下1桁「3」をNレジ
スタ11に書込み、ステップm9でNレジスタ11を表
示し、Xレジスタ8をクリアする。また、表示画面の右
肩空白部分に単純加算モードを示す記号18を表示す
る。FIG. 5 (4) is a display screen when the user presses the simple addition key 12 while FIG. 5 (3) is being displayed. Calculator 1 sets the simple addition mode in step m8, writes the last digit "3" of "53" written in the X register 8 to the N register 11 as the set digit number of the simple addition, and proceeds to step m9. The N register 11 is displayed with and the X register 8 is cleared. Further, a symbol 18 indicating the simple addition mode is displayed in the blank area on the right shoulder of the display screen.
【0025】図5(5)〜(14)は、単純加算処理に
おける表示画面の1例である。図5(5)は、ユーザが
「1」の置数キー13を押下し、計算機1がステップm
4〜m6を経て、ステップm7の単純加算処理に入り、
図4に示すフローチャートのステップn1を経て、ステ
ップn2で表示する表示画面である。ステップn1で
は、前記図3のステップm12と同様の演算を行い、X
レジスタ8に置数「1」を書込み、さらにXレジスタ8
内の数値の桁数をZレジスタ10に書込む。ステップn
2で、このXレジスタ8内の数値を表示する。FIGS. 5 (5) to 5 (14) are examples of display screens in the simple addition process. In FIG. 5 (5), the user presses the numeral key 13 of "1", and the computer 1 executes step m.
After 4 to m6, the simple addition process of step m7 is started,
It is a display screen displayed in step n2 through step n1 of the flowchart shown in FIG. In step n1, the same calculation as in step m12 in FIG.
The register number "1" is written in the register 8 and the X register 8
Write the number of digits in the number in the Z register 10. Step n
At 2, the numerical value in the X register 8 is displayed.
【0026】次のステップn3では、計算機1は、Zレ
ジスタ10の内容の数値の大きさと、Nレジスタ11の
内容の数値の大きさ、すなわち、入力された数値の桁数
と単純加算設定桁数とを比較し、Zレジスタ10内の数
値が、Nレジスタ11内の数値に達しない間は、次の置
数のため本処理を終了し、ステップm2に戻る。本単純
加算処理の設定桁数が3桁であるため、Xレジスタ8の
数値が3桁に達するまで、ステップn4〜n7の処理を
行わず、ステップm2に戻る。In the next step n3, the computer 1 determines the size of the numerical value of the contents of the Z register 10 and the numerical value of the contents of the N register 11, that is, the number of digits of the input numerical value and the number of digits of simple addition setting. When the numerical value in the Z register 10 does not reach the numerical value in the N register 11, the present process is terminated because of the next numeral and the process returns to step m2. Since the number of digits to be set in this simple addition processing is three, the processing of steps n4 to n7 is not performed and the processing returns to step m2 until the numerical value of the X register 8 reaches three digits.
【0027】図5(6),(7)は、ユーザが「1」に
引続き「2」,「3」の置数キー13を押下した場合に
表示される表示画面を示す。「3」の置数キー13が押
下されると、Xレジスタ8内の数値は、「123」とな
り、Zレジスタ10にXレジスタ8内の数値の桁数
「3」が書込まれる。図5(7)に示すように、ステッ
プn2において、Xレジスタ8の内容「123」が表示
される。ステップn3では、Zレジスタ10内の数値
「3」が、すなわち、Xレジスタ8内の数値「123」
の桁数が、Nレジスタ11内の数値「3」、すなわち、
単純加算設定桁数に達したことが判断され、次のステッ
プn4に移る。FIGS. 5 (6) and 5 (7) show display screens displayed when the user presses the numeral keys 13 of "2" and "3" following "1". When the numeral key 13 of "3" is pressed, the numerical value in the X register 8 becomes "123", and the digit number "3" in the X register 8 is written in the Z register 10. As shown in FIG. 5 (7), in step n2, the content "123" of the X register 8 is displayed. At step n3, the numerical value "3" in the Z register 10 is changed to the numerical value "123" in the X register 8.
The number of digits of the number is “3” in the N register 11, that is,
It is determined that the number of digits for simple addition has been reached, and the process proceeds to the next step n4.
【0028】ステップn4では、入力された数値が設定
桁数に達したことを示すために、確認音を発生する。次
のステップn5では、Xレジスタ8の内容「123」
と、Yレジスタ9の内容「0」を加算し、すなわち、1
23+0=123を計算し、Yレジスタ9に書込む。こ
のとき、Yレジスタ9には、ステップm1で初期値
「0」が与えられているが、この処理によって、「12
3」が与えられる。次のステップn6で、Xレジスタ8
に「0」を書込む。At step n4, a confirmation sound is generated to indicate that the input numerical value has reached the set digit number. At the next step n5, the content "123" of the X register 8
And Y register 9 contents “0” are added, that is, 1
23 + 0 = 123 is calculated and written in the Y register 9. At this time, the initial value “0” is given to the Y register 9 in step m1.
3 ”is given. In the next step n6, the X register 8
Write "0" to.
【0029】図5(8)は、ステップn5における演算
結果であるYレジスタ9の内容を表示した表示画面であ
る。FIG. 5 (8) is a display screen displaying the contents of the Y register 9 which is the calculation result in step n5.
【0030】図5(9)〜(11),(13),(1
4)は、図5(5)〜(7)と同様に、ステップn2で
表示されるXレジスタ8に入力された数値の表示画面で
ある。5 (9) to (11), (13), and (1)
Similarly to FIGS. 5 (5) to 5 (7), 4) is a display screen for displaying the numerical values input to the X register 8 displayed in step n2.
【0031】図5(12)は、図5(11)が表示され
る際の1つ前のステップであるステップn1で、Xレジ
スタ8に書込まれた数値「456」が、ステップn5
で、Yレジスタ9の内容「123」と加算され、すなわ
ち、456+123=579が計算され、Yレジスタ9
に上書きされたYレジスタ9の内容、すなわち、「57
9」を表示する画面である。In FIG. 5 (12), the numerical value "456" written in the X register 8 at step n1 which is the step immediately before the display of FIG. 5 (11) is changed to step n5.
Is added to the content “123” of the Y register 9, that is, 456 + 123 = 579 is calculated,
The contents of the Y register 9 overwritten by
9 is a screen displaying "9".
【0032】図5(15)は、単純加算処理における数
値入力の途中で、すなわち、Xレジスタ8に設定桁数3
桁に達しない数値「78」が保持されている段階で、イ
コールキー15が入力されたときの表示画面で、図3の
ステップm15で単純加算モードが解除され、ステップ
m16でYレジスタ9の数値「579」と、イコールキ
ー15の押下によって単純加算モードが解除されたこと
を示す記号19「=」を示す表示画面である。ステップ
m16では、同時にXレジスタ8、Yレジスタ9、Zレ
ジスタ10、Nレジスタ11の各レジスタをクリアし
て、ステップm2に戻る。FIG. 5 (15) shows that the number of digits set in the X register 8 is 3 during input of a numerical value in the simple addition process.
On the display screen when the equal key 15 is input while the numerical value "78" that does not reach the digit is held, the simple addition mode is canceled in step m15 of FIG. 3 and the numerical value of the Y register 9 is calculated in step m16. It is a display screen showing “579” and a symbol 19 “=” indicating that the simple addition mode is canceled by pressing the equal key 15. At step m16, the X register 8, the Y register 9, the Z register 10, and the N register 11 are simultaneously cleared, and the process returns to step m2.
【0033】図5(16)は、次に「9」の置数キー1
3が押下されたときの表示画面であり、通常計算モード
のXレジスタ8の置数を表示している。In FIG. 5 (16), the numeral key 1 of "9" is next.
3 is a display screen when 3 is pressed, and displays the register number of the X register 8 in the normal calculation mode.
【0034】以上のように本実施例によれば、単純加算
キー12を用いて単純加算モードを設定し、同一桁数の
数値の連続加算を行えば、数値入力の際には、置数キー
13を押すだけでよいので、キー入力の際の指の移動量
も少なく、加算キー14aの押し忘れや、置数キー13
の押し間違いなどの誤操作の発生を減少することができ
る。なお、加算に限らず、減算、乗算、除算に関連して
実施してもよく、また一般的な2変数演算に関して実施
するようにしてもよい。As described above, according to the present embodiment, if the simple addition mode is set by using the simple addition key 12 and continuous addition of numerical values having the same number of digits is performed, when inputting numerical values, the numeric keypad is used. Since it is only necessary to press 13, the amount of movement of the finger at the time of key input is small, forgetting to press the addition key 14a, and the numeric key 13
It is possible to reduce the occurrence of erroneous operations such as pressing the wrong button. It should be noted that the present invention is not limited to addition, but may be performed in connection with subtraction, multiplication, and division, or may be performed with respect to general 2-variable operation.
【0035】[0035]
【発明の効果】以上のように本発明によれば、計算機
は、予め定める桁数の数値の予め定める2変数演算を、
数値キーを用いて予め定める桁数の数値を入力するだけ
で実行するので、計算機の操作を簡単にし、誤操作を減
少することができる。As described above, according to the present invention, the computer executes a predetermined two-variable operation of a predetermined number of digits,
Since it is executed only by inputting a numerical value with a predetermined number of digits using the numerical keys, the operation of the computer can be simplified and erroneous operations can be reduced.
【図1】本発明の一実施例の全体の構成を示すブロック
図である。FIG. 1 is a block diagram showing the overall configuration of an embodiment of the present invention.
【図2】本実施例の平面図である。FIG. 2 is a plan view of the present embodiment.
【図3】本実施例の計算機1の全体の動作を示すフロー
チャートである。FIG. 3 is a flowchart showing the overall operation of the computer 1 of this embodiment.
【図4】図3のステップm7における単純加算処理の動
作を説明するフローチャートである。FIG. 4 is a flowchart illustrating an operation of simple addition processing in step m7 of FIG.
【図5】単純加算を行う際の表示部5における表示画面
の一例を示す図である。FIG. 5 is a diagram showing an example of a display screen on the display unit 5 when performing simple addition.
1 計算機 2 記憶部 3 演算部 4 キー入力部 8 Xレジスタ 9 Yレジスタ 1 computer 2 storage unit 3 arithmetic unit 4 key input unit 8 X register 9 Y register
Claims (1)
リの数値と前記演算結果メモリの数値との間で予め定め
る2変数演算を実行し、演算結果を前記演算結果メモリ
に記憶する演算手段とを含むことを特徴とする計算機。1. A numerical key for inputting a numerical value, a numerical memory for storing the input numerical value, a calculation result memory for storing a calculation result, and a numerical value memory for storing a numerical value having a predetermined number of digits. A computer comprising: a calculation unit that executes a predetermined two-variable calculation between a numerical value and a numerical value of the calculation result memory and stores the calculation result in the calculation result memory.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18218092A JPH0628317A (en) | 1992-07-09 | 1992-07-09 | Comuputer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18218092A JPH0628317A (en) | 1992-07-09 | 1992-07-09 | Comuputer |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0628317A true JPH0628317A (en) | 1994-02-04 |
Family
ID=16113745
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP18218092A Pending JPH0628317A (en) | 1992-07-09 | 1992-07-09 | Comuputer |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0628317A (en) |
-
1992
- 1992-07-09 JP JP18218092A patent/JPH0628317A/en active Pending
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