JPH06251382A - オフセット調整装置 - Google Patents
オフセット調整装置Info
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- JPH06251382A JPH06251382A JP3686693A JP3686693A JPH06251382A JP H06251382 A JPH06251382 A JP H06251382A JP 3686693 A JP3686693 A JP 3686693A JP 3686693 A JP3686693 A JP 3686693A JP H06251382 A JPH06251382 A JP H06251382A
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Abstract
(57)【要約】
【目的】 光学系ピックアップ装置に内蔵された複数の
フォトダイオードの逆バイアスによる暗電流並に汎用初
段アンプのオフセット電圧の和を調整する際の調整時間
を極力短縮させる。 【構成】 光学ピックアップ系に含まれる受光素子１
４，１５中の複数のフォトダイオードＡ〜Ｈの暗電流出
力及び該出力に接続された初段アンプ１６ａ〜１６ｆ，
１７ａ〜１７ｈのオフセット電圧の和を複数の自動オフ
セット消去回路２１ａ〜２１ｆ，２２ａ〜２２ｈで自動
的にコントローラ２３を介してキャンセルさせる。
フォトダイオードの逆バイアスによる暗電流並に汎用初
段アンプのオフセット電圧の和を調整する際の調整時間
を極力短縮させる。 【構成】 光学ピックアップ系に含まれる受光素子１
４，１５中の複数のフォトダイオードＡ〜Ｈの暗電流出
力及び該出力に接続された初段アンプ１６ａ〜１６ｆ，
１７ａ〜１７ｈのオフセット電圧の和を複数の自動オフ
セット消去回路２１ａ〜２１ｆ，２２ａ〜２２ｈで自動
的にコントローラ２３を介してキャンセルさせる。
Description
【０００１】
【産業上の利用分野】本発明は、光磁気ディスク（以下
ＭＯディスクと記す）等の光ピックアップに用いる受光
素子の暗電流や初段アンプのオフセットを自動的にキャ
ンセルさせる自動オフセット調整装置に関する。
ＭＯディスクと記す）等の光ピックアップに用いる受光
素子の暗電流や初段アンプのオフセットを自動的にキャ
ンセルさせる自動オフセット調整装置に関する。
【０００２】
【従来の技術】従来のＭＯディスク等からのＲＦ信号、
フォーカス信号、トラッキング信号等を取り出す為の一
般的な光学系のピックアップの構成を図５に示す。図５
で１はレーザダイオードであり、このレーザダイオード
１から出射したレーザ光はコリメータレンズ２に入射
し、平行光と成され、グレーティング３及びビームスプ
リッタ４、４５°ミラー５及び対物レンズ６を通じてＭ
Ｏディスク７に入射し、データの記録或はＭＯディスク
７からデータの再生が成される。又、ビームスプリッタ
４を透過したレーザ光はＡＰＣ用のフォトダイオード８
に入射し、ＡＰＣフォトダイオード８の出力でレーザダ
イオードを自動制御する。
フォーカス信号、トラッキング信号等を取り出す為の一
般的な光学系のピックアップの構成を図５に示す。図５
で１はレーザダイオードであり、このレーザダイオード
１から出射したレーザ光はコリメータレンズ２に入射
し、平行光と成され、グレーティング３及びビームスプ
リッタ４、４５°ミラー５及び対物レンズ６を通じてＭ
Ｏディスク７に入射し、データの記録或はＭＯディスク
７からデータの再生が成される。又、ビームスプリッタ
４を透過したレーザ光はＡＰＣ用のフォトダイオード８
に入射し、ＡＰＣフォトダイオード８の出力でレーザダ
イオードを自動制御する。
【０００３】更に、ＭＯディスク７から反射されたレー
ザ光は対物レンズ６→４５°ハーフミラー５→ビームス
プリッタ４→位相補償板９→１／２波長板１０→集光レ
ンズ１１→マルチレンズ１２を介して偏光ビームスプリ
ッタ１３に入射し、入射面に平行なＰ成分は透過し、垂
直なＳ成分を分離して、夫々第１及び第２の受光素子１
４及び１５に入射される。
ザ光は対物レンズ６→４５°ハーフミラー５→ビームス
プリッタ４→位相補償板９→１／２波長板１０→集光レ
ンズ１１→マルチレンズ１２を介して偏光ビームスプリ
ッタ１３に入射し、入射面に平行なＰ成分は透過し、垂
直なＳ成分を分離して、夫々第１及び第２の受光素子１
４及び１５に入射される。
【０００４】図６は上記した第１及び第２の受光素子１
４及び１５の構成を示すもので夫々の受光素子はＡ，
Ｂ，Ｃ，Ｄ，Ｅ，Ｆ，Ｇ，Ｈと８分割されたフォトダイ
オードで構成されている。そして、これらフォトダイオ
ードＡ〜Ｈの各出力は（第２の受光素子１５のフォトダ
イオードＦ，ＥとＨ，Ｇの出力は抵抗Ｒを介して共通に
されて各々１つの初段アンプ１６ａ及び１６ｆに接続さ
れる）電流−電圧変換回路を構成する初段アンプ１６ａ
〜１６ｆ及び１７ａ〜１７ｇとオフセット電圧を調整す
る可変抵抗器ＶＲ１〜ＶＲ１４を介して出力端子Ｔ1 〜
Ｔ14に出力される。
４及び１５の構成を示すもので夫々の受光素子はＡ，
Ｂ，Ｃ，Ｄ，Ｅ，Ｆ，Ｇ，Ｈと８分割されたフォトダイ
オードで構成されている。そして、これらフォトダイオ
ードＡ〜Ｈの各出力は（第２の受光素子１５のフォトダ
イオードＦ，ＥとＨ，Ｇの出力は抵抗Ｒを介して共通に
されて各々１つの初段アンプ１６ａ及び１６ｆに接続さ
れる）電流−電圧変換回路を構成する初段アンプ１６ａ
〜１６ｆ及び１７ａ〜１７ｇとオフセット電圧を調整す
る可変抵抗器ＶＲ１〜ＶＲ１４を介して出力端子Ｔ1 〜
Ｔ14に出力される。
【０００５】この出力のうちフォトダイオードＡ〜Ｄの
出力は図５での第１及び第２の受光素子１４及び１５の
Ｘ及びＹ軸方向ｘ1 及びｙ1 並にｘ2 及びｙ2 の位置信
号、フォーカス信号並にサーボの閾値を定めるプルイン
信号等として用いる様な演算が成されて最終的に出力さ
れる。
出力は図５での第１及び第２の受光素子１４及び１５の
Ｘ及びＹ軸方向ｘ1 及びｙ1 並にｘ2 及びｙ2 の位置信
号、フォーカス信号並にサーボの閾値を定めるプルイン
信号等として用いる様な演算が成されて最終的に出力さ
れる。
【０００６】これら８分割された第１及び第２の受光素
子１４及び１５の各々のフォトダイオードＡ〜Ｈは夫々
図７に示す様に負荷抵抗Ｒを通じてＰＮ接合に逆バイア
ス電圧が掛けられているので所定の漏れ電流（暗電流）
を持っている。
子１４及び１５の各々のフォトダイオードＡ〜Ｈは夫々
図７に示す様に負荷抵抗Ｒを通じてＰＮ接合に逆バイア
ス電圧が掛けられているので所定の漏れ電流（暗電流）
を持っている。
【０００７】更に、電流電圧変換回路である初段のアン
プ１６ａ〜１６ｆ、１７ａ〜１７ｈに夫々電気的オフセ
ットを有する。この初段アンプのオフセットとレーザダ
イオード１からレーザ光を出射しない時の第１及び第２
の受光素子の夫々のフォトダイオードＡ〜Ｈの暗電流の
和を零とした状態で図５に示す光学系の各光学素子と第
１及び第２の受光素子１４及び１５の位置関係を調整す
る（以下光学系のアライメント調整と記す）必要があ
る。
プ１６ａ〜１６ｆ、１７ａ〜１７ｈに夫々電気的オフセ
ットを有する。この初段アンプのオフセットとレーザダ
イオード１からレーザ光を出射しない時の第１及び第２
の受光素子の夫々のフォトダイオードＡ〜Ｈの暗電流の
和を零とした状態で図５に示す光学系の各光学素子と第
１及び第２の受光素子１４及び１５の位置関係を調整す
る（以下光学系のアライメント調整と記す）必要があ
る。
【０００８】この為に従来では図６に示す様に初段アン
プ１６ａ〜１６ｆ及び１７ａ〜１７ｈの出力端子Ｔ1 〜
Ｔ14とオシロスコープ１８間にスイッチＳ1 又はＳ2 を
介在させ、このスイッチを切換えて各フォトダイオード
Ａ〜Ｈ毎に暗電流と初段アンプ１６ａ〜１６ｆ及び１７
ａ〜１７ｈの電気的オフセット量を零にする様な調整を
オシロスコープ１８をみながら調整し、可変抵抗器ＶＲ
1 〜ＶＲ14を調整していた。
プ１６ａ〜１６ｆ及び１７ａ〜１７ｈの出力端子Ｔ1 〜
Ｔ14とオシロスコープ１８間にスイッチＳ1 又はＳ2 を
介在させ、このスイッチを切換えて各フォトダイオード
Ａ〜Ｈ毎に暗電流と初段アンプ１６ａ〜１６ｆ及び１７
ａ〜１７ｈの電気的オフセット量を零にする様な調整を
オシロスコープ１８をみながら調整し、可変抵抗器ＶＲ
1 〜ＶＲ14を調整していた。
【０００９】
【発明が解決しようとする課題】上述の様に従来の受光
素子１４及び１５では８分割された各フォトダイオード
Ａ〜Ｈの出力が零となる様にオシロスコープ１８をみな
がら調整用の可変抵抗器ＶＲ1 〜ＶＲ14をシリアルに調
整していたため、光ピックアップの光学系のアライメン
ト調整時のタクトは１０数分を要することとなり、非常
に長い時間が掛かる問題があった。
素子１４及び１５では８分割された各フォトダイオード
Ａ〜Ｈの出力が零となる様にオシロスコープ１８をみな
がら調整用の可変抵抗器ＶＲ1 〜ＶＲ14をシリアルに調
整していたため、光ピックアップの光学系のアライメン
ト調整時のタクトは１０数分を要することとなり、非常
に長い時間が掛かる問題があった。
【００１０】これは、上記した様にＭＯディスク用の光
ピックアップ光学系では８分割された受光素子１４及び
１５が２個あり、計１４個のフォトダイオードを夫々調
整しなければならず、これがタクト短縮の障害と成って
いた。更に初段アンプ等のオフセット電圧は時間経過
（温度上昇）と共に増加するため可変抵抗器ＶＲ1 〜Ｖ
Ｒ14を再度調整しなければならない等の問題があった。
ピックアップ光学系では８分割された受光素子１４及び
１５が２個あり、計１４個のフォトダイオードを夫々調
整しなければならず、これがタクト短縮の障害と成って
いた。更に初段アンプ等のオフセット電圧は時間経過
（温度上昇）と共に増加するため可変抵抗器ＶＲ1 〜Ｖ
Ｒ14を再度調整しなければならない等の問題があった。
【００１１】本発明は叙上の問題点を解消したオフセッ
ト調整装置を提供しようとするもので、その目的とする
ところはフォトダイオードの暗電流並に電流−電圧変換
回路を構成する初段アンプの電気的オフセットを自動的
に零にする様に成したので、受光素子位置を光学系位置
と合わせるアライメントのタクトを数１０秒（６０〜７
０秒）近く短縮可能なものが得られる。
ト調整装置を提供しようとするもので、その目的とする
ところはフォトダイオードの暗電流並に電流−電圧変換
回路を構成する初段アンプの電気的オフセットを自動的
に零にする様に成したので、受光素子位置を光学系位置
と合わせるアライメントのタクトを数１０秒（６０〜７
０秒）近く短縮可能なものが得られる。
【００１２】
【課題を解決するための手段】本発明のオフセット調整
装置はその例が図１に示されている様に、光学系に内蔵
された受光素子１４，１５位置と光学系位置のアライメ
ントをとる際に受光素子１４，１５及び初段アンプ出力
のオフセットを調整する様に成されたオフセット調整装
置に於いて、受光素子１４，１５の暗電流と、受光素子
１４，１５の後段に接続される初段アンプ１６ａ〜１６
ｆ，１７ａ〜１７ｈのオフセットの和を自動的に消去す
る消去手段２１ａ〜２２ｈを設けて成るものである。
装置はその例が図１に示されている様に、光学系に内蔵
された受光素子１４，１５位置と光学系位置のアライメ
ントをとる際に受光素子１４，１５及び初段アンプ出力
のオフセットを調整する様に成されたオフセット調整装
置に於いて、受光素子１４，１５の暗電流と、受光素子
１４，１５の後段に接続される初段アンプ１６ａ〜１６
ｆ，１７ａ〜１７ｈのオフセットの和を自動的に消去す
る消去手段２１ａ〜２２ｈを設けて成るものである。
【００１３】
【作用】本発明のオフセット調整装置は光ピックアップ
のアライメント時に受光素子の暗電流及び初段アンプの
電気的オフセットを自動的に零にする様なキャンセル回
路を設ける様にしたので、光ピックアップ１台当たりの
アライメント調整時のタクトを大幅に短縮可能と成る。
のアライメント時に受光素子の暗電流及び初段アンプの
電気的オフセットを自動的に零にする様なキャンセル回
路を設ける様にしたので、光ピックアップ１台当たりの
アライメント調整時のタクトを大幅に短縮可能と成る。
【００１４】
【実施例】以下、本発明のオフセット調整装置の一実施
例を図１乃至図４によって詳記する。
例を図１乃至図４によって詳記する。
【００１５】図１は本例のオフセット調整装置２０の全
体的な構成を示すもので、図５に示した光ピックアップ
の光学系に内蔵されている第１及び第２の受光素子１４
及び１５の８分割された各フォトダイオードＡ〜Ｈの初
段アンプ１６ａ〜１６ｆ及び１７ａ〜１７ｈの出力端子
Ｔ1 〜Ｔ14は複数の自動オフセット消去回路２１ａ〜２
１ｆ及び２２ａ〜２２ｈに接続される。
体的な構成を示すもので、図５に示した光ピックアップ
の光学系に内蔵されている第１及び第２の受光素子１４
及び１５の８分割された各フォトダイオードＡ〜Ｈの初
段アンプ１６ａ〜１６ｆ及び１７ａ〜１７ｈの出力端子
Ｔ1 〜Ｔ14は複数の自動オフセット消去回路２１ａ〜２
１ｆ及び２２ａ〜２２ｈに接続される。
【００１６】これら各自動オフセット消去回路２１ａ〜
２１ｆ及び２２ａ〜２２ｈにはマイクロコンピュータ等
の外部コントローラ２３からスタート信号が与えられ、
エンド信号が各自動オフセット消去回路２１ａ〜２１ｆ
及び２２ａ〜２２ｈから外部コントローラ２３に与えら
れる。又、コントローラ２３から調整終了時ストップ信
号をクロック発生器２４に与えることで、このクロック
発生器２４から各自動オフセット消去回路２１ａ〜２１
ｆ及び２２ａ〜２２ｈに供給されているクロックを停止
させる様にして、測定信号に余計なノイズが乗らない様
に成されている。
２１ｆ及び２２ａ〜２２ｈにはマイクロコンピュータ等
の外部コントローラ２３からスタート信号が与えられ、
エンド信号が各自動オフセット消去回路２１ａ〜２１ｆ
及び２２ａ〜２２ｈから外部コントローラ２３に与えら
れる。又、コントローラ２３から調整終了時ストップ信
号をクロック発生器２４に与えることで、このクロック
発生器２４から各自動オフセット消去回路２１ａ〜２１
ｆ及び２２ａ〜２２ｈに供給されているクロックを停止
させる様にして、測定信号に余計なノイズが乗らない様
に成されている。
【００１７】自動オフセット消去回路２１ａ及び２１
ｆ，２２ａ，２２ｂ及び２２ｇ，２２ｈからの出力は演
算回路２５ａ，２５ｃ，２６ａ並に２６ｃに供給され、
夫々所定の演算が成されて出力１、出力３、出力４並に
出力５として出力される。これら出力１及び出力３はト
ラッキング用信号出力であり、出力４及び出力５はモニ
タ信号が出力される。
ｆ，２２ａ，２２ｂ及び２２ｇ，２２ｈからの出力は演
算回路２５ａ，２５ｃ，２６ａ並に２６ｃに供給され、
夫々所定の演算が成されて出力１、出力３、出力４並に
出力５として出力される。これら出力１及び出力３はト
ラッキング用信号出力であり、出力４及び出力５はモニ
タ信号が出力される。
【００１８】受光素子１４及び１５の４分割されたＡ，
Ｂ，Ｃ，Ｄで示すフォトダイオードから初段アンプ１６
ｂ〜１６ｅ及び１７ｃ〜１７ｆを通し、各自動オフセッ
ト消去回路２１ｂ，２１ｃ，２１ｄ，２１ｅ及び２２
ｃ，２２ｄ，２２ｅ，２２ｆから得られたオフセットを
自動的に零とした出力は位置演算回路２５ｂ及び２６ｂ
に供給され、所定の後述する演算を行った後に出力２及
び出力５としてシンクロスコープ２７及び２８のＣＲＴ
等に受光素子１５及び１４の位置表示が成される。尚２
９はコントローラ２３に内蔵されたＣＲＴ等の表示手段
であり、オフセット調整終了等の表示が行なわれる。
Ｂ，Ｃ，Ｄで示すフォトダイオードから初段アンプ１６
ｂ〜１６ｅ及び１７ｃ〜１７ｆを通し、各自動オフセッ
ト消去回路２１ｂ，２１ｃ，２１ｄ，２１ｅ及び２２
ｃ，２２ｄ，２２ｅ，２２ｆから得られたオフセットを
自動的に零とした出力は位置演算回路２５ｂ及び２６ｂ
に供給され、所定の後述する演算を行った後に出力２及
び出力５としてシンクロスコープ２７及び２８のＣＲＴ
等に受光素子１５及び１４の位置表示が成される。尚２
９はコントローラ２３に内蔵されたＣＲＴ等の表示手段
であり、オフセット調整終了等の表示が行なわれる。
【００１９】図１で説明した演算回路２５ａ〜２５ｃ並
に２６ａ〜２６ｃの演算方法の大要を図４を用いて簡単
に説明する。
に２６ａ〜２６ｃの演算方法の大要を図４を用いて簡単
に説明する。
【００２０】図４で演算回路２６ａ，２６ｂ，２６ｃの
入力端には受光素子１４（ＰＤ１）からの８分割され
て、自動オフセット消去回路２２ａ〜２２ｈでオフセッ
ト補正が成された信号Ａ1 ，Ｂ1 ，Ｃ1 ，Ｄ1 ，Ｅ1 ，
Ｆ1 ，Ｇ1 ，Ｈ1 が入力される。
入力端には受光素子１４（ＰＤ１）からの８分割され
て、自動オフセット消去回路２２ａ〜２２ｈでオフセッ
ト補正が成された信号Ａ1 ，Ｂ1 ，Ｃ1 ，Ｄ1 ，Ｅ1 ，
Ｆ1 ，Ｇ1 ，Ｈ1 が入力される。
【００２１】同様に演算回路２５ａ，２５ｂ，２５ｃの
入力端には受光素子１５（ＰＤ２）からの８分割され
て、自動オフセット消去回路２１ａ〜２１ｆでオフセッ
ト補正が成された信号Ａ2 ，Ｂ2 ，Ｃ2 ，Ｄ2 ，Ｅ2 ＋
Ｆ2 ，Ｇ2 ＋Ｈ2 が入力される。
入力端には受光素子１５（ＰＤ２）からの８分割され
て、自動オフセット消去回路２１ａ〜２１ｆでオフセッ
ト補正が成された信号Ａ2 ，Ｂ2 ，Ｃ2 ，Ｄ2 ，Ｅ2 ＋
Ｆ2 ，Ｇ2 ＋Ｈ2 が入力される。
【００２２】演算回路２６ａ及び２６ｃでは信号Ｅ1 及
びＦ1 並に信号Ｇ1 及びＨ1 が夫々第１及び第２の減算
回路３０ａ及び３０ｂと第１及び第２の加算回路３１ａ
及び３１ｂに供給されて第１の減算回路３０ａで信号Ｅ
1 −Ｆ1 が、第２の減算回路３０ｂでは信号Ｇ1 −Ｈ1
が得られ夫々Ｅ1 −Ｆ1 信号及びＧ1 −Ｈ1 信号として
出力される。又、第１及び第２の減算回路３０ａ及び３
０ｂの出力は第３の加算回路３２に供給されて信号（Ｅ
1 ＋Ｇ1 ）−（Ｆ1 ＋Ｈ1 ）がサイドプッシュプル信号
として、第４の加算回路３４に供給される。第４の加算
回路３４では後述するＸ軸方向の信号がサイドプッシュ
プル信号（Ｅ1 ＋Ｇ1 ）−（Ｆ1 ＋Ｈ1）に加算されＹ
＋（Ｅ1 ＋Ｇ1 ）−（Ｆ1 ＋Ｈ1 ）信号と成されＤＰＰ
１に示す様にトラッキング信号として利用される。
びＦ1 並に信号Ｇ1 及びＨ1 が夫々第１及び第２の減算
回路３０ａ及び３０ｂと第１及び第２の加算回路３１ａ
及び３１ｂに供給されて第１の減算回路３０ａで信号Ｅ
1 −Ｆ1 が、第２の減算回路３０ｂでは信号Ｇ1 −Ｈ1
が得られ夫々Ｅ1 −Ｆ1 信号及びＧ1 −Ｈ1 信号として
出力される。又、第１及び第２の減算回路３０ａ及び３
０ｂの出力は第３の加算回路３２に供給されて信号（Ｅ
1 ＋Ｇ1 ）−（Ｆ1 ＋Ｈ1 ）がサイドプッシュプル信号
として、第４の加算回路３４に供給される。第４の加算
回路３４では後述するＸ軸方向の信号がサイドプッシュ
プル信号（Ｅ1 ＋Ｇ1 ）−（Ｆ1 ＋Ｈ1）に加算されＹ
＋（Ｅ1 ＋Ｇ1 ）−（Ｆ1 ＋Ｈ1 ）信号と成されＤＰＰ
１に示す様にトラッキング信号として利用される。
【００２３】第１及び第２の加算回路３１ａ及び３１ｂ
では信号Ｅ1 ＋Ｆ1 及びＧ1 ＋Ｈ1が加算されて夫々出
力され、この加算回路３１ａ及び３１ｂの出力は第３の
減算回路３３に供給され、（Ｅ1 ＋Ｆ1 ）−（Ｇ1 ＋Ｈ
1 ）信号となされ、スポット１（ＳＰＯＴ１）信号とし
て出力される。これら各出力信号はトラッキング信号等
を得る信号として利用される。
では信号Ｅ1 ＋Ｆ1 及びＧ1 ＋Ｈ1が加算されて夫々出
力され、この加算回路３１ａ及び３１ｂの出力は第３の
減算回路３３に供給され、（Ｅ1 ＋Ｆ1 ）−（Ｇ1 ＋Ｈ
1 ）信号となされ、スポット１（ＳＰＯＴ１）信号とし
て出力される。これら各出力信号はトラッキング信号等
を得る信号として利用される。
【００２４】次に受光素子１４の４分割されたフォトダ
イオードＡ，Ｂ，Ｃ，Ｄのオフセット補償された出力信
号Ａ1 ，Ｂ1 ，Ｃ1 ，Ｄ1 は第４乃至第６の減算回路３
５ａ，３５ｂ，３５ｃ並に第５の加算回路３６ａから成
る演算回路２６ｂに供給され、第４の減算回路３５ａで
はＸ軸方向のｘ1 位置が（Ａ1 ＋Ｂ1 ）−（Ｃ1 −
Ｄ 1 ）で演算され、第５の減算回路３５ｂではＹ軸方向
のｙ1 位置が（Ａ1 ＋Ｄ1）−（Ｂ1 ＋Ｃ1 ）で演算さ
れる。
イオードＡ，Ｂ，Ｃ，Ｄのオフセット補償された出力信
号Ａ1 ，Ｂ1 ，Ｃ1 ，Ｄ1 は第４乃至第６の減算回路３
５ａ，３５ｂ，３５ｃ並に第５の加算回路３６ａから成
る演算回路２６ｂに供給され、第４の減算回路３５ａで
はＸ軸方向のｘ1 位置が（Ａ1 ＋Ｂ1 ）−（Ｃ1 −
Ｄ 1 ）で演算され、第５の減算回路３５ｂではＹ軸方向
のｙ1 位置が（Ａ1 ＋Ｄ1）−（Ｂ1 ＋Ｃ1 ）で演算さ
れる。
【００２５】同様に第６の減算回路３５ｃではフォーカ
ス用の信号（Ａ1 ＋Ｃ1 ）−（Ｂ1＋Ｄ1 ）が出力さ
れ、第５の加算回路３６ａでは（Ａ1 ＋Ｂ1 ＋Ｃ1 ＋Ｄ
1 ）の加算が成されたプルイン信号が出力され、割算回
路３７ａ，３７ｂに供給される。この割算回路３７ａ，
３７ｂにはＸ及びＹ軸位置信号が供給されプルイン信号
で平均化されてｘ1 及びｙ1 信号として出力５としてシ
ンクロスコープ２８でｘ 1 及びｙ1 位置の表示が行なわ
れる。
ス用の信号（Ａ1 ＋Ｃ1 ）−（Ｂ1＋Ｄ1 ）が出力さ
れ、第５の加算回路３６ａでは（Ａ1 ＋Ｂ1 ＋Ｃ1 ＋Ｄ
1 ）の加算が成されたプルイン信号が出力され、割算回
路３７ａ，３７ｂに供給される。この割算回路３７ａ，
３７ｂにはＸ及びＹ軸位置信号が供給されプルイン信号
で平均化されてｘ1 及びｙ1 信号として出力５としてシ
ンクロスコープ２８でｘ 1 及びｙ1 位置の表示が行なわ
れる。
【００２６】受光素子１５（ＰＤ２）側の４分割された
Ａ，Ｂ，Ｃ，Ｄで示すフォトダイオードからのオフセッ
ト補正の成された出力信号Ａ2 ，Ｂ2 ，Ｃ2 ，Ｄ2 も位
置演算回路２５ｂに供給される。この構成は受光素子１
４の位置演算回路２６ｂと同様の第４〜第６の減算回路
３５ａ′〜３５ｃ′と第５の加算回路３６ａ′より構成
され割算回路３７ａ′，３７ｂ′の出力にＸ及びＹ軸方
向の受光素子１５の正常位置信号ｘ2 及びｙ2 を出力２
として出力してシンクロスコープ２７のＣＲＴ上に表示
させる。
Ａ，Ｂ，Ｃ，Ｄで示すフォトダイオードからのオフセッ
ト補正の成された出力信号Ａ2 ，Ｂ2 ，Ｃ2 ，Ｄ2 も位
置演算回路２５ｂに供給される。この構成は受光素子１
４の位置演算回路２６ｂと同様の第４〜第６の減算回路
３５ａ′〜３５ｃ′と第５の加算回路３６ａ′より構成
され割算回路３７ａ′，３７ｂ′の出力にＸ及びＹ軸方
向の受光素子１５の正常位置信号ｘ2 及びｙ2 を出力２
として出力してシンクロスコープ２７のＣＲＴ上に表示
させる。
【００２７】尚、演算回路２５ａ及び２５ｃは受光素子
１５のフォトダイオードＥ及びＦ並にＧ及びＨからのオ
フセット補正した加算出力Ｅ2 ＋Ｆ2 並にＧ2 ＋Ｈ2 を
反転回路３８ａ，３８ｂで反転した−（Ｅ2 ＋Ｆ2 ）及
び−（Ｇ2 ＋Ｈ2 ）を出力し、第７の減算回路でスポッ
ト信号（ＳＰＯＴ２）として上記両信号を減算した信号
を出力する。即ち、出力１，３，４，５は受光素子１
４，１５以外の光学系の調整に使用されるもので本例と
は直接関係がないので、これ以 上の説明は省略する。
１５のフォトダイオードＥ及びＦ並にＧ及びＨからのオ
フセット補正した加算出力Ｅ2 ＋Ｆ2 並にＧ2 ＋Ｈ2 を
反転回路３８ａ，３８ｂで反転した−（Ｅ2 ＋Ｆ2 ）及
び−（Ｇ2 ＋Ｈ2 ）を出力し、第７の減算回路でスポッ
ト信号（ＳＰＯＴ２）として上記両信号を減算した信号
を出力する。即ち、出力１，３，４，５は受光素子１
４，１５以外の光学系の調整に使用されるもので本例と
は直接関係がないので、これ以 上の説明は省略する。
【００２８】本例の自動オフセット消去回路２１ａ〜２
１ｆ並に２２ａ〜２２ｈの原理的構成図を図２に、具体
的回路構成を図３で詳記する。
１ｆ並に２２ａ〜２２ｈの原理的構成図を図２に、具体
的回路構成を図３で詳記する。
【００２９】図２では図１で示した受光素子１４（ＰＤ
1 ）の４分割されたフォトダイオードＡ，Ｂ，Ｃ，Ｄか
らのＡ，Ｄ，Ｃの出力が自動オフセット消去回路２２
ｃ，２２ｄ，２２ｅ‥‥の入力端子ＩＮ１，ＩＮ２，Ｉ
Ｎ３‥‥に供給される。
1 ）の４分割されたフォトダイオードＡ，Ｂ，Ｃ，Ｄか
らのＡ，Ｄ，Ｃの出力が自動オフセット消去回路２２
ｃ，２２ｄ，２２ｅ‥‥の入力端子ＩＮ１，ＩＮ２，Ｉ
Ｎ３‥‥に供給される。
【００３０】この入力端子ＩＮ１，ＩＮ２，ＩＮ３‥‥
には４分割された各フォトダイオードＡ，Ｂ，Ｃ，Ｄの
ＰＮ接合に逆電圧を掛けて、光の強弱に比例した電流出
力を得る様に成されているので、逆方向の漏れ電流（暗
電流）を含んでいると共に初段アンプ１７ｃ〜１７ｆの
電気的オフセットも含まれているものとする。例えば、
最大±５０ｍＶ程度のオフセット電圧を生じている。
には４分割された各フォトダイオードＡ，Ｂ，Ｃ，Ｄの
ＰＮ接合に逆電圧を掛けて、光の強弱に比例した電流出
力を得る様に成されているので、逆方向の漏れ電流（暗
電流）を含んでいると共に初段アンプ１７ｃ〜１７ｆの
電気的オフセットも含まれているものとする。例えば、
最大±５０ｍＶ程度のオフセット電圧を生じている。
【００３１】自動オフセット消去回路２２ａ〜２２ｈ及
び２１ａ〜２１ｆはオペアンプ４１を有する加算手段４
０と、コンパレータ４２、フリップフロップ回路４３、
Ｄ／Ａコンバータ４５、カウンタ４４並にクロック発生
回路２４から構成されている。
び２１ａ〜２１ｆはオペアンプ４１を有する加算手段４
０と、コンパレータ４２、フリップフロップ回路４３、
Ｄ／Ａコンバータ４５、カウンタ４４並にクロック発生
回路２４から構成されている。
【００３２】即ち、図２で入力端子ＩＮ１は入力抵抗Ｒ
S を介して初段のオペアンプ４１の反転入力端子に接続
され、非反転入力端子は抵抗Ｒ1 を介して接地されてい
る。反転入力端子には電圧源（−１２Ｖ）から抵抗ＲB
を介して電圧が加えられると共にＤ／Ａコンバータ４５
から抵抗ＲD を介して調整電圧ＶD が供給される。
S を介して初段のオペアンプ４１の反転入力端子に接続
され、非反転入力端子は抵抗Ｒ1 を介して接地されてい
る。反転入力端子には電圧源（−１２Ｖ）から抵抗ＲB
を介して電圧が加えられると共にＤ／Ａコンバータ４５
から抵抗ＲD を介して調整電圧ＶD が供給される。
【００３３】オペアンプ４１の出力端子ＶOUT と反転入
力端子間には抵抗ＲF とコンデンサＣ1 との並列回路が
接続されている。
力端子間には抵抗ＲF とコンデンサＣ1 との並列回路が
接続されている。
【００３４】オペアンプ４１の出力はオペアンプ４１の
出力が零と成ったことを検出するゼロクスス等の検出器
４６（図３参照）を介してコンパレータ４２に供給され
る。コンパレータ４２の出力はＤ型フリップフロップ回
路４３に供給される。
出力が零と成ったことを検出するゼロクスス等の検出器
４６（図３参照）を介してコンパレータ４２に供給され
る。コンパレータ４２の出力はＤ型フリップフロップ回
路４３に供給される。
【００３５】Ｄ型フリップフロップ回路４３の否定出力
ＱバーはＤ／Ａコンバータ４５のチップイネーブルに与
えられ、クロック発振器２４からのクロックは各々の自
動オフセット消去回路２２ａ〜２２ｈ，２１ａ〜２１ｆ
のアップカウンタ４４に供給されると共にリセット信号
がＤ型フリップフロップ回路４３及びアップカウンタ４
４に供給される様に成されている。
ＱバーはＤ／Ａコンバータ４５のチップイネーブルに与
えられ、クロック発振器２４からのクロックは各々の自
動オフセット消去回路２２ａ〜２２ｈ，２１ａ〜２１ｆ
のアップカウンタ４４に供給されると共にリセット信号
がＤ型フリップフロップ回路４３及びアップカウンタ４
４に供給される様に成されている。
【００３６】上述の零検出器４６やコンパレータ４２並
にリセット手段等の具体的構成を図３に示す。
にリセット手段等の具体的構成を図３に示す。
【００３７】零点を検出する零検出器４６はオペアンプ
４７より構成され、オペアンプ４１の出力ＶOUT は抵抗
Ｒ2 を介しオペアンプ４７の反転入力端子に供給され
る。オペアンプ４７の非反転入力端子は抵抗Ｒ3 を介し
て接地され、オペアンプ４７の反転入力端子と出力間に
は抵抗Ｒ4 とコンデンサＣ2 の並列回路が接続され、電
圧源（＋１２Ｖ）から抵抗Ｒ5 とＲ6 の直列回路を通じ
て抵抗Ｒ2 とＲ4 の接続点に電圧が供給され、抵抗Ｒ5
とＲ7 の直列回路を介して電圧源（＋１２Ｖ）はアース
されている。
４７より構成され、オペアンプ４１の出力ＶOUT は抵抗
Ｒ2 を介しオペアンプ４７の反転入力端子に供給され
る。オペアンプ４７の非反転入力端子は抵抗Ｒ3 を介し
て接地され、オペアンプ４７の反転入力端子と出力間に
は抵抗Ｒ4 とコンデンサＣ2 の並列回路が接続され、電
圧源（＋１２Ｖ）から抵抗Ｒ5 とＲ6 の直列回路を通じ
て抵抗Ｒ2 とＲ4 の接続点に電圧が供給され、抵抗Ｒ5
とＲ7 の直列回路を介して電圧源（＋１２Ｖ）はアース
されている。
【００３８】コンパレータ４２もオペアンプ４８で構成
されオペアンプ４７の出力が抵抗Ｒ 8 を介してオペアン
プ４８の反転入力端子に供給される。このオペアンプ４
８の非反転入力端子は直接接地され、抵抗Ｒ8 と反転入
力端子の接続点はコンデンサＣ3 を介して接地され、オ
ペアンプ４８の出力端はフリップフロップ回路４３のク
ロック端子ＣＫに入力され、電圧源（＋１２Ｖ）が抵抗
Ｒ9 を介して、クロック端子ＣＫに供給されている。
されオペアンプ４７の出力が抵抗Ｒ 8 を介してオペアン
プ４８の反転入力端子に供給される。このオペアンプ４
８の非反転入力端子は直接接地され、抵抗Ｒ8 と反転入
力端子の接続点はコンデンサＣ3 を介して接地され、オ
ペアンプ４８の出力端はフリップフロップ回路４３のク
ロック端子ＣＫに入力され、電圧源（＋１２Ｖ）が抵抗
Ｒ9 を介して、クロック端子ＣＫに供給されている。
【００３９】フリップフロップ回路４３の否定出力Ｑバ
ーは抵抗Ｒ10を介してＤ／Ａコンバータ４５のチップイ
ネーブル端子ＣＥに供給され、このチップイネーブル端
子ＣＥは抵抗Ｒ11を介して接地されている。更に抵抗Ｒ
10の一端はスイッチング用のトランジスタＴＲ1 のコレ
クタに接続され、エミッタは直接アースされ、ベースに
はリセットスイッチ４７からの電圧（＋１２Ｖ）を抵抗
Ｒ12及びＲ13で分圧したバイアス電圧が供給されてい
る。このリセット電圧はアップカウンタ４４及びフリッ
プフロップ回路４３にも与えられている。
ーは抵抗Ｒ10を介してＤ／Ａコンバータ４５のチップイ
ネーブル端子ＣＥに供給され、このチップイネーブル端
子ＣＥは抵抗Ｒ11を介して接地されている。更に抵抗Ｒ
10の一端はスイッチング用のトランジスタＴＲ1 のコレ
クタに接続され、エミッタは直接アースされ、ベースに
はリセットスイッチ４７からの電圧（＋１２Ｖ）を抵抗
Ｒ12及びＲ13で分圧したバイアス電圧が供給されてい
る。このリセット電圧はアップカウンタ４４及びフリッ
プフロップ回路４３にも与えられている。
【００４０】上述の構成での自動オフセット消去回路２
１ａ〜２１ｆ，２２ａ〜２２ｈの動作を以下説明する。
図２及び図３の入力端子ＩＮ１〜ＩＮ３にはフォトダイ
オードＡ，Ｂ，Ｃ，Ｄ‥‥のＰＮ接合に掛けた逆電圧に
よって生ずる暗電流並に光ピックアップ用の初段アンプ
が有するオフセット電圧との和の電圧を含む検出電圧が
入力される。
１ａ〜２１ｆ，２２ａ〜２２ｈの動作を以下説明する。
図２及び図３の入力端子ＩＮ１〜ＩＮ３にはフォトダイ
オードＡ，Ｂ，Ｃ，Ｄ‥‥のＰＮ接合に掛けた逆電圧に
よって生ずる暗電流並に光ピックアップ用の初段アンプ
が有するオフセット電圧との和の電圧を含む検出電圧が
入力される。
【００４１】この時、加算手段４０を構成するオペアン
プ４１の入力抵抗ＲS と帰還抵抗Ｒ F は光学系のレーザ
出力とサーボ系の利得で定まるが図３に示す様にＲS ＝
２．４ｋ，ＲF ＝８．２Ｋに選択されている。
プ４１の入力抵抗ＲS と帰還抵抗Ｒ F は光学系のレーザ
出力とサーボ系の利得で定まるが図３に示す様にＲS ＝
２．４ｋ，ＲF ＝８．２Ｋに選択されている。
【００４２】今、オペアンプ４１への許容入力オフセッ
ト電圧を±５０ｍＶとした時の、このオペアンプ４１の
出力電圧ＶOUT ＝±１ｍＶ程度に抑えている。このＶ
OUT は ＶOUT ＝−（−１２／ＲB ＋ＶIN／ＲS ＋ＶD ／ＲD ）・ＲF ‥‥（１） ここでＶINはフォトダイオードからのオフセットを含ん
だ入力電圧、ＶD は調整電圧、ＲD は調整電圧帰還回路
中の抵抗である。
ト電圧を±５０ｍＶとした時の、このオペアンプ４１の
出力電圧ＶOUT ＝±１ｍＶ程度に抑えている。このＶ
OUT は ＶOUT ＝−（−１２／ＲB ＋ＶIN／ＲS ＋ＶD ／ＲD ）・ＲF ‥‥（１） ここでＶINはフォトダイオードからのオフセットを含ん
だ入力電圧、ＶD は調整電圧、ＲD は調整電圧帰還回路
中の抵抗である。
【００４３】即ち、加算手段４０のオペアンプの入力端
子ＩＮ１に供給されたオフセットを含むフォトダイオー
ドの入力電流ｉ1 は電圧源−１２Ｖと抵抗ＲB によって
強制的に電流ｉ2 と成る様に引き込む様にバイアスされ
（１）式に示す出力電圧ＶOU T が出力されている。
子ＩＮ１に供給されたオフセットを含むフォトダイオー
ドの入力電流ｉ1 は電圧源−１２Ｖと抵抗ＲB によって
強制的に電流ｉ2 と成る様に引き込む様にバイアスされ
（１）式に示す出力電圧ＶOU T が出力されている。
【００４４】本例ではこのバイアスされた加算手段４０
の出力電圧をキャンセルさせる様に成す。この為に、図
３で示すデイプスイッチ４９を選択し、クロック発生器
２４のクロックオンスイッチ４８を動作させ、クロック
出力をアップカウンタ４４へ出力可能状態とする。次に
リセットスイッチ４７を「オン」させて、Ｄ型フリップ
フロップ回路４３のクリヤ、リセット系を動作させてフ
リップフロップ回路４３をプリセット（ＰＲ）させると
共にアップカウンタ４４をプリセット状態にし、トラン
ジスタＴＲ１をバイアスして「オン」状態としてフリッ
プフロップ回路４３の否定出力Ｑバーをアースする。
の出力電圧をキャンセルさせる様に成す。この為に、図
３で示すデイプスイッチ４９を選択し、クロック発生器
２４のクロックオンスイッチ４８を動作させ、クロック
出力をアップカウンタ４４へ出力可能状態とする。次に
リセットスイッチ４７を「オン」させて、Ｄ型フリップ
フロップ回路４３のクリヤ、リセット系を動作させてフ
リップフロップ回路４３をプリセット（ＰＲ）させると
共にアップカウンタ４４をプリセット状態にし、トラン
ジスタＴＲ１をバイアスして「オン」状態としてフリッ
プフロップ回路４３の否定出力Ｑバーをアースする。
【００４５】この状態ではＤ／Ａコンバータ４５の調整
電圧ＶD は零Ｖとなる様に、加算手段４０のオペアンプ
４１の反転端子に供給され、このオペアンプ４１の出力
電圧ＶOUT は上記した様にプラスにオフセットされてい
る。
電圧ＶD は零Ｖとなる様に、加算手段４０のオペアンプ
４１の反転端子に供給され、このオペアンプ４１の出力
電圧ＶOUT は上記した様にプラスにオフセットされてい
る。
【００４６】次にクロック発生器２４からのクロックが
アップカウンタ４４に供給されて、カウントを始める
と、Ｄ／Ａコンバータ４５からは零Ｖから（例えば０〜
２５５段階）の階段波状の出力電圧を１カウント毎に出
力してオペアンプ４１の反転入力端子に供給する。
アップカウンタ４４に供給されて、カウントを始める
と、Ｄ／Ａコンバータ４５からは零Ｖから（例えば０〜
２５５段階）の階段波状の出力電圧を１カウント毎に出
力してオペアンプ４１の反転入力端子に供給する。
【００４７】Ｄ／Ａコンバータ４５からの調整電圧が零
Ｖから１デシット毎に増加すると、オペアンプ４１の出
力電圧ＶOUT は零に近づいて来る。
Ｖから１デシット毎に増加すると、オペアンプ４１の出
力電圧ＶOUT は零に近づいて来る。
【００４８】この出力電圧ＶOUT は図２に示す様にコン
パレータ４２に供給されている。このコンパレータは図
３の様にコンパレータのオペアンプ４８の前段に零クロ
ス状態を検出する零検出器４６から成るオペアンプ４７
を有し、零Ｖに成ったことを検出すると共に、オペアン
プ４７の入出力抵抗比を大きく選択して、ノイズを抑え
る様に構成される。
パレータ４２に供給されている。このコンパレータは図
３の様にコンパレータのオペアンプ４８の前段に零クロ
ス状態を検出する零検出器４６から成るオペアンプ４７
を有し、零Ｖに成ったことを検出すると共に、オペアン
プ４７の入出力抵抗比を大きく選択して、ノイズを抑え
る様に構成される。
【００４９】コンパレータ４２で検出された零Ｖ電圧に
よりＤ型フリップフロップ回路４３をセットし、クロッ
クを停止し、Ｄ／Ａコンパレータ４５のチップイネーブ
ルＣＥに否定出力Ｑバーを供給して、カウンタの計数を
停止する様に成されている。
よりＤ型フリップフロップ回路４３をセットし、クロッ
クを停止し、Ｄ／Ａコンパレータ４５のチップイネーブ
ルＣＥに否定出力Ｑバーを供給して、カウンタの計数を
停止する様に成されている。
【００５０】勿論、これらの自動オフセット消去動作は
図１に示した第１及び第２の受光素子１４及び１５のフ
ォトダイオードＡ〜Ｈのすべてについてコントローラ２
３によって同時に行われ、これら各回路のＤ型フリップ
フロップ回路４３‥‥からのすべてのチップイネーブル
信号ＣＥがエンド信号としてコントローラ２３に与えら
れ、すべてがそろったらコントローラ２３はクロック発
生器２４にストップ信号を供給し、スイッチ４８を「オ
フ」させてクロックを停止させる。このスイッチ４８は
例えば、フォトダイオードに発光素子等より成るフォト
カプラ構成としクロックがＸ，Ｙ位置計測時に影響を与
えない構成とするを可とする。
図１に示した第１及び第２の受光素子１４及び１５のフ
ォトダイオードＡ〜Ｈのすべてについてコントローラ２
３によって同時に行われ、これら各回路のＤ型フリップ
フロップ回路４３‥‥からのすべてのチップイネーブル
信号ＣＥがエンド信号としてコントローラ２３に与えら
れ、すべてがそろったらコントローラ２３はクロック発
生器２４にストップ信号を供給し、スイッチ４８を「オ
フ」させてクロックを停止させる。このスイッチ４８は
例えば、フォトダイオードに発光素子等より成るフォト
カプラ構成としクロックがＸ，Ｙ位置計測時に影響を与
えない構成とするを可とする。
【００５１】本発明は勿論、計測装置側のオペアンプは
汎用の光学系に付加するオペアンプに比べてオフセット
が無い様な調整が成されている。
汎用の光学系に付加するオペアンプに比べてオフセット
が無い様な調整が成されている。
【００５２】本発明によれば、ＭＯディスクの光学系の
様に多くのフォトダイオードを含む出力のオフセット調
整時間が１秒以内に済み、光学系１台当たりのオフセッ
ト調整時間を数十秒（７０〜８０秒）短縮することが可
能となり、Ｘ及びＹ軸測定精度も向上したオフセット調
整装置を得ることが可能と成った。
様に多くのフォトダイオードを含む出力のオフセット調
整時間が１秒以内に済み、光学系１台当たりのオフセッ
ト調整時間を数十秒（７０〜８０秒）短縮することが可
能となり、Ｘ及びＹ軸測定精度も向上したオフセット調
整装置を得ることが可能と成った。
【００５３】
【発明の効果】本発明によれば７０〜８０秒のタクト短
縮及びスキルダウンと共にＸ，Ｙ軸方向の測定精度向上
可能なオフセット調整装置が得られる。
縮及びスキルダウンと共にＸ，Ｙ軸方向の測定精度向上
可能なオフセット調整装置が得られる。
【図１】本発明のオフセット調整装置の一実施例を示す
系統図である。
系統図である。
【図２】本発明のオフセット調整装置に用いる自動オフ
セット消去回路の原理的系統図である。
セット消去回路の原理的系統図である。
【図３】本発明のオフセット調整装置に用いる自動オフ
セット消去回路の要部回路図である。
セット消去回路の要部回路図である。
【図４】本発明のオフセット調整装置に用いる演算回路
の構成図である。
の構成図である。
【図５】従来の光学系の構成図である。
【図６】従来のフォトダイオードのオフセット調整装置
の要部回路図である。
の要部回路図である。
【図７】従来のフォトダイオードの逆バイアス説明図で
ある。
ある。
１４，１５ 受光素子 Ａ〜Ｈ フォトダイオード ２０ オフセット調整装置 １６ａ〜１６ｆ，１７ａ〜１７ｈ オペアンプ ２１ａ〜２１ｆ，２２ａ〜２２ｈ 自動オフセット消去
回路 ２３ コントローラ
回路 ２３ コントローラ
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成５年６月８日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００６
【補正方法】変更
【補正内容】
【０００６】これら８分割された第１及び第２の受光素
子１４及び１５の各々のフォトダイオードＡ〜Ｈは夫々
図７に示す様にＰＮ接合に逆バイアス電圧が掛けられて
いるので所定の漏れ電流（暗電流）を持っている。
子１４及び１５の各々のフォトダイオードＡ〜Ｈは夫々
図７に示す様にＰＮ接合に逆バイアス電圧が掛けられて
いるので所定の漏れ電流（暗電流）を持っている。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００１０
【補正方法】変更
【補正内容】
【００１０】これは、上記した様にＭＯディスク用の光
ピックアップ光学系では８分割された受光素子１４及び
１５が２個あり、計１４個のオフセット電圧を夫々調整
しなければならず、これがタクト短縮の障害と成ってい
た。更に初段アンプ等のオフセット電圧は時間経過（温
度上昇）と共に増加するため可変抵抗器ＶＲ1 〜ＶＲ 14
を再度調整しなければならない等の問題があった。
ピックアップ光学系では８分割された受光素子１４及び
１５が２個あり、計１４個のオフセット電圧を夫々調整
しなければならず、これがタクト短縮の障害と成ってい
た。更に初段アンプ等のオフセット電圧は時間経過（温
度上昇）と共に増加するため可変抵抗器ＶＲ1 〜ＶＲ 14
を再度調整しなければならない等の問題があった。
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】００１７
【補正方法】変更
【補正内容】
【００１７】自動オフセット消去回路２１ａ及び２１
ｆ，２２ａ，２２ｂ及び２２ｇ，２２ｈからの出力は演
算回路２５ａ，２５ｃ，２６ａ並に２６ｃに供給され、
夫々所定の演算が成されて出力１、出力３、出力４並に
出力５として出力される。これら出力１及び出力３はモ
ニタ信号出力であり、出力４及び出力６はトラッキング
信号が出力される。
ｆ，２２ａ，２２ｂ及び２２ｇ，２２ｈからの出力は演
算回路２５ａ，２５ｃ，２６ａ並に２６ｃに供給され、
夫々所定の演算が成されて出力１、出力３、出力４並に
出力５として出力される。これら出力１及び出力３はモ
ニタ信号出力であり、出力４及び出力６はトラッキング
信号が出力される。
【手続補正４】
【補正対象書類名】明細書
【補正対象項目名】００２４
【補正方法】変更
【補正内容】
【００２４】次に受光素子１４の４分割されたフォトダ
イオードＡ，Ｂ，Ｃ，Ｄのオフセット補償された出力信
号Ａ1 ，Ｂ1 ，Ｃ1 ，Ｄ1 は第４乃至第６の減算回路３
５ａ，３５ｂ，３５ｃ並に第５の加算回路３６ａから成
る演算回路２６ｂに供給され、第４の減算回路３５ａで
はＸ軸方向のｘ1 位置が（Ａ1 ＋Ｂ1 ）−（Ｃ 1 ＋
Ｄ 1 ）で演算され、第５の減算回路３５ｂではＹ軸方向
のｙ1 位置が（Ａ1 ＋Ｄ1）−（Ｂ1 ＋Ｄ1 ）で演算さ
れる。
イオードＡ，Ｂ，Ｃ，Ｄのオフセット補償された出力信
号Ａ1 ，Ｂ1 ，Ｃ1 ，Ｄ1 は第４乃至第６の減算回路３
５ａ，３５ｂ，３５ｃ並に第５の加算回路３６ａから成
る演算回路２６ｂに供給され、第４の減算回路３５ａで
はＸ軸方向のｘ1 位置が（Ａ1 ＋Ｂ1 ）−（Ｃ 1 ＋
Ｄ 1 ）で演算され、第５の減算回路３５ｂではＹ軸方向
のｙ1 位置が（Ａ1 ＋Ｄ1）−（Ｂ1 ＋Ｄ1 ）で演算さ
れる。
【手続補正５】
【補正対象書類名】明細書
【補正対象項目名】００２９
【補正方法】変更
【補正内容】
【００２９】図２では図１で示した受光素子１４（ＰＤ
1 ）の４分割されたフォトダイオードＡ，Ｂ，Ｃ，Ｄか
らのＡ，Ｂ，Ｃ，Ｄの出力が自動オフセット消去回路２
２ｃ，２２ｄ，２２ｅ‥‥の入力端子ＩＮ１，ＩＮ２，
ＩＮ３‥‥に供給される。
1 ）の４分割されたフォトダイオードＡ，Ｂ，Ｃ，Ｄか
らのＡ，Ｂ，Ｃ，Ｄの出力が自動オフセット消去回路２
２ｃ，２２ｄ，２２ｅ‥‥の入力端子ＩＮ１，ＩＮ２，
ＩＮ３‥‥に供給される。
【手続補正６】
【補正対象書類名】明細書
【補正対象項目名】００３８
【補正方法】変更
【補正内容】
【００３８】コンパレータ４２もオペアンプ４８で構成
されオペアンプ４７の出力が抵抗Ｒ 8 を介してオペアン
プ４８の反転入力端子に供給される。このオペアンプ４
８の非反転入力端子は直接接地され、抵抗Ｒ8 と反転入
力端子の接続点はコンデンサＣ3 を介して接地され、オ
ペアンプ４８の出力端はダイオードＣＤ１を介してフリ
ップフロップ回路４３のクロック端子ＣＫに入力され、
このダイオードＣＤ１とフリップフロップ回路４３との
接続点と接地間に抵抗Ｒ 9 が接続されている。
されオペアンプ４７の出力が抵抗Ｒ 8 を介してオペアン
プ４８の反転入力端子に供給される。このオペアンプ４
８の非反転入力端子は直接接地され、抵抗Ｒ8 と反転入
力端子の接続点はコンデンサＣ3 を介して接地され、オ
ペアンプ４８の出力端はダイオードＣＤ１を介してフリ
ップフロップ回路４３のクロック端子ＣＫに入力され、
このダイオードＣＤ１とフリップフロップ回路４３との
接続点と接地間に抵抗Ｒ 9 が接続されている。
【手続補正７】
【補正対象書類名】明細書
【補正対象項目名】００３９
【補正方法】変更
【補正内容】
【００３９】フリップフロップ回路４３の否定出力Ｑバ
ーは抵抗Ｒ10を介してＤ／Ａコンバータ４５のチップイ
ネーブル端子ＣＥに供給され、このチップイネーブル端
子ＣＥは抵抗Ｒ11を介して接地されている。更に抵抗Ｒ
10の一端はスイッチング用のトランジスタＴＲ1 のコレ
クタに接続され、エミッタは直接アースされ、ベースに
はリセットスイッチ５０からの電圧（＋１２Ｖ）を抵抗
Ｒ12及びＲ13で分圧したバイアス電圧が供給されてい
る。このリセット電圧はアップカウンタ４４及びフリッ
プフロップ回路４３にも与えられている。
ーは抵抗Ｒ10を介してＤ／Ａコンバータ４５のチップイ
ネーブル端子ＣＥに供給され、このチップイネーブル端
子ＣＥは抵抗Ｒ11を介して接地されている。更に抵抗Ｒ
10の一端はスイッチング用のトランジスタＴＲ1 のコレ
クタに接続され、エミッタは直接アースされ、ベースに
はリセットスイッチ５０からの電圧（＋１２Ｖ）を抵抗
Ｒ12及びＲ13で分圧したバイアス電圧が供給されてい
る。このリセット電圧はアップカウンタ４４及びフリッ
プフロップ回路４３にも与えられている。
【手続補正８】
【補正対象書類名】明細書
【補正対象項目名】００４４
【補正方法】変更
【補正内容】
【００４４】本例ではこのバイアスされた加算手段４０
の出力電圧をキャンセルさせる様に成す。この為に、図
３で示すデイプスイッチ４９を選択し、クロック発生器
２４のクロックオンスイッチ５１を動作させ、クロック
出力をアップカウンタ４４へ出力可能状態とする。次に
リセットスイッチ５０を「オン」させて、Ｄ型フリップ
フロップ回路４３のクリヤ、リセット系を動作させてフ
リップフロップ回路４３をプリセット（ＰＲ）させると
共にアップカウンタ４４をプリセット状態にし、トラン
ジスタＴＲ１をバイアスして「オン」状態としてフリッ
プフロップ回路４３の否定出力Ｑバーをアースする。
の出力電圧をキャンセルさせる様に成す。この為に、図
３で示すデイプスイッチ４９を選択し、クロック発生器
２４のクロックオンスイッチ５１を動作させ、クロック
出力をアップカウンタ４４へ出力可能状態とする。次に
リセットスイッチ５０を「オン」させて、Ｄ型フリップ
フロップ回路４３のクリヤ、リセット系を動作させてフ
リップフロップ回路４３をプリセット（ＰＲ）させると
共にアップカウンタ４４をプリセット状態にし、トラン
ジスタＴＲ１をバイアスして「オン」状態としてフリッ
プフロップ回路４３の否定出力Ｑバーをアースする。
【手続補正９】
【補正対象書類名】明細書
【補正対象項目名】００４５
【補正方法】変更
【補正内容】
【００４５】この状態ではＤ／Ａコンバータ４５の調整
電圧ＶD は零Ｖとなり、加算手段４０のオペアンプ４１
の反転端子に供給され、このオペアンプ４１の出力電圧
ＶOU T は上記した様にプラスにオフセットされている。
電圧ＶD は零Ｖとなり、加算手段４０のオペアンプ４１
の反転端子に供給され、このオペアンプ４１の出力電圧
ＶOU T は上記した様にプラスにオフセットされている。
【手続補正１０】
【補正対象書類名】明細書
【補正対象項目名】００４８
【補正方法】変更
【補正内容】
【００４８】この出力電圧ＶOUT は図２に示す様にコン
パレータ４２に供給されている。このコンパレータは図
３の様にコンパレータのオペアンプ４８の前段に零クロ
ス状態を検出する零検出器４６から成るオペアンプ４７
を有し、零Ｖに成ったことを検出すると共に、オペアン
プ４７の入出力抵抗比を大きく選択して、ノイズを抑え
感度を上げる様に構成される。
パレータ４２に供給されている。このコンパレータは図
３の様にコンパレータのオペアンプ４８の前段に零クロ
ス状態を検出する零検出器４６から成るオペアンプ４７
を有し、零Ｖに成ったことを検出すると共に、オペアン
プ４７の入出力抵抗比を大きく選択して、ノイズを抑え
感度を上げる様に構成される。
【手続補正１１】
【補正対象書類名】明細書
【補正対象項目名】００４９
【補正方法】変更
【補正内容】
【００４９】コンパレータ４２で検出された零Ｖ電圧に
よりＤ型フリップフロップ回路４３をセットし、クロッ
クを停止し、Ｄ／Ａコンパレータ４５のチップイネーブ
ルＣＥに否定出力Ｑバーを供給して、出力の増加を停止
する様に成されている。
よりＤ型フリップフロップ回路４３をセットし、クロッ
クを停止し、Ｄ／Ａコンパレータ４５のチップイネーブ
ルＣＥに否定出力Ｑバーを供給して、出力の増加を停止
する様に成されている。
【手続補正１２】
【補正対象書類名】明細書
【補正対象項目名】００５０
【補正方法】変更
【補正内容】
【００５０】勿論、これらの自動オフセット消去動作は
図１に示した第１及び第２の受光素子１４及び１５のフ
ォトダイオードＡ〜Ｈのすべてについてコントローラ２
３によって同時に行われ、これら各回路のＤ型フリップ
フロップ回路４３‥‥からのすべてのチップイネーブル
信号ＣＥがエンド信号としてコントローラ２３に与えら
れ、すべてがそろったらコントローラ２３はクロック発
生器２４にストップ信号を供給し、スイッチ５１を「オ
フ」させてクロックを停止させる。このスイッチ５１は
例えば、フォトダイオードに発光素子等より成るフォト
カプラ構成としクロックがＸ，Ｙ位置計測時に影響を与
えない構成とするを可とする。
図１に示した第１及び第２の受光素子１４及び１５のフ
ォトダイオードＡ〜Ｈのすべてについてコントローラ２
３によって同時に行われ、これら各回路のＤ型フリップ
フロップ回路４３‥‥からのすべてのチップイネーブル
信号ＣＥがエンド信号としてコントローラ２３に与えら
れ、すべてがそろったらコントローラ２３はクロック発
生器２４にストップ信号を供給し、スイッチ５１を「オ
フ」させてクロックを停止させる。このスイッチ５１は
例えば、フォトダイオードに発光素子等より成るフォト
カプラ構成としクロックがＸ，Ｙ位置計測時に影響を与
えない構成とするを可とする。
【手続補正１３】
【補正対象書類名】図面
【補正対象項目名】図１
【補正方法】変更
【補正内容】
【図１】
【手続補正１４】
【補正対象書類名】図面
【補正対象項目名】図２
【補正方法】変更
【補正内容】
【図２】
【手続補正１５】
【補正対象書類名】図面
【補正対象項目名】図３
【補正方法】変更
【補正内容】
【図３】
【手続補正１６】
【補正対象書類名】図面
【補正対象項目名】図４
【補正方法】変更
【補正内容】
【図４】
【手続補正１７】
【補正対象書類名】図面
【補正対象項目名】図６
【補正方法】変更
【補正内容】
【図６】
【手続補正１８】
【補正対象書類名】図面
【補正対象項目名】図７
【補正方法】変更
【補正内容】
【図７】
Claims (5)
- 【請求項１】 光学系に内蔵された受光素子位置と光学
系位置のアライメントをとる際に、該受光素子及び初段
アンプ出力のオフセットを調整する様に成されたオフセ
ット調整装置に於いて、 上記受光素子の暗電流と、該受光素子の後段に接続され
た上記初段アンプのオフセットの和を自動的に消去する
様にした自動オフセット消去手段を設けて成ることを特
徴とするオフセット調整装置。 - 【請求項２】 光学系に内蔵された受光素子に接続され
た電流−電圧変換手段の出力によって、該受光素子のＸ
及びＹ軸方向位置を検知すると共に該受光素子の暗電流
及び該電流−電圧変換手段の電気的オフセットの和を自
動的に消去する自動オフセット消去手段と、 上記自動オフセット消去手段を制御する制御手段とを具
備し、 上記制御手段は上記自動オフセット消去手段の出力を零
電位と成る様に制御し、所定設定値以下に成った時に自
動オフセット調整を終了させる様に成したことを特徴と
するオフセット調整装置。 - 【請求項３】 前記複数のオフセット消去手段を１つの
前記制御手段で同時に制御する様に構成して成ることを
特徴とする請求項２記載のオフセット調整装置。 - 【請求項４】 前記オフセット消去手段からの自動オフ
セット消去終了信号を前記制御手段に供給することによ
って、該制御手段はクロック信号のオフセット消去手段
への供給を停止させる様に構成して成ることを特徴とす
る請求項２又は請求項３記載のいずれか１項記載のオフ
セット調整装置。 - 【請求項５】 前記オフセット自動消去手段は、オフセ
ット電圧を含む計測電圧が供給され、階段的に変化する
調整電圧が供給される加算手段と、 上記加算手段の出力電圧の零Ｖ状態を検出する比較手段
と、 上記比較手段の零ボルト出力で調整電圧を停止させるＤ
／Ａコンバータとより成ることを特徴とする請求項１乃
至請求項４記載のいずれか１項記載のオフセット調整装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3686693A JPH06251382A (ja) | 1993-02-25 | 1993-02-25 | オフセット調整装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3686693A JPH06251382A (ja) | 1993-02-25 | 1993-02-25 | オフセット調整装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06251382A true JPH06251382A (ja) | 1994-09-09 |
Family
ID=12481711
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3686693A Pending JPH06251382A (ja) | 1993-02-25 | 1993-02-25 | オフセット調整装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06251382A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010080038A (ja) * | 2008-08-25 | 2010-04-08 | Tdk Corp | 光学ドライブ装置 |
| JP2011100544A (ja) * | 2009-06-18 | 2011-05-19 | Tdk Corp | 光学ドライブ装置及び増幅率決定方法 |
-
1993
- 1993-02-25 JP JP3686693A patent/JPH06251382A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010080038A (ja) * | 2008-08-25 | 2010-04-08 | Tdk Corp | 光学ドライブ装置 |
| JP2011100544A (ja) * | 2009-06-18 | 2011-05-19 | Tdk Corp | 光学ドライブ装置及び増幅率決定方法 |
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