JPH0621849A - デジタル２重通信用中間取り出し装置を備える通信システム - Google Patents
デジタル２重通信用中間取り出し装置を備える通信システムInfo
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- JPH0621849A JPH0621849A JP4239977A JP23997792A JPH0621849A JP H0621849 A JPH0621849 A JP H0621849A JP 4239977 A JP4239977 A JP 4239977A JP 23997792 A JP23997792 A JP 23997792A JP H0621849 A JPH0621849 A JP H0621849A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L5/00—Arrangements affording multiple use of the transmission path
- H04L5/14—Two-way operation using the same type of signal, i.e. duplex
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B3/00—Line transmission systems
- H04B3/02—Details
- H04B3/20—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other
- H04B3/23—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other using a replica of transmitted signal in the time domain, e.g. echo cancellers
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- Signal Processing (AREA)
- Computer Networks & Wireless Communication (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
- Bidirectional Digital Transmission (AREA)
Abstract
(57)【要約】
【目的】 デジタル２重通信を通信線を分断することな
く中間取り出しすることができる通信システム及び装置
を提供する。 【構成】 本発明による通信システムにおいてはデジタ
ル２重通信の中間取り出しが弁別手段と、この弁別手段
に結合されたエコー除去手段によりなされる。本発明
は、より大きな振幅を持つ通信の流れは弁別手段によっ
てデジタル２重通信から弁別することができ、次いで他
の通信の流れは通信線からのデジタル２重通信と弁別手
段からの大きな振幅の通信の流れとが供給されるエコー
除去手段によってデジタル２重通信から弁別することが
できるという認識に基づいている。
く中間取り出しすることができる通信システム及び装置
を提供する。 【構成】 本発明による通信システムにおいてはデジタ
ル２重通信の中間取り出しが弁別手段と、この弁別手段
に結合されたエコー除去手段によりなされる。本発明
は、より大きな振幅を持つ通信の流れは弁別手段によっ
てデジタル２重通信から弁別することができ、次いで他
の通信の流れは通信線からのデジタル２重通信と弁別手
段からの大きな振幅の通信の流れとが供給されるエコー
除去手段によってデジタル２重通信から弁別することが
できるという認識に基づいている。
Description
【０００１】
【産業上の利用分野】この発明は、デジタル２重通信(d
igital duplex traffic)用の通信線を備える通信システ
ムに係り、特にデジタル２重通信の中間取り出し装置を
有するような通信システムに関する。
igital duplex traffic)用の通信線を備える通信システ
ムに係り、特にデジタル２重通信の中間取り出し装置を
有するような通信システムに関する。
【０００２】
【従来の技術】この種の通信システムは一般に知られて
いる。例えば、統合サービスデジタル通信網(ISDN)にお
いては、デジタルデータは回路網端末器(Network Termi
nation: NT)等の第１の送受信装置と交換器等の第２の
送受信装置との間の通信線により２重モード(duplex mo
de)で伝送される。
いる。例えば、統合サービスデジタル通信網(ISDN)にお
いては、デジタルデータは回路網端末器(Network Termi
nation: NT)等の第１の送受信装置と交換器等の第２の
送受信装置との間の通信線により２重モード(duplex mo
de)で伝送される。
【０００３】アナログ２重通信とは対象的に、デジタル
２重通信は簡単な方法では中間取り出しを行うことはで
きない。アナログ２重通信の中間取り出し用の装置は、
例えば、アナログ２重通信が行われる通信線に（必要な
ら増幅器を介して）結合されたヘッドフォン及び／叉は
音声記録器(voice logger)を有している。この場合、上
記のアナログ２重通信は、２つのアナログ単信通信(ana
log simplex traffic)の信号の流れの和として、ヘッド
フォンを介して知覚することができるか、叉は音声記録
器により磁気テープ上に記録されるか、叉はこれらの両
方を行うことができる。
２重通信は簡単な方法では中間取り出しを行うことはで
きない。アナログ２重通信の中間取り出し用の装置は、
例えば、アナログ２重通信が行われる通信線に（必要な
ら増幅器を介して）結合されたヘッドフォン及び／叉は
音声記録器(voice logger)を有している。この場合、上
記のアナログ２重通信は、２つのアナログ単信通信(ana
log simplex traffic)の信号の流れの和として、ヘッド
フォンを介して知覚することができるか、叉は音声記録
器により磁気テープ上に記録されるか、叉はこれらの両
方を行うことができる。
【０００４】上記のようなアナログ２重通信の中間取り
出し装置をデジタル２重通信が行われる通信線にデジタ
ル・アナログ変換器によって結合するやり方は、デジタ
ル単信通信の２つの反対方向の流れからなるようなデジ
タル２重通信の中間取り出しを行うには不適である。何
故なら、アナログの形態に変換されるデジタル２重通信
は、個々にアナログの形態に変換されたデジタル単信通
信の信号の流れの和とは明らかに相違するからである。
出し装置をデジタル２重通信が行われる通信線にデジタ
ル・アナログ変換器によって結合するやり方は、デジタ
ル単信通信の２つの反対方向の流れからなるようなデジ
タル２重通信の中間取り出しを行うには不適である。何
故なら、アナログの形態に変換されるデジタル２重通信
は、個々にアナログの形態に変換されたデジタル単信通
信の信号の流れの和とは明らかに相違するからである。
【０００５】デジタル２重通信の中間取り出しは、既知
の通信システムにおいても、その通信線上の中間取り出
し点に相互結合された２つの混成回路(hybrid circuit)
を挿入することにより可能となる。その結果として上記
混成回路間の２線式通信線は４線式接続へと変換され、
４本の線の中の２本によって一方向にデジタル単信通信
がなされ、上記４本の線の中の残りの２本により他方向
へのデジタル単信通信がなされるようになる。そして、
デジタル単信通信の各流れをデジタル・アナログ変換器
によりアナログ単信通信の流れに別個に変換し、これら
を合成し叉は合成しないでヘッドフォン及び／叉は音声
記録器へ供給することにより、当該デジタル２重通信を
知覚し及び／叉は磁気テープに記憶することができる。
の通信システムにおいても、その通信線上の中間取り出
し点に相互結合された２つの混成回路(hybrid circuit)
を挿入することにより可能となる。その結果として上記
混成回路間の２線式通信線は４線式接続へと変換され、
４本の線の中の２本によって一方向にデジタル単信通信
がなされ、上記４本の線の中の残りの２本により他方向
へのデジタル単信通信がなされるようになる。そして、
デジタル単信通信の各流れをデジタル・アナログ変換器
によりアナログ単信通信の流れに別個に変換し、これら
を合成し叉は合成しないでヘッドフォン及び／叉は音声
記録器へ供給することにより、当該デジタル２重通信を
知覚し及び／叉は磁気テープに記憶することができる。
【０００６】上記のような既知の通信システムは、デジ
タル２重通信がなされる通信線が中間取り出し点におい
て前記の２つの相互接続された混成回路を挿入するため
に分断されねばならないという欠点を有し、またこれら
の混成回路自体がクロストーク減衰が無限には大きくは
ないという欠点を有している。
タル２重通信がなされる通信線が中間取り出し点におい
て前記の２つの相互接続された混成回路を挿入するため
に分断されねばならないという欠点を有し、またこれら
の混成回路自体がクロストーク減衰が無限には大きくは
ないという欠点を有している。
【０００７】
【発明の目的及び概要】したがって、本発明の目的とす
るところは本明細書の冒頭で述べたような通信システム
であって、デジタル２重通信を通信線の分断を要するこ
となく中間取り出しすることができるような通信システ
ムを提供することにある。
るところは本明細書の冒頭で述べたような通信システム
であって、デジタル２重通信を通信線の分断を要するこ
となく中間取り出しすることができるような通信システ
ムを提供することにある。
【０００８】上記目的を達成するため、本発明による通
信システムは、中間取り出し装置がデジタル２重通信か
ら一方向にデジタル単信通信を弁別する弁別手段を有す
ると共に、この弁別手段に結合されて上記デジタル２重
通信から他方向にデジタル単信通信を弁別するエコー除
去手段を有していることを特徴としている。
信システムは、中間取り出し装置がデジタル２重通信か
ら一方向にデジタル単信通信を弁別する弁別手段を有す
ると共に、この弁別手段に結合されて上記デジタル２重
通信から他方向にデジタル単信通信を弁別するエコー除
去手段を有していることを特徴としている。
【０００９】本発明は、中間取り出し点が第２の送受信
装置（交換器）よりも第１の送受信装置（回路網端末
器）に近い場合は、通信線上の減衰の結果として一方向
（回路網端末器から交換器へ）のデジタルデータ通信は
他方向（交換器から回路網端末器へ）のデジタルデータ
通信よりも大きな振幅を持つという認識に基づいてい
る。一方向における（回路網端末器からくる）上記デジ
タル単信通信は、弁別手段により１以上のレベルに基づ
いてデジタル２重通信から弁別される。そして、上記一
方向のデジタル単信通信は、デジタル２重通信と同様
に、エコー除去手段に供給される。このエコー除去手段
によっては、他方向の（交換器からくる）デジタル単信
通信がデジタル２重通信から弁別される。中間取り出し
点が第１の送受信装置（回路網端末器）よりも第２の送
受信装置（交換器）に近い場合は、通信線上の減衰の結
果として他方向（交換器から回路網端末器へ）のデジタ
ルデータ通信の方が一方向（回路網端末器から交換器
へ）のデジタルデータ通信よりも大きな振幅を持つ。こ
の場合、他方向における（交換器からくる）上記デジタ
ル単信通信は、弁別手段により１以上のレベルに基づい
てデジタル２重通信から弁別される。そして、上記他方
向のデジタル単信通信は、デジタル２重通信と同様に、
エコー除去手段に供給され、このエコー除去手段により
一方向の（回路網端末器からくる）デジタル単信通信が
デジタル２重通信から弁別される。
装置（交換器）よりも第１の送受信装置（回路網端末
器）に近い場合は、通信線上の減衰の結果として一方向
（回路網端末器から交換器へ）のデジタルデータ通信は
他方向（交換器から回路網端末器へ）のデジタルデータ
通信よりも大きな振幅を持つという認識に基づいてい
る。一方向における（回路網端末器からくる）上記デジ
タル単信通信は、弁別手段により１以上のレベルに基づ
いてデジタル２重通信から弁別される。そして、上記一
方向のデジタル単信通信は、デジタル２重通信と同様
に、エコー除去手段に供給される。このエコー除去手段
によっては、他方向の（交換器からくる）デジタル単信
通信がデジタル２重通信から弁別される。中間取り出し
点が第１の送受信装置（回路網端末器）よりも第２の送
受信装置（交換器）に近い場合は、通信線上の減衰の結
果として他方向（交換器から回路網端末器へ）のデジタ
ルデータ通信の方が一方向（回路網端末器から交換器
へ）のデジタルデータ通信よりも大きな振幅を持つ。こ
の場合、他方向における（交換器からくる）上記デジタ
ル単信通信は、弁別手段により１以上のレベルに基づい
てデジタル２重通信から弁別される。そして、上記他方
向のデジタル単信通信は、デジタル２重通信と同様に、
エコー除去手段に供給され、このエコー除去手段により
一方向の（回路網端末器からくる）デジタル単信通信が
デジタル２重通信から弁別される。
【００１０】本発明による通信システムの第１の実施例
は、前記弁別手段が比較器手段を有し、この比較器手段
が前記通信線に結合されてデジタル２重通信を入力する
ための第１の入力端子と、基準点に結合されて基準信号
を入力するための第２の入力端子とを有していることを
特徴としている。
は、前記弁別手段が比較器手段を有し、この比較器手段
が前記通信線に結合されてデジタル２重通信を入力する
ための第１の入力端子と、基準点に結合されて基準信号
を入力するための第２の入力端子とを有していることを
特徴としている。
【００１１】比較器手段として構成された弁別手段の助
けにより、より大きな振幅を持つデジタル単信通信が１
以上のレベルに基づいて簡単な方法でデジタル２重通信
から選択される。この場合、上記基準点に存在する基準
信号が前記レベルの高さを決定する。デジタル単信通信
が２値信号を有する場合は、当該レベルより上側に位置
する論理値「１」と当該レベルより下側に位置する論理
値「０」との間の弁別を行うために単一のレベルが必要
となる。デジタル単信通信が３値信号のような２値以上
の信号を有する場合は、異なる信号値を弁別するために
２以上のレベルが必要である。３値信号の場合は、前記
比較器手段の第２の入力端子は第１及び第２の副入力端
子を有する必要があり、ここで第１及び第２の副入力端
子は異なるレベルに対応する第１及び第２の基準信号を
各々入力するために第１及び第２の基準点に結合され
る。
けにより、より大きな振幅を持つデジタル単信通信が１
以上のレベルに基づいて簡単な方法でデジタル２重通信
から選択される。この場合、上記基準点に存在する基準
信号が前記レベルの高さを決定する。デジタル単信通信
が２値信号を有する場合は、当該レベルより上側に位置
する論理値「１」と当該レベルより下側に位置する論理
値「０」との間の弁別を行うために単一のレベルが必要
となる。デジタル単信通信が３値信号のような２値以上
の信号を有する場合は、異なる信号値を弁別するために
２以上のレベルが必要である。３値信号の場合は、前記
比較器手段の第２の入力端子は第１及び第２の副入力端
子を有する必要があり、ここで第１及び第２の副入力端
子は異なるレベルに対応する第１及び第２の基準信号を
各々入力するために第１及び第２の基準点に結合され
る。
【００１２】本発明による通信システムの第２の実施例
は、前記エコー除去手段がエコー除去装置とシンボル間
妨害除去装置とを有し、上記エコー除去装置の入力端子
が前記比較器手段の出力端子に結合され、該エコー除去
装置の出力端子がシンボル間妨害除去装置の入力端子に
結合されていることを特徴としている。
は、前記エコー除去手段がエコー除去装置とシンボル間
妨害除去装置とを有し、上記エコー除去装置の入力端子
が前記比較器手段の出力端子に結合され、該エコー除去
装置の出力端子がシンボル間妨害除去装置の入力端子に
結合されていることを特徴としている。
【００１３】前記エコー除去手段がエコー除去装置とシ
ンボル間妨害除去装置との両方を有している場合は、一
旦前記比較器手段によりデジタル２重通信から弁別され
ると共にこの動作の結果として不可避的な歪を有してい
るようなより大きな振幅を持つデジタル単信通信がエコ
ー除去装置に供給され、このエコー除去装置に上記のよ
り大きな振幅を持つ元のデジタル単信通信が正確に複製
される。次いで、デジタル２重通信と上記のより大きな
振幅を持ち複製されたデジタル単信通信との間の差をシ
ンボル間妨害除去装置に供給することにより、該装置は
より小さな振幅を持つデジタル単信通信を正確に決定す
る。
ンボル間妨害除去装置との両方を有している場合は、一
旦前記比較器手段によりデジタル２重通信から弁別され
ると共にこの動作の結果として不可避的な歪を有してい
るようなより大きな振幅を持つデジタル単信通信がエコ
ー除去装置に供給され、このエコー除去装置に上記のよ
り大きな振幅を持つ元のデジタル単信通信が正確に複製
される。次いで、デジタル２重通信と上記のより大きな
振幅を持ち複製されたデジタル単信通信との間の差をシ
ンボル間妨害除去装置に供給することにより、該装置は
より小さな振幅を持つデジタル単信通信を正確に決定す
る。
【００１４】本発明による通信システムの第３の実施例
は、当該装置が更に前記比較器手段の出力端子に結合さ
れた第１のデスクランブラと、前記シンボル間妨害除去
装置の入力端子に結合された第２のデスクランブラとを
有することを特徴としている。
は、当該装置が更に前記比較器手段の出力端子に結合さ
れた第１のデスクランブラと、前記シンボル間妨害除去
装置の入力端子に結合された第２のデスクランブラとを
有することを特徴としている。
【００１５】従来のシステムは、既に存在し且つ混成回
路の近傍に位置するような他のエコー除去システム用と
してスクランブラ及びデスクランブラをしばしば有して
いる。これらのスクランブラ及びデスクランブラの目的
はデジタル単信通信の２つの流れの間の相関を除去する
ことにある。そのような場合、デジタル２重通信を中間
取り出しするための装置はデスクランブラを有さなけれ
ばならず、その中の比較器手段の出力端子に結合された
第１のデスクランブラはより大きな振幅を持つデジタル
単信通信をデスクランブルするためのものであり、シン
ボル間妨害除去装置の入力端子に結合された第２のデス
クランブラはより小さな振幅を持つデジタル単信通信を
デスクランブルするためのものである。
路の近傍に位置するような他のエコー除去システム用と
してスクランブラ及びデスクランブラをしばしば有して
いる。これらのスクランブラ及びデスクランブラの目的
はデジタル単信通信の２つの流れの間の相関を除去する
ことにある。そのような場合、デジタル２重通信を中間
取り出しするための装置はデスクランブラを有さなけれ
ばならず、その中の比較器手段の出力端子に結合された
第１のデスクランブラはより大きな振幅を持つデジタル
単信通信をデスクランブルするためのものであり、シン
ボル間妨害除去装置の入力端子に結合された第２のデス
クランブラはより小さな振幅を持つデジタル単信通信を
デスクランブルするためのものである。
【００１６】本発明による通信システムの第４の実施例
は、前記エコー除去装置が第１のシフトレジスタと第１
のメモリ手段との直列結合を有し、前記シンボル間妨害
除去装置が第２のシフトレジスタと第２のメモリ手段と
の直列結合を有し、これら第１及び第２のメモリ手段が
デジタル・アナログ変換器を介して加算器の第１の入力
端子に結合され、当該加算器の第２の入力端子が前記比
較器手段の第１の入力端子に結合され、この加算器の出
力端子が第１及び第２のメモリ手段の各入力端子と第２
のシフトレジスタとに結合されていることを特徴として
いる。
は、前記エコー除去装置が第１のシフトレジスタと第１
のメモリ手段との直列結合を有し、前記シンボル間妨害
除去装置が第２のシフトレジスタと第２のメモリ手段と
の直列結合を有し、これら第１及び第２のメモリ手段が
デジタル・アナログ変換器を介して加算器の第１の入力
端子に結合され、当該加算器の第２の入力端子が前記比
較器手段の第１の入力端子に結合され、この加算器の出
力端子が第１及び第２のメモリ手段の各入力端子と第２
のシフトレジスタとに結合されていることを特徴として
いる。
【００１７】この通信システムにおいては、デジタル２
重通信を中間取り出しするための装置が簡単に且つ価格
効率よく実現することができる。
重通信を中間取り出しするための装置が簡単に且つ価格
効率よく実現することができる。
【００１８】本発明は、更に、本明細書の冒頭で述べた
ような形式の通信システムに使用されるデジタル２重通
信の中間取り出しを行う装置にも関する。
ような形式の通信システムに使用されるデジタル２重通
信の中間取り出しを行う装置にも関する。
【００１９】本発明の他の目的は、デジタル２重通信を
中間取り出しする装置であって、このデジタル２重通信
を通信線の分断を要せずに中間取り出しすることができ
るような装置を提供することにある。
中間取り出しする装置であって、このデジタル２重通信
を通信線の分断を要せずに中間取り出しすることができ
るような装置を提供することにある。
【００２０】この目的のため、本発明による装置はデジ
タル２重通信から一方向のデジタル単信通信を弁別する
弁別手段を有すると共に、弁別手段に結合され前記デジ
タル２重通信から他方向のデジタル単信通信を弁別する
エコー除去手段を含むことを特徴としている。
タル２重通信から一方向のデジタル単信通信を弁別する
弁別手段を有すると共に、弁別手段に結合され前記デジ
タル２重通信から他方向のデジタル単信通信を弁別する
エコー除去手段を含むことを特徴としている。
【００２１】本発明による装置の第１の実施例は、前記
弁別手段が比較器手段を有し、この比較器手段が通信線
に結合可能であってデジタル２重通信を入力するための
第１の入力端子と、基準点に結合されて基準信号を入力
するための第２の入力端子とを有していることを特徴と
している。
弁別手段が比較器手段を有し、この比較器手段が通信線
に結合可能であってデジタル２重通信を入力するための
第１の入力端子と、基準点に結合されて基準信号を入力
するための第２の入力端子とを有していることを特徴と
している。
【００２２】本発明による装置の第２の実施例は、前記
エコー除去手段がエコー除去装置とシンボル間妨害除去
装置とを有し、上記エコー除去装置の入力端子が前記比
較器手段の出力端子に結合され、該エコー除去装置の出
力端子が前記シンボル間妨害除去装置の入力端子に結合
されていることを特徴としている。
エコー除去手段がエコー除去装置とシンボル間妨害除去
装置とを有し、上記エコー除去装置の入力端子が前記比
較器手段の出力端子に結合され、該エコー除去装置の出
力端子が前記シンボル間妨害除去装置の入力端子に結合
されていることを特徴としている。
【００２３】本発明による装置の第３の実施例は、当該
装置が更に前記比較器手段の出力端子に結合された第１
のデスクランブラと、前記シンボル間妨害除去装置の入
力端子に結合された第２のデスクランブラとを有するこ
とを特徴としている。
装置が更に前記比較器手段の出力端子に結合された第１
のデスクランブラと、前記シンボル間妨害除去装置の入
力端子に結合された第２のデスクランブラとを有するこ
とを特徴としている。
【００２４】本発明による装置の第４の実施例は、前記
エコー除去装置が第１のシフトレジスタと第１のメモリ
手段との直列結合を有し、前記シンボル間妨害除去装置
が第２のシフトレジスタと第２のメモリ手段との直列結
合を有し、これら第１及び第２のメモリ手段がデジタル
・アナログ変換器を介して加算器の第１の入力端子に結
合され、当該加算器の第２の入力端子が前記比較器手段
の第１の入力端子に結合され、この加算器の出力端子が
第１及び第２のメモリ手段の各入力端子と第２のシフト
レジスタとに結合されていることを特徴としている。
エコー除去装置が第１のシフトレジスタと第１のメモリ
手段との直列結合を有し、前記シンボル間妨害除去装置
が第２のシフトレジスタと第２のメモリ手段との直列結
合を有し、これら第１及び第２のメモリ手段がデジタル
・アナログ変換器を介して加算器の第１の入力端子に結
合され、当該加算器の第２の入力端子が前記比較器手段
の第１の入力端子に結合され、この加算器の出力端子が
第１及び第２のメモリ手段の各入力端子と第２のシフト
レジスタとに結合されていることを特徴としている。
【００２５】
【実施例】以下、本発明の実施例を図面を参照して詳細
に説明する。
に説明する。
【００２６】図１に示す本発明による通信システムは、
西(WEST)で示す回路網端末器(NT)のような第１の送受信
装置１と、東(EAST)で示す交換器のような第２の送受信
装置２とを有している。回路網端末器１と交換器２とは
２線式通信線３により相互接続され、該通信線によりデ
ジタルデータが、２重モードにおいて連続的に、または
バーストモード法において使用されるようなある副区間
内で伝送される。この通信システムは、更に、上記２重
通信の中間取り出しを行うための装置４〜２１を有し、
この装置は中間取り出し点において通信線３に接続され
ている。
西(WEST)で示す回路網端末器(NT)のような第１の送受信
装置１と、東(EAST)で示す交換器のような第２の送受信
装置２とを有している。回路網端末器１と交換器２とは
２線式通信線３により相互接続され、該通信線によりデ
ジタルデータが、２重モードにおいて連続的に、または
バーストモード法において使用されるようなある副区間
内で伝送される。この通信システムは、更に、上記２重
通信の中間取り出しを行うための装置４〜２１を有し、
この装置は中間取り出し点において通信線３に接続され
ている。
【００２７】上記装置４〜２１は比較器４として構成さ
れた弁別手段を有し、この比較器の第１の入力端子４-1
はデジタル２重通信を受信するために前記通信線３に接
続され、第２の入力端子４-2は接地基準点に接続されて
いる。この装置４〜２１は、更に、比較器４の出力端子
４-3に結合されたエコー除去手段５〜２１を有してい
る。このエコー除去手段５〜２１はエコー除去装置６〜
８を有し、この装置の入力端子６-2は前記比較器４の出
力端子４-3に接続され、出力端子７-3はエコー除去手段
５〜２１に属するシンボル間妨害除去装置９〜１１の入
力端子９-2に結合されている。
れた弁別手段を有し、この比較器の第１の入力端子４-1
はデジタル２重通信を受信するために前記通信線３に接
続され、第２の入力端子４-2は接地基準点に接続されて
いる。この装置４〜２１は、更に、比較器４の出力端子
４-3に結合されたエコー除去手段５〜２１を有してい
る。このエコー除去手段５〜２１はエコー除去装置６〜
８を有し、この装置の入力端子６-2は前記比較器４の出
力端子４-3に接続され、出力端子７-3はエコー除去手段
５〜２１に属するシンボル間妨害除去装置９〜１１の入
力端子９-2に結合されている。
【００２８】エコー除去装置６〜８（以下、ｅｃ装置と
呼ぶ）は、シフトレジスタ６と、メモリ手段７と、アッ
プダウン・カウンタ８とを有している。上記シフトレジ
スタ６は、入力端子６-2と、タイミング信号Ｔb,westを
入力するクロック入力端子６-1と、前記メモリ手段７の
アドレス入力端子７-2に接続された出力端子６-3とを有
している。このメモリ手段７は、選択信号bit/phase
westを入力する選択入力端子７-1と、入力端子７-4と、
出力端子７-3とを更に有している。上記入力端子７-4は
アップダウン・カウンタ８の出力端子８-3に接続され、
前記出力端子７-3は同カウンタの入力端子８-2に接続さ
れ、このカウンタ８は更に制御入力端子８-1を有してい
る。
呼ぶ）は、シフトレジスタ６と、メモリ手段７と、アッ
プダウン・カウンタ８とを有している。上記シフトレジ
スタ６は、入力端子６-2と、タイミング信号Ｔb,westを
入力するクロック入力端子６-1と、前記メモリ手段７の
アドレス入力端子７-2に接続された出力端子６-3とを有
している。このメモリ手段７は、選択信号bit/phase
westを入力する選択入力端子７-1と、入力端子７-4と、
出力端子７-3とを更に有している。上記入力端子７-4は
アップダウン・カウンタ８の出力端子８-3に接続され、
前記出力端子７-3は同カウンタの入力端子８-2に接続さ
れ、このカウンタ８は更に制御入力端子８-1を有してい
る。
【００２９】前記シンボル間妨害除去装置９〜１１（以
下、isic装置と呼ぶ）は、シフトレジスタ９と、メモリ
手段１０と、アップダウン・カウンタ１１とを有してい
る。上記シフトレジスタ９は、入力端子９-2と、タイミ
ング信号Ｔb,eastを入力するクロック入力端子９-1と、
前記メモリ手段１０のアドレス入力端子１０-2に接続さ
れた出力端子９-3とを有している。このメモリ手段１０
は、選択信号bit/phaseeastを入力する選択入力端子１
０-1と、入力端子１０-4と、出力端子１０-3とを更に有
している。上記入力端子１０-4はアップダウン・カウン
タ１１の出力端子１１-3に接続され、前記出力端子１０
-3は同カウンタの入力端子１１-2に接続され、このカウ
ンタ１１は更に制御入力端子１１-1を有している。
下、isic装置と呼ぶ）は、シフトレジスタ９と、メモリ
手段１０と、アップダウン・カウンタ１１とを有してい
る。上記シフトレジスタ９は、入力端子９-2と、タイミ
ング信号Ｔb,eastを入力するクロック入力端子９-1と、
前記メモリ手段１０のアドレス入力端子１０-2に接続さ
れた出力端子９-3とを有している。このメモリ手段１０
は、選択信号bit/phaseeastを入力する選択入力端子１
０-1と、入力端子１０-4と、出力端子１０-3とを更に有
している。上記入力端子１０-4はアップダウン・カウン
タ１１の出力端子１１-3に接続され、前記出力端子１０
-3は同カウンタの入力端子１１-2に接続され、このカウ
ンタ１１は更に制御入力端子１１-1を有している。
【００３０】前記出力端子７-3及び１０-3は、加算手段
１２の入力端子１２-1及び１２-2に各々接続され、この
加算手段はデジタル・アナログ変換器（以下、ＤＡＣと
呼ぶ）１３の入力端子１３-1に接続された出力端子１２
-3を有している。ＤＡＣ１３の出力端子１３-2は加算器
１４の（−）入力端子１４-1に接続され、この加算器は
前記比較器４の入力端子４-1に接続された（＋）入力端
子１４-2と、比較器１５の（＋）入力端子１５-1及び比
較器１７の（＋）入力端子１７-1に接続された出力端子
１４-3とを有している。
１２の入力端子１２-1及び１２-2に各々接続され、この
加算手段はデジタル・アナログ変換器（以下、ＤＡＣと
呼ぶ）１３の入力端子１３-1に接続された出力端子１２
-3を有している。ＤＡＣ１３の出力端子１３-2は加算器
１４の（−）入力端子１４-1に接続され、この加算器は
前記比較器４の入力端子４-1に接続された（＋）入力端
子１４-2と、比較器１５の（＋）入力端子１５-1及び比
較器１７の（＋）入力端子１７-1に接続された出力端子
１４-3とを有している。
【００３１】上記比較器１５は、接地点に接続された
（−）入力端子１５-2と、ＲＤラッチ回路１６の入力端
子１６-2に接続された出力端子１５-3とを更に有してい
る。このＲＤラッチ回路１６は、タイミング信号Ｔb,ea
st及びタイミング信号Ｔph,eastを入力するクロック入
力端子１６-1と、シフトレジスタ９の入力端子９-2に接
続された出力端子１６-3とを更に有している。また、比
較器１７は、レベルシフト回路１９の出力端子１９-4に
接続された（−）入力端子１７-2を有し、このレベルシ
フト回路１９はタイミング信号Ｔb,eastを入力するクロ
ック入力端子１９-1と、入力端子１９-2及び１９-3とを
有している。上記入力端子１９-2は前記ＲＤラッチ回路
１６の出力端子１６-3に接続され、入力端子１９-3はＥ
Ｓラッチ回路１８の出力端子１８-3に接続されている。
このＥＳラッチ回路１８はタイミング信号Ｔb,eastを入
力するクロック入力端子１８-1と、前記比較器１７の出
力端子１７-3に接続された入力端子１８-2とを有してい
る。
（−）入力端子１５-2と、ＲＤラッチ回路１６の入力端
子１６-2に接続された出力端子１５-3とを更に有してい
る。このＲＤラッチ回路１６は、タイミング信号Ｔb,ea
st及びタイミング信号Ｔph,eastを入力するクロック入
力端子１６-1と、シフトレジスタ９の入力端子９-2に接
続された出力端子１６-3とを更に有している。また、比
較器１７は、レベルシフト回路１９の出力端子１９-4に
接続された（−）入力端子１７-2を有し、このレベルシ
フト回路１９はタイミング信号Ｔb,eastを入力するクロ
ック入力端子１９-1と、入力端子１９-2及び１９-3とを
有している。上記入力端子１９-2は前記ＲＤラッチ回路
１６の出力端子１６-3に接続され、入力端子１９-3はＥ
Ｓラッチ回路１８の出力端子１８-3に接続されている。
このＥＳラッチ回路１８はタイミング信号Ｔb,eastを入
力するクロック入力端子１８-1と、前記比較器１７の出
力端子１７-3に接続された入力端子１８-2とを有してい
る。
【００３２】前記ＲＤラッチ回路１６の出力端子１６-3
は切換スイッチ２０の選択接点２０-2に接続され、ＥＳ
ラッチ回路１８の出力端子１８-3は同切換スイッチ２０
の選択接点２０-1に接続されている。この切換スイッチ
の主接点２０-3は前記アップダウン・カウンタ８の制御
入力端子８-1と、アップダウン・カウンタ１１の制御入
力端子１１-1とに接続されている。前記選択信号bit/ph
aseeastの制御の下で、切換スイッチ２０は選択接点２
０-1叉は２０-2の何れかを主接点２０-3に接続する。
は切換スイッチ２０の選択接点２０-2に接続され、ＥＳ
ラッチ回路１８の出力端子１８-3は同切換スイッチ２０
の選択接点２０-1に接続されている。この切換スイッチ
の主接点２０-3は前記アップダウン・カウンタ８の制御
入力端子８-1と、アップダウン・カウンタ１１の制御入
力端子１１-1とに接続されている。前記選択信号bit/ph
aseeastの制御の下で、切換スイッチ２０は選択接点２
０-1叉は２０-2の何れかを主接点２０-3に接続する。
【００３３】当該装置４〜２１は、更に、２個のデスク
ランブラ(descrambler)５及び２１を有している。デス
クランブラ５は前記比較器４の出力端子４-3に接続され
た入力端子５-2と、タイミング信号Ｔb,westを入力する
クロック入力端子５-1とを有している。この場合、この
デスクランブラ５の出力端子５-3には当該中間取り出し
点に一番近い送受信装置のデータ（この実施例では、回
路網端末器１のデータ）が得られる。一方、デスクラン
ブラ２１はＲＤラッチ回路１６の出力端子１６-3とシフ
トレジスタ９の入力端子９-2とに接続された入力端子２
１-2と、タイミング信号Ｔb,eastを入力するクロック入
力端子２１-1とを有している。このデスクランブラ２１
の出力端子２１-3には、中間取り出し点から一番遠い送
受信装置のデータ（この実施例においては、交換器２の
データ）が得られる。
ランブラ(descrambler)５及び２１を有している。デス
クランブラ５は前記比較器４の出力端子４-3に接続され
た入力端子５-2と、タイミング信号Ｔb,westを入力する
クロック入力端子５-1とを有している。この場合、この
デスクランブラ５の出力端子５-3には当該中間取り出し
点に一番近い送受信装置のデータ（この実施例では、回
路網端末器１のデータ）が得られる。一方、デスクラン
ブラ２１はＲＤラッチ回路１６の出力端子１６-3とシフ
トレジスタ９の入力端子９-2とに接続された入力端子２
１-2と、タイミング信号Ｔb,eastを入力するクロック入
力端子２１-1とを有している。このデスクランブラ２１
の出力端子２１-3には、中間取り出し点から一番遠い送
受信装置のデータ（この実施例においては、交換器２の
データ）が得られる。
【００３４】このように、比較器１５、１７、ラッチ回
路１６、１８、レベルシフト回路１９、切換スイッチ２
０及びアップダウン・カウンタ８、１１により、加算器
１４の出力端子１４-3とメモリ手段７、１０の入力端子
７-4、１０-4との間に信号結合が実現される。また、比
較器１５とＲＤラッチ回路１６とにより加算器１４の出
力端子１４-3とシフトレジスタ９の入力端子９-2との間
に信号結合が達成され、メモリ手段７、１０の出力端子
７-3、１０-3は加算手段１２とＤＡＣ１３とにより加算
器１４の入力端子１４-1に結合される。
路１６、１８、レベルシフト回路１９、切換スイッチ２
０及びアップダウン・カウンタ８、１１により、加算器
１４の出力端子１４-3とメモリ手段７、１０の入力端子
７-4、１０-4との間に信号結合が実現される。また、比
較器１５とＲＤラッチ回路１６とにより加算器１４の出
力端子１４-3とシフトレジスタ９の入力端子９-2との間
に信号結合が達成され、メモリ手段７、１０の出力端子
７-3、１０-3は加算手段１２とＤＡＣ１３とにより加算
器１４の入力端子１４-1に結合される。
【００３５】次に、図１に示した通信システムの概略動
作を説明する。ここで、通信線３上には、反対方向に移
動し且つ一緒になってデジタル２重通信を形成するよう
な中間取り出しされるべきデジタル単信通信の各流れが
伝送される。当該中間取り出し点が交換器２よりも回路
網端末器１に近いとすると、通信線による減衰の結果と
して一方向のデジタル単信通信（通信網端末器１から交
換器２への方向の、即ち西から東への、データ通信）
は、他方向のデジタル単信通信（交換器から回路網端末
器への方向、即ち東から西への、データ通信）よりも大
きな振幅を有する。一方、当該中間取り出し点が回路網
端末器１より交換器２に近い場合は、上記とは逆になる
ことは明かである。
作を説明する。ここで、通信線３上には、反対方向に移
動し且つ一緒になってデジタル２重通信を形成するよう
な中間取り出しされるべきデジタル単信通信の各流れが
伝送される。当該中間取り出し点が交換器２よりも回路
網端末器１に近いとすると、通信線による減衰の結果と
して一方向のデジタル単信通信（通信網端末器１から交
換器２への方向の、即ち西から東への、データ通信）
は、他方向のデジタル単信通信（交換器から回路網端末
器への方向、即ち東から西への、データ通信）よりも大
きな振幅を有する。一方、当該中間取り出し点が回路網
端末器１より交換器２に近い場合は、上記とは逆になる
ことは明かである。
【００３６】かくして、中間取り出し点におけるデジタ
ル２重通信は、比較的大きな振幅を持つ一方向へのデジ
タル単信通信と比較的小さな振幅を持つ他方向へのデジ
タル単信通信とを含むことになる。このようなデジタル
２重通信が前記比較器４に供給され、該比較器は単一の
レベルに基づいて、比較的大きな振幅を持つデジタル単
信通信をデジタル２重通信から弁別する（ここで、上記
デジタル２重通信が接地レベルに対して対称であると仮
定すると、上記単一のレベルは接地レベルである）。こ
のことは、上記デジタル単信通信が２値信号を有し、そ
の場合は当該レベルよりも上に位置する論理値「１」を
該レベルよりも下に位置する論理値「０」から弁別する
ための単一のレベルが必要であるという仮定に基づいて
いる。一方、上記デジタル単信通信が３値信号のような
２値以上の信号からなる場合は、異なる信号レベルの間
の弁別を行うために２以上のレベルが必要となろう。３
値信号の場合は、前記比較器４の第２入力端子４-2は第
１及び第２の副入力端子を有する必要があり、この場合
第１の副入力端子は第１の基準点に、また第２の副入力
端子は第２の基準点に各々結合され、相互に異なる第１
及び第２の基準信号を入力するようにする。
ル２重通信は、比較的大きな振幅を持つ一方向へのデジ
タル単信通信と比較的小さな振幅を持つ他方向へのデジ
タル単信通信とを含むことになる。このようなデジタル
２重通信が前記比較器４に供給され、該比較器は単一の
レベルに基づいて、比較的大きな振幅を持つデジタル単
信通信をデジタル２重通信から弁別する（ここで、上記
デジタル２重通信が接地レベルに対して対称であると仮
定すると、上記単一のレベルは接地レベルである）。こ
のことは、上記デジタル単信通信が２値信号を有し、そ
の場合は当該レベルよりも上に位置する論理値「１」を
該レベルよりも下に位置する論理値「０」から弁別する
ための単一のレベルが必要であるという仮定に基づいて
いる。一方、上記デジタル単信通信が３値信号のような
２値以上の信号からなる場合は、異なる信号レベルの間
の弁別を行うために２以上のレベルが必要となろう。３
値信号の場合は、前記比較器４の第２入力端子４-2は第
１及び第２の副入力端子を有する必要があり、この場合
第１の副入力端子は第１の基準点に、また第２の副入力
端子は第２の基準点に各々結合され、相互に異なる第１
及び第２の基準信号を入力するようにする。
【００３７】上記の場合、比較的大きな振幅を持つデジ
タル単信通信はデジタル２重通信と共に前記エコー除去
手段５〜２１に供給され、該手段により比較的小さな振
幅を持つデジタル単信通信がデジタル２重通信から弁別
される。俗な言葉で言うと、上記のことは、比較的大き
な振幅を持つデジタル単信通信を前記ｅｃ装置６〜８に
供給することによりなされ、該装置は可能な最良の方法
により比較的大きな振幅を持つ元のデジタル単信通信を
複製する。一方、前記比較器４はデジタル２重通信から
比較的大きな振幅を持つデジタル単信通信を弁別する
が、この後者の通信信号は不可避的に僅かに歪んでい
る。そして、デジタル２重通信と比較的大きな振幅を持
つ複製されたデジタル単信通信との間の差が供給される
前記isic装置９〜１１により、比較的小さな振幅を持つ
デジタル単信通信が正確に決定される。
タル単信通信はデジタル２重通信と共に前記エコー除去
手段５〜２１に供給され、該手段により比較的小さな振
幅を持つデジタル単信通信がデジタル２重通信から弁別
される。俗な言葉で言うと、上記のことは、比較的大き
な振幅を持つデジタル単信通信を前記ｅｃ装置６〜８に
供給することによりなされ、該装置は可能な最良の方法
により比較的大きな振幅を持つ元のデジタル単信通信を
複製する。一方、前記比較器４はデジタル２重通信から
比較的大きな振幅を持つデジタル単信通信を弁別する
が、この後者の通信信号は不可避的に僅かに歪んでい
る。そして、デジタル２重通信と比較的大きな振幅を持
つ複製されたデジタル単信通信との間の差が供給される
前記isic装置９〜１１により、比較的小さな振幅を持つ
デジタル単信通信が正確に決定される。
【００３８】次に、図１に示した通信システムの詳細な
動作を図２に示す各タイミング信号及びこれら信号から
得られる制御信号を参照して説明する。ここで、デジタ
ル単信通信の各流れは２相符号化信号を有するものと仮
定する。言うまでもなく、本発明は例えばＡＭＩ(alter
nate mark inversion)信号叉は２値以上の信号のような
上記とは異なる態様で符号化された信号を有するデジタ
ル単信通信の流れにも使用することができる。
動作を図２に示す各タイミング信号及びこれら信号から
得られる制御信号を参照して説明する。ここで、デジタ
ル単信通信の各流れは２相符号化信号を有するものと仮
定する。言うまでもなく、本発明は例えばＡＭＩ(alter
nate mark inversion)信号叉は２値以上の信号のような
上記とは異なる態様で符号化された信号を有するデジタ
ル単信通信の流れにも使用することができる。
【００３９】図２に示した２相信号は、比較的小さな振
幅を持つデジタル単信通信、即ち交換器２から回路網端
末器１への（東から西への）デジタル単信通信に対応す
る。なお、図２においては４つのシンボル期間が示され
ている。この場合、各シンボル期間においては２相信号
は２回、即ちサンプリング時点Ｔb,n,east及びＴph,n,e
ast（第１のシンボル期間に関してはｎ＝１、第２のシ
ンボル期間に関してはｎ＝２、…）でサンプリングされ
る。この動作は例えばヨーロッパ特許出願公開第EP-A-0
162505号に詳述されているようなサンプリング装置の助
けによりなされる。時点Ｔb,n,eastにおけるサンプリン
グは当該シンボル期間における２相信号の極性を検出す
るためになされる。２相信号のこの極性は、当該シンボ
ル期間ｎにおける該２相信号の情報内容の判断基準とな
る。約１／４シンボル期間後に時点Ｔph,n,eastが発生
し、このサンプリング時点においては当該シンボル期間
の零交差点が存在する。（平坦な）最大点叉は最小点よ
りも（急峻な）零交差点を検出する方が簡単であるか
ら、上記のサンプリング装置は連続したシンボル期間に
関して単に零交差点に調整を行い、２つのサンプリング
時点Ｔb,n,eastとＴph,n,eastとのシンボル間期間の概
ね１／４の固定間隔により２相信号の極性、即ち情報内
容がシンボル期間ｎ毎に簡単に決定される。
幅を持つデジタル単信通信、即ち交換器２から回路網端
末器１への（東から西への）デジタル単信通信に対応す
る。なお、図２においては４つのシンボル期間が示され
ている。この場合、各シンボル期間においては２相信号
は２回、即ちサンプリング時点Ｔb,n,east及びＴph,n,e
ast（第１のシンボル期間に関してはｎ＝１、第２のシ
ンボル期間に関してはｎ＝２、…）でサンプリングされ
る。この動作は例えばヨーロッパ特許出願公開第EP-A-0
162505号に詳述されているようなサンプリング装置の助
けによりなされる。時点Ｔb,n,eastにおけるサンプリン
グは当該シンボル期間における２相信号の極性を検出す
るためになされる。２相信号のこの極性は、当該シンボ
ル期間ｎにおける該２相信号の情報内容の判断基準とな
る。約１／４シンボル期間後に時点Ｔph,n,eastが発生
し、このサンプリング時点においては当該シンボル期間
の零交差点が存在する。（平坦な）最大点叉は最小点よ
りも（急峻な）零交差点を検出する方が簡単であるか
ら、上記のサンプリング装置は連続したシンボル期間に
関して単に零交差点に調整を行い、２つのサンプリング
時点Ｔb,n,eastとＴph,n,eastとのシンボル間期間の概
ね１／４の固定間隔により２相信号の極性、即ち情報内
容がシンボル期間ｎ毎に簡単に決定される。
【００４０】比較的小さな振幅を持つ上記デジタル単信
通信（交換器２から回路網端末器１への、即ち東から西
への通信）と、比較的大きな振幅を持つデジタル単信通
信（回路網端末器１から交換器２への、即ち西から東へ
の通信）との両方をサンプリングしなければならないの
は言うまでもない。この目的のため、当該通信システム
は比較的大きな振幅のデジタル単信通信をサンプリング
するためにヨーロッパ特許出願第EP-A-0162505号に記載
されているような第１のサンプリング装置を有する。こ
のサンプリング装置（図１には示されていないが）は比
較器４の出力端子４-3に接続されて、タイミング信号Ｔ
b,westとＴph,westとを発生する。更に、当該通信シス
テムは比較的小さな振幅を持つデジタル単信通信をサン
プルするためにヨーロッパ特許出願第EP-A-0162505号に
記載されているような第２のサンプリング装置を有す
る。このサンプリング装置（図１には示されていない
が）はＲＤラッチ回路１６の出力端子１６-3及び／叉は
ＥＳラッチ回路１８の出力端子１８-3に接続されて、タ
イミング信号Ｔb,eastとＴph,eastとを発生する。
通信（交換器２から回路網端末器１への、即ち東から西
への通信）と、比較的大きな振幅を持つデジタル単信通
信（回路網端末器１から交換器２への、即ち西から東へ
の通信）との両方をサンプリングしなければならないの
は言うまでもない。この目的のため、当該通信システム
は比較的大きな振幅のデジタル単信通信をサンプリング
するためにヨーロッパ特許出願第EP-A-0162505号に記載
されているような第１のサンプリング装置を有する。こ
のサンプリング装置（図１には示されていないが）は比
較器４の出力端子４-3に接続されて、タイミング信号Ｔ
b,westとＴph,westとを発生する。更に、当該通信シス
テムは比較的小さな振幅を持つデジタル単信通信をサン
プルするためにヨーロッパ特許出願第EP-A-0162505号に
記載されているような第２のサンプリング装置を有す
る。このサンプリング装置（図１には示されていない
が）はＲＤラッチ回路１６の出力端子１６-3及び／叉は
ＥＳラッチ回路１８の出力端子１８-3に接続されて、タ
イミング信号Ｔb,eastとＴph,eastとを発生する。
【００４１】２つのデジタル単信通信の流れの中の何れ
もがシンボル期間毎に２回サンプリングされるので、２
つのメモリ手段７、１０は、各々、ビットテーブル及び
フェーズテーブルを有している。メモリ手段７のビット
テーブルはサンプリング時点Ｔb,n,westでとられた比較
的大きな振幅を持つデジタル単信通信のサンプル値を有
し、このメモリ手段７のフェーズテーブルはサンプリン
グ時点Ｔph,n,westでとられた比較的大きな振幅を持つ
デジタル単信通信のサンプル値を有する。一方、メモリ
手段１０のビットテーブルはサンプリング時点Ｔb,n,ea
stでとられた比較的小さな振幅を持つデジタル単信通信
のサンプル値を有し、このメモリ手段１０のフェーズテ
ーブルは比較的小さな振幅を持つデジタル単信通信のサ
ンプリング時点Ｔph,n,eastでとられたサンプル値を有
する。選択信号bit/phasewestの制御の下で、メモリ手
段７のビットテーブルか叉はフェーズテーブルの何れか
がアドレス入力端子７-2を介してアドレス可能となり、
これにより出力端子７-3を介して読出可能となり、また
入力端子７-4を介して書込可能（１だけ増加叉は減少さ
れる）となる。同様に、選択信号bit/phaseeastの制御
の下で、メモリ手段１０のビットテーブルか叉はフェー
ズテーブルの何れかがアドレス入力端子１０-2を介して
アドレス可能となり、これにより出力端子１０-3を介し
て読出可能となり、また入力端子１０-4を介して書込可
能（１だけ増加叉は減少される）となる。メモリ手段７
の出力端子７-3に得られたデジタルコードは前記加算手
段１２の入力端子１２-1に供給され、メモリ手段１０の
出力端子１０-3に得られたデジタルコードは前記加算手
段１２の入力端子１２-2に供給される。この加算手段１
２は、次いで、これら２つのコードを加算して出力端子
１２-3にデジタル和コードを発生する。このデジタル和
コードはＤＡＣ１３の入力端子１３-1に供給され、この
ＤＡＣ１３はこのデジタル和コードをアナログ電圧に変
換する。この電圧は上記和コードが増加すると上昇し、
減少すると低下する。このアナログ電圧は前記加算器１
４の（−）入力端子１４-1に供給され、この加算器によ
りその（＋）入力端子１４-2に供給される中間取り出し
点のデジタル２重通信から減算される。このようにして
当該加算器１４の出力端子１４-3に得られた差分電圧は
図２においてはＶeyeとして示してある。
もがシンボル期間毎に２回サンプリングされるので、２
つのメモリ手段７、１０は、各々、ビットテーブル及び
フェーズテーブルを有している。メモリ手段７のビット
テーブルはサンプリング時点Ｔb,n,westでとられた比較
的大きな振幅を持つデジタル単信通信のサンプル値を有
し、このメモリ手段７のフェーズテーブルはサンプリン
グ時点Ｔph,n,westでとられた比較的大きな振幅を持つ
デジタル単信通信のサンプル値を有する。一方、メモリ
手段１０のビットテーブルはサンプリング時点Ｔb,n,ea
stでとられた比較的小さな振幅を持つデジタル単信通信
のサンプル値を有し、このメモリ手段１０のフェーズテ
ーブルは比較的小さな振幅を持つデジタル単信通信のサ
ンプリング時点Ｔph,n,eastでとられたサンプル値を有
する。選択信号bit/phasewestの制御の下で、メモリ手
段７のビットテーブルか叉はフェーズテーブルの何れか
がアドレス入力端子７-2を介してアドレス可能となり、
これにより出力端子７-3を介して読出可能となり、また
入力端子７-4を介して書込可能（１だけ増加叉は減少さ
れる）となる。同様に、選択信号bit/phaseeastの制御
の下で、メモリ手段１０のビットテーブルか叉はフェー
ズテーブルの何れかがアドレス入力端子１０-2を介して
アドレス可能となり、これにより出力端子１０-3を介し
て読出可能となり、また入力端子１０-4を介して書込可
能（１だけ増加叉は減少される）となる。メモリ手段７
の出力端子７-3に得られたデジタルコードは前記加算手
段１２の入力端子１２-1に供給され、メモリ手段１０の
出力端子１０-3に得られたデジタルコードは前記加算手
段１２の入力端子１２-2に供給される。この加算手段１
２は、次いで、これら２つのコードを加算して出力端子
１２-3にデジタル和コードを発生する。このデジタル和
コードはＤＡＣ１３の入力端子１３-1に供給され、この
ＤＡＣ１３はこのデジタル和コードをアナログ電圧に変
換する。この電圧は上記和コードが増加すると上昇し、
減少すると低下する。このアナログ電圧は前記加算器１
４の（−）入力端子１４-1に供給され、この加算器によ
りその（＋）入力端子１４-2に供給される中間取り出し
点のデジタル２重通信から減算される。このようにして
当該加算器１４の出力端子１４-3に得られた差分電圧は
図２においてはＶeyeとして示してある。
【００４２】上記の差信号Ｖeyeは接地基準レベルに対
してシンボル期間当たり２回サンプリングされる（ここ
で、前記デジタル２重通信とＤＡＣ１３からのアナログ
電圧とは共に接地レベル付近に位置するものと仮定す
る）。この動作は、タイミング信号Ｔb,east及びＴph,e
astの制御の下で、サンプリング時点Ｔb,n,east及びＴp
h,n,eastにおいて比較器１５とＲＤラッチ回路１６との
組み合わせにより実行される。Ｖeyeボルト＜０に対し
ては、ＲＤラッチ回路１６は論理値「０」を持つ信号を
発生し、Ｖeyeボルト＞０に対しては、ＲＤラッチ回路
１６は論理値「１」を持つ信号を発生し、これら信号は
その出力端子１６-3に現れる。更に、前記差信号Ｖeye
は基準レベルＶblockに対してシンボル期間当たり１回
サンプリングされるが、この基準レベルはレベルシフト
回路１９により発生されその出力端子１９-4に得られ
る。この基準レベルＶblockに対するサンプリングは、
タイミング信号Ｔb,eastの制御の下で、サンプリング時
点Ｔb,n,eastにおいて比較器１７とＥＳラッチ回路１８
との組み合わせによりなされる。Ｖeye＜Ｖblockに対し
てはＥＳラッチ回路１８は論理値「０」を持つ信号を発
生し、Ｖeye＞Ｖblockに対してはＥＳラッチ回路１８は
論理値「１」を持つ信号を発生し、これら信号はその出
力端子１８-3に現れる。
してシンボル期間当たり２回サンプリングされる（ここ
で、前記デジタル２重通信とＤＡＣ１３からのアナログ
電圧とは共に接地レベル付近に位置するものと仮定す
る）。この動作は、タイミング信号Ｔb,east及びＴph,e
astの制御の下で、サンプリング時点Ｔb,n,east及びＴp
h,n,eastにおいて比較器１５とＲＤラッチ回路１６との
組み合わせにより実行される。Ｖeyeボルト＜０に対し
ては、ＲＤラッチ回路１６は論理値「０」を持つ信号を
発生し、Ｖeyeボルト＞０に対しては、ＲＤラッチ回路
１６は論理値「１」を持つ信号を発生し、これら信号は
その出力端子１６-3に現れる。更に、前記差信号Ｖeye
は基準レベルＶblockに対してシンボル期間当たり１回
サンプリングされるが、この基準レベルはレベルシフト
回路１９により発生されその出力端子１９-4に得られ
る。この基準レベルＶblockに対するサンプリングは、
タイミング信号Ｔb,eastの制御の下で、サンプリング時
点Ｔb,n,eastにおいて比較器１７とＥＳラッチ回路１８
との組み合わせによりなされる。Ｖeye＜Ｖblockに対し
てはＥＳラッチ回路１８は論理値「０」を持つ信号を発
生し、Ｖeye＞Ｖblockに対してはＥＳラッチ回路１８は
論理値「１」を持つ信号を発生し、これら信号はその出
力端子１８-3に現れる。
【００４３】レベルシフト回路１９は、接地レベル周辺
に位置し、ピーク振幅Ｖblock（ピーク対ピーク振幅は
２＊Ｖblock）を有し、且つその半サイクルがシンボル
期間長に等しいような矩形波電圧を発生する。この場
合、上記矩形波電圧の零交差点は前記サンプリング時点
Ｔb,n,east及びＴph,n,eastとは一致せず、従って図２
においては一例として矩形波に関してサンプリング時点
Ｔb,n,eastに対してシンボル期間の長さの半分の距離に
位置する零交差点を選択する。レベルシフト回路１９の
目的は、そのピーク振幅Ｖblockが前記差電圧Ｖeye（Ｖ
eyeの振幅はこの信号の情報内容に依存する。即ち、多
数の論理値「１」叉は多数の論理値「０」が連続して発
生する場合は、その振幅は論理値「１」及び「０」が交
互に発生する場合よりも一般に大きくなる。）に等しく
されるべき矩形波電圧を発生することにある。この目的
のため、レベルシフト回路１９は積分器を有し、この積
分器は信号RISEの制御の下でピーク振幅Ｖblockを僅か
に増加させ（この場合、信号RISEは論理値「１」を持
つ）、叉は僅かに減少させる（この場合、信号RISEは論
理値「０」を持つ）。上記矩形波電圧の接地レベルに対
する極性は信号BLOCKにより示され、この信号BLOCKが論
理値「１」を持つ場合は前記矩形波電圧は正であり、信
号BLOCKが論理値「０」を持つ場合は前記矩形波電圧は
負である。前記信号RISEは上記信号BLOCKと、ＲＤラッ
チ回路１６及びＥＳラッチ回路１８の各出力とに依存す
る。この依存性を表１に示す。
に位置し、ピーク振幅Ｖblock（ピーク対ピーク振幅は
２＊Ｖblock）を有し、且つその半サイクルがシンボル
期間長に等しいような矩形波電圧を発生する。この場
合、上記矩形波電圧の零交差点は前記サンプリング時点
Ｔb,n,east及びＴph,n,eastとは一致せず、従って図２
においては一例として矩形波に関してサンプリング時点
Ｔb,n,eastに対してシンボル期間の長さの半分の距離に
位置する零交差点を選択する。レベルシフト回路１９の
目的は、そのピーク振幅Ｖblockが前記差電圧Ｖeye（Ｖ
eyeの振幅はこの信号の情報内容に依存する。即ち、多
数の論理値「１」叉は多数の論理値「０」が連続して発
生する場合は、その振幅は論理値「１」及び「０」が交
互に発生する場合よりも一般に大きくなる。）に等しく
されるべき矩形波電圧を発生することにある。この目的
のため、レベルシフト回路１９は積分器を有し、この積
分器は信号RISEの制御の下でピーク振幅Ｖblockを僅か
に増加させ（この場合、信号RISEは論理値「１」を持
つ）、叉は僅かに減少させる（この場合、信号RISEは論
理値「０」を持つ）。上記矩形波電圧の接地レベルに対
する極性は信号BLOCKにより示され、この信号BLOCKが論
理値「１」を持つ場合は前記矩形波電圧は正であり、信
号BLOCKが論理値「０」を持つ場合は前記矩形波電圧は
負である。前記信号RISEは上記信号BLOCKと、ＲＤラッ
チ回路１６及びＥＳラッチ回路１８の各出力とに依存す
る。この依存性を表１に示す。
【００４４】
【表１】
【００４５】ここで、レベルシフト回路１９の動作を表
１を参照して更に説明する。前述したように、レベルシ
フト回路１９の目的は、そのピーク振幅Ｖblockが前記
差電圧Ｖeyeに等しくされるべき矩形波電圧を発生する
ことにある。この動作は、当該レベルシフト回路１９に
属する積分器が信号RISEの制御の下でピーク振幅Ｖbloc
kを僅かに増加叉は減少させることにより達成される。
この信号RISEは信号BLOCK、ＲＤ（ＲＤラッチ回路１６
の出力信号）及びＥＳ（ＥＳラッチ回路１８の出力信
号）に依存する。この点に関しては、２つの場合を区別
しなければならない。即ち、第１の場合は、Ｖblockと
Ｖeyeとが逆の極性を有するために信号BLOCKと信号ＲＤ
とが各々異なる値を持つ場合である。図２においては、
この状況はサンプリング時点Ｔb,2,east及びＴb,3,east
において見られる。言うまでもなく、この場合はＶbloc
kをＶeyeに合わせる必要はなく、従って信号RISEは元の
値を維持する。表１においては、この状況は「変化な
し」として示されている。次に、第２の場合は信号BLOC
Kと信号ＲＤとが等しい値を有する場合であり、この状
況は図２においてはサンプリング時点Ｔb,1,east（これ
ら２つの信号は論理値「０」である）とサンプリング時
点Ｔb,4,east（これら２つの信号は論理値「１」であ
る）とでみられる。ここでサンプリング時点Ｔb,1,east
においては２つの可能性がある。即ち、｜Ｖeye｜＜｜
Ｖblock｜であって、信号ＥＳが論理値「１」を有し且
つ信号RISEが論理値「０」（ピーク振幅Ｖblockを小さ
くする）を得る場合、叉は｜Ｖeye｜＞｜Ｖblock｜であ
って、信号ＥＳが論理値「０」を有し且つ信号RISEが論
理値「１」（ピーク振幅Ｖblockを大きくする）を得る
場合の何れかである。また、サンプリング時点Ｔb,4,ea
stにおいても２つの可能性がある。即ち、｜Ｖeye｜＜
｜Ｖblock｜であって、信号ＥＳが論理値「０」を得且
つ信号RISEが論理値「０」（ピーク振幅Ｖblockを小さ
くする）を有する場合、叉は｜Ｖeye｜＞｜Ｖblock｜で
あって、信号ＥＳが論理値「１」を有し且つ信号RISEが
論理値「１」（ピーク振幅Ｖblockを大きくする）を得
る場合の何れである。
１を参照して更に説明する。前述したように、レベルシ
フト回路１９の目的は、そのピーク振幅Ｖblockが前記
差電圧Ｖeyeに等しくされるべき矩形波電圧を発生する
ことにある。この動作は、当該レベルシフト回路１９に
属する積分器が信号RISEの制御の下でピーク振幅Ｖbloc
kを僅かに増加叉は減少させることにより達成される。
この信号RISEは信号BLOCK、ＲＤ（ＲＤラッチ回路１６
の出力信号）及びＥＳ（ＥＳラッチ回路１８の出力信
号）に依存する。この点に関しては、２つの場合を区別
しなければならない。即ち、第１の場合は、Ｖblockと
Ｖeyeとが逆の極性を有するために信号BLOCKと信号ＲＤ
とが各々異なる値を持つ場合である。図２においては、
この状況はサンプリング時点Ｔb,2,east及びＴb,3,east
において見られる。言うまでもなく、この場合はＶbloc
kをＶeyeに合わせる必要はなく、従って信号RISEは元の
値を維持する。表１においては、この状況は「変化な
し」として示されている。次に、第２の場合は信号BLOC
Kと信号ＲＤとが等しい値を有する場合であり、この状
況は図２においてはサンプリング時点Ｔb,1,east（これ
ら２つの信号は論理値「０」である）とサンプリング時
点Ｔb,4,east（これら２つの信号は論理値「１」であ
る）とでみられる。ここでサンプリング時点Ｔb,1,east
においては２つの可能性がある。即ち、｜Ｖeye｜＜｜
Ｖblock｜であって、信号ＥＳが論理値「１」を有し且
つ信号RISEが論理値「０」（ピーク振幅Ｖblockを小さ
くする）を得る場合、叉は｜Ｖeye｜＞｜Ｖblock｜であ
って、信号ＥＳが論理値「０」を有し且つ信号RISEが論
理値「１」（ピーク振幅Ｖblockを大きくする）を得る
場合の何れかである。また、サンプリング時点Ｔb,4,ea
stにおいても２つの可能性がある。即ち、｜Ｖeye｜＜
｜Ｖblock｜であって、信号ＥＳが論理値「０」を得且
つ信号RISEが論理値「０」（ピーク振幅Ｖblockを小さ
くする）を有する場合、叉は｜Ｖeye｜＞｜Ｖblock｜で
あって、信号ＥＳが論理値「１」を有し且つ信号RISEが
論理値「１」（ピーク振幅Ｖblockを大きくする）を得
る場合の何れである。
【００４６】タイミング信号Ｔb,eastの制御の下で比較
器１５とＲＤラッチ回路１６との組み合わせによりシン
ボル期間当たり１回とられる接地レベルに対する前記差
信号Ｖeyeのサンプル値は、シフトレジスタ９の入力端
子９-2に供給され、交換器２からくるデータDATA EAST
を形成する。
器１５とＲＤラッチ回路１６との組み合わせによりシン
ボル期間当たり１回とられる接地レベルに対する前記差
信号Ｖeyeのサンプル値は、シフトレジスタ９の入力端
子９-2に供給され、交換器２からくるデータDATA EAST
を形成する。
【００４７】基準レベル±Ｖblockに対する前記差信号
Ｖeyeのサンプル値は、タイミング信号Ｔb,eastの制御
の下で比較器１７とＥＳラッチ回路１８との組み合わせ
によりシンボル期間当たり１回とられ、切換スイッチ２
０によりアップダウン・カウンタ８、１１の各制御入力
端子８-1、１１-1に供給される。この場合、上記切換ス
イッチ２０は、選択信号bit/phaseeastの制御の下で、
選択接点２０-1を主接点２０-3に接続する。もしＶeye
がＶblockに対して正であるか叉はＶblockよりも少な目
に負である場合は、Ｖeyeは減少されねばならない。こ
の場合、信号ＥＳは論理値「１」を有し、この信号に応
答してアップダウン・カウンタ８、１１はメモリ手段
７、１０中のビットテーブルにおけるアドレスされた値
を減少させる。一方、ＶeyeがＶblockに対して負である
か叉はＶblockよりも少な目に正である場合は、Ｖeyeは
増加されねばならない。この場合、信号ＥＳは論理値
「０」を有し、この信号に応答してアップダウン・カウ
ンタ８、１１はメモリ手段７、１０中のビットテーブル
におけるアドレスされた値を増加させる。この動作は信
号ＲＤと信号BLOCKとの間の関係に無関係に実施され
る。その理由は、もし両信号が同一の論理値を有する場
合は上記補正は正しく、これら２つの信号が異なる論理
値を有する場合は補正は信号BLOCKによって専ら決まる
が、この信号BLOCKは矩形波電圧であって論理値「０」
を有するのと同様の頻度で論理値「１」を有するから長
期間では平均化がされ、従って長期間では補正は正しく
なるからである。
Ｖeyeのサンプル値は、タイミング信号Ｔb,eastの制御
の下で比較器１７とＥＳラッチ回路１８との組み合わせ
によりシンボル期間当たり１回とられ、切換スイッチ２
０によりアップダウン・カウンタ８、１１の各制御入力
端子８-1、１１-1に供給される。この場合、上記切換ス
イッチ２０は、選択信号bit/phaseeastの制御の下で、
選択接点２０-1を主接点２０-3に接続する。もしＶeye
がＶblockに対して正であるか叉はＶblockよりも少な目
に負である場合は、Ｖeyeは減少されねばならない。こ
の場合、信号ＥＳは論理値「１」を有し、この信号に応
答してアップダウン・カウンタ８、１１はメモリ手段
７、１０中のビットテーブルにおけるアドレスされた値
を減少させる。一方、ＶeyeがＶblockに対して負である
か叉はＶblockよりも少な目に正である場合は、Ｖeyeは
増加されねばならない。この場合、信号ＥＳは論理値
「０」を有し、この信号に応答してアップダウン・カウ
ンタ８、１１はメモリ手段７、１０中のビットテーブル
におけるアドレスされた値を増加させる。この動作は信
号ＲＤと信号BLOCKとの間の関係に無関係に実施され
る。その理由は、もし両信号が同一の論理値を有する場
合は上記補正は正しく、これら２つの信号が異なる論理
値を有する場合は補正は信号BLOCKによって専ら決まる
が、この信号BLOCKは矩形波電圧であって論理値「０」
を有するのと同様の頻度で論理値「１」を有するから長
期間では平均化がされ、従って長期間では補正は正しく
なるからである。
【００４８】タイミング信号Ｔph,eastの制御の下で比
較器１５とＲＤラッチ回路１６との組み合わせによりシ
ンボル期間当たり１回とられる基準接地レベルに対する
前記差信号Ｖeyeのサンプル値は、切換スイッチ２０に
よりアップダウン・カウンタ８、１１の各制御入力端子
８-1、１１-1に供給される。この場合、上記切換スイッ
チ２０は、選択信号bit/phaseeastの制御の下で、選択
接点２０-2を主接点２０-3に接続する。
較器１５とＲＤラッチ回路１６との組み合わせによりシ
ンボル期間当たり１回とられる基準接地レベルに対する
前記差信号Ｖeyeのサンプル値は、切換スイッチ２０に
よりアップダウン・カウンタ８、１１の各制御入力端子
８-1、１１-1に供給される。この場合、上記切換スイッ
チ２０は、選択信号bit/phaseeastの制御の下で、選択
接点２０-2を主接点２０-3に接続する。
【００４９】もしＶeyeが接地レベルに対して正である
場合は、Ｖeyeは減少されねばならない。この場合、信
号ＲＤは論理値「１」を有し、この信号に応答してアッ
プダウン・カウンタ８、１１はメモリ手段７、１０中の
フェーズテーブルにおけるアドレスされた値を減少させ
る。一方、Ｖeyeが接地レベルに対して負である場合
は、Ｖeyeは増加されねばならない。この場合、信号Ｒ
Ｄは論理値「０」を有し、この信号に応答してアップダ
ウン・カウンタ８、１１はメモリ手段７、１０中のフェ
ーズテーブルにおけるアドレスされた値を増加させる。
場合は、Ｖeyeは減少されねばならない。この場合、信
号ＲＤは論理値「１」を有し、この信号に応答してアッ
プダウン・カウンタ８、１１はメモリ手段７、１０中の
フェーズテーブルにおけるアドレスされた値を減少させ
る。一方、Ｖeyeが接地レベルに対して負である場合
は、Ｖeyeは増加されねばならない。この場合、信号Ｒ
Ｄは論理値「０」を有し、この信号に応答してアップダ
ウン・カウンタ８、１１はメモリ手段７、１０中のフェ
ーズテーブルにおけるアドレスされた値を増加させる。
【００５０】アップダウン・カウンタ８及び１１の各制
御入力端子８-1及び１１-1は相互に接続されているか
ら、メモリ手段７のビットテーブルにおけるアドレスさ
れた値とメモリ手段１０のビットテーブルにおけるアド
レスされた値とは同様の方法で補正（増加叉は減少）さ
れる。同様のことが、メモリ手段７のフェーズテーブル
におけるアドレスされた値及びメモリ手段１０のフェー
ズテーブルにおけるアドレスされた値について成り立
つ。その理由は、加算器１４の出力端子１４-3における
差信号Ｖeyeからは何処で最も大きなエラーが発生した
か分からないからである。即ち、エラーはｅｃ装置６〜
８及びisic装置９〜１１の両方で発生しているかもしれ
ない。エラー補正はWESTのデータとEASTのデータが相関
関係にない場合にのみ同様に行うことができる。なぜな
ら、その場合には長期間でみると誤った増加及び誤った
減少がしばしば等しくなされるからである。
御入力端子８-1及び１１-1は相互に接続されているか
ら、メモリ手段７のビットテーブルにおけるアドレスさ
れた値とメモリ手段１０のビットテーブルにおけるアド
レスされた値とは同様の方法で補正（増加叉は減少）さ
れる。同様のことが、メモリ手段７のフェーズテーブル
におけるアドレスされた値及びメモリ手段１０のフェー
ズテーブルにおけるアドレスされた値について成り立
つ。その理由は、加算器１４の出力端子１４-3における
差信号Ｖeyeからは何処で最も大きなエラーが発生した
か分からないからである。即ち、エラーはｅｃ装置６〜
８及びisic装置９〜１１の両方で発生しているかもしれ
ない。エラー補正はWESTのデータとEASTのデータが相関
関係にない場合にのみ同様に行うことができる。なぜな
ら、その場合には長期間でみると誤った増加及び誤った
減少がしばしば等しくなされるからである。
【００５１】多くの場合に、異なるデータ送信機からの
データ通信は可能性のある相関を避けるためにスクラン
ブルされる。この目的のため、各データ送信機はスクラ
ンブラを備えている。この場合、受信されたデータ通信
はデスクランブルされねばならないから、デジタル中間
取り出しを行うための当該装置４〜２１はデスクランブ
ラ５及び２１を有している。この装置においては、デス
クランブラ５はWESTデータ用のデータ送信機のスクラン
ブラに適合しており、デスクランブラ２１はEASTデータ
用のデータ送信機のスクランブラに適合している。
データ通信は可能性のある相関を避けるためにスクラン
ブルされる。この目的のため、各データ送信機はスクラ
ンブラを備えている。この場合、受信されたデータ通信
はデスクランブルされねばならないから、デジタル中間
取り出しを行うための当該装置４〜２１はデスクランブ
ラ５及び２１を有している。この装置においては、デス
クランブラ５はWESTデータ用のデータ送信機のスクラン
ブラに適合しており、デスクランブラ２１はEASTデータ
用のデータ送信機のスクランブラに適合している。
【００５２】前記制御入力端子８-1及び１１-1が相互接
続されている事実に起因する誤った増加及び誤った減少
の影響は、出力端子７-3及び１０-3の全てのビットは入
力端子１２-1及び１２-2に供給しないようにすることに
より減少させることができる。例えば、出力端子７-3及
び１０-3が各々１２ビットを有している場合は、各出力
端子７-3、１０-3から最上位側の９ビット以上を入力端
子１２-1、１２-2に供給することにより上記影響を十分
に減少させることができる。
続されている事実に起因する誤った増加及び誤った減少
の影響は、出力端子７-3及び１０-3の全てのビットは入
力端子１２-1及び１２-2に供給しないようにすることに
より減少させることができる。例えば、出力端子７-3及
び１０-3が各々１２ビットを有している場合は、各出力
端子７-3、１０-3から最上位側の９ビット以上を入力端
子１２-1、１２-2に供給することにより上記影響を十分
に減少させることができる。
【００５３】前記タイミング信号（２相符号化信号に属
する）及びこれら信号から本発明による装置を制御する
ために作成された制御信号を再度表２に示す。この表２
を参照して当該装置の制御を更に説明し且つ不定状態に
も言及する。
する）及びこれら信号から本発明による装置を制御する
ために作成された制御信号を再度表２に示す。この表２
を参照して当該装置の制御を更に説明し且つ不定状態に
も言及する。
【００５４】
【表２】
【００５５】上記表において、信号BLOCKはレベルシフ
ト回路１９により発生されてピーク振幅Ｖblockを持つ
矩形波電圧を表す。この信号BLOCKが論理値「１」を有
する場合は上記矩形波電圧は正であり、当該信号が論理
値「０」を有する場合はこの矩形波電圧は負であり、そ
れらの振幅は各々＋｜Ｖblock｜及び−｜Ｖblock｜であ
る。信号ＲＤは前記２相信号の極性を表す。サンプリン
グ時点Ｔb,1,east及びＴb,2,eastにおいては信号ＲＤは
論理値「０」を有し、サンプリング時点Ｔb,3,east及び
Ｔb,4,eastにおいては当該信号は論理値「１」を有す
る。サンプリング時点Ｔph,n,east（前記２相信号の零
交差点）においては、この信号ＲＤはサンプリング時点
Ｔph,n,eastの零交差点に対する正確な位置に依存し
て、ある時は論理値「０」を有し、ある時は論理値
「１」を有する。
ト回路１９により発生されてピーク振幅Ｖblockを持つ
矩形波電圧を表す。この信号BLOCKが論理値「１」を有
する場合は上記矩形波電圧は正であり、当該信号が論理
値「０」を有する場合はこの矩形波電圧は負であり、そ
れらの振幅は各々＋｜Ｖblock｜及び−｜Ｖblock｜であ
る。信号ＲＤは前記２相信号の極性を表す。サンプリン
グ時点Ｔb,1,east及びＴb,2,eastにおいては信号ＲＤは
論理値「０」を有し、サンプリング時点Ｔb,3,east及び
Ｔb,4,eastにおいては当該信号は論理値「１」を有す
る。サンプリング時点Ｔph,n,east（前記２相信号の零
交差点）においては、この信号ＲＤはサンプリング時点
Ｔph,n,eastの零交差点に対する正確な位置に依存し
て、ある時は論理値「０」を有し、ある時は論理値
「１」を有する。
【００５６】信号ＥＳは、サンプリング時点Ｔb,n,east
においてピーク振幅Ｖblockを持つ矩形波電圧に対する
差信号Ｖeyeの位置を表す。信号BLOCK及びＲＤの両方が
論理値「０」を有する場合は、信号ＥＳは｜Ｖeye｜＜
｜Ｖblock｜に対しては論理値「１」を有し、｜Ｖeye｜
＞｜Ｖblock｜に対しては論理値「０」を有する。ま
た、上記の２つの信号の両方が論理値「１」を有する場
合は、信号ＥＳは｜Ｖeye｜＜｜Ｖblock｜に対しては論
理値「０」を有し、｜Ｖeye｜＞｜Ｖblock｜に対しては
論理値「１」を有する。信号BLOCKと信号ＲＤとが各々
異なる論理値を有する場合は、信号ＥＳは信号BLOCKと
は異なる論理値を有し、矩形波電圧である信号BLOCKに
より専ら決定される。結果として、信号ＥＳは時には正
しくない値を有することになるが、これらは長い期間で
みると平均化されてしまう。サンプリング時点Ｔph,n,e
ast（前記２相信号の零交差点）における信号ＥＳの値
は重要ではなく、これらは表２においてはｘなる値（如
何なる値でも構わない）で示されている。信号ＲＡＭは
メモリ手段７、１０のビットテーブル及びフェーズテー
ブルにおいてアドレスされた値が１だけ増加されるべき
か叉は減少されるべきかを示す。サンプリング時点Ｔb,
n,eastにおいては、信号ＥＳが論理値「０」であれば信
号ＲＡＭは「＋１」なる値をとり、信号ＥＳが論理値
「１」であれば信号ＲＡＭは「−１」なる値をとる。ま
た、サンプリング時点Ｔph,n,eastにおいては、信号Ｒ
Ｄが論理値「０」であれば信号ＲＡＭは「＋１」なる値
をとり、信号ＲＤが論理値「１」であれば信号ＲＡＭは
「−１」なる値をとる。
においてピーク振幅Ｖblockを持つ矩形波電圧に対する
差信号Ｖeyeの位置を表す。信号BLOCK及びＲＤの両方が
論理値「０」を有する場合は、信号ＥＳは｜Ｖeye｜＜
｜Ｖblock｜に対しては論理値「１」を有し、｜Ｖeye｜
＞｜Ｖblock｜に対しては論理値「０」を有する。ま
た、上記の２つの信号の両方が論理値「１」を有する場
合は、信号ＥＳは｜Ｖeye｜＜｜Ｖblock｜に対しては論
理値「０」を有し、｜Ｖeye｜＞｜Ｖblock｜に対しては
論理値「１」を有する。信号BLOCKと信号ＲＤとが各々
異なる論理値を有する場合は、信号ＥＳは信号BLOCKと
は異なる論理値を有し、矩形波電圧である信号BLOCKに
より専ら決定される。結果として、信号ＥＳは時には正
しくない値を有することになるが、これらは長い期間で
みると平均化されてしまう。サンプリング時点Ｔph,n,e
ast（前記２相信号の零交差点）における信号ＥＳの値
は重要ではなく、これらは表２においてはｘなる値（如
何なる値でも構わない）で示されている。信号ＲＡＭは
メモリ手段７、１０のビットテーブル及びフェーズテー
ブルにおいてアドレスされた値が１だけ増加されるべき
か叉は減少されるべきかを示す。サンプリング時点Ｔb,
n,eastにおいては、信号ＥＳが論理値「０」であれば信
号ＲＡＭは「＋１」なる値をとり、信号ＥＳが論理値
「１」であれば信号ＲＡＭは「−１」なる値をとる。ま
た、サンプリング時点Ｔph,n,eastにおいては、信号Ｒ
Ｄが論理値「０」であれば信号ＲＡＭは「＋１」なる値
をとり、信号ＲＤが論理値「１」であれば信号ＲＡＭは
「−１」なる値をとる。
【００５７】レベルシフト回路９内の積分器が前記矩形
波電圧のピーク振幅Ｖblockを増加させるか叉は減少さ
せるかを決定する信号RISEは、ＶeyeとＶblockとが反対
の極性を有する場合は、今の値を維持する（ｎｃ＝no c
hange）。この状況は信号BLOCKと信号ＲＤとが異なる値
を有する場合である。上記両信号が各々値「０」を有す
る時は、信号ＥＳが論理値「１」であれば信号RISEは論
理値「０」をとり、信号ＥＳが論理値「０」であれば信
号RISEは論理値「１」をとる。また、両信号BLOCK及び
ＲＤが論理値「１」を有する場合は、信号RISEは信号Ｅ
Ｓと同じ論理値をとる。このことは、サンプリング時点
Ｔb,n,eastに関し、ＶeyeがＶblockを等しくすべき最大
値叉は最小値を有する場合にも当てはまる。サンプリン
グ時点Ｔph,n,eastにおいてはＶeyeは零交差を呈するの
で、信号RISEは信号BLOCK、ＲＤ及び／叉はＥＳには依
存しないことは明かである。
波電圧のピーク振幅Ｖblockを増加させるか叉は減少さ
せるかを決定する信号RISEは、ＶeyeとＶblockとが反対
の極性を有する場合は、今の値を維持する（ｎｃ＝no c
hange）。この状況は信号BLOCKと信号ＲＤとが異なる値
を有する場合である。上記両信号が各々値「０」を有す
る時は、信号ＥＳが論理値「１」であれば信号RISEは論
理値「０」をとり、信号ＥＳが論理値「０」であれば信
号RISEは論理値「１」をとる。また、両信号BLOCK及び
ＲＤが論理値「１」を有する場合は、信号RISEは信号Ｅ
Ｓと同じ論理値をとる。このことは、サンプリング時点
Ｔb,n,eastに関し、ＶeyeがＶblockを等しくすべき最大
値叉は最小値を有する場合にも当てはまる。サンプリン
グ時点Ｔph,n,eastにおいてはＶeyeは零交差を呈するの
で、信号RISEは信号BLOCK、ＲＤ及び／叉はＥＳには依
存しないことは明かである。
【００５８】メモリ手段７、１０のビットテーブル及び
フェーズテーブルは動作に先立ち各アドレスにロードす
る必要はない。原理的には、エコー除去手段５〜２１は
４個の全てのテーブルが空である時に初期化することが
でき、その際、当該装置４〜２１はメモリ手段７の各テ
ーブルが十分なデータを有するようになるまでは正しく
動作しない。この場合、前記ｅｃ装置６〜８の方がisic
装置９〜１１よりも重要である。即ち、ｅｃ装置６〜８
は比較的大きな振幅を持つ元のデジタル単信通信を可能
な最良の方法で複製し、その後これがデジタル２重通信
から減算される。このようにして得られた差信号（Ｖey
e）は、比較的小さな振幅を持つデジタル単信通信を形
成する。次いで、isic装置９〜１１がこの信号を正確に
決定する。
フェーズテーブルは動作に先立ち各アドレスにロードす
る必要はない。原理的には、エコー除去手段５〜２１は
４個の全てのテーブルが空である時に初期化することが
でき、その際、当該装置４〜２１はメモリ手段７の各テ
ーブルが十分なデータを有するようになるまでは正しく
動作しない。この場合、前記ｅｃ装置６〜８の方がisic
装置９〜１１よりも重要である。即ち、ｅｃ装置６〜８
は比較的大きな振幅を持つ元のデジタル単信通信を可能
な最良の方法で複製し、その後これがデジタル２重通信
から減算される。このようにして得られた差信号（Ｖey
e）は、比較的小さな振幅を持つデジタル単信通信を形
成する。次いで、isic装置９〜１１がこの信号を正確に
決定する。
【００５９】なお、加算器１４に他の（−）入力端子を
設けると共に、前記出力端子１０-3をこの他の（−）入
力端子に結合する他のデジタル・アナログ変換器を設け
ることによりデジタル加算手段１２を削除することがで
きる。しかしながら、デジタル加算手段１２の削除によ
る利点は、加算手段１２よりずっと高価なＤＡＣの追加
による不利益によっては決して相殺されない。
設けると共に、前記出力端子１０-3をこの他の（−）入
力端子に結合する他のデジタル・アナログ変換器を設け
ることによりデジタル加算手段１２を削除することがで
きる。しかしながら、デジタル加算手段１２の削除によ
る利点は、加算手段１２よりずっと高価なＤＡＣの追加
による不利益によっては決して相殺されない。
【００６０】上述したように、本発明は中間取り出し点
が第２の送受信装置（交換器２）よりも第１の送受信装
置（回路網端末器１）に近い場合に通信線での減衰の結
果一方向への（回路網端末器１から交換器２への）デジ
タルデータ通信が他の方向への（交換器２から回路網端
末器１への）デジタルデータ通信よりも大きな振幅を持
つという認識に基づいている。上記中間取り出し点が回
路網端末器１よりも交換器２に近い場合は疑いもなく上
記の逆が成り立つ。何れの場合にせよ、１以上のレベル
を持つ弁別手段４によりデジタル２重通信から何れかの
方向のデジタル単信通信を弁別するためには通信線上に
十分な減衰が存在すべきである。もし通信線上に十分な
減衰がない場合（例えば、回路網端末器１と交換器２と
の間の通信線３が非常に短い場合）は、例えば通信線３
を切断してそこに減衰線区間を挿入すること等により付
加的な減衰を導入する必要がある。このやり方は、好ま
しくない通信線の切断という点で不利である。しかしな
がら、回路網端末器１及び交換器２の近傍にはしばしば
プラグ式の相互接続部があるので、これをプラグ式の減
衰線区間に置き換えることは容易である。このような減
衰線区間の一方の側では一方向のデータ通信はより大き
な振幅を持ち、この減衰線区間の他方の側では他の方向
のデータ通信がより大きな振幅を持つことになるので、
上記減衰線区間の一方の側の第１の弁別手段と他方の側
の第２の弁別手段とによりデジタル２重通信から両方の
データ通信を弁別することが可能である。
が第２の送受信装置（交換器２）よりも第１の送受信装
置（回路網端末器１）に近い場合に通信線での減衰の結
果一方向への（回路網端末器１から交換器２への）デジ
タルデータ通信が他の方向への（交換器２から回路網端
末器１への）デジタルデータ通信よりも大きな振幅を持
つという認識に基づいている。上記中間取り出し点が回
路網端末器１よりも交換器２に近い場合は疑いもなく上
記の逆が成り立つ。何れの場合にせよ、１以上のレベル
を持つ弁別手段４によりデジタル２重通信から何れかの
方向のデジタル単信通信を弁別するためには通信線上に
十分な減衰が存在すべきである。もし通信線上に十分な
減衰がない場合（例えば、回路網端末器１と交換器２と
の間の通信線３が非常に短い場合）は、例えば通信線３
を切断してそこに減衰線区間を挿入すること等により付
加的な減衰を導入する必要がある。このやり方は、好ま
しくない通信線の切断という点で不利である。しかしな
がら、回路網端末器１及び交換器２の近傍にはしばしば
プラグ式の相互接続部があるので、これをプラグ式の減
衰線区間に置き換えることは容易である。このような減
衰線区間の一方の側では一方向のデータ通信はより大き
な振幅を持ち、この減衰線区間の他方の側では他の方向
のデータ通信がより大きな振幅を持つことになるので、
上記減衰線区間の一方の側の第１の弁別手段と他方の側
の第２の弁別手段とによりデジタル２重通信から両方の
データ通信を弁別することが可能である。
【００６１】付加的な減衰を導入してはならない場合
は、通信線３を切断しこの切断点の位置に中継器(repea
ter)を設置することができ、この中継器においては２線
式通信線３が４線接続に変換され、このような中継器は
前述した２つの相互結合された混成回路のように簡単に
中間取り出しすることができる。言うまでもなく、これ
らの全ての変形例においても、通信線の切断が必要なく
且つ付加的な減衰を設ける必要のない本発明による装置
が理想である。
は、通信線３を切断しこの切断点の位置に中継器(repea
ter)を設置することができ、この中継器においては２線
式通信線３が４線接続に変換され、このような中継器は
前述した２つの相互結合された混成回路のように簡単に
中間取り出しすることができる。言うまでもなく、これ
らの全ての変形例においても、通信線の切断が必要なく
且つ付加的な減衰を設ける必要のない本発明による装置
が理想である。
【図１】 図１は、本発明による通信システムの一実施
例の概要を示すブロック図、
例の概要を示すブロック図、
【図２】 図２は、２相符号化された信号に属するタイ
ミング信号、及び本発明による中間取り出し装置を制御
するためにこれらタイミング信号から取り出される制御
信号のタイムチャートである。
ミング信号、及び本発明による中間取り出し装置を制御
するためにこれらタイミング信号から取り出される制御
信号のタイムチャートである。
１…送受信装置、 ２…送受信装
置、３…通信線、 ４…比較
器、５…デスクランブラ、 ６…シフ
トレジスタ、７…メモリ手段、 ８
…アップダウン・カウンタ ９…シフトレジスタ、 10…メモリ手
段、11…アップダウン・カウンタ、 12…加算手
段、13…デジタル・アナログ変換器、 14…加算
器、15…比較器、 16…ラッチ
回路、17…比較器、 18…ラッ
チ回路、19…レベルシフト回路、 20…切
換スイッチ、21…デスクランブラ。
置、３…通信線、 ４…比較
器、５…デスクランブラ、 ６…シフ
トレジスタ、７…メモリ手段、 ８
…アップダウン・カウンタ ９…シフトレジスタ、 10…メモリ手
段、11…アップダウン・カウンタ、 12…加算手
段、13…デジタル・アナログ変換器、 14…加算
器、15…比較器、 16…ラッチ
回路、17…比較器、 18…ラッ
チ回路、19…レベルシフト回路、 20…切
換スイッチ、21…デスクランブラ。
Claims (12)
- 【請求項１】 デジタル２重通信用の通信線を備えかつ
当該デジタル２重通信を中間取り出しするための装置を
有する通信システムにおいて、 前記装置が前記デジタル２重通信から一方向にデジタル
単信通信を弁別する弁別手段を有すると共に、該弁別手
段に結合されて前記デジタル２重通信から他方向にデジ
タル単信通信を弁別するエコー除去手段を有する、 ことを特徴とする通信システム。 - 【請求項２】 請求項１に記載の通信システムにおい
て、前記弁別手段が比較器手段を有し、該比較器手段は
前記通信線に結合されて前記デジタル２重通信を入力す
るための第１の入力端子と、基準点に結合されて基準信
号を入力するための第２の入力端子とを有することを特
徴とする通信システム。 - 【請求項３】 請求項２に記載の通信システムにおい
て、前記前記エコー除去手段がエコー除去装置とシンボ
ル間妨害除去装置とを有し、前記エコー除去装置の入力
端子が前記比較器手段の出力端子に結合され、同エコー
除去装置の出力端子が前記シンボル間妨害除去装置の入
力端子に結合されていることを特徴とする通信システ
ム。 - 【請求項４】 請求項３に記載の通信システムにおい
て、前記中間取り出し装置が前記比較器手段の出力端子
に結合された第１のデスクランブラと、前記シンボル間
妨害除去装置の入力端子に結合された第２のデスクラン
ブラとを更に有することを特徴とする通信システム。 - 【請求項５】 請求項４に記載の通信システムにおい
て、前記エコー除去装置が第１のシフトレジスタと第１
のメモリ手段との直列結合を有し、前記シンボル間妨害
除去装置が第２のシフトレジスタと第２のメモリ手段と
の直列結合を有し、前記第１及び第２のメモリ手段がデ
ジタル・アナログ変換器を介して加算器の第１の入力端
子に結合され、前記加算器の第２の入力端子が前記比較
器手段の第１の入力端子に結合され、同加算器の出力端
子が前記第１及び第２のメモリ手段の各入力端子と前記
第２のシフトレジスタとに結合されていることを特徴と
する通信システム。 - 【請求項６】 請求項１に記載のデジタル２重通信用の
通信線を備える通信システムに使用されるデジタル２重
通信を中間取り出しするための装置において、 当該装置が前記デジタル２重通信から一方向にデジタル
単信通信を弁別する弁別手段を有すると共に、弁別手段
に結合されて前記デジタル２重通信から他方向にデジタ
ル単信通信を弁別するエコー除去手段を有する、 ことを特徴とする中間取り出し装置。 - 【請求項７】 請求項６に記載のデジタル２重通信を中
間取り出しするための装置において、前記弁別手段が比
較器手段を有し、該比較器手段は前記通信線に結合可能
であって前記デジタル２重通信を入力するための第１の
入力端子と、基準点に結合されて基準信号を入力するた
めの第２の入力端子とを有することを特徴とする中間取
り出し装置。 - 【請求項８】 請求項７に記載のデジタル２重通信を中
間取り出しするための装置おいて、前記前記エコー除去
手段がエコー除去装置とシンボル間妨害除去装置とを有
し、前記エコー除去装置の入力端子が前記比較器手段の
出力端子に結合され、同エコー除去装置の出力端子が前
記シンボル間妨害除去装置の入力端子に結合されている
ことを特徴とする中間取り出し装置。 - 【請求項９】 請求項８に記載のデジタル２重通信を中
間取り出しするための装置において、該装置が前記比較
器手段の出力端子に結合された第１のデスクランブラ
と、前記シンボル間妨害除去装置の入力端子に結合され
た第２のデスクランブラとを更に有することを特徴とす
る中間取り出し装置。 - 【請求項１０】 請求項９に記載のデジタル２重通信を
中間取り出しするための装置において、前記エコー除去
装置が第１のシフトレジスタと第１のメモリ手段との直
列結合を有し、前記シンボル間妨害除去装置が第２のシ
フトレジスタと第２のメモリ手段との直列結合を有し、
前記第１及び第２のメモリ手段がデジタル・アナログ変
換器を介して加算器の第１の入力端子に結合され、前記
加算器の第２の入力端子が前記比較器手段の第１の入力
端子に結合され、同加算器の出力端子が前記第１及び第
２のメモリ手段の各入力端子と前記第２のシフトレジス
タとに結合されていることを特徴とする中間取り出し装
置。 - 【請求項１１】 請求項１ないし５の何れか一項に記載
の通信システムにおいて、前記通信線が付加的な減衰を
有していることを特徴とする通信システム。 - 【請求項１２】 請求項６ないし１０の何れか一項に記
載のデジタル２重通信を中間取り出しするための装置に
おいて、前記通信線が付加的な減衰を有していることを
特徴とする中間取り出し装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| EP91202115 | 1991-08-20 | ||
| NL91202115.1 | 1991-08-20 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0621849A true JPH0621849A (ja) | 1994-01-28 |
| JP3272411B2 JP3272411B2 (ja) | 2002-04-08 |
Family
ID=8207835
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23997792A Expired - Fee Related JP3272411B2 (ja) | 1991-08-20 | 1992-08-17 | デジタル２重通信用中間取り出し装置を備える通信システム |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5502716A (ja) |
| EP (1) | EP0528491B1 (ja) |
| JP (1) | JP3272411B2 (ja) |
| DE (1) | DE69207509T2 (ja) |
| HK (1) | HK171196A (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE4423333C1 (de) * | 1994-06-21 | 1995-08-31 | Siemens Ag | Meßeinrichtung für die U-Schnittstelle einer ISDN(Integrated Services Digital Network)-Übertragungsstrecke |
| JP2776290B2 (ja) * | 1995-03-15 | 1998-07-16 | 日本電気株式会社 | ディジタル伝送システム |
| US5668865A (en) * | 1996-02-26 | 1997-09-16 | Lucent Technologies Inc. | Echo canceler E-side speech detector |
| FR2750818B1 (fr) * | 1996-07-02 | 1998-10-02 | Genin Jacques | Dispositif d'extraction et de separation de signaux transportes par une ligne filaire |
| US6704277B1 (en) | 1999-12-29 | 2004-03-09 | Intel Corporation | Testing for digital signaling |
| US6720801B2 (en) * | 2001-06-18 | 2004-04-13 | The United States Of America As Represented By The Secretary Of The Navy | RS-232 bus data tap apparatus |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3934213A (en) * | 1974-06-28 | 1976-01-20 | International Business Machines Corporation | Broad band directional coupling circuit |
| GB1566223A (en) * | 1978-01-17 | 1980-04-30 | Standard Telephones Cables Ltd | Digital duplex transmission system |
| GB2123259A (en) * | 1982-06-25 | 1984-01-25 | Philips Electronic Associated | Digital duplex communication system |
| GB2123258A (en) * | 1982-06-25 | 1984-01-25 | Philips Electronic Associated | Digital duplex communication system |
| IT1162836B (it) * | 1983-03-04 | 1987-04-01 | Cselt Centro Studi Lab Telecom | Ricestrasmettitore numerico per trasmissione bidirezionale simultanea di segnali logici su una linea unica |
| NL8401310A (nl) * | 1984-04-24 | 1985-11-18 | Philips Nv | Inrichting voor het opwekken van een kloksignaal. |
| US4591669A (en) * | 1984-09-26 | 1986-05-27 | At&T Bell Laboratories | Adaptive filter update gain normalization |
| US4845658A (en) * | 1986-12-01 | 1989-07-04 | Massachusetts Institute Of Technology | Information method and apparatus using simplex and duplex communications |
| US4864617A (en) * | 1987-07-15 | 1989-09-05 | Paradyne Corp. | System and method for reducing deadlock conditions caused by repeated transmission of data sequences equivalent to those used for inter-device signalling |
| US4995031A (en) * | 1989-06-19 | 1991-02-19 | Northern Telecom Limited | Equalizer for ISDN-U interface |
| US5181198A (en) * | 1991-03-12 | 1993-01-19 | Bell Communications Research, Inc. | Coordinated transmission for two-pair digital subscriber lines |
-
1992
- 1992-08-11 DE DE69207509T patent/DE69207509T2/de not_active Expired - Fee Related
- 1992-08-11 EP EP92202480A patent/EP0528491B1/en not_active Expired - Lifetime
- 1992-08-17 JP JP23997792A patent/JP3272411B2/ja not_active Expired - Fee Related
-
1994
- 1994-07-25 US US08/279,983 patent/US5502716A/en not_active Expired - Fee Related
-
1996
- 1996-09-12 HK HK171196A patent/HK171196A/xx not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| US5502716A (en) | 1996-03-26 |
| EP0528491A2 (en) | 1993-02-24 |
| DE69207509D1 (de) | 1996-02-22 |
| JP3272411B2 (ja) | 2002-04-08 |
| HK171196A (en) | 1996-09-20 |
| EP0528491B1 (en) | 1996-01-10 |
| EP0528491A3 (ja) | 1994-02-16 |
| DE69207509T2 (de) | 1996-08-22 |
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Legal Events
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| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20011218 |
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