JPH06189223A - 直流伝送率補正回路 - Google Patents
直流伝送率補正回路Info
- Publication number
- JPH06189223A JPH06189223A JP33744192A JP33744192A JPH06189223A JP H06189223 A JPH06189223 A JP H06189223A JP 33744192 A JP33744192 A JP 33744192A JP 33744192 A JP33744192 A JP 33744192A JP H06189223 A JPH06189223 A JP H06189223A
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- Japan
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- signal
- circuit
- voltage
- correction
- capacitor
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Abstract
(57)【要約】
【目的】画面上のペデスタルレベルを変えないようにす
るとともにＡＰＬの低い信号から高い信号まで正確な補
正をすることができる直流伝送率補正回路を提供するこ
とを目的とする。 【構成】輝度信号をクランプパルスの入力によって基準
電位にクランプするペデスタルクランプ回路１０と、こ
のペデスタルクランプ回路１０の出力信号を増幅するバ
ッファアンプ１１と、この増幅されたバッファアンプ１
１の出力信号の電圧を積分するコンデンサＣ１と、この
コンデンサＣ１の電圧を基準電位と比較し増幅する比較
増幅回路１２と、この比較増幅回路１２の出力信号を前
記バッファアンプ１１の出力信号に重畳する加算器２
と、ＡＰＬの所定の値より大きくなった時にオン動作
し、前記コンデンサＣ１によって充電された電圧を放電
することによって原信号に重畳する補正信号の補正レベ
ルを小さくするために設けられたスィッチ手段Ｄ１とを
具備したことを特徴とする直流伝送率補正回路。
るとともにＡＰＬの低い信号から高い信号まで正確な補
正をすることができる直流伝送率補正回路を提供するこ
とを目的とする。 【構成】輝度信号をクランプパルスの入力によって基準
電位にクランプするペデスタルクランプ回路１０と、こ
のペデスタルクランプ回路１０の出力信号を増幅するバ
ッファアンプ１１と、この増幅されたバッファアンプ１
１の出力信号の電圧を積分するコンデンサＣ１と、この
コンデンサＣ１の電圧を基準電位と比較し増幅する比較
増幅回路１２と、この比較増幅回路１２の出力信号を前
記バッファアンプ１１の出力信号に重畳する加算器２
と、ＡＰＬの所定の値より大きくなった時にオン動作
し、前記コンデンサＣ１によって充電された電圧を放電
することによって原信号に重畳する補正信号の補正レベ
ルを小さくするために設けられたスィッチ手段Ｄ１とを
具備したことを特徴とする直流伝送率補正回路。
Description
【０００１】
【産業上の利用分野】本発明は、ＴＶ受像機器のビデオ
回路に関する。
回路に関する。
【０００２】
【従来の技術】一般に、高圧安定化回路のないＴＶ受像
機器において、輝度信号の直流成分が減ってしまうと、
黒レベルや白レベルが画面全体の明るさによって変動し
てしまう。その意味で、陰極線管（以下ＣＲＴという）
のカソード電流が変化すると高圧も変動する。したがっ
て、この高圧を分圧しているスクリーン電圧も変動す
る。 また、平均映像レベル（以下ＡＰＬという）の高
い時はスクリーン電圧が下がり、カソード電流は低下
し、画面上黒つぶれをおこす。逆に、ＡＰＬの低いとき
は黒浮きを生じる。これを補正するために、従来より使
用されている直流伝送率補正回路がある。
機器において、輝度信号の直流成分が減ってしまうと、
黒レベルや白レベルが画面全体の明るさによって変動し
てしまう。その意味で、陰極線管（以下ＣＲＴという）
のカソード電流が変化すると高圧も変動する。したがっ
て、この高圧を分圧しているスクリーン電圧も変動す
る。 また、平均映像レベル（以下ＡＰＬという）の高
い時はスクリーン電圧が下がり、カソード電流は低下
し、画面上黒つぶれをおこす。逆に、ＡＰＬの低いとき
は黒浮きを生じる。これを補正するために、従来より使
用されている直流伝送率補正回路がある。
【０００３】このような直流伝送率補正回路を図２に示
す。
す。
【０００４】図２は従来における直流伝送率補正回路を
示す回路図である。
示す回路図である。
【０００５】図２において、符号１は入力端子であり、
この入力端子１には輝度信号が入力される。入力端子１
はペデスタルクランプ回路１０に接続されている。この
ペデスタルクランプ回路１０はクランプパルス信号が導
かれており、さらに基準電圧Ｖｒを与えられている。
この入力端子１には輝度信号が入力される。入力端子１
はペデスタルクランプ回路１０に接続されている。この
ペデスタルクランプ回路１０はクランプパルス信号が導
かれており、さらに基準電圧Ｖｒを与えられている。
【０００６】ここで前記ペデスタルクランプ回路１０に
入力された輝度信号は、前記ペデスタルクランプ回路１
０によってクランプ期間中に基準電圧Ｖｒにクランプさ
れる。このペデスタルクランプ回路１０の出力はこれに
接続される増幅器１１に供給している。この増幅器１１
で増幅された出力はＡ点において、基準電圧Ｖｒにクラ
ンプされた輝度信号が作成される。さらにこの信号は抵
抗Ｒ１を介し、抵抗Ｒ２とコンデンサＣ１で形成される
積分回路にて積分される。Ｃ点ではこのように積分され
た信号が作成され、また、平均Ｄｃ電圧が生じるように
なっている。前記コンデンサＣ１では基準電圧Ｖｒ以上
の電圧が貯蓄される。
入力された輝度信号は、前記ペデスタルクランプ回路１
０によってクランプ期間中に基準電圧Ｖｒにクランプさ
れる。このペデスタルクランプ回路１０の出力はこれに
接続される増幅器１１に供給している。この増幅器１１
で増幅された出力はＡ点において、基準電圧Ｖｒにクラ
ンプされた輝度信号が作成される。さらにこの信号は抵
抗Ｒ１を介し、抵抗Ｒ２とコンデンサＣ１で形成される
積分回路にて積分される。Ｃ点ではこのように積分され
た信号が作成され、また、平均Ｄｃ電圧が生じるように
なっている。前記コンデンサＣ１では基準電圧Ｖｒ以上
の電圧が貯蓄される。
【０００７】一方、増幅器１１の出力端Ａ点からは抵抗
３を介して、加算器２に出力するようになっている。そ
して、抵抗Ｒ１の出力端Ｂ点からは比較増幅器１２に出
力するようになっている。この比較増幅器１２には比較
するための基準電圧Ｖｅを与えられている。
３を介して、加算器２に出力するようになっている。そ
して、抵抗Ｒ１の出力端Ｂ点からは比較増幅器１２に出
力するようになっている。この比較増幅器１２には比較
するための基準電圧Ｖｅを与えられている。
【０００８】抵抗Ｒ１と抵抗Ｒ２によって分圧されたＢ
点の電圧Ｖｆと基準電圧Ｖｅは、クランプパルスを導い
ている比較増幅器１２においてクランプ期間中に比較増
幅され、この比較した電圧△Ｖを加算器２よって出力信
号に重畳される。したがって、出力端子３の出力信号
は、△Ｖ＝Ｖｆ−Ｖｅとなり、この出力信号は出力端子
３を介して反転されＣＲＴのカソードへと供給してい
る。
点の電圧Ｖｆと基準電圧Ｖｅは、クランプパルスを導い
ている比較増幅器１２においてクランプ期間中に比較増
幅され、この比較した電圧△Ｖを加算器２よって出力信
号に重畳される。したがって、出力端子３の出力信号
は、△Ｖ＝Ｖｆ−Ｖｅとなり、この出力信号は出力端子
３を介して反転されＣＲＴのカソードへと供給してい
る。
【０００９】図３は図１の入、出力信号波形を示す波形
図であり、図３（Ａ）はＡＰＬの高い時を示し、図３
（Ｂ）はＡＰＬの低い時を示す。図４はＡＰＬとスクリ
ーン電圧の関係を示す説明図である。
図であり、図３（Ａ）はＡＰＬの高い時を示し、図３
（Ｂ）はＡＰＬの低い時を示す。図４はＡＰＬとスクリ
ーン電圧の関係を示す説明図である。
【００１０】前記した直流伝送率補正回路は図３（Ａ）
に示すように、輝度信号を基準電圧Ｖｒにクランプさ
れ、△Ｖを加算されて出力している。つまりＡＰＬが高
くなればなるほどそれに比例して△Ｖも大きくなり補正
量が大きくなるようになっている。したがって、従来の
直流伝送率補正回路では、ＡＰＬの高いときはペデスタ
ルレベル（黒レベル）が上がり、そのため画面上黒潰れ
が生じなくななり補正することができるが、前述したよ
うにＡＰＬと補正量との関係は比例関係になっているの
でＡＰＬの変化に対し補正量は増加してしまっていた。
に示すように、輝度信号を基準電圧Ｖｒにクランプさ
れ、△Ｖを加算されて出力している。つまりＡＰＬが高
くなればなるほどそれに比例して△Ｖも大きくなり補正
量が大きくなるようになっている。したがって、従来の
直流伝送率補正回路では、ＡＰＬの高いときはペデスタ
ルレベル（黒レベル）が上がり、そのため画面上黒潰れ
が生じなくななり補正することができるが、前述したよ
うにＡＰＬと補正量との関係は比例関係になっているの
でＡＰＬの変化に対し補正量は増加してしまっていた。
【００１１】また、図３（Ｂ）に示すように、ＡＰＬの
低いときは輝度信号を基準電圧Ｖｒにクランプされてい
るが、基準電圧ＶｒとＶｆの電圧差が生じていないため
前記したように補正量は小さくなっている。したがって
ＡＰＬの低いときは、この従来の補正回路で補うことが
可能である。しかしながら図４に示すようにＡＰＬの変
化に対するスクリーン電圧の変化がＡＰＬが高くなれば
なるほどスクリーン電圧がＡＰＬのある所定の位置まで
急峻に下降し、この後直線的に下降してしまうという非
線形的な特性をもっているため、このような非線形的な
特性に従って補正がかけられず、すなわちＡＰＬの低い
信号から高い信号まで完全に補正することができなかっ
た。
低いときは輝度信号を基準電圧Ｖｒにクランプされてい
るが、基準電圧ＶｒとＶｆの電圧差が生じていないため
前記したように補正量は小さくなっている。したがって
ＡＰＬの低いときは、この従来の補正回路で補うことが
可能である。しかしながら図４に示すようにＡＰＬの変
化に対するスクリーン電圧の変化がＡＰＬが高くなれば
なるほどスクリーン電圧がＡＰＬのある所定の位置まで
急峻に下降し、この後直線的に下降してしまうという非
線形的な特性をもっているため、このような非線形的な
特性に従って補正がかけられず、すなわちＡＰＬの低い
信号から高い信号まで完全に補正することができなかっ
た。
【００１２】
【発明が解決しようとする課題】前記した従来の直流伝
送率補正回路では、ＡＰＬが高くなるほどそれに比例し
てＡＰＬの所定の位置より補正量が大きくなってしま
い、ＡＰＬの低い信号から高い信号まで非線形的な補正
をかけることができなかった。
送率補正回路では、ＡＰＬが高くなるほどそれに比例し
てＡＰＬの所定の位置より補正量が大きくなってしま
い、ＡＰＬの低い信号から高い信号まで非線形的な補正
をかけることができなかった。
【００１３】そこで、本発明は上記問題を除去し、画面
上のペデスタルレベルを変えないようにするとともにＡ
ＰＬの低い信号から高い信号まで正確な補正をすること
ができる直流伝送率補正回路を提供することを目的とす
る。
上のペデスタルレベルを変えないようにするとともにＡ
ＰＬの低い信号から高い信号まで正確な補正をすること
ができる直流伝送率補正回路を提供することを目的とす
る。
【００１４】
【課題を解決するための手段】請求項１記載の本発明に
よる直流伝送率補正回路は、輝度信号をクランプパルス
の入力によって基準電位にクランプするペデスタルクラ
ンプ回路と、このペデスタルクランプ回路の出力信号を
増幅するバッファアンプと、この増幅されたバッファア
ンプの出力信号の電圧を積分するコンデンサと、このコ
ンデンサの電圧を基準電位と比較し増幅する比較増幅回
路と、この比較増幅回路の出力信号を前記バッファアン
プの出力信号に重畳する加算器と、ＡＰＬの所定の値よ
り大きくなった時にオン動作し、前記コンデンサによっ
て充電された電圧を放電することによって原信号に重畳
する補正信号の補正レベルを小さくするために設けられ
たスィッチ手段とを具備したことを特徴とする。
よる直流伝送率補正回路は、輝度信号をクランプパルス
の入力によって基準電位にクランプするペデスタルクラ
ンプ回路と、このペデスタルクランプ回路の出力信号を
増幅するバッファアンプと、この増幅されたバッファア
ンプの出力信号の電圧を積分するコンデンサと、このコ
ンデンサの電圧を基準電位と比較し増幅する比較増幅回
路と、この比較増幅回路の出力信号を前記バッファアン
プの出力信号に重畳する加算器と、ＡＰＬの所定の値よ
り大きくなった時にオン動作し、前記コンデンサによっ
て充電された電圧を放電することによって原信号に重畳
する補正信号の補正レベルを小さくするために設けられ
たスィッチ手段とを具備したことを特徴とする。
【００１５】
【作用】本発明においては、ＡＰＬの所定の地点にてダ
イオードがオン状態になり、これにより補正するために
加算される余分な電圧をバッファアンプ内でアースに放
電することにより非線形的に補正をかけることができ
る。
イオードがオン状態になり、これにより補正するために
加算される余分な電圧をバッファアンプ内でアースに放
電することにより非線形的に補正をかけることができ
る。
【００１６】
【実施例】実施例について図面を参照して説明する。図
１は本発明の一実施例に係る直流伝送率補正回路を示す
回路図であり、図１において図２と同一の構成用件には
同符号を付す。図１において、入力端子１には輝度信号
が入力される。入力端子１はペデスタルクランプ回路１
０に接続されている。このペデスタルクランプ回路１０
はクランプパルス信号が導かれており、さらに基準電圧
Ｖｒを与えられている。
１は本発明の一実施例に係る直流伝送率補正回路を示す
回路図であり、図１において図２と同一の構成用件には
同符号を付す。図１において、入力端子１には輝度信号
が入力される。入力端子１はペデスタルクランプ回路１
０に接続されている。このペデスタルクランプ回路１０
はクランプパルス信号が導かれており、さらに基準電圧
Ｖｒを与えられている。
【００１７】ここで前記ペデスタルクランプ回路１０に
入力された輝度信号は、前記クランプパルスによってク
ランプ期間中に基準電圧Ｖｒにクランプされる。このペ
デスタルクランプ回路１０の出力はこれに接続される増
幅器１１に供給している。この増幅器１１で増幅された
出力はＡ点において、基準電圧Ｖｒにクランプされた輝
度信号が作成される。さらにこの信号は抵抗Ｒ１を介
し、抵抗Ｒ２とコンデンサＣ１で形成される積分回路に
て積分される。Ｃ点ではこのように積分された信号が作
成され、また、平均Ｄｃ電圧が生じるようになってい
る。前記コンデンサＣ１では基準電圧Ｖｒ以上の電圧が
貯蓄される。
入力された輝度信号は、前記クランプパルスによってク
ランプ期間中に基準電圧Ｖｒにクランプされる。このペ
デスタルクランプ回路１０の出力はこれに接続される増
幅器１１に供給している。この増幅器１１で増幅された
出力はＡ点において、基準電圧Ｖｒにクランプされた輝
度信号が作成される。さらにこの信号は抵抗Ｒ１を介
し、抵抗Ｒ２とコンデンサＣ１で形成される積分回路に
て積分される。Ｃ点ではこのように積分された信号が作
成され、また、平均Ｄｃ電圧が生じるようになってい
る。前記コンデンサＣ１では基準電圧Ｖｒ以上の電圧が
貯蓄される。
【００１８】一方、増幅器１１の出力端Ａ点からは抵抗
３を介して、加算器２に出力するようになっている。そ
して、抵抗Ｒ１の出力端Ｂ点からは比較増幅器１２に出
力するようになっている。もう一方の抵抗Ｒ１の出力端
Ｂ点からは抵抗Ｒ４を介してダイオードＤ１のアノード
へ接続されており、このダイオードＤ１のカソードから
はＡ点に接続されている。また、前記比較増幅器１２に
は比較するための基準電圧Ｖｅを与えられている。
３を介して、加算器２に出力するようになっている。そ
して、抵抗Ｒ１の出力端Ｂ点からは比較増幅器１２に出
力するようになっている。もう一方の抵抗Ｒ１の出力端
Ｂ点からは抵抗Ｒ４を介してダイオードＤ１のアノード
へ接続されており、このダイオードＤ１のカソードから
はＡ点に接続されている。また、前記比較増幅器１２に
は比較するための基準電圧Ｖｅを与えられている。
【００１９】抵抗Ｒ１と抵抗Ｒ２によって分圧されたＢ
点の電圧Ｖｆと基準電圧Ｖｅは、クランプパルスを導い
ている比較増幅器１２においてクランプ期間中に比較増
幅され、この比較した電圧△Ｖを加算器２よって出力信
号に重畳される。したがって、出力端子３の出力信号
は、△Ｖ＝Ｖｆ−Ｖｅとなり、この出力信号は出力端子
３を介して反転されＣＲＴのカソードへと供給してい
る。
点の電圧Ｖｆと基準電圧Ｖｅは、クランプパルスを導い
ている比較増幅器１２においてクランプ期間中に比較増
幅され、この比較した電圧△Ｖを加算器２よって出力信
号に重畳される。したがって、出力端子３の出力信号
は、△Ｖ＝Ｖｆ−Ｖｅとなり、この出力信号は出力端子
３を介して反転されＣＲＴのカソードへと供給してい
る。
【００２０】このように本発明の直流伝送率補正回路で
は、ダイオードを設けた非線形回路を用いて構成してい
るこのような構成の本発明の回路の動作において従来例
と異なる部分を図１を参照して説明する。たとえば、Ａ
ＰＬの低い信号が入力端１に入力された場合、基準電圧
Ｖｒに対してコンデンサＣ１に充電される電圧Ｖｃはさ
ほど変化はなく、したがってＣ点にかかる電圧とＡ点に
かかる電圧との電圧差はあまり生じていない。このため
Ａ点とＢ点との間に並列に設けられたダイオードＤ１
は、オフのままであり従来例と同様に出力される。
は、ダイオードを設けた非線形回路を用いて構成してい
るこのような構成の本発明の回路の動作において従来例
と異なる部分を図１を参照して説明する。たとえば、Ａ
ＰＬの低い信号が入力端１に入力された場合、基準電圧
Ｖｒに対してコンデンサＣ１に充電される電圧Ｖｃはさ
ほど変化はなく、したがってＣ点にかかる電圧とＡ点に
かかる電圧との電圧差はあまり生じていない。このため
Ａ点とＢ点との間に並列に設けられたダイオードＤ１
は、オフのままであり従来例と同様に出力される。
【００２１】ところが、ＡＰＬの高い信号が入力された
場合、Ｃ点の電圧は上昇し、ある所定値のところで前記
ダイオードＤ１がオンされる。その結果、Ａ−Ｂ間のイ
ンピーダンスは下がることになる。これにより基準電圧
Ｖｒに対するＢ点の電圧は下がるので直流伝送補正パル
スのレベルは小さくなる。すなわちＡＰＬの信号が高い
時は直流伝送補正の補正量を小さくすることができる。
場合、Ｃ点の電圧は上昇し、ある所定値のところで前記
ダイオードＤ１がオンされる。その結果、Ａ−Ｂ間のイ
ンピーダンスは下がることになる。これにより基準電圧
Ｖｒに対するＢ点の電圧は下がるので直流伝送補正パル
スのレベルは小さくなる。すなわちＡＰＬの信号が高い
時は直流伝送補正の補正量を小さくすることができる。
【００２２】したがって、前記ダイオードＤ１がオンす
る所定値のところと、スクリーン電圧が急峻に変化する
所定値のところとを一致させることによって、スクリー
ン電圧の変化にともなう補正すなわち非線形的な補正を
することができる。その結果、スクリーン電圧の変化に
対してもペデスタルレベルの浮き沈みをなくし変動しな
いようにすることができる。さらにＡＰＬの低い信号か
ら高い信号まで正確な補正をかけることができる。
る所定値のところと、スクリーン電圧が急峻に変化する
所定値のところとを一致させることによって、スクリー
ン電圧の変化にともなう補正すなわち非線形的な補正を
することができる。その結果、スクリーン電圧の変化に
対してもペデスタルレベルの浮き沈みをなくし変動しな
いようにすることができる。さらにＡＰＬの低い信号か
ら高い信号まで正確な補正をかけることができる。
【００２３】
【発明の効果】以上述べたように本発明では、ダイオー
ドスイッチを設けた非線形回路を用いることによって、
ＡＰＬが変動しスクリーン電圧が変化しても画面上のペ
デスタルレベルを変えないようにすることができる。す
なわち画面上の黒つぶれや黒浮き等の状態をなくし、Ａ
ＰＬの低い信号から高い信号まで正確な補正をかけるこ
とができる。
ドスイッチを設けた非線形回路を用いることによって、
ＡＰＬが変動しスクリーン電圧が変化しても画面上のペ
デスタルレベルを変えないようにすることができる。す
なわち画面上の黒つぶれや黒浮き等の状態をなくし、Ａ
ＰＬの低い信号から高い信号まで正確な補正をかけるこ
とができる。
【図１】本発明に係る直流伝送率補正回路の一実施例を
示す回路図。
示す回路図。
【図２】従来における直流伝送率補正回路の回路図。
【図３】図２の直流伝送率補正回路の回路の入出力波形
を示す波形図。
を示す波形図。
【図４】ＡＰＬの信号とスクリーン電圧の関係を示す説
明図。
明図。
１…輝度信号入力端子 ２…加算器 ３…輝度信号出力端子 ４…クランプパルス入力端子 １０…ペデスタルクランプ回路 １１…バッファアンプ １２…比較増幅器 Ｖｒ、Ｖｅ…基準電圧 Ｄ１…ダイオード Ｃ１…コンデンサ
Claims (1)
- 【請求項１】輝度信号をクランプパルスの入力によって
基準電位にクランプするペデスタルクランプ回路と、 このペデスタルクランプ回路の出力信号を増幅するバッ
ファアンプと、 この増幅されたバッファアンプの出力信号の電圧を積分
するコンデンサと、 このコンデンサの電圧を基準電位と比較し増幅する比較
増幅回路と、 この比較増幅回路の出力信号を前記バッファアンプの出
力信号に重畳する加算器と、 ＡＰＬの所定の値より大きくなった時にオン動作し、前
記コンデンサによって充電された電圧を放電することに
よって原信号に重畳する補正信号の補正レベルを小さく
するために設けられたスィッチ手段と、 を具備したことを特徴とする直流伝送率補正回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33744192A JPH06189223A (ja) | 1992-12-17 | 1992-12-17 | 直流伝送率補正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33744192A JPH06189223A (ja) | 1992-12-17 | 1992-12-17 | 直流伝送率補正回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06189223A true JPH06189223A (ja) | 1994-07-08 |
Family
ID=18308667
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33744192A Pending JPH06189223A (ja) | 1992-12-17 | 1992-12-17 | 直流伝送率補正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06189223A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010095011A1 (en) | 2009-02-18 | 2010-08-26 | Council Of Scientific & Industrial Research | Process to deposit diamond like carbon as protective coating on inner surface of a shaped object. |
-
1992
- 1992-12-17 JP JP33744192A patent/JPH06189223A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010095011A1 (en) | 2009-02-18 | 2010-08-26 | Council Of Scientific & Industrial Research | Process to deposit diamond like carbon as protective coating on inner surface of a shaped object. |
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