JPH06161594A - Electronic circuit device - Google Patents
Electronic circuit deviceInfo
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- JPH06161594A JPH06161594A JP4305750A JP30575092A JPH06161594A JP H06161594 A JPH06161594 A JP H06161594A JP 4305750 A JP4305750 A JP 4305750A JP 30575092 A JP30575092 A JP 30575092A JP H06161594 A JPH06161594 A JP H06161594A
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- mpu
- microprocessor
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Abstract
Description
【０００１】[0001]
【産業上の利用分野】本発明は、例えば、ICカードに使
用する電子回路装置に関するものである。従来より、電
池を主電源とする電子機器、例えばICカードでは CMOS
プロセスのマイクロプセッサ( 以下、MPU と省略する)
を用いると共に、不使用時にはこのMPU に供給している
クロックを停止させ、回路の消費電力を低減させること
が良く行われている。そして、このクロック発振回路は
MPU IC の中に含まれている電子回路( 増幅器) と外部
に設けた共振回路によって構成するのが一般的である。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an electronic circuit device used for an IC card, for example. Conventionally, electronic devices that use a battery as the main power source, such as CMOS for IC cards
Microprocessor of process (hereinafter abbreviated as MPU)
It is common practice to reduce the power consumption of the circuit by stopping the clock supplied to this MPU when not in use. And this clock oscillator circuit
It is generally composed of an electronic circuit (amplifier) included in the MPU IC and an external resonance circuit.
【０００２】しかしながら、MPU ICの中のクロック発振
回路を用いている場合、使用可能な共振回路の選定自由
度が小さく、結果として機器の小型化・低価格化に制約
を与えることがある。特に、ICカードの様な薄い形状の
機器ではその制約を強く受ける場合がある( 後述する)
。However, when the clock oscillation circuit in the MPU IC is used, the degree of freedom in selecting a usable resonance circuit is small, and as a result, there are restrictions on downsizing and cost reduction of equipment. In particular, thin devices such as IC cards may be subject to that restriction (described later).
.
【０００３】そこで、装置の小型・低価格化の実現を図
ることを目的とする。Therefore, it is an object of the present invention to realize downsizing and cost reduction of the device.
【０００４】[0004]
【従来の技術】図４は従来例の構成図である。図におい
て、MPU 11には、常時、電圧 Vccが印加していて、図示
しない動作スイッチを押すと MPU 11 からH レベルの電
圧がインバータ21に印加する。そこで、インバータ21,
振動子22, コンデンサC1, C2で構成されるクロック発振
回路はクロックCKを生成してMPU 11に供給する。2. Description of the Related Art FIG. 4 is a block diagram of a conventional example. In the figure, the voltage Vcc is always applied to the MPU 11, and when the operation switch (not shown) is pressed, the HPU level voltage is applied from the MPU 11 to the inverter 21. Therefore, the inverter 21,
The clock oscillation circuit composed of the oscillator 22 and the capacitors C 1 and C 2 generates the clock CK and supplies it to the MPU 11.
【０００５】MPU 11はROM 12に格納されているプログラ
ムに従って、例えば、インタフェース13を介して入力し
た情報に対して処理してRAM 14に格納する。しかし、MP
U が所定時間の間、処理をしなければ、図示しないタイ
マで動作スイッチを自動的にオフにする様になってい
る。そこで、MPU からインバータに印加していたH レベ
ルの電圧がL レベルとなり、クロック発振回路の動作が
停止する。The MPU 11 processes the information input through the interface 13 according to the program stored in the ROM 12, and stores the processed information in the RAM 14. But MP
If U does not perform processing for a predetermined time, the operation switch is automatically turned off by a timer (not shown). Therefore, the H-level voltage applied from the MPU to the inverter becomes L-level, and the operation of the clock oscillation circuit stops.
【０００６】ここで、MPU ICの内部回路はMPU の動作を
優先にして作られている為、振動子を接続して発振させ
る場合、共振回路の周波数範囲や負荷容量の値などが指
定される等の制約があることが多い( 例えば、MPU のク
ロック周波数として、1.228MHz が指定されることがあ
る) 。Since the internal circuit of the MPU IC is made by giving priority to the operation of the MPU, the frequency range of the resonant circuit and the value of the load capacitance are specified when the oscillator is connected and oscillated. There are many restrictions such as (for example, 1.228MHz may be specified as the clock frequency of MPU).
【０００７】[0007]
【発明が解決しようとする課題】上記の様に、MPU に供
給するクロックの周波数により、振動子の共振周波数が
決定される為、振動子を自由に選択することができず、
機器の小型・低価格化の実現を図ることが難しいと云う
問題がある。As described above, since the resonance frequency of the vibrator is determined by the frequency of the clock supplied to the MPU, the vibrator cannot be freely selected.
There is a problem that it is difficult to reduce the size and cost of equipment.
【０００８】本発明は装置の小型・低価格化の実現を図
ることを目的とする。It is an object of the present invention to realize downsizing and cost reduction of a device.
【０００９】[0009]
【課題を解決するための手段】図１は本発明の原理構成
図である。図中、５は動作状態の時はＨレベルの出力を
送出すると共に、格納されたプログラムに従って処理を
行い、待機状態の時はＬレベルの出力を送出し、処理を
停止するマイクロプロセッサ、３はマイクロプロセッサ
から送出される出力がＨレベルの時、所定周波数のクロ
ックを生成し、Ｌレベルの時に該クロックの生成を停止
するクロック発振回路、４はクロック発振回路の出力を
分周してマイクロプロセッサに供給する分周器である。FIG. 1 is a block diagram showing the principle of the present invention. In the figure, reference numeral 5 denotes a microprocessor that outputs an H level output in the operating state, performs processing in accordance with a stored program, and outputs an L level output in the standby state and stops the processing. A clock oscillator circuit 4 generates a clock of a predetermined frequency when the output sent from the microprocessor is at the H level and stops the generation of the clock when the output is at the L level. It is a frequency divider to be supplied to.
【００１０】[0010]
【作用】第１，第２の本発明は回路的に制約の強いMPU
の内部クロック発振回路を使用せずにMPU 外に発振回路
を設け、周波数を合わせる為の分周回路とMPU からの制
御( MPU が立上がると、電圧をクロック発振回路に印加
する) を組み合わせることにより、クロックの共振回路
の選定自由度を増やし、結果として装置の小型化・低価
格化を実現する様にしたものである。The first and second inventions of the present invention are MPUs with strong circuit restrictions.
An oscillator circuit is provided outside the MPU without using the internal clock oscillator circuit, and a frequency divider circuit to match the frequency and control from the MPU (when the MPU starts up, apply voltage to the clock oscillator circuit) are combined. Thus, the degree of freedom in selecting the clock resonance circuit is increased, and as a result, downsizing and cost reduction of the device are realized.
【００１１】即ち、クロック発振回路とMPU とは独立し
た回路で構成し、クロック発振回路で発生したクロック
は分周器によりMPU が必要とする周波数に変換する。ま
た、クロック発振回路の電源はMPU の出力ポートより提
供し、MPU によりクロック発振回路の動作・非動作を制
御する( MPU が動作中は電圧が印加され、停止すれば電
圧は印加されない) 。That is, the clock oscillation circuit and the MPU are composed of independent circuits, and the clock generated by the clock oscillation circuit is converted into a frequency required by the MPU by a frequency divider. The power supply of the clock oscillation circuit is provided from the output port of the MPU, and the MPU controls the operation / non-operation of the clock oscillation circuit (voltage is applied while the MPU is operating, and no voltage is applied if it is stopped).
【００１２】更に、MPU の一部を使用した発振回路では
充分な発振安定性が得られない場合においても、例え
ば、外部回路の利得を大きくすることにり良好な結果を
得ることができる。Further, even when the oscillation circuit using a part of the MPU cannot obtain sufficient oscillation stability, a good result can be obtained by, for example, increasing the gain of the external circuit.
【００１３】[0013]
【実施例】図２は第１，第２の本発明の実施例の構成
図、図３は第１，第２の本発明の別の実施例の構成図で
ある。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS FIG. 2 is a block diagram of the first and second embodiments of the present invention, and FIG. 3 is a block diagram of another embodiment of the first and second inventions.
【００１４】ここで、インバータ31, 振動子32, コンデ
ンサC1, C2はクロック発振回路３の構成部分である。以
下、図２，図３の動作を説明するが、上記で詳細説明し
た部分については概略説明し、本発明の部分について詳
細説明する。Here, the inverter 31, the oscillator 32, and the capacitors C 1 and C 2 are components of the clock oscillation circuit 3. The operation of FIGS. 2 and 3 will be described below, but the portions described in detail above will be briefly described, and the portions of the present invention will be described in detail.
【００１５】先ず、図２において、上記の様にMPU のク
ロックとして1.228 MHz が必要であるが、この周波数帯
ではICカード向きの超薄型, 低価格の振動子がない為、
2.456 MHz の振動子を用いてクロック発振回路を形成
し、この出力をフリップフロップ41により２分周してMP
U ５に供給している。First, in FIG. 2, 1.228 MHz is required as the clock of the MPU as described above, but in this frequency band there is no ultra-thin, low-cost oscillator for IC cards,
A clock oscillation circuit is formed using a 2.456 MHz oscillator, and this output is divided by 2 by a flip-flop 41 to generate MP.
Supplying to U5.
【００１６】発振素子であるC-MOS インバータ31の電源
(VCC )は、MPU の出力ポートより供給している。この様
な構成とすることにより、MPU の静止時にクロック発振
回路も停止させて消費電流を低減することができる。Power supply for the C-MOS inverter 31, which is an oscillating element
(V CC ) is supplied from the output port of MPU. With such a configuration, it is possible to reduce the current consumption by stopping the clock oscillation circuit when the MPU is stationary.
【００１７】また、C-MOS フリップフロップ 41 の入力
側にプルダウン抵抗R を設けて０Vにしている。これ
は、抵抗R がない場合、クロック発振回路の動作停止
時、C-MOS フリップフロップ 41 の入力がオープン状態
となるので雑音により誤動作して異常出力を送出する可
能性があるので、これを防止する為である。Further, a pull-down resistor R is provided on the input side of the C-MOS flip-flop 41 to set it to 0V. This is because if the resistor R is not present, the input of the C-MOS flip-flop 41 will be in the open state when the operation of the clock oscillation circuit is stopped, which may cause malfunction due to noise and send out an abnormal output. To do so.
【００１８】次に、図３は実施例の変形でインバータを
多段構成にすることにより、損失の多い共振器が使用で
きる様にしたものである。また、MPU を用いた機器のク
ロック用振動子を自由に選定することができ、ICカード
等の機器の小型・薄型化、低価格化に寄与することがで
きる。Next, FIG. 3 shows a modification of the embodiment, in which the inverter has a multi-stage structure so that a resonator with a large loss can be used. In addition, it is possible to freely select a clock oscillator for equipment that uses an MPU, which can contribute to making devices such as IC cards smaller, thinner, and cheaper.
【００１９】[0019]
【発明の効果】以上詳細に説明した様に本発明によれ
ば、装置の小型・低価格化の実現を図ることができると
云う効果がある。As described in detail above, according to the present invention, there is an effect that the size and cost of the device can be reduced.
【図１】本発明の原理構成図である。FIG. 1 is a principle configuration diagram of the present invention.
【図２】第１，第２の本発明の実施例の構成図である。FIG. 2 is a configuration diagram of the first and second embodiments of the present invention.
【図３】第１，第２の本発明の別の実施例の構成図であ
る。FIG. 3 is a configuration diagram of another embodiment of the first and second inventions.
【図４】従来例の構成図である。FIG. 4 is a configuration diagram of a conventional example.
３ クロック発振回路 ４ 分周器 ５ マイクロプロセッサ 3 clock oscillation circuit 4 frequency divider 5 microprocessor
Claims (2)
ると共に、格納されたプログラムに従って処理を行い、
待機状態の時はＬレベルの出力を送出し、処理を停止す
るマイクロプロセッサ(5) と、該マイクロプロセッサか
ら送出される出力がＨレベルの時、所定周波数のクロッ
クを生成し、Ｌレベルの時に該クロックの生成を停止す
るクロック発振回路(3) と、該クロック発振回路の出力
を分周して該マイクロプロセッサに供給する分周器(4)
とを有することを特徴とする電子回路装置。1. When in an operating state, an H-level output is sent, and processing is performed according to a stored program,
A microprocessor (5) that outputs an L level output in the standby state and stops processing, and generates a clock of a predetermined frequency when the output sent from the microprocessor is an H level, and when the output is an L level. A clock oscillator circuit (3) for stopping the generation of the clock, and a frequency divider (4) for dividing the output of the clock oscillator circuit and supplying it to the microprocessor.
An electronic circuit device comprising:
載の電子回路装置。2. The electronic circuit device according to claim 1, which is used in an IC card device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4305750A JPH06161594A (en) | 1992-11-17 | 1992-11-17 | Electronic circuit device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4305750A JPH06161594A (en) | 1992-11-17 | 1992-11-17 | Electronic circuit device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06161594A true JPH06161594A (en) | 1994-06-07 |
Family
ID=17948900
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4305750A Withdrawn JPH06161594A (en) | 1992-11-17 | 1992-11-17 | Electronic circuit device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06161594A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5569903A (en) * | 1993-07-05 | 1996-10-29 | Mitsubishi Denki Kabushiki Kaisha | Non-contact IC card |
-
1992
- 1992-11-17 JP JP4305750A patent/JPH06161594A/en not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5569903A (en) * | 1993-07-05 | 1996-10-29 | Mitsubishi Denki Kabushiki Kaisha | Non-contact IC card |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20000201 |