JPH0552158B2 - - Google Patents

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JPH0552158B2
JPH0552158B2 JP61305848A JP30584886A JPH0552158B2 JP H0552158 B2 JPH0552158 B2 JP H0552158B2 JP 61305848 A JP61305848 A JP 61305848A JP 30584886 A JP30584886 A JP 30584886A JP H0552158 B2 JPH0552158 B2 JP H0552158B2
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circuit
signal
pulse generator
current detection
sample
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Yutaka Koizumi
Yutaka Ono
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Yokogawa Electric Corp
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Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、サーボモータのコイルに流れる電流
を検出し、検出信号をフイードバツクしてサーボ
モータを駆動する回路のリツプル低減に関するも
のである。
DETAILED DESCRIPTION OF THE INVENTION [Industrial Application Field] The present invention relates to ripple reduction in a circuit that detects a current flowing through a coil of a servo motor and feeds back a detection signal to drive the servo motor.

[従来の技術] サーボモータのコイルに流れる電流を検出する
ための電圧検出回路として、本出願人による昭和
61年11月6日出願の「電流検出回路」があつた。
以下、この回路について説明する。
[Prior Art] As a voltage detection circuit for detecting the current flowing in the coil of a servo motor,
A "current detection circuit" was filed on November 6, 1961.
This circuit will be explained below.

この電流検出回路の構成を第3図に示す。 The configuration of this current detection circuit is shown in FIG.

図で、X1は入力回路、X2は出力回路、TRはト
ランスである。
In the figure, X1 is an input circuit, X2 is an output circuit, and TR is a transformer.

トランスTRは、入力回路X1が接続された一次
巻線n1と、出力回路X2が接続された二次巻線n2
と、一次巻線と二次巻線の間に配置された三次巻
線n3からなる。
The transformer TR has a primary winding n 1 to which input circuit X 1 is connected, and a secondary winding n 2 to which output circuit X 2 is connected.
and a tertiary winding n 3 placed between the primary and secondary windings.

入力回路X1で、1,2はラインlが接続され
た入力端子、rは入力端子1,2間に接続された
抵抗である。ラインlモータのコイルに直列に接
続されているため、抵抗rは端子1,2を介して
モータのコイルに直列に接続される。
In the input circuit X1 , 1 and 2 are input terminals to which line l is connected, and r is a resistor connected between input terminals 1 and 2. Since line l is connected in series with the coil of the motor, the resistor r is connected in series with the coil of the motor via terminals 1 and 2.

抵抗rには、抵抗R1とコンデンサC1の直列回
路が並列に接続されている。抵抗rの抵抗値は例
えば5mΩ程度であつて、抵抗R1の抵抗値に比べ
て十分小さい。更に、並列ダイオード回路D1
一次巻線n1の直列回路がコンデンサC1と並列に接
続されている。並列ダイオード回路D1は、ダイ
オードD1とD12が互いに逆極性に並列接続された
ものである。
A series circuit of a resistor R 1 and a capacitor C 1 is connected in parallel to the resistor r. The resistance value of the resistor r is, for example, about 5 mΩ, which is sufficiently smaller than the resistance value of the resistor R1 . Furthermore, a series circuit of a parallel diode circuit D 1 and a primary winding n 1 is connected in parallel with the capacitor C 1 . The parallel diode circuit D1 has diodes D1 and D12 connected in parallel with opposite polarities.

出力回路X2で、3,4は出力端子である。出
力端子3,4間にはローパスフイルタ(以下、
LPFとする)5と抵抗R2とコンデンサC2の直列
回路が接続されている。コンデンサC2の両端に
は、並列ダイオード回路D2と巻線n2の直列回路
が接続されている。コンデンサC2は平均化手段
を構成している。並列ダイオード回路D2は並列
ダイオード回路D1と同様の構成になつている。
In the output circuit X2 , 3 and 4 are output terminals. A low-pass filter (hereinafter referred to as
A series circuit consisting of LPF 5, resistor R 2 and capacitor C 2 is connected. A series circuit of a parallel diode circuit D 2 and a winding n 2 is connected across the capacitor C 2 . Capacitor C 2 constitutes the averaging means. The parallel diode circuit D2 has the same configuration as the parallel diode circuit D1 .

並列ダイオード回路D1,D第2に加わる電圧
e1と流れる電流i1の関係は、第4図に示すように
非線形の関係になる。
Voltage applied to parallel diode circuit D1 , D2
The relationship between e 1 and the flowing current i 1 is a nonlinear relationship as shown in FIG.

OSはパルス発生器であり、抵抗R3とコンデン
サC3を介して巻線n3に接続されている。
OS is a pulse generator, connected to winding n 3 through resistor R 3 and capacitor C 3 .

このように構成した回路で、トランスTRの一
次巻線n1と二次巻線n2の巻線比を1:1とし、三
次巻線n3に正負対称のインパルス信号を与える
と、その等価回路は第5図に示すようになる。
In a circuit configured in this way, if the turns ratio of the primary winding n 1 of the transformer TR and the secondary winding n 2 is 1:1, and an impulse signal with positive and negative symmetry is applied to the tertiary winding n 3 , the equivalent The circuit becomes as shown in FIG.

第5図の等価回路において、入力電圧Eiは、rI
(抵抗rの抵抗値もrで表す)となる。
In the equivalent circuit of Fig. 5, the input voltage E i is rI
(The resistance value of the resistor r is also expressed by r).

スイツチS1,S2はダイオードD11,D12,D21
D22のスイツチング動作を表示したものであつ
て、パルス発生器OSから正極性のインパルスが
印加されると、スイツチS1,S2が接点a側に接続
され(ダイオードD11,D21が導通)、負極性のイ
ンパルスが印加されると、スイツチS1,S2が接点
c側に接続される(ダイオードD12,D22が導
通)。また、インパルスが印加されない状態では、
スイツチS1,S2は接点bに接続される(いずれの
ダイオードも不導通)。各ダイオードD11〜D22
は、いずれも順方向電圧Δ動抵抗(順方向抵抗)
rとの直列接続で表わされる。
Switches S 1 and S 2 are diodes D 11 , D 12 , D 21 ,
This shows the switching operation of D 22. When a positive impulse is applied from the pulse generator OS, switches S 1 and S 2 are connected to the contact a side (diodes D 11 and D 21 are turned on). ), when a negative impulse is applied, switches S 1 and S 2 are connected to the contact c side (diodes D 12 and D 22 are conductive). Also, when no impulse is applied,
Switches S 1 and S 2 are connected to contact b (both diodes are non-conducting). Each diode D 11 ~ D 22
are both forward voltage Δ dynamic resistance (forward resistance)
It is represented by a series connection with r.

いま、パルス発生器OSから正極性のインパル
スioが印加されている状態では、スイツチS1,S2
は接点aに接続されたのと等価(ダイオード
D11,D21が導通)となり、インバルスioはダイオ
ードD11側とダイオートD21側に図示するように
io/2ずつ等しく分流する。この状態では、出力
端子3,4間の出力電圧Eo1は式で表わすこと
ができる。
Now, when the positive impulse IO is being applied from the pulse generator OS, the switches S 1 and S 2
is equivalent to connected to contact a (diode
D 11 and D 21 are conductive), and the inverse io is connected to the diode D 11 side and the diode D 21 side as shown in the figure.
Divides the flow equally by io/2. In this state, the output voltage Eo 1 between the output terminals 3 and 4 can be expressed by the formula.

Eo1=Ei+Δ11+io/2(r11−r21)−Δ21 また、負極性のインパルスio(振幅は正極性の
場合と同じとする)が印加された状態では、出力
端子3,4間の出力電圧Eo2は式で表わすこと
ができる。
Eo 1 = Ei + Δ 11 + io/2 (r 11 − r 21 ) − Δ 21 In addition, when a negative polarity impulse io (the amplitude is the same as the positive polarity case) is applied, the voltage between output terminals 3 and 4 The output voltage Eo 2 of can be expressed by the formula.

Eo2=Ei+Δ12+io/2(r12−r22)−Δ22 パルス発生器OSから正負極性のインパルスは、
第6図イに示すように繰り返し周期Tで印加され
るとともに、コンデンサC1,C2の容量をインパ
ルスの充放電による電位変化が小さくなるように
十分大きくしておけば、出力電圧EoはEo1とEo2
の平均値となり、式と式から式で表わすこ
とができる。
Eo 2 = Ei + Δ 12 + io/2 (r 12 − r 22 ) − Δ 22 The impulses of positive and negative polarity from the pulse generator OS are:
As shown in Fig. 6A, if the voltage is applied at a repetition period T and the capacitances of capacitors C 1 and C 2 are made sufficiently large so that potential changes due to charging and discharging of impulses are small, the output voltage Eo becomes Eo 1 and Eo 2
It is the average value of , and can be expressed by the following equation.

Eo=E01+E02/2=Ei+1/2 (Δ11−Δ12−Δ21+Δ22)+io/4 (r11−r12−r21+r22) 式において、 Δ11=Δ12,Δ21=Δ22 r11=r12,r21=r22 であるとすれば、第2項及び第3項はともに0と
なり、出力電圧Eoは入力電圧Eiと等しくなる。
従つて、入力回路に与えられた電圧Eiを、電気的
に絶縁し出力回路側から取り出すことができる。
Eo=E 01 +E 02 /2=Ei+1/2 (Δ 11 −Δ 12 −Δ 2122 )+io/4 (r 11 − r 12 − r 21 + r 22 ) In the formula, Δ 11 = Δ 12 , Δ 2122 r 11 = r 12 and r 21 = r 22 , the second term and the third term are both 0, and the output voltage Eo becomes equal to the input voltage Ei.
Therefore, the voltage Ei applied to the input circuit can be electrically isolated and taken out from the output circuit side.

ここで、式に示す条件は、並列ダイオード回
路を構成する素子D11とD12及びD21とD22にそれ
ぞれ同一規格のものを用いたり、同一温度に保持
するなどして容易に実現できる。
Here, the conditions shown in the formula can be easily realized by using elements D 11 and D 12 and D 21 and D 22 that constitute the parallel diode circuit, respectively, of the same standard, or by maintaining them at the same temperature.

第6図は第5図における動作波形図で、イはパ
ルス発生器OSからの正負極性のインパルス、ロ
は並列ダイオート回路D1,D2側に分流する電流、
ハは出力電圧である。ここでは、出力電圧Eoの
リツプル分を誇張して示してある。
Figure 6 is an operating waveform diagram in Figure 5, where A is the impulse of positive and negative polarity from the pulse generator OS, B is the current shunted to the parallel diode circuits D 1 and D 2 ,
C is the output voltage. Here, the ripple portion of the output voltage Eo is exaggerated.

この電圧検出回路では、入力電圧が小さくて
も、入力電圧に等しい電圧を高精度で出力できる
ため、入力側に接続された抵抗rの抵抗値を小さ
くでき、入力側での消費電力を低減できるという
利点を有する。
This voltage detection circuit can output a voltage equal to the input voltage with high precision even if the input voltage is small, so the resistance value of the resistor r connected to the input side can be reduced, reducing power consumption on the input side. It has the advantage of

この電流検出回路をサーボモータの駆動回路に
用いると、駆動回路の構成は例えば第7図に示す
ようになる。
When this current detection circuit is used in a servo motor drive circuit, the structure of the drive circuit becomes as shown in FIG. 7, for example.

図で、G1〜G4はサーボモータMのコイルLに
流れる電流を制御するトランジスタのゲート、5
はゲートG1〜G4を駆動するゲートドライバ、6
はコイルLに直列に接続された抵抗rの両端電圧
をもとにコイルLに流れる電流を検出する電流検
出回路(第3図の電流検出回路に相当する)、7
は電流検出回路6の検出信号の高周波域をカツト
する高域カツトフイルタ、8は電流の指令値uと
高域カツトフイルタ7を通過後の電流検出信号の
差をとる減算器、9は差信号の位相を補償する位
相補償回路、10は位相補償した信号をもとに生
成したパルス幅変調信号をゲートドライバ5に与
えるパルス幅変調回路である。
In the figure, G 1 to G 4 are the gates of transistors that control the current flowing to the coil L of the servo motor M, and 5
is a gate driver that drives gates G1 to G4 , 6
7 is a current detection circuit (corresponding to the current detection circuit in FIG. 3) that detects the current flowing through the coil L based on the voltage across the resistor r connected in series with the coil L;
8 is a high frequency cut filter that cuts the high frequency range of the detection signal of the current detection circuit 6; 8 is a subtracter that takes the difference between the current command value u and the current detection signal after passing through the high frequency cut filter 7; 9 is a phase of the difference signal. 10 is a pulse width modulation circuit that provides the gate driver 5 with a pulse width modulation signal generated based on the phase compensated signal.

[発明が解決しようとする問題点] このような駆動回路では、電流検出器6の応答
周波数を上げた場合、出力に大きなリツプルが生
じるのを防止するために高域カツトフイルタ7が
不可欠となるが、このフイルタによりフイードバ
ツク信号に位相遅れが生じるため、モータに発振
等の有害な現象が生じやすくなるという問題点が
あつた。
[Problems to be Solved by the Invention] In such a drive circuit, when the response frequency of the current detector 6 is increased, the high-frequency cut filter 7 is essential to prevent large ripples from occurring in the output. Since this filter causes a phase delay in the feedback signal, there is a problem that harmful phenomena such as oscillation are likely to occur in the motor.

本発明は上述した問題点を解決するためになさ
れたものであり、帰還路に高域カツトフイルタを
設けなくても電流検出回路の出力に含まれたリツ
プルを有効に防止できるモータの駆動回路を提供
することを目的とする。
The present invention has been made to solve the above-mentioned problems, and provides a motor drive circuit that can effectively prevent ripples contained in the output of a current detection circuit without providing a high-frequency cut filter in the return path. The purpose is to

[問題点を解決するための手段] サーボモータのコイルに流れる電流を電流検出
回路により検出し、検出信号をフイードバツクし
てサーボモータを駆動する回路において、 前記電流検出回路は微小な電圧信号を絶縁伝送
する微小信号アイソレータを用いて、タイミン
グ・クロツクのタイミングで電流を検出する回路
であつて、 前記タイミング・クロツクがハイレベルにある
ときにコントロール・クロツクを発生する第1の
パルス発生器と、 前記タイミング・クロツクがローレベルにある
ときにコントロール・クロツクを発生する第2の
パルス発生器と、 前記第1のパルス発生器のパルス発生時に前記
電流検出回路が発生する検出信号をホールドする
ことによつて正側のリツプル信号をホールドする
第1のサンプルホールド回路と、 前記第2のパルス発生器のパルス発生時に前記
電流検出回路が発生する検出信号をホールドする
ことによつて負側のリツプル信号をホールドする
第2のサンプルホールド回路と、 前記第1のサンプルホールド回路と第2のサン
プルホールド回路がホールドした信号を加算して
正側と負側のリツプル信号をキヤンセルし、この
信号をフイード・バツクする加算器、 を設けたことを特徴とするモータの駆動回路であ
る。
[Means for solving the problem] In a circuit that detects the current flowing through the coil of a servo motor using a current detection circuit and feeds back the detection signal to drive the servo motor, the current detection circuit isolates minute voltage signals. A circuit for detecting current at the timing of a timing clock using a transmitting small signal isolator, the first pulse generator generating a control clock when the timing clock is at a high level; A second pulse generator generates a control clock when the timing clock is at a low level, and a detection signal generated by the current detection circuit when the first pulse generator generates a pulse is held. a first sample and hold circuit that holds a ripple signal on the positive side; and a ripple signal on the negative side by holding a detection signal generated by the current detection circuit when the second pulse generator generates a pulse. A second sample-and-hold circuit holds the signals, and the signals held by the first sample-and-hold circuit and the second sample-and-hold circuit are added together to cancel the ripple signals on the positive and negative sides, and this signal is fed back. This is a motor drive circuit characterized in that it is provided with an adder that performs the following steps.

[実施例] 以下、図面を用いて本発明を説明する。[Example] Hereinafter, the present invention will be explained using the drawings.

第1図は本発明にかかるモータの駆動回路の一
実施例の構成図である。図で、第7図と同一のも
のは同一符号を付ける。
FIG. 1 is a configuration diagram of an embodiment of a motor drive circuit according to the present invention. In the figure, the same parts as in FIG. 7 are given the same reference numerals.

図で、11はコントロール・クロツクCLK1
(以下、単にCLK1とする)を発生する第1のク
ロツク発生器、12はコントロール・クロツク
CLK2(以下、単にCLK2とする)を発生する第
2のクロツク発生器、13はCLK1により与え
られるタイミングで電流検出回路6の出力Aをホ
ールドする第1のサンプルホールド回路、14は
CLK2により与えられるタイミングで出力Aを
ホールドする第2のサンプルホールド回路、15
はサンプルホールド回路13と14の出力BとC
を加算し、加算信号Dを減算器8に帰還する加算
器である。
In the figure, 11 is the control clock CLK1
(hereinafter simply referred to as CLK1); 12 is a control clock;
A second clock generator generates CLK2 (hereinafter referred to simply as CLK2); 13 is a first sample and hold circuit that holds the output A of the current detection circuit 6 at the timing given by CLK1; 14 is a
A second sample-and-hold circuit that holds output A at the timing given by CLK2, 15
are the outputs B and C of sample and hold circuits 13 and 14.
This is an adder that adds up the addition signal D and returns the addition signal D to the subtracter 8.

このような駆動回路の動作について説明する。 The operation of such a drive circuit will be explained.

第2図は動作説明用のタイムチヤートである。 FIG. 2 is a time chart for explaining the operation.

図で、CLKは電流検出回路6に駆動タイミン
グを与えるタイミング・クロツクであり、第3図
のパルス発生器OSが発生する。
In the figure, CLK is a timing clock that provides drive timing to the current detection circuit 6, which is generated by the pulse generator OS in FIG.

電流検出回路6は、入力波形Vに対し、出力A
にはCLKと同期したリツプルが生じる。CLK1
はCLKのハイレベルのタイミングと同期し、
CLK2はCLKのローレベルのタイミングと同期
するように設定されている。これにより、第1の
サンプルホールド回路13はCLKはハイレベル
のときの出力A(以下、正側のリツプルとする)
をサンプルしホールードし、第2のサンプルホー
ルド回路14は、CLKがローレベルのときの出
力A(以下、負側のリツプルとする)をサンプル
し、ホールドする。
The current detection circuit 6 outputs an output A for an input waveform V.
A ripple occurs in synchronization with CLK. CLK1
is synchronized with the high level timing of CLK,
CLK2 is set to synchronize with the low level timing of CLK. As a result, the first sample and hold circuit 13 outputs A when CLK is at a high level (hereinafter referred to as positive ripple).
The second sample and hold circuit 14 samples and holds the output A (hereinafter referred to as negative ripple) when CLK is at a low level.

出力Aのリツプル成分は入力波形Vに関して対
称になるので、サンプルホールド回路13と14
でホールドした信号BとCの和を加算器15でと
ることによつて正側と負側のリツプルがキヤンセ
ルされ、Dのような信号になる。
Since the ripple component of the output A is symmetrical with respect to the input waveform V, the sample and hold circuits 13 and 14
By adding the sum of the signals B and C held in the adder 15, the ripples on the positive side and the negative side are canceled and a signal like D is obtained.

[効果] 本発明によれば、電流検出回路6の出力の正側
と負側のリツプルを加算してキヤンセルする構成
になつているため、電流検出回路6の帰還路にリ
ツプル防止用の高域カツトフイルタを設ける必要
がなくなる。これによつて、フイードバツク信号
の位相特性を周波数特性が良好になり、モータの
発振等の高域カツトフイルタを設けた場合の弊害
を防止できる。
[Effects] According to the present invention, since the ripples on the positive side and negative side of the output of the current detection circuit 6 are added and canceled, a high frequency band for ripple prevention is provided in the feedback path of the current detection circuit 6. There is no need to provide a cut filter. This improves the phase and frequency characteristics of the feedback signal, and prevents problems such as motor oscillation that would otherwise occur if a high-frequency cut filter is provided.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明にかかるモータの駆動回路の一
実施例の構成図、第2は第1図の動作説明図、第
3図は電流検出回路の構成例を示した図、第4図
から第6図は第3図回路の動作説明図、第7図は
第3図回路が適用可能なモータ駆動回路の構成例
を示した図である。 M……サーボモータ、L……コイル、r……抵
抗、11……第1のクロツク発生器、12……第
2のクロツク発生器、13……第1のサンプルホ
ールド回路、14……第2のサンプルホールド回
路、15……加算器。
FIG. 1 is a configuration diagram of an embodiment of a motor drive circuit according to the present invention, FIG. 2 is an explanatory diagram of the operation of FIG. 1, FIG. 3 is a diagram showing an example of the configuration of a current detection circuit, and FIG. FIG. 6 is an explanatory diagram of the operation of the circuit of FIG. 3, and FIG. 7 is a diagram showing an example of the configuration of a motor drive circuit to which the circuit of FIG. 3 can be applied. M... Servo motor, L... Coil, r... Resistor, 11... First clock generator, 12... Second clock generator, 13... First sample and hold circuit, 14... Third 2 sample hold circuit, 15...adder.

Claims (1)

【特許請求の範囲】 1 サーボモータのコイルに流れる電流を電流検
出回路により検出し、検出信号をフイードバツク
してサーボモータを駆動する回路において、 前記電流検出回路は微小な電圧信号を絶縁伝送
する微小信号アイソレータを用いて、タイミン
グ・クロツクのタイミングで電流を検出する回路
であつて、 前記タイミング・クロツクがハイレベルにある
ときにコントロール・クロツクを発生する第1の
パルス発生器と、 前記タイミング・クロツクがローレベルにある
ときにコントロール・クロツクを発生する第2の
パルス発生器と、 前記第1のパルス発生器のパルス発生時に前記
電流検出回路が発生する検出信号をホールドする
ことによつて正側のリツプル信号をホールドする
第1のサンプルホールド回路と、 前記第2のパルス発生器のパルス発生時に前記
電流検出回路が発生する検出信号をホールドする
ことによつて負側のリツプル信号をホールドする
第2のサンプルホールド回路と、 前記第1のサンプルホールド回路と第2のサン
プルホールド回路がホールドした信号を加算して
正側と負側のリツプル信号をキヤンセルし、この
信号をフイード・バツクする加算器、 を設けたことを特徴とするモータの駆動回路。
[Claims] 1. In a circuit that detects a current flowing through a coil of a servo motor using a current detection circuit, and feeds back a detection signal to drive the servo motor, the current detection circuit is a micrometer that insulates and transmits a minute voltage signal. A circuit that detects current at the timing of a timing clock using a signal isolator, the circuit comprising: a first pulse generator that generates a control clock when the timing clock is at a high level; a second pulse generator that generates a control clock when the current detection circuit is at a low level; and a second pulse generator that generates a control clock when the first pulse generator is at a low level; a first sample-and-hold circuit that holds the ripple signal of the second pulse generator; and a second sample-and-hold circuit that holds the ripple signal on the negative side by holding the detection signal that the current detection circuit generates when the second pulse generator generates a pulse. an adder that adds the signals held by the first sample and hold circuit and the second sample and hold circuit, cancels the positive side and negative side ripple signals, and feeds back this signal. , A motor drive circuit characterized in that it is provided with the following.
JP61305848A 1986-12-22 1986-12-22 Drive circuit for servomotor Granted JPS63161899A (en)

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